JPS58172713A - プログラマブル・コントロ−ラのcrt図示式プログラミング装置 - Google Patents

プログラマブル・コントロ−ラのcrt図示式プログラミング装置

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JPS58172713A
JPS58172713A JP57054175A JP5417582A JPS58172713A JP S58172713 A JPS58172713 A JP S58172713A JP 57054175 A JP57054175 A JP 57054175A JP 5417582 A JP5417582 A JP 5417582A JP S58172713 A JPS58172713 A JP S58172713A
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JP
Japan
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error
circuit diagram
display
ladder circuit
relay ladder
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Pending
Application number
JP57054175A
Other languages
English (en)
Inventor
Yoshinori Takahashi
義則 高橋
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Omron Corp
Original Assignee
Tateisi Electronics Co
Omron Tateisi Electronics Co
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Filing date
Publication date
Application filed by Tateisi Electronics Co, Omron Tateisi Electronics Co filed Critical Tateisi Electronics Co
Priority to JP57054175A priority Critical patent/JPS58172713A/ja
Publication of JPS58172713A publication Critical patent/JPS58172713A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G05CONTROLLING; REGULATING
    • G05BCONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
    • G05B19/00Programme-control systems
    • G05B19/02Programme-control systems electric
    • G05B19/04Programme control other than numerical control, i.e. in sequence controllers or logic controllers
    • G05B19/05Programmable logic controllers, e.g. simulating logic interconnections of signals according to ladder diagrams or function charts
    • G05B19/056Programming the PLC

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Automation & Control Theory (AREA)
  • Programmable Controllers (AREA)
  • Testing And Monitoring For Control Systems (AREA)
  • Digital Computer Display Output (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、プログラマブル・コントローラとユーザと
を結び付けるマン/マシーンインターフェイスとしての
CR’1図示式プログラミング装置の改良に関する。
゛ 最近の中規模以上のプログラマブル・コント0−う
にはマン/マシーンインターフェイスとしてCRI−図
示式プログラミング装置が用意されており、ユーザプロ
グラムを継電器ラダー回路図の形で作成できるようにな
っている。つまり、この神のCR1図示式プログラミン
グ装置は、キー人力装置と、CR1表示装置と、上記キ
ー人′h装置による入力を受けてト記CR丁表示装置に
プログラマブル・コントローラのソースプログラムとな
る継電器ラダー回路図を表示する表示制御手段と、1配
CRT表示装置の画面に作成された継電器〕ダー回路図
を10グラマプル・コントローラの機械語によるオブジ
ェクトプログラムに変換するアセンブル手段とを基本的
に備えるものである。また表示画面トの継電器ラダー回
路図をオブジェクドブし1グラムに変換するのに先だっ
て、回路図中に誤りがあるか否かをチェックするエラー
検出手段が設け−られている。従来のこの種の装置では
、回路図中にエラーが検出された場合、そのエラーを含
んでいる全回路図(111面分)のアセンブルは行われ
ず、甲に「エラーあり」なる趣旨のメツセージが表示画
面に表示されるだけであった。
従って、ユーザは表示中の回路図になんらかのエラーが
あることが判るのみで、どの部分にどのような■−ラー
があるかは判らず、またエラー箇所が1箇所なのかWI
教箇所なのかも判らない。そのため]−ザは表示中の回
路図について入念に検84し、1ラー箇所を捜し出し、
J′修lしな(Jればなら?、特にエラー箇所を捜し出
すことが非常に面倒【・ あ −) lこ 。
この発明は1)ホした従来の問題点に鑑みなされラダー
回路図のエラー箇所およびエラーの種類が明確に判るよ
うにしたプログラマブル・コントローラのCR7図示式
プログラミング装置を提供することにある。
F&l!の目的を達成するため【こ、この発明は、1−
記7センプル手段の動作に先だって継電器ラダー回路図
中に所定のエラーが存在するか否かを企画面分について
チェックするエラー検出手段と、この]−ラー検出手段
にてエラーが検出されたとき、ト記CRT表示装置の画
面の継電器ラダー回路図中のエラー箇所の表示輝度をそ
の他の部分と変えるとともに、表示画面中におけるエラ
ー箇所と位置を対応付けてエラーの種類を示すエラーメ
ツセージを表示するエラー表示制御手段とを設けたこと
を特徴とする。
以下、この発明の実施例を図面に基づいて詳細に説明す
る。
第1図はこの発明に係るC R’I図示式プログラミン
グ装置の構成を示すブロック図である。この装置はCF
) LJ (マイクロプロセッサ)1とCP tJlに
よって実(■されるプログラムを格納したROM2およ
びCP tJ 1によって各種可変データの同時記憶■
す/7として使われるRAM3とからなる制m+装置と
、キー人力装置4と、CRT−表示装置5と、プログラ
マブル・コント0−ラフを接続するインターノエイス回
路6とを備えている。
1記CR1’表示狼15は、CRT51と、全体の同期
制御等の表示制御を行なうCR丁制御回路52と、キト
ラクタジIネレータ53と、CR’15)1に表示させ
るデータがキャラクタコードの形(・格納されるデータ
メモリ54と、データメtす54の各う“−夕と1対1
に対応した制御フラグが設定されたフラグメしり55と
、データメモリ54およびノフグメしり55に対してC
RT III御回路52が)7り廿スするかCP jJ
 1がアクセスするかを切換えるンルチプレクサ56.
j−3よび57と、II・フクタジIネレータ53から
読出される並列y”−−夕を^列データに変換する並直
列変換回路5)t3と、CI<1制御回路52およびフ
ラグメモリ55からの制御信号を受けて動作し、並1列
変換回路58から出力されるビデオ信号をCR151に
供給して表示させるビデオ制御回路59とを備えている
、第2図はl−記キー人力装置4にお&Jる継電器ラダ
ー回路図作画用キーボード部分を示す図である。
このキー人力装置4には、プ[1グラム作成時に使用さ
れる各回路素子シンボルに対応したシンボルキ一群42
と、回路素子番号や!Iコグラムアドレス等の数値デー
タを人力づるためのテンキー43と、CRT表示画面上
の表示位蒙を指定するカーソルを左右前後に移動させる
ためのカーソル移動¥F−44と、CR’l’ 51の
表示画面に継電器ラダー回路図を作成した後に、当該回
路図をオブジェクトプログラムに変換するアセンブル動
作を開始させるためのアセンブル開始キー45等が設け
られCいる。
周知のように、この種の装置のGRT51の表示画面は
表示制御[マトリックス状に区画されていて、各区画に
1つの回路素子シンボルが表小されるようになっている
。各区画は縦横の2次元座標でもって特定される。F記
カーソル移動キー44によって表示画面上のh−ツルが
任意の区画に移動され、そのカーソルが位置している部
分に入ノJに応じた表示がなされる。
第3図はCP tJ 1によって実行される表示III
御7 oグうムの概要を示寸フL1−チ1/−トで、特
にこの発明に係わる部分を中心に表している。以下この
フローチャートに従って順次説明する。まず最初のステ
ップ100にてイニシャル処理としてノックメ七り55
中の4べCの表示区画に対応した輝度調整ビットを饅通
wI酸に設定する。つまり、この種の装置にお&JるC
RT表系装置5ではl−述した各表示区内毎にその表示
輝度を制御できるようになっており、的記スjツブ10
0では全表示区−の表示輝度を鮪通輝喚にイニシtνラ
イズする訳ぐある。次のステップ101ではキー人力装
置4の[述した回路図作画用キーボードの操作に応纂し
Cに Rl b 1の画11に継電器ウダー回路図を表
示づる。勿論このラダー回路図の表示データはデータメ
モリ54に蓄えられる。
プログラム作成者はCRT51の表示画面に■愈の継電
器ラダー回路図を作成したならば、キー人力装置4のア
センブル開始キー45を操作する。
ステップ102にてアセンブル開始キー45の操作が検
出されると次のステップ1(13以岬の?センプル処理
が開始される。ラダー回路図の/7しンブルはF記各表
承区画単位で順番に行なわれる。
ステップ103では最初にアセンブルされる表示区画の
座標をセットする。次のステップ104て゛はセットさ
れた座標(本座標と称す)の表示データをデータメモリ
54がら読取り、前後の関係がら本座標の回路素子につ
いてエラーがあるか否かを検査する。周知のように継電
器ラダー回路図のエラーとしては、結線の開放、結線の
短絡、スタックのオバーフロー、テンポラリ−レジスタ
のオバーフロー、入力シンボルが必要な出力シンボルに
対応した入力シンボルがない、入力シンボルは不要なシ
ンボルに入力シンボルが付いている、各人出1ノシンボ
ルに設定番号の異常、ぞの他各処即系の規約によるエラ
ーがある。ステップ104では本座標について上記各エ
ラーに該当するかどうかが検査される。イしてステップ
105でエラーの4無に応じて分岐する。1ラーが検出
されなかった場合はステップ108に進み、1−山分の
最後の表示8画まで1シー検査が終了したか否かを判1
iグる。最後の区画まで達しでいない場合はステップ1
09に進み、検査対象座標値として次の座標値をセット
し、先のステップ104に戻る。
このように検査対象座標を順番に更新しながら各座標に
ついてエラーが存在するか否かを検査する。
イしである座標の回路表示についでエラーが検出8れる
とスフツブ105から106に進み;エラーが検出され
た本座標に対応するt記フラグメモリ55の輝度調整ピ
ットを高輝度に設定する。また次のステップ107で検
出されたエラーの種類を小すトフーメッし一ジを本FI
l樟と対応する位置に表示づる。これらによってCRr
51の表示画1n11の回路のJツーを含む表示区画の
輝度がその他の部分より明かるくなり、1ラー箇所が明
確に表示される。またそのエラーの内容がエラー箇所と
対応した位置に表示される。第4図はt述した1ラ一表
示がなされている状態の(CR丁51の表示画面の一例
を示している。この例ではCRRb2O表示画面にJり
けるX=2.Y=4のP1樟始(示される表示区画に結
線の短絡Iう〜がある。、この場合、X=2.Y=4の
表示区画の結線人tj<が他の部分より高輝度に表示さ
れる(太線で・示している)。かつこのエラーに対応し
、Y=4の417Mの画面も端部にエラー内容である「
短絡1なるメツセージ表示がなされる。
ト述した各表示区画に対する1ラーの検査は、ある区画
に1ラーが検出された時点で終了づるのではなく、既に
エラーが検出されても企画面分について行なわれる。そ
して、1画面から複数の1ラーが検出されれば、各エラ
ー箇所が全て高輝度で表示されるとともに、そのエラー
箇所に対応する表示画面のも端部にそれぞれのJツー内
容がメツセージ表示される。従って、プログラム作成者
はC1<151の表示を見れば、どこにどのような1ラ
ーが含まれているかが一目瞭然となり、速やかにそれら
エラーを修正して所望の正しいソース![1グラムを作
成し、その後オブジェクトプログラムに7センプルする
ことができる。
以1詳細に説明したように、この発明に係るプ[1グラ
ンプル・コントローラのCRT図示式プログラミング@
画によれば、ソースプログラムである継電器ラダー回路
図を表示画面1に作成した際に、ぞの回路図に含まれる
エラーが明確に判り、極めC修正がし易くなり、よって
希望するプログラムを完成づるまでの時間が短縮できる
ようになる。
’1.hlffl+の簡甲な説明 第1図はこの発明の一実施例によるプログラミング装面
の概略構成を示すブロック図、第2図は4−人力装置i
14におけるキー配列の一部を示す図、第3図は本発明
に係る[ラー表示制御動作を小す)11−/ l、−ト
、第4図は本発明によるエラー表小が<1された012
151の表示画面の一例を小ゆ図ぐある。。
2・・・・・・ROM 3・・・・・・RAM 4・・・・・・キー人力装置 5・・・・・・CRT表示装置 特許出願人 立Eii機株式会召 ¥t12図 第311

Claims (1)

    【特許請求の範囲】
  1. (1)キー人力@胃と、CR1表示装置と、−[配置−
    人力1mlによる人力を受けて上記CR1表示装置にプ
    ログラマブル・コントローラのソースプログラムとなる
    継電器ラダー回路図を表示する表小&11肺手段と、に
    記CRT表示装置の画面に作成された継電器ラダー回路
    図をプログラマブル・コン1−[ト→の機械ポによるオ
    ブジェクトプログラムに変換づ−るIt?ンプル手段と
    、このアセンブル1段の動作に先だって上記継電器ラダ
    ー回路図中に所定のエラーが存在するか否かを企画面分
    につい(チェックするエラー検出手段と、このエラー検
    出手段にてエラーが検出されたとき、上記CR1表示菰
    薗の画面の継電器ラダー回路図中のエラー箇所の表小輝
    度をその他の部分と変えるとともに、人小画面中におけ
    る1ラー箇所と佼菌を対応付けてエラーの種類を示すエ
    ラーメツセージを表示するエラー表示制御手段とを備え
    てなるプログラマブル・コントローラのCR1図示式プ
    ログラミング装置。
JP57054175A 1982-04-01 1982-04-01 プログラマブル・コントロ−ラのcrt図示式プログラミング装置 Pending JPS58172713A (ja)

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JP57054175A JPS58172713A (ja) 1982-04-01 1982-04-01 プログラマブル・コントロ−ラのcrt図示式プログラミング装置

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JPS58172713A true JPS58172713A (ja) 1983-10-11

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02141804A (ja) * 1988-11-24 1990-05-31 Matsushita Electric Ind Co Ltd シーケンス制御装置
JP2015084246A (ja) * 2014-12-24 2015-04-30 富士電機株式会社 ソフトウェア開発支援装置

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5441645A (en) * 1977-09-09 1979-04-03 Casio Comput Co Ltd Error message display system
JPS54102476A (en) * 1978-01-27 1979-08-11 Toyoda Mach Works Ltd Sequence controller monitor

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