JPS58153434A - 多重変換方式 - Google Patents

多重変換方式

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JPS58153434A
JPS58153434A JP57035823A JP3582382A JPS58153434A JP S58153434 A JPS58153434 A JP S58153434A JP 57035823 A JP57035823 A JP 57035823A JP 3582382 A JP3582382 A JP 3582382A JP S58153434 A JPS58153434 A JP S58153434A
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serial
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Hiroshi Fujimura
藤村　博司
Kiyoaki Kawai
河合　清明
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NEC Corp
Nippon Electric Co Ltd
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    • H04—ELECTRIC COMMUNICATION TECHNIQUE
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    • H04L25/38—Synchronous or start-stop systems, e.g. for Baudot code
    • H04L25/40—Transmitting circuits; Receiving circuits
    • H04L25/49—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
    • H04L25/4906—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using binary codes
    • H04L25/4908—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using binary codes using mBnB codes
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04J—MULTIPLEX COMMUNICATION
    • H04J3/00—Time-division multiplex systems
    • H04J3/02—Details
    • H04J3/06—Synchronising arrangements
    • H04J3/07—Synchronising arrangements using pulse stuffing for systems with different or fluctuating information rates or bit rates

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は低次群信号を多重化しまたその逆に多重分離す
る多重変換方式に関する。
従来の多重変換方式は低次群信号を多重化および多重分
離する機能のみを有するものであるから。
伝送路と接続してシステムを構成する場合、伝送路の他
に端局中継装置を必要とし伝送システムが高価になると
いう欠点があった。
従って本発明の目的は、直接伝送路に接続可能な多重変
換方式を提供することにある。
本発明の他の目的は、経済的伝送システムを構成できる
多重変換方式を提供することにある。
本発明によれば、ｎ個の低次群信号を１個別に受信して
スタッフ同期によシ得られるｎ系列の同期゛化信号を得
ると共に並列処理によシ余剰ビットにフレーム同期ノク
ルス、制御符号等の挿入を行なう同期化部と、並直列変
換にょシ多重化しＩ系列信号を送出する並直列変換部と
を有する送信装置と。
該送信装置からの前記１系列信号を受信してフレーム同
期を取って多重分離する直並列変換部と。
ｎ個の信号系列から余剰ビットを除去して前記ｎ個の低
次゛群信号を再生するデスタッフ部とを有する受信装置
とから構成される多重変換方式において、前記送信装置
の前記同期化部と前記並直列変換部との間に該同期化部
からのｎ系列の信号を受けて並列処理によ）ｍ系列の信
号に変換して該ｍ系列の信号を該並直列変換部に送出す
るｎＢｍＢ変換部を設け、前記受信装置の前記直並列変
換部と前記デスタッフ部との間に該直並列変換部からの
ｍ系列の信号を受けて並列処理によりｎ系列の信号に変
換して該ｎ系列の信号を該デスタッフ部に送出するｎＢ
ｍＢ逆変換部を設けて成る多重変換方式が得られる。
以下図面を参照して詳細に説明する。
第１図は従来の多重変換方式の構成をブロック図によシ
示したものである。図においてｌは送信装置、２は受信
装置であり、送信装置１はｎ個の入力端子ｌ−１，・・
・、１−ｎを有し、受信装置２はｎ個の出力端子、２’
ｚ　１．・・・、　２　ｆ　ｎを有している。
送信装置１は同期化部１１と並直列変換部１３とから構
成されている。同期化部１１Ｆｉ、入力端子１−１．・
・・、１−ｎよ、９ｎ個の低次群信号を受信しスタッフ
同期によってｎ系列の同期化信号を得ると共に余剰ビッ
トにフレーム同期ノｅルス、制御符号等の挿入を行なう
。並直列変換部１３は。
同期化部１１の並列なｎ個の出力信号を受けて並直列変
換により多重化し、出力端子１４へ１系列信号として送
出する。
一方受信装置２は直並列変換部２２とデスタッフ部２４
．とから構成されている。直並列変換部２２は、入力端
子２１を介して受信した信号のフレーム同期を取シ多重
分離にょ５ｎ個の信号系列を得る。デスタッフ部２４は
、直並列変換部２２からｎ個の信号系列を受けて、該ｎ
個の信号系列から余剰ビットを除去しｎ個の低次群信号
を再生してｎ個の出力端子２−１．・・・、２−ｎに送
、出する。
この様に、従来の多重変換方式は多重化および多重分離
する機能のみを有するものであるから。
第２図に示されるように伝送システムとして構成子る場
合、端局中継装置３，４を介して伝送路５と接続しなけ
ればならない。
第３図は本発明による多重変換方式の一実施例の構成を
ブロック図により示したもので、送信装装 置１′〆受信装置２′から構成される。
送信装置１′は同期化部１１′とｎＢｍＢ変換部１２′
と並直列変換部１３′とから構成される。同期化部１１
′は、第１図の同期化部１１と同一の機能を有し、入力
端子１’−１，・・・＋１’−ｎよｐｎ個の低次群信号
を受信しれ系列の同期化信号をｎＢｍＢ変換部１２′に
送出する。ｎＢｍＢ変換部１２′は該ｎ系列の同期化信
号を並列処理によｐｍ系列の信号に変換する。並直列変
換部１３’は該ｍ系列の信号を多重化して出力端子１４
′から１系列信号としで１接伝送路に送出する。
一方受信装置２′は直並列変換部２２′とｎＢｎＢ逆変
換部２３’とデスタッフ部２４′とから構成される。
直並列・変換部２２′は、伝送路を介して伝送された前
記１系列信号を直接入力端子２１′より受けて前記ｎＢ
ｍＢ変換部１２によってｎＢｍＢ変換を受けたフレーム
同期・やターンを検出し、フレーム同期を取ることによ
りｍ系列の信号に多重分離する。
ｎＢｍＢ逆変換部２３′は該ｍ系列の信号を並列処理に
よりｎ系列の信号に変換すなわちｎＢｍＢ逆変換を行な
う。デスタッフ部２４′は、第１図のデスタッフ部２４
と同一の機能を有し、　ｎＢｍＢ逆変換部２３′より前
記ｎ系列の信号を受けてｎ個の低次群信号を出力端子２
’−１，・・・　２′−ｎに送出する。
送信装置１′のｎＢｍＢ変換□部１２′によるｎＢｒｎ
Ｂ符号変換方式は、原信号ｎビットを１ブロツクとして
ｍピットの符号に変換するブロック符号化方式であシ、
これにより伝送路符号として必要な平衡符号を得るもの
″である。また、同期化部１１′に入力する低次群入力
信号数ｎに対応したｎＢｍＢ符号変換方式を用いるので
、同期化部１１′から出力される同期化低次群出力信号
を直接ｎＢｍＢ変換部１２′の入力信号とすることがで
きる。これにょシ。
ｎＢｍＢ変換部１２′の回路構成を必要最小限に留める
ことができ９本発明の送信装置１′の従来の送信装置１
に対する回路規模の増大は少なくくてすむ。同様のこと
は本発明の受信装置でもいえる。
上記詳述したように１本発明によれば、端局中できると
いう効果がある。
【図面の簡単な説明】
第１図は従来の多重変換方式の構成を示したブロック図
、第２図は従来の多重変換方式を用いた伝送システムの
構成を示したブロック図、第３図は本発明による多重変
換方式の一実施例の構成を示したブロック図である。 記号の説明： １は従来の多重変換方式の送信装置、１′は本発明によ
る多重変換方式の送信装置、２は従来の多重変換方式の
受信装置、２′は本発明による多重変換方式の受信装置
、３は送信側の端局中継装置。 ４は受信側の端局中継装置、５は伝送路、１１゜１１′
は同期化部、１２′はｎ　ＢｍＢ変換部、１３．１３’
は並直列変換部、１４．１４’は出力端子、２１゜２１
′は入力端子、２２．２２’は直並列変換部。 ２３′はｎＢｍＢ逆変換部、２４．２４’はデスタッフ
部、　１−１．・・・ＩＩ−ｆｉ１１’−１１・・・＋
　１’　−ｎは入力端子、２−１．・・・＋　２−　ｎ
　＋　２’−１＋・・・＋　２’　−ｎは出力端子をそ
れぞれあられしている。

Claims (1)

  1. 【特許請求の範囲】 １、　　ｎ個の低次群信号を個別に受信してスタッフ同
    期によシ得られるｎ系列の同期化信号を得ると共に並列
    処理によシ余剰ビットにフレーム同期パルス、制御符号
    等の挿入を行なう同期化部と・並直列変換によシ多重化
    し１系列信号を送出する並直列変換部とを有する送信装
    置と、該送信装置からの前記１系列信号を受信してフレ
    ーム同期を増って多重分離する直並列変換部と、ｎ個の
    信号系列から余剰ピットを除去して前記ｎ個の低次群信
    号を再生するデスタッフ部とを有する受信装置とから構
    成される多重変換方式において、前記送信装置の前記同
    期化部と前記並直列変換部との間に該同期化部からのｎ
    系列の信号を受けて並列処理によ１ｍ系列の信号に変換
    して該ｍ系列の信号を該並直列変換部に送出するｎＢｍ
    Ｂ変換部を設け。 前記受信装置の前記直並列変換部と前記デスク。 フ部との間に該直並列変換部からのｍ系列の信号を受け
    て並列処理によりｎ系列の信号に変換して該ｎ系列の信
    号を該デスク、フ部に送出するｎＢｍ　Ｂ逆変換部を設
    けて成る多重変換方式。
JP57035823A 1982-03-09 1982-03-09 多重変換方式 Granted JPS58153434A (ja)

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EP83102270A EP0088432B1 (en) 1982-03-09 1983-03-08 Multiplexer apparatus having nbmb coder
US06/473,393 US4744082A (en) 1982-03-09 1983-03-08 Multiplexer apparatus having nBmB coder
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