JPS58147232A - デイジタル・オ−デイオデイスクプレ−ヤ - Google Patents
デイジタル・オ−デイオデイスクプレ−ヤInfo
- Publication number
- JPS58147232A JPS58147232A JP3034382A JP3034382A JPS58147232A JP S58147232 A JPS58147232 A JP S58147232A JP 3034382 A JP3034382 A JP 3034382A JP 3034382 A JP3034382 A JP 3034382A JP S58147232 A JPS58147232 A JP S58147232A
- Authority
- JP
- Japan
- Prior art keywords
- digital
- signal
- analog
- operational amplifier
- offset
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/66—Digital/analogue converters
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はディジタル・オーディオディスクプレーヤに関
し、特にディジタル・アナログ変換部に於ける直流的な
安定度を高めたディジタル・オーディオディスクプレー
ヤに関するものである。
し、特にディジタル・アナログ変換部に於ける直流的な
安定度を高めたディジタル・オーディオディスクプレー
ヤに関するものである。
ディジタル・オーディオディスクは、オーディオ信号お
よび同期信号等をディジタル化してディスクの表面に線
速度一定として光学的に高密匿で記録したものであり、
このディジタル・オーディオディスクを再生してオーデ
ィオ信号を取り出すのがディジタル・オーディオディス
クプレーヤである。この場合、ディジタル・オーディオ
ディスクプレーヤに於いては、ディスクの表面に記録さ
れるディジタル情報を絖み取って対応するアナログ値の
オーディオ信号を取９出すためにディジタル・アナログ
変換部が設けられており、このディジタル・アナログ変
換部はディジタル・オーディオディスクプレーヤに於け
るＸ＊な部分となっている。
よび同期信号等をディジタル化してディスクの表面に線
速度一定として光学的に高密匿で記録したものであり、
このディジタル・オーディオディスクを再生してオーデ
ィオ信号を取り出すのがディジタル・オーディオディス
クプレーヤである。この場合、ディジタル・オーディオ
ディスクプレーヤに於いては、ディスクの表面に記録さ
れるディジタル情報を絖み取って対応するアナログ値の
オーディオ信号を取９出すためにディジタル・アナログ
変換部が設けられており、このディジタル・アナログ変
換部はディジタル・オーディオディスクプレーヤに於け
るＸ＊な部分となっている。
第１図は従来一般に用いられているディジタル・オーデ
ィオディスクプレーヤのディジタル・アナログ変換部の
一例を示す回路図であって、ディスクの表面から光学的
に読み取られ九シリアルなディジタル信号は、例えば１
６ビツトのパラレル信号に変換された後にディジタル入
力信号ムとしてディジタル・アナログコンバータ１に供
給される。ディジタル・アナμグコンノ々−夕１は、デ
ィジタル入力信号を対応する電流値のアナログ信号に変
換する。演算増幅器２はディジタル・アナログコンバー
タｌの出力を入力として変換することによシ、対応する
アナログ値の電圧信号をアナログスイッチ３に供給する
。アナログスイッチ３はディジタル入力信号ムに同期し
友サンプリングツぐルスＢをスイッチング１１１ＩＩｌ
栖号とすることによシ、ディジタル・アナログ変侠時に
於ける立ち上）時の不安定部分を１＠４）除いて安定し
た部分のみを出力する。
ィオディスクプレーヤのディジタル・アナログ変換部の
一例を示す回路図であって、ディスクの表面から光学的
に読み取られ九シリアルなディジタル信号は、例えば１
６ビツトのパラレル信号に変換された後にディジタル入
力信号ムとしてディジタル・アナログコンバータ１に供
給される。ディジタル・アナμグコンノ々−夕１は、デ
ィジタル入力信号を対応する電流値のアナログ信号に変
換する。演算増幅器２はディジタル・アナログコンバー
タｌの出力を入力として変換することによシ、対応する
アナログ値の電圧信号をアナログスイッチ３に供給する
。アナログスイッチ３はディジタル入力信号ムに同期し
友サンプリングツぐルスＢをスイッチング１１１ＩＩｌ
栖号とすることによシ、ディジタル・アナログ変侠時に
於ける立ち上）時の不安定部分を１＠４）除いて安定し
た部分のみを出力する。
そして、このアナログスイッチ３の出力信号は、スイッ
チングノイズ等を確実に除去する九めにり４を介して取
り出される。この場合、ローノ臂スフィルタ４は、カッ
トオフ特性が急峻でかつゲインロスが少ないことが必要
であり、このためにループぞスフィルタ４は演算増幅器
５．抵抗６．７およびコンデンサ８，９によって構成さ
れる例えば８個のアクティブフィルタ１０．〜Ｉｏｎが
シリアルに接続された構成となっている。このようにし
て取シ出されたループスフィルタ４の出力信号は、演算
増幅器１１に於いて増幅された後にオーディオ信号０と
して出力端１２に供給されるように構成されている。
チングノイズ等を確実に除去する九めにり４を介して取
り出される。この場合、ローノ臂スフィルタ４は、カッ
トオフ特性が急峻でかつゲインロスが少ないことが必要
であり、このためにループぞスフィルタ４は演算増幅器
５．抵抗６．７およびコンデンサ８，９によって構成さ
れる例えば８個のアクティブフィルタ１０．〜Ｉｏｎが
シリアルに接続された構成となっている。このようにし
て取シ出されたループスフィルタ４の出力信号は、演算
増幅器１１に於いて増幅された後にオーディオ信号０と
して出力端１２に供給されるように構成されている。
しかしながら、上記構成によるディジタル・オーディオ
ディスクプレーヤのディジタル・アナログ変換部に於い
ては、ディジタル・アナログコンバータｌのオフセット
ミスおよび後段に直結によって接続される数多くの演算
Ｎｉ幅器２゜５．１１にオフセットミスが生ずると、オ
ーディオ出力信号０にドリフトが生じてしまう、従って
、全演算増幅器のオフセット調整を［５ｊ！に行なう必
要があるが、演算増幅器の数が極めて多いために、その
作業は極めて困瘤なものとなる。また、このように多数
の演算増幅器がシリアルに接続された場合には、温度等
によるＰリフト分が相乗的に影響し合って直流的な不安
定要素が拡大する等の種々問題を有している。
ディスクプレーヤのディジタル・アナログ変換部に於い
ては、ディジタル・アナログコンバータｌのオフセット
ミスおよび後段に直結によって接続される数多くの演算
Ｎｉ幅器２゜５．１１にオフセットミスが生ずると、オ
ーディオ出力信号０にドリフトが生じてしまう、従って
、全演算増幅器のオフセット調整を［５ｊ！に行なう必
要があるが、演算増幅器の数が極めて多いために、その
作業は極めて困瘤なものとなる。また、このように多数
の演算増幅器がシリアルに接続された場合には、温度等
によるＰリフト分が相乗的に影響し合って直流的な不安
定要素が拡大する等の種々問題を有している。
従って、本考案による目的は、ディジタル・アナログコ
ンバータ夕および演算増幅器の各段別オフセット調整を
不要にするとと４に、ドリフトによる出力の不安定化を
防止したディジタル・アナログ変換部を有するディジタ
ル・オーディオディスクプレーヤを提供することである
。
ンバータ夕および演算増幅器の各段別オフセット調整を
不要にするとと４に、ドリフトによる出力の不安定化を
防止したディジタル・アナログ変換部を有するディジタ
ル・オーディオディスクプレーヤを提供することである
。
このような目的を達成するために本発明は、ディジタル
・アナログ変換部のオーディオ出力信号をループフィル
タとコンパレータとによって構成されるオフセット制御
回路を介してディジタル・アナログコンバータの出力側
に設けられている演算増幅器のオフセット調整端にフィ
ードバックするものである。以下、図面を用いて本考案
によるディジタル・オーディオディスクプレーヤを詳細
に貌明する。
・アナログ変換部のオーディオ出力信号をループフィル
タとコンパレータとによって構成されるオフセット制御
回路を介してディジタル・アナログコンバータの出力側
に設けられている演算増幅器のオフセット調整端にフィ
ードバックするものである。以下、図面を用いて本考案
によるディジタル・オーディオディスクプレーヤを詳細
に貌明する。
第２図は本発明によるディジタル・オーディオプレーヤ
に用いられるディジタル・アナログ変換部の一例を示す
回路図であって、第１図と同一部分は同一記号を用いて
示しである。同図に於いて１４は演算増幅器１１から出
力されるオーディオ出力信号０を入力とするループぞス
フィルタであって、時足数の大きなＯＲ回路等によって
構成されている。１５はループにスフィルタ１４から供
給されるオーディオ出力信号０に含まれる直流分をアー
ス電位と比較し、その差分をオフセット制御信号りとし
てディジタルＱアナログコンバータ１の後段に位置する
演算増幅器２のオフセット調整端に供給する演算増幅器
であって、これらはフィートノ々ツク制御によってオフ
セット調整を行なうオフセット制御回路１６を構成して
いる。
に用いられるディジタル・アナログ変換部の一例を示す
回路図であって、第１図と同一部分は同一記号を用いて
示しである。同図に於いて１４は演算増幅器１１から出
力されるオーディオ出力信号０を入力とするループぞス
フィルタであって、時足数の大きなＯＲ回路等によって
構成されている。１５はループにスフィルタ１４から供
給されるオーディオ出力信号０に含まれる直流分をアー
ス電位と比較し、その差分をオフセット制御信号りとし
てディジタルＱアナログコンバータ１の後段に位置する
演算増幅器２のオフセット調整端に供給する演算増幅器
であって、これらはフィートノ々ツク制御によってオフ
セット調整を行なうオフセット制御回路１６を構成して
いる。
このように構成され九回路に於いて、入力信号入が供給
されると、ディジタル暢アナログコンバータ１はディジ
タル値の入力信号を対応するアナログ値の電流信号とし
て出力し、この電流信号は演算増幅器２に於いて増幅さ
れて電圧値信号としてアナログスイッチ３に供給される
。
されると、ディジタル暢アナログコンバータ１はディジ
タル値の入力信号を対応するアナログ値の電流信号とし
て出力し、この電流信号は演算増幅器２に於いて増幅さ
れて電圧値信号としてアナログスイッチ３に供給される
。
アナログスイッチ３は入力信号ムに同期して供給される
す／シリング／ぞルスＢによりスイッチング制御される
ことにより、ディジタル・アナログ変換による出力の安
定部分が取り出されてローパスフィルタ４に供給される
。この場合、ローパスフィルタ４は第１図で詳記したよ
うに、アクティブフィルタが多数個シリアルに接続され
てカットオフ周波数が２０ＫＨｚでかつカットオフ特性
が急峻となるように設定されている。
す／シリング／ぞルスＢによりスイッチング制御される
ことにより、ディジタル・アナログ変換による出力の安
定部分が取り出されてローパスフィルタ４に供給される
。この場合、ローパスフィルタ４は第１図で詳記したよ
うに、アクティブフィルタが多数個シリアルに接続され
てカットオフ周波数が２０ＫＨｚでかつカットオフ特性
が急峻となるように設定されている。
従って、このローノにスフィルタ４からは、アナログス
イッチ３等に於いて発生される ノイズ分が確実に除去
され、２０ＫＨｚ以下の再生オーディオ信号のみが取９
出される。このオーディオ信号は演算増幅器１１に於い
て１１ｍ＠された後にオーディオ出力信号Ｏとして出力
端１２に送出される。
イッチ３等に於いて発生される ノイズ分が確実に除去
され、２０ＫＨｚ以下の再生オーディオ信号のみが取９
出される。このオーディオ信号は演算増幅器１１に於い
て１１ｍ＠された後にオーディオ出力信号Ｏとして出力
端１２に送出される。
一方、ローパスフィルタ１４はオーディオ出力信号Ｃに
含まれる直流分を取り出すことによシ、出力信号中に含
まれるオフセット電圧が検出される。従って、この場合
に於けるローパスフィルタ１４は、オーディオ信号の影
響を受けないように十分に大きな時定数を持たせる必要
がある。このようにして、ローパスフィルタ１４から出
力されるオフセット電圧は、演算増幅器１５に於いてア
ース電位とが比較され、その差信号がオフセット制御信
号りとして出力される。
含まれる直流分を取り出すことによシ、出力信号中に含
まれるオフセット電圧が検出される。従って、この場合
に於けるローパスフィルタ１４は、オーディオ信号の影
響を受けないように十分に大きな時定数を持たせる必要
がある。このようにして、ローパスフィルタ１４から出
力されるオフセット電圧は、演算増幅器１５に於いてア
ース電位とが比較され、その差信号がオフセット制御信
号りとして出力される。
このオフセット制御信号りは、演算増幅器２のオフセッ
ト制御端にフィードバックされることにより、オフセッ
ト値が負帰還制御されて演算増幅器１１から出力される
オーディオ出力信号に含まれるオフセット電圧が零に制
御される。
ト制御端にフィードバックされることにより、オフセッ
ト値が負帰還制御されて演算増幅器１１から出力される
オーディオ出力信号に含まれるオフセット電圧が零に制
御される。
つまり、各演算増幅器のオフセット値をｔｈぼ調整して
おくのみで、オフセット制御回路１６がオーディオ出力
信号中に含まれるオフセット値とアース電位との差をオ
フセット制御信号りとして演算増幅器２に負帰還してｇ
整するものであるために、オフセット調整は各段別に行
なう必要がなくなり、その調整作業はいずれかの段部の
みをｉＩ４整すれば良い丸めに極めて容易となる。また
、各演算増幅器の各段部に於けるドリフトによるオフセ
ット値の変化も、オフセット制御回路１６がオフセット
値をフィード／セック制御するために、オーディオ出力
信号Ｏに含まれるオフセット値は常に零となり、これに
伴なって直流出力が常に安定化されることになる。
おくのみで、オフセット制御回路１６がオーディオ出力
信号中に含まれるオフセット値とアース電位との差をオ
フセット制御信号りとして演算増幅器２に負帰還してｇ
整するものであるために、オフセット調整は各段別に行
なう必要がなくなり、その調整作業はいずれかの段部の
みをｉＩ４整すれば良い丸めに極めて容易となる。また
、各演算増幅器の各段部に於けるドリフトによるオフセ
ット値の変化も、オフセット制御回路１６がオフセット
値をフィード／セック制御するために、オーディオ出力
信号Ｏに含まれるオフセット値は常に零となり、これに
伴なって直流出力が常に安定化されることになる。
なお、上記実施例に於いては、オフセット制御回路１６
としてローパスフィルタ１４と演算増幅器１５とによっ
て構成した場合について説明したが１本発明はこれに限
定されるものではなく、オーディオ出力信号Ｃに含まれ
る直流分を検出してアース電位との差分をオフセット制
御信号りとして出力するものであれば良く、例えば第３
図に示すように演算増幅器１７とコンデンサ１８および
抵抗１９によって構成しても嵐い、また、演算増幅器２
はディジタル・アナログコンバータｌの外部に設けられ
ている場合について説明したが、点崎で示すようにディ
ジタル・アナログコンバータ１の内部に設けられている
場合に於いても同様である。
としてローパスフィルタ１４と演算増幅器１５とによっ
て構成した場合について説明したが１本発明はこれに限
定されるものではなく、オーディオ出力信号Ｃに含まれ
る直流分を検出してアース電位との差分をオフセット制
御信号りとして出力するものであれば良く、例えば第３
図に示すように演算増幅器１７とコンデンサ１８および
抵抗１９によって構成しても嵐い、また、演算増幅器２
はディジタル・アナログコンバータｌの外部に設けられ
ている場合について説明したが、点崎で示すようにディ
ジタル・アナログコンバータ１の内部に設けられている
場合に於いても同様である。
以上説明したように、本発明によるディジタル・オーデ
ィオディスクプレーヤは、ディジタル・アナログ変換部
の出力に含まれる直流分を検出してアース電位との差分
をオフセット制御信号として出力するオフセット制御回
ｗＩヲ設け、このオフセット制御信号をディジタルＯア
ナログ変換部の前段側に位置する演算増幅器のオフセッ
トをフィードバック制御するものである。
ィオディスクプレーヤは、ディジタル・アナログ変換部
の出力に含まれる直流分を検出してアース電位との差分
をオフセット制御信号として出力するオフセット制御回
ｗＩヲ設け、このオフセット制御信号をディジタルＯア
ナログ変換部の前段側に位置する演算増幅器のオフセッ
トをフィードバック制御するものである。
よって、多数の演算増幅段を有するディジタル自アナロ
グ変換部の各段に於けるオフセット調ｌｉを行なうこと
なく、一部の段部の調Ｉｉを行なうのみでオフセット値
を零にｉ＆ｌ［−することが出来るために、そのＭＭ作
業が極めて容易になる。
グ変換部の各段に於けるオフセット調ｌｉを行なうこと
なく、一部の段部の調Ｉｉを行なうのみでオフセット値
を零にｉ＆ｌ［−することが出来るために、そのＭＭ作
業が極めて容易になる。
また１本発明に於いては、オーディオ出力信号中に含ま
れる直流分が常に零となるように負帰還制御が加わるた
めに、谷演鼻ｊ！輪器のＰリフト分が自動的に補正され
てｔｍ流的な安定度が大幅に向上する等の植々浚れた効
果を有する。
れる直流分が常に零となるように負帰還制御が加わるた
めに、谷演鼻ｊ！輪器のＰリフト分が自動的に補正され
てｔｍ流的な安定度が大幅に向上する等の植々浚れた効
果を有する。
第１図は従来のディジタル・オーディオディスクプレー
ヤに用いられているディジタル・アナログ変換部の一例
を示す回路図、第２図は本発明によるディジタル・オー
ディオディスクプレーヤに用いられるディジタル・アナ
ログ変換部の一実施例を示す回路図、第３図は第２図に
示すオフセット制御回路の他の実施例を示す回路図であ
る。 ｌ・・・ディジタル・アナログコ／ノ々−タ、２゜１１
．１５，１７−・・演算増幅器、３・・・アナログスイ
ッチ、４．１４・・・ローノぞスフィルタ、１６・・・
オフセット制御回路、１８−・抵抗％ １９−・抵抗。
ヤに用いられているディジタル・アナログ変換部の一例
を示す回路図、第２図は本発明によるディジタル・オー
ディオディスクプレーヤに用いられるディジタル・アナ
ログ変換部の一実施例を示す回路図、第３図は第２図に
示すオフセット制御回路の他の実施例を示す回路図であ
る。 ｌ・・・ディジタル・アナログコ／ノ々−タ、２゜１１
．１５，１７−・・演算増幅器、３・・・アナログスイ
ッチ、４．１４・・・ローノぞスフィルタ、１６・・・
オフセット制御回路、１８−・抵抗％ １９−・抵抗。
Claims (1)
- （１）ディスクの表面に書き込まれているディジタル情
報を光学的に読み散シ、このディジタル信号をアナログ
信号に変換する複数段の演算増幅器を備え九ディジタル
・アナログ変換部を有するディジタル・オーディオディ
スクプレーヤに於いて、前記ディジタルアナ日グ変換部
の出力中に含まれる直流分を検出して基準レベルとの差
分をオフセット制御信号として発生するオフセット制御
回路と、このオフ・セット制御信号を前記ディジタル・
アナログ変換部の前段側に設けられている前ｉｅ演算増
幅器のオフセット制御端子に帰還し、前記ディジタル・
アナログ変換部の出力中に含まれるオフセット電圧を小
さくする回路網とを設けたことを特徴とするディジタル
のオーディオディスクプレーヤ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3034382A JPS58147232A (ja) | 1982-02-26 | 1982-02-26 | デイジタル・オ−デイオデイスクプレ−ヤ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3034382A JPS58147232A (ja) | 1982-02-26 | 1982-02-26 | デイジタル・オ−デイオデイスクプレ−ヤ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58147232A true JPS58147232A (ja) | 1983-09-02 |
Family
ID=12301184
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3034382A Pending JPS58147232A (ja) | 1982-02-26 | 1982-02-26 | デイジタル・オ−デイオデイスクプレ−ヤ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58147232A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60169946U (ja) * | 1984-04-20 | 1985-11-11 | 株式会社ケンウッド | デジタル／アナログ変換装置 |
| JPS6123738U (ja) * | 1984-07-13 | 1986-02-12 | オンキヨー株式会社 | Ｄ／ａコンバ−タ |
| JPS61197733U (ja) * | 1985-05-30 | 1986-12-10 | ||
| WO1995002923A1 (en) * | 1993-07-12 | 1995-01-26 | Analog Devices, Inc. | Method and apparatus for calibrating a gain control circuit |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54136163A (en) * | 1978-04-14 | 1979-10-23 | Hitachi Ltd | Digital-analog converting device |
-
1982
- 1982-02-26 JP JP3034382A patent/JPS58147232A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54136163A (en) * | 1978-04-14 | 1979-10-23 | Hitachi Ltd | Digital-analog converting device |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60169946U (ja) * | 1984-04-20 | 1985-11-11 | 株式会社ケンウッド | デジタル／アナログ変換装置 |
| JPS6123738U (ja) * | 1984-07-13 | 1986-02-12 | オンキヨー株式会社 | Ｄ／ａコンバ−タ |
| JPS61197733U (ja) * | 1985-05-30 | 1986-12-10 | ||
| WO1995002923A1 (en) * | 1993-07-12 | 1995-01-26 | Analog Devices, Inc. | Method and apparatus for calibrating a gain control circuit |
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