JPS58145366A - ア−ク溶接機 - Google Patents
ア−ク溶接機Info
- Publication number
- JPS58145366A JPS58145366A JP57026930A JP2693082A JPS58145366A JP S58145366 A JPS58145366 A JP S58145366A JP 57026930 A JP57026930 A JP 57026930A JP 2693082 A JP2693082 A JP 2693082A JP S58145366 A JPS58145366 A JP S58145366A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- short
- arc
- welding machine
- arc welding
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B23—MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
- B23K—SOLDERING OR UNSOLDERING; WELDING; CLADDING OR PLATING BY SOLDERING OR WELDING; CUTTING BY APPLYING HEAT LOCALLY, e.g. FLAME CUTTING; WORKING BY LASER BEAM
- B23K9/00—Arc welding or cutting
- B23K9/10—Other electric circuits therefor; Protective circuits; Remote controls
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Plasma & Fusion (AREA)
- Mechanical Engineering (AREA)
- Arc Welding Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は消耗性電極を用いて溶接を行うアーク＃接磯に
関する。
関する。
消耗性電極を用いるアータ＃Ｉ接機においては、消耗性
電極が母材ＫＩｌ触した時からアークが再発生するまで
の間に多量のスパッタが発生する。こｏ Ｘ バッタな
、ｓｒｓ路と直列にインダクタンスな挿入することであ
る１度抑制で自為ことはすでに知られている。
電極が母材ＫＩｌ触した時からアークが再発生するまで
の間に多量のスパッタが発生する。こｏ Ｘ バッタな
、ｓｒｓ路と直列にインダクタンスな挿入することであ
る１度抑制で自為ことはすでに知られている。
従来のアークｆＩＩＩＩｌｌＩ−ｗｃおいては、スパッ
タな抑制するためのインダクタンスは、鉄心ニコイルな
巻付１て実現されており、ｓ接機の容積のかなりの部分
を占めると共に、コスト面でも大きな比率を持っていた
。また、同一〇＃ｌｌｌＲ１１″Ｃｈ浴接法を切替える
場合浴接−てはｌＩＩＪｍＫ示すように、も々ｏｆｓ羨
法に逼し九インダクタンス（Ｌ、） （Ｌｍ） ヲｌッ
グ等で切替えるように構成されており、材料面でも大き
な無駄であつ九・なお１１１図において（１）は主回路
制御部である。
タな抑制するためのインダクタンスは、鉄心ニコイルな
巻付１て実現されており、ｓ接機の容積のかなりの部分
を占めると共に、コスト面でも大きな比率を持っていた
。また、同一〇＃ｌｌｌＲ１１″Ｃｈ浴接法を切替える
場合浴接−てはｌＩＩＪｍＫ示すように、も々ｏｆｓ羨
法に逼し九インダクタンス（Ｌ、） （Ｌｍ） ヲｌッ
グ等で切替えるように構成されており、材料面でも大き
な無駄であつ九・なお１１１図において（１）は主回路
制御部である。
本発明は上記０ＡＫＩｌｉみ、小皺化及びコストダウン
を図ることのできるアーク＃ｌ羨砿を得ることを目的と
する。
を図ることのできるアーク＃ｌ羨砿を得ることを目的と
する。
すなわち本発明は、消耗性電極が母材に接触し友ことを
検出する検出回路と、この検出回路からのａＩ号によシ
短諮電流を次第に増加させる短絡電流制御Ｍ１回路と、
この短絡電流制御回路により制御される帥記短絡電ＩＥ
Ｏ増加程度を任意の時定数にＷｋｙｊｉ！する設定回路
とを設は良ものであシ、従来の如く大きなインダクタン
スな用いることなく、簡単な電子回路を用−てＩＩＩＩ
ＩＮ電流を制御できるので、装置の小臘化及びコストダ
ウンを実現できるのである。
検出する検出回路と、この検出回路からのａＩ号によシ
短諮電流を次第に増加させる短絡電流制御Ｍ１回路と、
この短絡電流制御回路により制御される帥記短絡電ＩＥ
Ｏ増加程度を任意の時定数にＷｋｙｊｉ！する設定回路
とを設は良ものであシ、従来の如く大きなインダクタン
スな用いることなく、簡単な電子回路を用−てＩＩＩＩ
ＩＮ電流を制御できるので、装置の小臘化及びコストダ
ウンを実現できるのである。
以下本発明の一実施例を図′＃ＪＫ基づいて説明する０
ｗ、２図において、砿ｍＨ）で囲まれ大部分は本発明の
特徴部分でｈ）、破線０）の外側部分は一般的なチョッ
パ臘のＳｍ−主回路の概略を示す・（２）はトランス及
び平滑囲路、（勾はトランジスタ属動部、（Ｔｒ、）は
出力制御ｍ１ｍ）う／ジスタ、 （Ｌｓ）は前記出力ｗ
Ｊ＃用トランジスタ（Ｔｒｔ）を保■する丸めのりアク
ドル、（Ｄｓ）はフライホイールダイオード、（８Ｈ）
は電ｆＩＩｔ検出用シャントである。アーク出力電圧は
抵抗（Ｒｔ）（＆）で分圧され、演算増幅器から成る比
較＃ （４）で消耗性電極と母材と０＠触すなわち短絡
発生が検出される− （Ｌ）（８１）はアナログスイッ
チで、一方のアナログスイッチ（Ｓｌ）は、短絡発生時
にオフ、アーク存在中にオンとな多、他方のアナログス
イッチ（８ｍ）は、短絡発生時に端子（２）と端子０と
が短絡され、アータ存在中Ｋｊ１ｍｌ子β）と端子ｒ）
とが短絡されるように動作する。アーク電流はシャン）
Ｃ３Ｈ）Ｋよ〕検出され、演算項＠器から成る増−！
！ （６３で増幅されるー、アーク発生中は、アナログ
スイッチ（８，）がオン、アナログスイッチ（心）の端
子０１１０が短絡された状態であるので、増−器（旬の
出力と可変抵抗器ｆｆＲ，）で設定され圧設定値とが演
算項＠器から成る比較１！ （ａ）で比較され、増−一
（ｂ）の出力が設定値を越えた場合には、抵抗（ａｓ）
及びトランジスタ（Ｔｈ冨）を介してトランジスタ躯動
部（８に入力されるトランジスタ駆動信号（ロ）を論理
積回路（１）で遣断し、トランジスタ（Ｔｒｓ）をオフ
させて、トランジスタ（Ｔｒｓ ）に過大電流が流れな
ｉように保躾する。短絡が検出されて、アナログスイッ
チ（８θがオフ、アナログスイッチ（Ｓりの端子（Ａ）
０が短絡された状態になると、コンデンサ（Ｃ１）は短
絡検出時点の電圧値から可変抵抗器（ＶＲｌ）の抵抗値
几マｌにより充電され、時定数ＣＩＡＶＲで増加してい
く、このとＩｉＯコンデ・ノー？（ＣＩ）の電圧は、演
算増幅器から成る増幅器（２）及びアナログスイッチ（
Ｓ、）を介して比較１！ （６）に設定値として入力さ
れてお！ｌ、）う／ジスタ（ＴｒＪをオフする電流値を
決定していることから、トランジスタ（′ｒ口）を流れ
るアーク電＃ｌも時定数ＣｔＲＶｌで増加してゆく、シ
たがッテ、ＣｔＲＶｌの値を適ＩＡＫ設定することによ
って、スパッタの少ないＳ接機を実現できる。なおＩＮ
２ ｆＩＭ Ｋ ＆ イ？、 （Ｒ４）〜（Ｒｅ）
ハＪｌｔ Ｋ、（ＺＤ、）はツェナーダイオードである
。
ｗ、２図において、砿ｍＨ）で囲まれ大部分は本発明の
特徴部分でｈ）、破線０）の外側部分は一般的なチョッ
パ臘のＳｍ−主回路の概略を示す・（２）はトランス及
び平滑囲路、（勾はトランジスタ属動部、（Ｔｒ、）は
出力制御ｍ１ｍ）う／ジスタ、 （Ｌｓ）は前記出力ｗ
Ｊ＃用トランジスタ（Ｔｒｔ）を保■する丸めのりアク
ドル、（Ｄｓ）はフライホイールダイオード、（８Ｈ）
は電ｆＩＩｔ検出用シャントである。アーク出力電圧は
抵抗（Ｒｔ）（＆）で分圧され、演算増幅器から成る比
較＃ （４）で消耗性電極と母材と０＠触すなわち短絡
発生が検出される− （Ｌ）（８１）はアナログスイッ
チで、一方のアナログスイッチ（Ｓｌ）は、短絡発生時
にオフ、アーク存在中にオンとな多、他方のアナログス
イッチ（８ｍ）は、短絡発生時に端子（２）と端子０と
が短絡され、アータ存在中Ｋｊ１ｍｌ子β）と端子ｒ）
とが短絡されるように動作する。アーク電流はシャン）
Ｃ３Ｈ）Ｋよ〕検出され、演算項＠器から成る増−！
！ （６３で増幅されるー、アーク発生中は、アナログ
スイッチ（８，）がオン、アナログスイッチ（心）の端
子０１１０が短絡された状態であるので、増−器（旬の
出力と可変抵抗器ｆｆＲ，）で設定され圧設定値とが演
算項＠器から成る比較１！ （ａ）で比較され、増−一
（ｂ）の出力が設定値を越えた場合には、抵抗（ａｓ）
及びトランジスタ（Ｔｈ冨）を介してトランジスタ躯動
部（８に入力されるトランジスタ駆動信号（ロ）を論理
積回路（１）で遣断し、トランジスタ（Ｔｒｓ）をオフ
させて、トランジスタ（Ｔｒｓ ）に過大電流が流れな
ｉように保躾する。短絡が検出されて、アナログスイッ
チ（８θがオフ、アナログスイッチ（Ｓりの端子（Ａ）
０が短絡された状態になると、コンデンサ（Ｃ１）は短
絡検出時点の電圧値から可変抵抗器（ＶＲｌ）の抵抗値
几マｌにより充電され、時定数ＣＩＡＶＲで増加してい
く、このとＩｉＯコンデ・ノー？（ＣＩ）の電圧は、演
算増幅器から成る増幅器（２）及びアナログスイッチ（
Ｓ、）を介して比較１！ （６）に設定値として入力さ
れてお！ｌ、）う／ジスタ（ＴｒＪをオフする電流値を
決定していることから、トランジスタ（′ｒ口）を流れ
るアーク電＃ｌも時定数ＣｔＲＶｌで増加してゆく、シ
たがッテ、ＣｔＲＶｌの値を適ＩＡＫ設定することによ
って、スパッタの少ないＳ接機を実現できる。なおＩＮ
２ ｆＩＭ Ｋ ＆ イ？、 （Ｒ４）〜（Ｒｅ）
ハＪｌｔ Ｋ、（ＺＤ、）はツェナーダイオードである
。
Ｊｇａ図は第２図ｏｍｓｏ＊＊波形図で６９、（イ）は
アーク電圧＃Ｌ形、＠は比較器（２）Ｏプラス側入力端
の入力電圧％０はアーク電流波形をそれぞれ示す、なお
１１３図において、ｅ→は値纏機出期調であシ、破線に
）は本発明の特徴部分であるＪ１１２図砿謙０）でｗＡ
すれｌＩ−回路を用いない場合のアータ電ＩＩＬ畝形で
ある。
アーク電圧＃Ｌ形、＠は比較器（２）Ｏプラス側入力端
の入力電圧％０はアーク電流波形をそれぞれ示す、なお
１１３図において、ｅ→は値纏機出期調であシ、破線に
）は本発明の特徴部分であるＪ１１２図砿謙０）でｗＡ
すれｌＩ−回路を用いない場合のアータ電ＩＩＬ畝形で
ある。
以上説明し丸ように、本発明にかかるアーク溶１ｉ２１
１によれば、従来Ｏ如く大きなイｙダタタンスを用いる
ことなく、簡単な電子四路によりスパッタを低減できる
ので、装置の装置軽量化及びコストダウンを実現し得る
。特に、短絡型Ｒの増加の割合を任意に制御できるので
、同−ａＳＳ機で溶接法を切替える場合、従来の如く複
数のインダクタンスな設ける必要がなく、極めて効果的
である。
１によれば、従来Ｏ如く大きなイｙダタタンスを用いる
ことなく、簡単な電子四路によりスパッタを低減できる
ので、装置の装置軽量化及びコストダウンを実現し得る
。特に、短絡型Ｒの増加の割合を任意に制御できるので
、同−ａＳＳ機で溶接法を切替える場合、従来の如く複
数のインダクタンスな設ける必要がなく、極めて効果的
である。
第１図は従来例の説明図、第２図は本発明の一実施例に
おけるアーク溶接機の要部回路図、第３図四〜（Ｑは第
２図に示す回路の各部披形図である。 （４）（・）・・・比較器、（７）・・・論理積回路％
（８，） （８す・・・アｔ Ｏ／ スイ７ ｆ −（
Ｃｔ） ・・・：” ７ ｆ ンｔ 、（ＶＩＪ） ｆ
ｆＲ＊）・・・可変抵抗器、（ａ、）〜（８・）・・・
抵抗、 （ＺＤｔ）・・・ツェナーダイオード 代理人 森本義弘 第１図 第２図 第５図
おけるアーク溶接機の要部回路図、第３図四〜（Ｑは第
２図に示す回路の各部披形図である。 （４）（・）・・・比較器、（７）・・・論理積回路％
（８，） （８す・・・アｔ Ｏ／ スイ７ ｆ −（
Ｃｔ） ・・・：” ７ ｆ ンｔ 、（ＶＩＪ） ｆ
ｆＲ＊）・・・可変抵抗器、（ａ、）〜（８・）・・・
抵抗、 （ＺＤｔ）・・・ツェナーダイオード 代理人 森本義弘 第１図 第２図 第５図
Claims (1)
- １、 消耗性電極が母＃に＊紬し九ことを検出する検出
−路と、この検出回路からＯＩ１号ＩＩｃよシ短絡電流
を次第に増加させる短絡電流制御回路と、この短絡電流
制御回路によ参制御される―紀短絡電流の増加程度を任
意の時定数に設定する設定回路とを設けたアータ濤接ａ
＃
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57026930A JPS58145366A (ja) | 1982-02-19 | 1982-02-19 | ア−ク溶接機 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57026930A JPS58145366A (ja) | 1982-02-19 | 1982-02-19 | ア−ク溶接機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58145366A true JPS58145366A (ja) | 1983-08-30 |
| JPH0224631B2 JPH0224631B2 (ja) | 1990-05-30 |
Family
ID=12206874
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57026930A Granted JPS58145366A (ja) | 1982-02-19 | 1982-02-19 | ア−ク溶接機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58145366A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5071111B2 (ja) * | 2007-03-07 | 2012-11-14 | パナソニック株式会社 | 溶接装置 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03120136U (ja) * | 1990-03-20 | 1991-12-10 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57142176A (en) * | 1981-02-26 | 1982-09-02 | Fuji Electric Co Ltd | Control system for cyclo converter |
-
1982
- 1982-02-19 JP JP57026930A patent/JPS58145366A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57142176A (en) * | 1981-02-26 | 1982-09-02 | Fuji Electric Co Ltd | Control system for cyclo converter |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5071111B2 (ja) * | 2007-03-07 | 2012-11-14 | パナソニック株式会社 | 溶接装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0224631B2 (ja) | 1990-05-30 |
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