JPS58140649A - 電圧検出回路 - Google Patents

電圧検出回路

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JPS58140649A
JPS58140649A JP57023309A JP2330982A JPS58140649A JP S58140649 A JPS58140649 A JP S58140649A JP 57023309 A JP57023309 A JP 57023309A JP 2330982 A JP2330982 A JP 2330982A JP S58140649 A JPS58140649 A JP S58140649A
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JP
Japan
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vcc
output
point
vth
voltage
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JP57023309A
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English (en)
Inventor
Tsutomu Nakamori
中森　勉
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
    • H03K17/22—Modifications for ensuring a predetermined initial state when the supply voltage has been applied
    • H03K17/223—Modifications for ensuring a predetermined initial state when the supply voltage has been applied in field-effect transistor switches
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R19/00—Arrangements for measuring currents or voltages or for indicating presence or sign thereof
    • G01R19/165—Indicating that current or voltage is either above or below a predetermined value or within or outside a predetermined range of values
    • G01R19/16504—Indicating that current or voltage is either above or below a predetermined value or within or outside a predetermined range of values characterised by the components employed
    • G01R19/16519—Indicating that current or voltage is either above or below a predetermined value or within or outside a predetermined range of values characterised by the components employed using FET's
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/24—Resetting means

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 （１）　　発明のｇｔ術分野 本発明は電圧検出回路に関し、特に電源の投せ 入時に内部回路を自動リセットさがる場合に用いられる
′に擁立上り検出回路に関する。
（２）　技術の背景 １子４１１１器の動作にあたっては、電子機器を構成す
る＋ＩＩＡ能ブロックｔ−富に初期状態にリセットして
から正常動作を行わせている。このため各機能ブロック
には、電源電圧が所にの電圧まで到達する直後の時間内
に内部回路をリセットする丸めの信号入力端子を備え、
一方、電源電圧が所定の電圧まで到達するまでの時間内
にリセットパルスを出力する電源立上り検出回路を付加
させている。
この樵の電源立上シ検出回路は、通常キャパシタと を抵抗からなる積分回路を利用したものが多い。
最近では、集積回路の進展によって、この電源立上り検
出回路を集積回路内に内戚させるようになってきており
、集積回路自体が自動リセットを行なっている。これは
檀々の用途に多用逼れている所のマイクロプロセッサに
おいても一般化しており、電源立上り検出回路も檀々の
形態が考えら１裏 り段を用いて増幅する形式のものである。　　゛（３）
従来技術と問題点 従来の電源立上シ検出回路の代表例は第１図に示される
如きもので、キャパシタ、抵抗ならびにＮチャンネルＭ
Ｏ日トランジスタＴＲ１からなる直列回路１．２段の相
補形ＭＯ８イ／バータ段よりなる増幅１！ｊ１２、ＮＯ
Ｒの７リツプフロツプよりなる出力ＩＲ３から構成され
ている。図中、Ｐチャンネルトランジスタは簡単のため
太実線にて表示している。
この回路の動作を、第２図を参照して説明すると、この
回路ｔ′含めて全体に印加される電源電圧’ｌ’Ｑｏ　
　が時間経過と共に図示の通り保々に上昇したとすると
、この電圧上昇はキャパシターを介してＡ点の１圧レベ
ル上昇をもたらす。Ｂ点電位もＡ点電位に同じく上昇す
るが、トランジスタＴＲＩの閾値電圧（約ＩＶ）でクラ
γブされる。ＰチャンネルトランジスタＴＲ２とＮチャ
ンネルトランジスタＴＲ３のＣＭＯＳインバータは、Ｖ
　Ｏｃ／　２のｎ４　ＩＩ電圧を有するから、ｖＣＣ／
２のラインが、Ａ点とＢ点のクランプレベルに至るまで
は、トランジスタＴＲ３がＯＮＬ、以後はトランジスタ
ＴＲ２がＯＩＬ、０点での出力はｖｃｃの上昇に追随す
る。０点出力の立上りによってトランジスタＴＲ５はＯ
Ｎし、Ｄ点出力は立下る。
上記回路では、Ａ点電圧は約ＩＶにクランプされ、よっ
てＤ点出力は高々２ｖである。尚、トランジスタの閾値
電圧は実際上は（１８Ｖであり、従って、Ｄ点出力は実
際上はＬ６Ｖであるに過ぎない。Ｄ点出力のレベルが比
較的低いので、フリップフロップ３の動作が確実に行わ
れ暖い問題がある０ この問題を解決するためには、Ａ点でのクランプ電位を
高めればよく、トランジスタＴＲＩの閾値のみ高めれば
よいのであるが、電源電圧が安冗した後もＡ点電位は保
持されるから、Ａ点電位を増大させ九だけでは、ＣＭＯ
ＳインバータのＰチャンネル両トランジスタを共にＯＮ
することになり、直流電流が流れる結果となる。
（４）　　発明の目的 本発明は上記従来の゛−電源立上検出回路における誤出
力の可能性を一段と低め、これによりｇに正常動作を行
わせ得る電源立上り検出回路を提供せんとするものであ
る。
本発明では、また、第１図に例示される直列回路１のグ
ランプ電圧を高めることなく、インバータ段２の出力を
高め得る電源立上り検出回路を提供せんとするものであ
る。
（５）　　発明の構成 上記の目的は、本発明によれば゛嵯源電位の変化に追随
する電位・噴出回路、電位検出回路の出力に上り駆動さ
れる相補形トランジスタ対よりなる第１のインバータ段
、第１のインバータ段と電源端子間に直袈俊絖した開直
素子、第１のインバータ段出力によシ駆動される相補形
トランジスタ対よりなる第２のインバータ段よシなるこ
とを特徴とする電圧検出回路とすることにより達成され
る。
（６）　　発明の実施例 第３図は本発明の実施例になる電源立上り電圧検出回路
の回路図でおって、第１図と同一の参照数字は、第１図
と同−吻を示している。本実施例では、インバータ段２
の入力段にある０Ｍ０日インバータのＰチャンネルトラ
ンジスタＴＲ２とＶｃｃ　端子間に、１ｊＩｉｌ値素子
としてのＰチャンネルトランジスタＴＲ６が直列接続し
である。
第１図を参照して本実施例の回路動作を説明すると、電
源電圧ＶＯＱ　　の立上りによって、Ａ点電位は、（ａ
）図の如く上昇する。トランジスタＴＲ６の介挿によっ
て、トランジスタＴｆｔ２とＴＲ３の両趨子間電圧は、
（Ｖｃａ　−ｖｔｈ　）　テ６ッテ、（ｂ）図に示され
る通りである。ｖｔｈ　　はトランジスタＴＲ６の閾値
電圧で約１４（実際上は（１８Ｖ）である。従って、ト
ランジスタＴＲ２とＴＩ（３のＣＭＯＳインバータの閾
値はＣＶｃｃ　　Ｖｔｈ）／２であって、（ｂ）図の如
くである。Ａ点とＢ点の電位は、トランジスタＴＲ１で
クランプされた値（約ＩＶ）にとどまッテイるから、（
Ｖｃｃ　　ｖｔｈ）／２ラインと交叉する以前はトラン
ジスタＴＲ３がＯＮし０点出力は（０）図の通り接地電
位にあり、（Ｖｃｃ−ｖｔｈ）／２　が、点Ｂの電位よ
り増大するとき、トランジスタＴＲ２がＯＮする。ＴＲ
２のＯＮによ９０点出力は（ｄ）図の如く約３ｖ（実験
上では２．．６〜２．４Ｖ）から接地電位に低下する。
上記の実施例では、１−値素子としてのＰチャンネルト
ランジスタＴＲ６を用いたが、これは他の閾値素子、例
えばダイオード、シ望ットキーダイオードに代えること
ができ、また素子数は１素子に限らず１俵叔設けてもよ
い。但し、ＶＣＣが所定電位まで達した後にＤ点出力が
立上ることになると、素子全体として動作しうる電源′
電圧範囲の丁限を高くするおそれがある。
（７）　　発明の効果 以上述べた嫌に、本発明では電源立上り検出回路におけ
る最初のインバータ波負荷に閾値素子を介挿したので、
当該インバータ出力の立上りを遅延でさ、次段インバー
タの出力を所望の比較的高レベルから嶺地まで急峻に立
上げることができる。従って、電源立上り検出回路の出
力は一層確爽なものとすることができ、請用慎器の回路
動作の光全を期すことができるものである。
【図面の簡単な説明】
第１図は従来の電源立上り検出回路の回路図、第２図は
５ｇ１図の回路の各部位における電圧変化を示す夕、イ
ムチャート、第３図は本発明の実施例になる電源立上り
検出回路の回路図、第４図は第３図の回路の各部位にお
ける電圧変化を示すタイムチャートである。

Claims (1)

  1. 【特許請求の範囲】 電源電位の変化に追随する電位検出回路、電位検出回路
    の出力により駆動される相補形トランジスタ対よりなる
    第１のインバータ段、第１のインバータ段と電源端子間
    に直列接続した閾値素子。 第１のインバータ段出力により駆動される相補形トラン
    ジスタ対よりなる第２のインバータ段よりなることを待
    機とする゛電圧検出回路。
JP57023309A 1982-02-16 1982-02-16 電圧検出回路 Pending JPS58140649A (ja)

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