JPS5812460A - 伝送形式自動整合装置 - Google Patents
伝送形式自動整合装置Info
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- JPS5812460A JPS5812460A JP56110185A JP11018581A JPS5812460A JP S5812460 A JPS5812460 A JP S5812460A JP 56110185 A JP56110185 A JP 56110185A JP 11018581 A JP11018581 A JP 11018581A JP S5812460 A JPS5812460 A JP S5812460A
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- transmission
- terminal device
- transmission format
- code
- format
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L1/00—Arrangements for detecting or preventing errors in the information received
- H04L1/0078—Avoidance of errors by organising the transmitted data in a format specifically designed to deal with errors, e.g. location
- H04L1/0083—Formatting with frames or packets; Protocol or part of protocol for error control
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Small-Scale Networks (AREA)
- Communication Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、シリアル伝送ラインで結ばれた中央処理装
置とその１または複数の端末装置との間の伝送形式、た
とえば伝送速度、ならびに１桁を構成するピット数およ
びパリティなどのキャラクタ・モードを自動的に整合さ
せる装置に関する。
置とその１または複数の端末装置との間の伝送形式、た
とえば伝送速度、ならびに１桁を構成するピット数およ
びパリティなどのキャラクタ・モードを自動的に整合さ
せる装置に関する。
シリアル伝送はパラレル伝送に比べて標準化されている
ので、多くのタイプの端末装置たと１えばメーカの異な
る端末装置も中央処理装置に接続しうるという利点があ
る。しかしながら、各端末装置によって伝送形式が異な
るから、伝送形式を一致させるという作業が必要である
。
ので、多くのタイプの端末装置たと１えばメーカの異な
る端末装置も中央処理装置に接続しうるという利点があ
る。しかしながら、各端末装置によって伝送形式が異な
るから、伝送形式を一致させるという作業が必要である
。
従来は、中央処理装置の交信用インターフェイスに、伝
送速度やキャラクタ・モード等の項目を設定するスイッ
チを設けておき、このスイッチによって接続すべき端末
装置との伝送形式を合わせていた。ところがこの操作に
は専門的知識が要求されるとともに、手作業で行なわれ
ていたから、端末装置の接続作業がめんどうであり、か
つ接続不良を起こすこともある。
送速度やキャラクタ・モード等の項目を設定するスイッ
チを設けておき、このスイッチによって接続すべき端末
装置との伝送形式を合わせていた。ところがこの操作に
は専門的知識が要求されるとともに、手作業で行なわれ
ていたから、端末装置の接続作業がめんどうであり、か
つ接続不良を起こすこともある。
この発明は、中央処理装置とこれに接続される端末装置
との間の伝送形式を自動的に整合させる装置を提供し、
もって端末装置の接続を専門的知識がなくても簡単に行
なえるようにすることを目的とする。
との間の伝送形式を自動的に整合させる装置を提供し、
もって端末装置の接続を専門的知識がなくても簡単に行
なえるようにすることを目的とする。
以下、図面を参照してこの発明の実施例について詳述す
る。
る。
第１図は、中央処理装置（ＣＰＵという）を含む中央制
御装置（１）に、多数の端末装置（２）が、シリアル伝
送ラインで接続されている様子を示している。
御装置（１）に、多数の端末装置（２）が、シリアル伝
送ラインで接続されている様子を示している。
第２図は、中央制御装置（１）の内部構成を示している
。ＣＰＵＱＱＩは、後述する伝送形式テーブルを備えた
メモリα１）、伝送形式整合処理開始用操作ボタン０２
、端末装置（２）からの応答監視用タイマ０３１、およ
び各端末用の通信制御装置圓を備えている。通信制御装
置α４は、各端末装置（２）ごとに設けられており、発
振器を内蔵した伝送速度制御回路口５）、ＣＰＵＧＯＩ
から命令された伝送形式を記憶する操作レジスタαｅ、
ならびにこれらの制御回路（１５１およびレジスタＱ６
１によって制御され、設定された伝送形式で端末装置（
２）とのデータの送受信を行なう送、受信バッファ０η
０８１から構成されている。送信バッファαηはパラレ
ル・データのシリアル・データへの変換、受信バッファ
（旧はシリアル・データのパラレル・データへの変換を
それぞれ行なう。
。ＣＰＵＱＱＩは、後述する伝送形式テーブルを備えた
メモリα１）、伝送形式整合処理開始用操作ボタン０２
、端末装置（２）からの応答監視用タイマ０３１、およ
び各端末用の通信制御装置圓を備えている。通信制御装
置α４は、各端末装置（２）ごとに設けられており、発
振器を内蔵した伝送速度制御回路口５）、ＣＰＵＧＯＩ
から命令された伝送形式を記憶する操作レジスタαｅ、
ならびにこれらの制御回路（１５１およびレジスタＱ６
１によって制御され、設定された伝送形式で端末装置（
２）とのデータの送受信を行なう送、受信バッファ０η
０８１から構成されている。送信バッファαηはパラレ
ル・データのシリアル・データへの変換、受信バッファ
（旧はシリアル・データのパラレル・データへの変換を
それぞれ行なう。
第３図は、メモリα１）に設定されている各種テーブル
を示している。この実施例では、シリアル伝送形式には
、伝送速度とキャラクタ・モードとがある。メモリ０旧
こは、伝送速度テーブル、キャラクタ・モード・テーブ
ルおよび端末設定テーブルが設けられている。伝送速度
テーブルは、各端末装置の予想される多数の伝送速度を
記憶するもので、これらの伝送速度がアドレスＮ −Ｎ
十ｎまで記憶さｎている。キャラクタ・モードには、
１桁を構成するビット数およびｉ４リテイの形式がある
。キャラクタ・モード−テーブルには、異なるビット数
とパリティの組合せからなる多数のキャラクタ・モード
がアドレスＭ −Ｍ 十ｍまで記憶されている。端末設
定テーブルは、後述する整合処理によって決定された伝
送形式を各端末装置ごとに記憶するものである。
を示している。この実施例では、シリアル伝送形式には
、伝送速度とキャラクタ・モードとがある。メモリ０旧
こは、伝送速度テーブル、キャラクタ・モード・テーブ
ルおよび端末設定テーブルが設けられている。伝送速度
テーブルは、各端末装置の予想される多数の伝送速度を
記憶するもので、これらの伝送速度がアドレスＮ −Ｎ
十ｎまで記憶さｎている。キャラクタ・モードには、
１桁を構成するビット数およびｉ４リテイの形式がある
。キャラクタ・モード−テーブルには、異なるビット数
とパリティの組合せからなる多数のキャラクタ・モード
がアドレスＭ −Ｍ 十ｍまで記憶されている。端末設
定テーブルは、後述する整合処理によって決定された伝
送形式を各端末装置ごとに記憶するものである。
第４゛図は、端末装置（２）の内部構成の一例を示して
いる。端末装置（２）もまたＣＰＵ＠ｌによって制御さ
れ、各種データを記憶するメモＩＪ ２１＋、ＣＲＴま
たはプリンタなどからなる表示装置（出力装置）（２２
１、キーボード（入力装置） （２３＋、および通信制
御装置（至）を備えている。通信制御装置（２４１は、
中央制御装置（１）とのシリアル・データ伝送を制御す
るものであって、伝送形式を設定するためのスイッチ（
ハ）、この設定さｎた形式で動作する伝送速度制御回路
（ハ）およびキャラクタ・モード制御器Ｊｌ、ならびに
これらの制御回路（２）（至）によって制御され、設定
された伝送形式でパラレル−シリアル変換およびシリア
ル−パラレル変換をそれぞれ行なう送、受信バッファ罰
■から構成さｎている。
いる。端末装置（２）もまたＣＰＵ＠ｌによって制御さ
れ、各種データを記憶するメモＩＪ ２１＋、ＣＲＴま
たはプリンタなどからなる表示装置（出力装置）（２２
１、キーボード（入力装置） （２３＋、および通信制
御装置（至）を備えている。通信制御装置（２４１は、
中央制御装置（１）とのシリアル・データ伝送を制御す
るものであって、伝送形式を設定するためのスイッチ（
ハ）、この設定さｎた形式で動作する伝送速度制御回路
（ハ）およびキャラクタ・モード制御器Ｊｌ、ならびに
これらの制御回路（２）（至）によって制御され、設定
された伝送形式でパラレル−シリアル変換およびシリア
ル−パラレル変換をそれぞれ行なう送、受信バッファ罰
■から構成さｎている。
第５図は、中央制御装置（１）のＣＰＵ［ｌｌによる伝
送形式整合処理の手順を示している。操作ボタンα２が
押されることによってこの処理が開始する。まず、メモ
リαＤの伝送速度テーブルのアドレスＮの伝送速度およ
びキャラクタ・モード・テーブルのアドレスＭのキャラ
クタ・モードを読出して、この伝送形式を伝送速度制御
回路αＳおよび操作レジスタαｅに設定する（ステップ
ｔ３１１ ）。そして、この伝送形式で、コードＡを整
合すべき端末装置（２）に云送するとともに、タイマｕ
３をスタートさせる（ステップ（至））。コードＡを送
信する電文形式は、たとえば送信すべき端末のアドレス
とコードＡとから構成される。
送形式整合処理の手順を示している。操作ボタンα２が
押されることによってこの処理が開始する。まず、メモ
リαＤの伝送速度テーブルのアドレスＮの伝送速度およ
びキャラクタ・モード・テーブルのアドレスＭのキャラ
クタ・モードを読出して、この伝送形式を伝送速度制御
回路αＳおよび操作レジスタαｅに設定する（ステップ
ｔ３１１ ）。そして、この伝送形式で、コードＡを整
合すべき端末装置（２）に云送するとともに、タイマｕ
３をスタートさせる（ステップ（至））。コードＡを送
信する電文形式は、たとえば送信すべき端末のアドレス
とコードＡとから構成される。
コードＡは、１桁以上のビット数で構成されている。後
に示すよろに、端末装Ｍ（２）は、コードＡを受信する
と、整合処理であることを知り、これに応答してコード
Ｂを含む電文を送出する。
に示すよろに、端末装Ｍ（２）は、コードＡを受信する
と、整合処理であることを知り、これに応答してコード
Ｂを含む電文を送出する。
この電文は、送信元の端末装置のアドレスとコードＢと
から構成されている。
から構成されている。
端末装置（２）からのコードＢを含む電文を正常に受信
すれば（ステップ国てＹＥＳ）、ステップＣ１１ｌで設
定した伝送形式が端末装置（２）に設定されている伝送
形式と一致しているのであるから、その伝送形式を、メ
モリαＤの端末設定テーブルの該当する端末装置の番号
に対応する場所に記憶しくステップ（至））、整合処理
を終る。必要ならば、終了電文を該当する端末装置（２
）に云送しておけば、その端末装置（２）は、伝送形式
の整合が終了したことを知ることができる。
すれば（ステップ国てＹＥＳ）、ステップＣ１１ｌで設
定した伝送形式が端末装置（２）に設定されている伝送
形式と一致しているのであるから、その伝送形式を、メ
モリαＤの端末設定テーブルの該当する端末装置の番号
に対応する場所に記憶しくステップ（至））、整合処理
を終る。必要ならば、終了電文を該当する端末装置（２
）に云送しておけば、その端末装置（２）は、伝送形式
の整合が終了したことを知ることができる。
ステップｌ３１）で設定した伝送形式が端末装置（２）
のそれと一致しない場合には、端末装置（２）はコード
Ａを含む電文を正常に受信できないから、タイマ（１３
１の設定時間が経過しても、コードＢを含む電文が送ら
れることはない（ステップ（３３）でＮｏ、ステップ（
至）でＹＥＳ）。この場合には、メモリ（１１）の伝送
速度テーブルおよびキャラクタ・モード・テーブルのす
べての組合せが終了したかどうかをチェックして（ステ
ップ（３６１）、終了してぃなけｎば、これらのテーブ
ルの内容を指定するアドレスを更新して（ステップ啼）
新たな伝送形式を選定しくステップｔ３１１）、同様の
処理を繰返えす。アドレスＮの伝送速度とアドレスＭの
キャラクタ・モードとの組合せの次は。
のそれと一致しない場合には、端末装置（２）はコード
Ａを含む電文を正常に受信できないから、タイマ（１３
１の設定時間が経過しても、コードＢを含む電文が送ら
れることはない（ステップ（３３）でＮｏ、ステップ（
至）でＹＥＳ）。この場合には、メモリ（１１）の伝送
速度テーブルおよびキャラクタ・モード・テーブルのす
べての組合せが終了したかどうかをチェックして（ステ
ップ（３６１）、終了してぃなけｎば、これらのテーブ
ルの内容を指定するアドレスを更新して（ステップ啼）
新たな伝送形式を選定しくステップｔ３１１）、同様の
処理を繰返えす。アドレスＮの伝送速度とアドレスＭの
キャラクタ・モードとの組合せの次は。
たとえばアドレスＮの伝送速度とアドレスＭ十１のキャ
ラクタ・モードとを組合せるという具合に、すべての伝
送形式の組合せによってステップ（３１）〜（至）の処
理を繰返えす。すべての伝送形式について整合処理をし
ても、いずれの伝送形式も一致しない場合には（ステッ
プ（至）でＹＥＳ）、該当する伝送形式がないのである
から異常表示をして処理を終える（ステップ（３［１１
）。
ラクタ・モードとを組合せるという具合に、すべての伝
送形式の組合せによってステップ（３１）〜（至）の処
理を繰返えす。すべての伝送形式について整合処理をし
ても、いずれの伝送形式も一致しない場合には（ステッ
プ（至）でＹＥＳ）、該当する伝送形式がないのである
から異常表示をして処理を終える（ステップ（３［１１
）。
第６図は、端末装置（２）の処理手順を示している。自
己の端末あての電文を受信すると（ステップ＋４１））
、その電文中にコードＡが含まれているかどうかを調べ
る（ステップ（４２１）。電文を正常に受信しない場合
および受信した電文中にコードＡが含まれていない場合
には、スタートに戻る。コードＡを含む電文を受信した
場合には、コードＢを含む電文を編集して、装置（１）
に送信しくステップ＋４３））、処理を終える。
己の端末あての電文を受信すると（ステップ＋４１））
、その電文中にコードＡが含まれているかどうかを調べ
る（ステップ（４２１）。電文を正常に受信しない場合
および受信した電文中にコードＡが含まれていない場合
には、スタートに戻る。コードＡを含む電文を受信した
場合には、コードＢを含む電文を編集して、装置（１）
に送信しくステップ＋４３））、処理を終える。
ステップ（財）で受信した電文の内容を表示装置＠によ
って出力すると、操作者はその電文中にコードＡが含ま
れているかどうかを知ることができる。そして、コード
Ａがあれば、操作者はキーボード＠によってコードＢを
人力する。すると、このコードＢを含む電文が送信され
る。
って出力すると、操作者はその電文中にコードＡが含ま
れているかどうかを知ることができる。そして、コード
Ａがあれば、操作者はキーボード＠によってコードＢを
人力する。すると、このコードＢを含む電文が送信され
る。
もちろん、メモリ（２１）内にコードＡおよびＢを記憶
しておき、ＣＰＵ（２０１によって受信電文中にコード
Ａがあるかどうかを検査し、コードＡがあれば、メモリ
ｆｆ１ｌ＋からコードＢを読出してコードＢを含む電文
を編集し、送信するようにすることもできる。
しておき、ＣＰＵ（２０１によって受信電文中にコード
Ａがあるかどうかを検査し、コードＡがあれば、メモリ
ｆｆ１ｌ＋からコードＢを読出してコードＢを含む電文
を編集し、送信するようにすることもできる。
接続すべき端末装置が複数ある場合には、その端末装置
に対応する通信制御装置−を用いて、上記の操作が各端
末装置ごとに行なわれるのは以上詳細に説明したように
、この発明によれば、中央処理装置がわにあらかじめ多
数の伝送形式を記憶しておき、これらの伝送形式を順次
設定して、その設定した伝送形式で端末装置との間の交
信を行ない、伝送形式が整合しているかどうかを調べて
いる。したがって、伝送形式の整合を自動的に行なうこ
とができ、専門的知識がなく゛てもきわめて簡単に端末
装置を接続し、かつ伝送形式を整合させることができる
。
に対応する通信制御装置−を用いて、上記の操作が各端
末装置ごとに行なわれるのは以上詳細に説明したように
、この発明によれば、中央処理装置がわにあらかじめ多
数の伝送形式を記憶しておき、これらの伝送形式を順次
設定して、その設定した伝送形式で端末装置との間の交
信を行ない、伝送形式が整合しているかどうかを調べて
いる。したがって、伝送形式の整合を自動的に行なうこ
とができ、専門的知識がなく゛てもきわめて簡単に端末
装置を接続し、かつ伝送形式を整合させることができる
。
第１図は、中央制御装置に複数の端末装置が接続されて
いる様子を示すブロック図、第２図は中央制御装置の内
部構成を示すブロック図、第３図はメモリの伝送形式テ
ーブルを示す図、第４図は端末装置の内部構成を示すブ
ロック図、第５図は、中央制御装置がゎの整合処理の手
順を示すフロー・チャート、第６図は端末装置がわの伝
送処理手順を示すフロー・チャートである０ （１）・・・中央制御装置、（２）・・一端末装置、（
１０１（イ）・・・ＣＰＵ、α１）・・・メモリ、０４
１ ｃｏ・・・通信制御装置。 以 上 外４名 第６図
いる様子を示すブロック図、第２図は中央制御装置の内
部構成を示すブロック図、第３図はメモリの伝送形式テ
ーブルを示す図、第４図は端末装置の内部構成を示すブ
ロック図、第５図は、中央制御装置がゎの整合処理の手
順を示すフロー・チャート、第６図は端末装置がわの伝
送処理手順を示すフロー・チャートである０ （１）・・・中央制御装置、（２）・・一端末装置、（
１０１（イ）・・・ＣＰＵ、α１）・・・メモリ、０４
１ ｃｏ・・・通信制御装置。 以 上 外４名 第６図
Claims (2)
- （１） シリアル伝送ラインで結ばれる中央処理装置
とその端末装置との間の伝送形式を自動的に整合させる
装置であって、中央処理装置がわに、複数の伝送形式を
あらかじめ記憶する記憶装置、端末装置との間のデータ
伝送を設定された伝送形式で制御する通信制御装置、お
よび記憶装置に記憶されている伝送形式を通信制御装置
に順次設定し、その伝送形式で端末装置に所定の電文を
送信させ、端末装置からの所定の電文を受信したときに
、通信制御装置に設定した伝送形式を整合した形式とす
る制御装置が備えられている、伝送形式自動整合装置。 - （２） 中央処理装置に複数の端末装置が接続されて
おり、中央処理装置がわに各端末装置ごとに通信制御装
置が設けられている、特許請求の範囲第（１）項記載の
伝送形式自動整合装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56110185A JPS5812460A (ja) | 1981-07-14 | 1981-07-14 | 伝送形式自動整合装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56110185A JPS5812460A (ja) | 1981-07-14 | 1981-07-14 | 伝送形式自動整合装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5812460A true JPS5812460A (ja) | 1983-01-24 |
| JPS6347178B2 JPS6347178B2 (ja) | 1988-09-20 |
Family
ID=14529193
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56110185A Granted JPS5812460A (ja) | 1981-07-14 | 1981-07-14 | 伝送形式自動整合装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5812460A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6184142A (ja) * | 1984-09-07 | 1986-04-28 | フィリップス コミュニカシオン ダントレプリズ | モノリシツクアナログインターフエース回路 |
| JPS639337A (ja) * | 1986-06-30 | 1988-01-16 | Pfu Ltd | シリアルインタフエ−スを用いるシステムの通信制御方式 |
| JPS6386697A (ja) * | 1986-09-30 | 1988-04-18 | Nec Corp | Ｃａｔｖ回線利用自動検針システム |
-
1981
- 1981-07-14 JP JP56110185A patent/JPS5812460A/ja active Granted
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6184142A (ja) * | 1984-09-07 | 1986-04-28 | フィリップス コミュニカシオン ダントレプリズ | モノリシツクアナログインターフエース回路 |
| JPS639337A (ja) * | 1986-06-30 | 1988-01-16 | Pfu Ltd | シリアルインタフエ−スを用いるシステムの通信制御方式 |
| JPS6386697A (ja) * | 1986-09-30 | 1988-04-18 | Nec Corp | Ｃａｔｖ回線利用自動検針システム |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6347178B2 (ja) | 1988-09-20 |
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