JPH1115551A - ネットワーク・インタフェース装置 - Google Patents
ネットワーク・インタフェース装置Info
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- JPH1115551A JPH1115551A JP9184397A JP18439797A JPH1115551A JP H1115551 A JPH1115551 A JP H1115551A JP 9184397 A JP9184397 A JP 9184397A JP 18439797 A JP18439797 A JP 18439797A JP H1115551 A JPH1115551 A JP H1115551A
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- clock frequency
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- 238000000034 method Methods 0.000 description 2
- 238000004891 communication Methods 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 239000000284 extract Substances 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
- 239000002699 waste material Substances 0.000 description 1
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/04—Generating or distributing clock signals or signals derived directly therefrom
- G06F1/08—Clock generators with changeable or programmable clock frequency
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- Accessory Devices And Overall Control Thereof (AREA)
Abstract
(57)【要約】
【目的】 電流容量が異なるＯＡ機器に対して共通に用
いることができるネットワーク・インタフェース装置を
提供する。 【構成】 プリンタ、複写機、ＦＡＸ、スキャナ等のＯ
Ａ機器と接続し、且つ電源供給を受けて、前記ＯＡ機器
にネットワーク・インタフェースを付与するネットワー
ク・インタフェース装置の構成として、ＯＡ機器からの
電源供給、ＯＡ機器とのデータの送受を行うインタフェ
ースの制御を行う拡張インタフェース制御部と、ＣＰ
Ｕ、ネットワーク・コントローラ、拡張インタフェース
制御部へのクロック周波数を可変に制御するクロック周
波数制御部と、を設ける。そして、拡張インタフェース
制御部において、ＯＡ機器からの供給可能な電流容量を
ＯＡ機器に問い合わせ、その電流容量以内にネットワー
ク・インタフェース装置の消費電流を抑えるべく、クロ
ック周波数制御部にてクロックの周波数を調整する。
いることができるネットワーク・インタフェース装置を
提供する。 【構成】 プリンタ、複写機、ＦＡＸ、スキャナ等のＯ
Ａ機器と接続し、且つ電源供給を受けて、前記ＯＡ機器
にネットワーク・インタフェースを付与するネットワー
ク・インタフェース装置の構成として、ＯＡ機器からの
電源供給、ＯＡ機器とのデータの送受を行うインタフェ
ースの制御を行う拡張インタフェース制御部と、ＣＰ
Ｕ、ネットワーク・コントローラ、拡張インタフェース
制御部へのクロック周波数を可変に制御するクロック周
波数制御部と、を設ける。そして、拡張インタフェース
制御部において、ＯＡ機器からの供給可能な電流容量を
ＯＡ機器に問い合わせ、その電流容量以内にネットワー
ク・インタフェース装置の消費電流を抑えるべく、クロ
ック周波数制御部にてクロックの周波数を調整する。
Description
【０００１】
【産業上の利用分野】本発明は、ネットワーク・インタ
フェース装置に関し、特に、プリンタ、複写機、ＦＡ
Ｘ、スキャナ等のＯＡ機器と接続し、且つ電源供給を受
けて、ＯＡ機器にネットワーク・インタフェースを付与
するネットワーク・インタフェース装置に関する。
フェース装置に関し、特に、プリンタ、複写機、ＦＡ
Ｘ、スキャナ等のＯＡ機器と接続し、且つ電源供給を受
けて、ＯＡ機器にネットワーク・インタフェースを付与
するネットワーク・インタフェース装置に関する。
【０００２】
【従来の技術】昨今のＬＡＮ等のネットワークの普及は
めざましいものがあり、パーソナル・コンピュータ、ワ
ークステーション等の複数のクライアントのデータ共有
のみならず、プリンタ、スキャナの入出力機器の共有等
も行われている。また、この傾向は、ＦＡＸ等の事務機
にも及び、そのデジタル化に伴って、プリンタ、スキャ
ナとしての入出力機能のネットワークを通しての活用が
行われている。
めざましいものがあり、パーソナル・コンピュータ、ワ
ークステーション等の複数のクライアントのデータ共有
のみならず、プリンタ、スキャナの入出力機器の共有等
も行われている。また、この傾向は、ＦＡＸ等の事務機
にも及び、そのデジタル化に伴って、プリンタ、スキャ
ナとしての入出力機能のネットワークを通しての活用が
行われている。
【０００３】この状況に伴って、プリンタ、複写機、Ｆ
ＡＸ、スキャナ等のＯＡ機器にＬＡＮ等のネットワーク
機能を付与するネットワーク・インタフェース装置が、
各社より販売されている。これらの中で、ＯＡ機器本体
に拡張インタフェースが備えられ、そのインタフェース
で接続されるネットワーク・インタフェース装置で、そ
のインタフェースを通して、ＯＡ機器本体から電源の供
給を受けるネットワーク・インタフェース装置が存在す
る。
ＡＸ、スキャナ等のＯＡ機器にＬＡＮ等のネットワーク
機能を付与するネットワーク・インタフェース装置が、
各社より販売されている。これらの中で、ＯＡ機器本体
に拡張インタフェースが備えられ、そのインタフェース
で接続されるネットワーク・インタフェース装置で、そ
のインタフェースを通して、ＯＡ機器本体から電源の供
給を受けるネットワーク・インタフェース装置が存在す
る。
【０００４】
【発明が解決しようとする課題】上述した、プリンタ、
複写機、ＦＡＸ、スキャナ等のＯＡ機器と拡張インタフ
ェースで接続し、且つ前記インタフェースを通して電源
供給を受けて、前記ＯＡ機器にＬＡＮ等のネットワーク
・インタフェースを付与するネットワーク・インタフェ
ース装置には、以下に述べるような問題があった。
複写機、ＦＡＸ、スキャナ等のＯＡ機器と拡張インタフ
ェースで接続し、且つ前記インタフェースを通して電源
供給を受けて、前記ＯＡ機器にＬＡＮ等のネットワーク
・インタフェースを付与するネットワーク・インタフェ
ース装置には、以下に述べるような問題があった。
【０００５】つまり、ネットワーク・インタフェース装
置と各種ＯＡ機器とは統一された拡張インタフェース仕
様が定められ、１種類のネットワーク・インタフェース
装置で各種ＯＡ機器に対応することが望ましい。しか
し、対応すべき各種ＯＡ機器自体の仕様は様々で、ネッ
トワーク・インタフェース装置に要求する処理能力や、
拡張インタフェースを通してネットワーク・インタフェ
ース装置に供給できる電流容量も様々である。
置と各種ＯＡ機器とは統一された拡張インタフェース仕
様が定められ、１種類のネットワーク・インタフェース
装置で各種ＯＡ機器に対応することが望ましい。しか
し、対応すべき各種ＯＡ機器自体の仕様は様々で、ネッ
トワーク・インタフェース装置に要求する処理能力や、
拡張インタフェースを通してネットワーク・インタフェ
ース装置に供給できる電流容量も様々である。
【０００６】例えば、小型低価格で、プリント速度４枚
／分の低速プリンタと、プリント速度４０枚／分の高速
複写機が同一の拡張インタフェースを備え、１種類のネ
ットワーク・インタフェース装置で、両機に対応すると
する。高速複写機は、そのプリント速度を活かすべく、
高速なネットワーク・インタフェースを要求し、一方、
低速プリンタは、そのプリント速度に見合ったネットワ
ーク・インタフェースであればよく、高速複写機が要す
るほどの高速な処理能力をネットワーク・インタフェー
ス装置に要求しない。また、供給可能な電流容量は、一
般に低速のＯＡ機器ほど、電源のスペースが制限され、
拡張インタフェースへまわせる電流は小さい。これに対
して、一般にネットワーク・インタフェース装置は、そ
の処理能力は高くなるほど、その消費電流も大きなもの
となる。
／分の低速プリンタと、プリント速度４０枚／分の高速
複写機が同一の拡張インタフェースを備え、１種類のネ
ットワーク・インタフェース装置で、両機に対応すると
する。高速複写機は、そのプリント速度を活かすべく、
高速なネットワーク・インタフェースを要求し、一方、
低速プリンタは、そのプリント速度に見合ったネットワ
ーク・インタフェースであればよく、高速複写機が要す
るほどの高速な処理能力をネットワーク・インタフェー
ス装置に要求しない。また、供給可能な電流容量は、一
般に低速のＯＡ機器ほど、電源のスペースが制限され、
拡張インタフェースへまわせる電流は小さい。これに対
して、一般にネットワーク・インタフェース装置は、そ
の処理能力は高くなるほど、その消費電流も大きなもの
となる。
【０００７】したがって、高速複写機に対応した処理能
力の高いネットワーク・インタフェース装置は、低速プ
リンタの供給可能な電流容量では不足するという事態が
おこり、速度を除いた機能が同一でありながら、２種類
のネットワーク・インタフェース装置を用意する必要が
あった。
力の高いネットワーク・インタフェース装置は、低速プ
リンタの供給可能な電流容量では不足するという事態が
おこり、速度を除いた機能が同一でありながら、２種類
のネットワーク・インタフェース装置を用意する必要が
あった。
【０００８】したがって、本発明の目的は、電流容量が
異なるＯＡ機器に対して共通に用いることができるネッ
トワーク・インタフェース装置を提供することにある。
異なるＯＡ機器に対して共通に用いることができるネッ
トワーク・インタフェース装置を提供することにある。
【０００９】
【課題を解決するための手段】本発明のネットワーク・
インタフェース装置は、プリンタ、複写機、ＦＡＸ、ス
キャナ等のＯＡ機器と接続し、且つ電源供給を受けて、
前記ＯＡ機器にネットワーク・インタフェースを付与す
るネットワーク・インタフェース装置において、前記Ｏ
Ａ機器からの電源供給、ＯＡ機器とのデータの送受を行
うインタフェースの制御を行う拡張インタフェース制御
部と、ＣＰＵ、ネットワーク・コントローラ、前記拡張
インタフェース制御部へのクロック周波数を可変に制御
するクロック周波数制御部とで構成される。
インタフェース装置は、プリンタ、複写機、ＦＡＸ、ス
キャナ等のＯＡ機器と接続し、且つ電源供給を受けて、
前記ＯＡ機器にネットワーク・インタフェースを付与す
るネットワーク・インタフェース装置において、前記Ｏ
Ａ機器からの電源供給、ＯＡ機器とのデータの送受を行
うインタフェースの制御を行う拡張インタフェース制御
部と、ＣＰＵ、ネットワーク・コントローラ、前記拡張
インタフェース制御部へのクロック周波数を可変に制御
するクロック周波数制御部とで構成される。
【００１０】前記拡張インタフェース制御部において、
前記ＯＡ機器からの供給可能な電流容量を前記ＯＡ機器
に問い合わせ、その電流容量以内にネットワーク・イン
タフェース装置の消費電流を抑えるべく、クロック周波
数制御部にてクロックの周波数を調整する。
前記ＯＡ機器からの供給可能な電流容量を前記ＯＡ機器
に問い合わせ、その電流容量以内にネットワーク・イン
タフェース装置の消費電流を抑えるべく、クロック周波
数制御部にてクロックの周波数を調整する。
【００１１】
【実施例】本発明の実施例として、統一された拡張イン
タフェースを備えたプリンタ、複写機に装着され、ＬＡ
Ｎインタフェースを備え、前記プリンタ、複写機にＬＡ
Ｎプリント機能を付与するプリントサーバボードを説明
する。ここでは、複写機においてＬＡＮプリント機能の
みの例を挙げるので、複写機もプリントサーバボードか
ら見たプリンタと表現する。
タフェースを備えたプリンタ、複写機に装着され、ＬＡ
Ｎインタフェースを備え、前記プリンタ、複写機にＬＡ
Ｎプリント機能を付与するプリントサーバボードを説明
する。ここでは、複写機においてＬＡＮプリント機能の
みの例を挙げるので、複写機もプリントサーバボードか
ら見たプリンタと表現する。
【００１２】第１図は本発明の実施例のプリントサーバ
ボードのブロック図であり、１はプリンタの供給可能な
電源電流容量に応じて、それに適した周波数のクロック
を後述するＣＰＵへ供給するクロック周波数制御部、２
は前記クロック周波数制御部へその元となる固定周波数
のクロックを供給する発振器、３はプリンタとの拡張イ
ンタフェースを制御する拡張インタフェース制御部、４
はプリンタの拡張インタフェーススロットの装着される
部分である拡張インタフェースコネクタ、５はプリント
サーバボード全体の制御を行うＣＰＵである。
ボードのブロック図であり、１はプリンタの供給可能な
電源電流容量に応じて、それに適した周波数のクロック
を後述するＣＰＵへ供給するクロック周波数制御部、２
は前記クロック周波数制御部へその元となる固定周波数
のクロックを供給する発振器、３はプリンタとの拡張イ
ンタフェースを制御する拡張インタフェース制御部、４
はプリンタの拡張インタフェーススロットの装着される
部分である拡張インタフェースコネクタ、５はプリント
サーバボード全体の制御を行うＣＰＵである。
【００１３】ＣＰＵ５は前記クロック周波数制御部から
入力されるクロックの周波数をＣＰＵ内部で４倍にし、
その４倍にしたクロックを出力する機能を備え、前記拡
張インタフェース制御部３と後述のＬＡＮコントローラ
に供給している。６はプリントサーバボードのブートプ
ログラムおよびボードの制御プログラムを格納したＲＯ
Ｍであり、７はＲＯＭ６からの制御プログラムが展開さ
れる、また、データ領域として使用されるＤＲＡＭであ
る。
入力されるクロックの周波数をＣＰＵ内部で４倍にし、
その４倍にしたクロックを出力する機能を備え、前記拡
張インタフェース制御部３と後述のＬＡＮコントローラ
に供給している。６はプリントサーバボードのブートプ
ログラムおよびボードの制御プログラムを格納したＲＯ
Ｍであり、７はＲＯＭ６からの制御プログラムが展開さ
れる、また、データ領域として使用されるＤＲＡＭであ
る。
【００１４】本実施例では、ＲＯＭ上でサーバボードが
ブートされ、ＲＯＭからＤＲＡＭに制御プログラムが転
送、展開され、より高速なＤＲＡＭ上で制御プログラム
の実行が行われる。８はＬＡＮの制御を行うＬＡＮコン
トローラであり、本実施例のサーバボードでは１００Ｍ
ｂｉｔ／ＳのＦａｓｔ Ｅｔｈｅｒｎｅｔのメディアア
クセスコントロール（ＭＡＣ）を行う。ＬＡＮコントロ
ーラ８にはＣＰＵ５からのクロック出力が入力される。
またコントローラ８はＣＰＵ５にバス制御権を要求し、
ＣＰＵの許可によって、バスマスタとなって、ＬＡＮか
らの受信データをＤＲＡＭ７にシステムバスを通して転
送する。９はＦａｓｔ Ｅｔｈｅｒｎｅｔの１００Ｂａ
ｓｅ−ＴＸの通信の物理レイヤを担当するトランシーバ
で一般にＰＨＹと呼ばれている。１０は絶縁用トランス
フォーマと耐コモン・モード・ノイズ用トランスフォー
マで構成されるフィルタ、１１は１００Ｂａｓｅ−ＴＸ
用のコネクタであるＲＪ４５コネクタ、１２はＬＡＮの
１００Ｂａｓｅ−ＴＸケーブルであり、１３はシステム
バスである。
ブートされ、ＲＯＭからＤＲＡＭに制御プログラムが転
送、展開され、より高速なＤＲＡＭ上で制御プログラム
の実行が行われる。８はＬＡＮの制御を行うＬＡＮコン
トローラであり、本実施例のサーバボードでは１００Ｍ
ｂｉｔ／ＳのＦａｓｔ Ｅｔｈｅｒｎｅｔのメディアア
クセスコントロール（ＭＡＣ）を行う。ＬＡＮコントロ
ーラ８にはＣＰＵ５からのクロック出力が入力される。
またコントローラ８はＣＰＵ５にバス制御権を要求し、
ＣＰＵの許可によって、バスマスタとなって、ＬＡＮか
らの受信データをＤＲＡＭ７にシステムバスを通して転
送する。９はＦａｓｔ Ｅｔｈｅｒｎｅｔの１００Ｂａ
ｓｅ−ＴＸの通信の物理レイヤを担当するトランシーバ
で一般にＰＨＹと呼ばれている。１０は絶縁用トランス
フォーマと耐コモン・モード・ノイズ用トランスフォー
マで構成されるフィルタ、１１は１００Ｂａｓｅ−ＴＸ
用のコネクタであるＲＪ４５コネクタ、１２はＬＡＮの
１００Ｂａｓｅ−ＴＸケーブルであり、１３はシステム
バスである。
【００１５】次に、プリントサーバボードとしてのＬＡ
Ｎからの受信データをプリンタ本体におくるパスを簡単
に説明する。ＬＡＮからのデータを受信したＬＡＮコン
トローラ８は、自分宛のデータパケットのうち、必要な
部分である、ソース・アドレス、ディスティネーション
・アドレス、パケット長、ＬＬＣ（リンク・レイヤ・コ
ントロール）データを取り出し、自分がバス・マスタと
なって、前記ＤＲＡＭ７にデータを格納し、ＣＰＵ５は
ＤＲＡＭ７上で、ＬＡＮコントローラから送られてきた
データのパケット処理を行う。拡張インタフェース制御
部３は、パケット処理されたデータを受け取り、拡張イ
ンタフェースコネクタ４を通して、プリンタ本体にプリ
ントデータを送る。このパスは市場に出ているプリント
・サーバでの基本的なものである。
Ｎからの受信データをプリンタ本体におくるパスを簡単
に説明する。ＬＡＮからのデータを受信したＬＡＮコン
トローラ８は、自分宛のデータパケットのうち、必要な
部分である、ソース・アドレス、ディスティネーション
・アドレス、パケット長、ＬＬＣ（リンク・レイヤ・コ
ントロール）データを取り出し、自分がバス・マスタと
なって、前記ＤＲＡＭ７にデータを格納し、ＣＰＵ５は
ＤＲＡＭ７上で、ＬＡＮコントローラから送られてきた
データのパケット処理を行う。拡張インタフェース制御
部３は、パケット処理されたデータを受け取り、拡張イ
ンタフェースコネクタ４を通して、プリンタ本体にプリ
ントデータを送る。このパスは市場に出ているプリント
・サーバでの基本的なものである。
【００１６】次に、第２図の本発明の実施例のクロック
周波数の設定を説明する表に基づいて、本発明の特徴で
ある動作を説明する。本実施例では、表に示すように３
種類のクロック周波数が設定可能である。つまＣＰＵ周
波数として最高の５０ＭＨｚ、最高周波数の２／３の３
３．３ＭＨｚ、最高周波数１／２の２５ＭＨｚであり、
ＣＰＵはこの動作周波数で動作し、ＬＡＮコントロー
ラ、拡張インタフェース制御部に同じ周波数のクロック
を供給している。この３種類のクロック制御を行ってい
るのは、前記クロック周波数制御部１であり、これはシ
ステム・バス１３に接続され、ＣＰＵの設定によって３
種類のクロックを出力し、ＣＰＵに供給している。
周波数の設定を説明する表に基づいて、本発明の特徴で
ある動作を説明する。本実施例では、表に示すように３
種類のクロック周波数が設定可能である。つまＣＰＵ周
波数として最高の５０ＭＨｚ、最高周波数の２／３の３
３．３ＭＨｚ、最高周波数１／２の２５ＭＨｚであり、
ＣＰＵはこの動作周波数で動作し、ＬＡＮコントロー
ラ、拡張インタフェース制御部に同じ周波数のクロック
を供給している。この３種類のクロック制御を行ってい
るのは、前記クロック周波数制御部１であり、これはシ
ステム・バス１３に接続され、ＣＰＵの設定によって３
種類のクロックを出力し、ＣＰＵに供給している。
【００１７】ＣＰＵは、このクロック周波数制御部から
のクロックの周波数をＣＰＵ内部で４倍にし、その周波
数で自身が動作し、同時にこれを出力している。よっ
て、クロック周波数制御部の出力クロック周波数は、最
高の１２．５ＭＨｚ、最高の２／３の８．３３ＭＨｚ、
最高の１／２の６．２５ＭＨｚとなっている。クロック
周波数制御部の動作はシステム・バスのデータの２ビッ
トの設定値（（１，０）、（０，１）、（０，０））で
図２に示すように制御される。なお、電源リセット時
は、最低周波数の６．２５ＭＨｚに設定される。ＣＰＵ
は、前記拡張インタフェース制御部３で、プリンタ本体
から、プリンタの供給可能な電源電流を問い合わせ、
１．１Ａの場合最高の１２．５ＭＨｚ、０．８Ａの場合
８．３３ＭＨｚ、０．６Ａの場合６．２５ＭＨｚにクロ
ック周波数制御部を設定する。この根拠を以下に述べ
る。
のクロックの周波数をＣＰＵ内部で４倍にし、その周波
数で自身が動作し、同時にこれを出力している。よっ
て、クロック周波数制御部の出力クロック周波数は、最
高の１２．５ＭＨｚ、最高の２／３の８．３３ＭＨｚ、
最高の１／２の６．２５ＭＨｚとなっている。クロック
周波数制御部の動作はシステム・バスのデータの２ビッ
トの設定値（（１，０）、（０，１）、（０，０））で
図２に示すように制御される。なお、電源リセット時
は、最低周波数の６．２５ＭＨｚに設定される。ＣＰＵ
は、前記拡張インタフェース制御部３で、プリンタ本体
から、プリンタの供給可能な電源電流を問い合わせ、
１．１Ａの場合最高の１２．５ＭＨｚ、０．８Ａの場合
８．３３ＭＨｚ、０．６Ａの場合６．２５ＭＨｚにクロ
ック周波数制御部を設定する。この根拠を以下に述べ
る。
【００１８】一般に、例えばプリント速度４０枚／秒程
度の高速複写機や高速プリンタはそのプリント速度を活
かすべく、高速なネットワーク・インタフェースを要求
し、一方、例えばプリント速度４枚／秒程度の低速プリ
ンタは、そのプリント速度に見合ったネットワーク・イ
ンタフェースであればよく、高速複写機が要するほどの
高速な処理能力をネットワーク・インタフェース装置に
要求しない。また、供給可能な電流容量は、一般に低速
のＯＡ機器ほど、電源のスペースが制限され、拡張イン
タフェースへまわせる電流は小さい。また、本プリント
サーバ装置は、クロックを下げて処理能力を下げるほ
ど、その消費電流が小さなものとなり、したがって、供
給電流の小さな低速ＯＡ機器ほどクロックを下げる設定
としているのである。
度の高速複写機や高速プリンタはそのプリント速度を活
かすべく、高速なネットワーク・インタフェースを要求
し、一方、例えばプリント速度４枚／秒程度の低速プリ
ンタは、そのプリント速度に見合ったネットワーク・イ
ンタフェースであればよく、高速複写機が要するほどの
高速な処理能力をネットワーク・インタフェース装置に
要求しない。また、供給可能な電流容量は、一般に低速
のＯＡ機器ほど、電源のスペースが制限され、拡張イン
タフェースへまわせる電流は小さい。また、本プリント
サーバ装置は、クロックを下げて処理能力を下げるほ
ど、その消費電流が小さなものとなり、したがって、供
給電流の小さな低速ＯＡ機器ほどクロックを下げる設定
としているのである。
【００１９】本実施例の対応プリンタの例として、４０
枚／秒で拡張インタフェースへの供給可能電流１．１Ａ
の高速プリンタ、１６枚／秒で拡張インタフェースへの
供給可能電流０．８Ａの中速プリンタ、４枚／秒で拡張
インタフェースへの供給可能電流０．６Ａの低速小型プ
リンタを想定する。そして、本実施例プリントサーバの
最大消費電流値は各周波数動作時で、それぞれ、１２．
５ＭＨｚ時１．０Ａ、８．３３ＭＨｚ時０．７Ａ、６．
２５ＭＨｚ時０．５Ａである。よって、高速プリンタに
は１２．５ＭＨｚ、中速プリンタには８．３３ＭＨｚ、
低速プリンタには６．２５ＭＨｚに設定される。
枚／秒で拡張インタフェースへの供給可能電流１．１Ａ
の高速プリンタ、１６枚／秒で拡張インタフェースへの
供給可能電流０．８Ａの中速プリンタ、４枚／秒で拡張
インタフェースへの供給可能電流０．６Ａの低速小型プ
リンタを想定する。そして、本実施例プリントサーバの
最大消費電流値は各周波数動作時で、それぞれ、１２．
５ＭＨｚ時１．０Ａ、８．３３ＭＨｚ時０．７Ａ、６．
２５ＭＨｚ時０．５Ａである。よって、高速プリンタに
は１２．５ＭＨｚ、中速プリンタには８．３３ＭＨｚ、
低速プリンタには６．２５ＭＨｚに設定される。
【００２０】このように、本実施例のプリントサーバ
は、電源供給能力の高い高速プリンタには高速の周波数
を設定して、高い処理能力を提供し、電源供給能力の低
い小型プリンタには、周波数を落とし、消費電流を抑
え、かつプリンタに見合った処理能力を提供する。
は、電源供給能力の高い高速プリンタには高速の周波数
を設定して、高い処理能力を提供し、電源供給能力の低
い小型プリンタには、周波数を落とし、消費電流を抑
え、かつプリンタに見合った処理能力を提供する。
【００２１】次に、第３図の本実施例のクロック周波数
の制御動作を説明するフロー図によって、クロック周波
数制御部への設定の説明を行う。本処理は電源リセット
時にのみ行われる。電源リセット時にはクロック周波数
制御部は、最も消費電流の低い、ハードウェアで６．２
５ＭＨｚに設定される。リセット後、Ｓ３，１におい
て、拡張インタフェースにて、プリンタ本体へ供給可能
な電源電流情報を問い合わせ、これを取得する。次にＳ
３，２において、取得した供給可能電流情報が０．８Ａ
かどうか判断し、ＹＥＳであれば、Ｓ３，３においてク
ロック周波数制御部の出力クロック周波数を８．３３Ｍ
Ｈｚに設定し、終了し、ＮＯであれば、Ｓ３，４におい
て取得した供給可能電流情報が１．１Ａかどうか判断
し、ＹＥＳであれば、Ｓ３，５においてクロック周波数
制御部の出力クロック周波数を１２．５ＭＨｚに設定
し、終了し、ＮＯであれば、そのまま終了する。
の制御動作を説明するフロー図によって、クロック周波
数制御部への設定の説明を行う。本処理は電源リセット
時にのみ行われる。電源リセット時にはクロック周波数
制御部は、最も消費電流の低い、ハードウェアで６．２
５ＭＨｚに設定される。リセット後、Ｓ３，１におい
て、拡張インタフェースにて、プリンタ本体へ供給可能
な電源電流情報を問い合わせ、これを取得する。次にＳ
３，２において、取得した供給可能電流情報が０．８Ａ
かどうか判断し、ＹＥＳであれば、Ｓ３，３においてク
ロック周波数制御部の出力クロック周波数を８．３３Ｍ
Ｈｚに設定し、終了し、ＮＯであれば、Ｓ３，４におい
て取得した供給可能電流情報が１．１Ａかどうか判断
し、ＹＥＳであれば、Ｓ３，５においてクロック周波数
制御部の出力クロック周波数を１２．５ＭＨｚに設定
し、終了し、ＮＯであれば、そのまま終了する。
【００２２】次にクロック周波数制御部の動作を説明す
る。第４図はクロック周波数制御部のブロック図であ
り、前記発振器１より５０ＭＨｚのクロックに入力し、
これを６分周して８．３３ＭＨｚのクロックを生成し、
５０ＭＨｚを４分周して、１２．５ＭＨｚのクロックを
生成し、さらに、これを２分周して６．２５ＭＨｚを生
成する。そして、この３つの周波数から、システム・バ
スを通してＣＰＵより設定されたデータ２ビットによっ
て１つの周波数を選択して、出力する。
る。第４図はクロック周波数制御部のブロック図であ
り、前記発振器１より５０ＭＨｚのクロックに入力し、
これを６分周して８．３３ＭＨｚのクロックを生成し、
５０ＭＨｚを４分周して、１２．５ＭＨｚのクロックを
生成し、さらに、これを２分周して６．２５ＭＨｚを生
成する。そして、この３つの周波数から、システム・バ
スを通してＣＰＵより設定されたデータ２ビットによっ
て１つの周波数を選択して、出力する。
【００２３】第５図はクロック周波数制御部の動作を説
明するタイミングチャートであり、元となる５０ＭＨｚ
の周波数のクロックに同期した、各３種類の周波数の波
形を図示している。
明するタイミングチャートであり、元となる５０ＭＨｚ
の周波数のクロックに同期した、各３種類の周波数の波
形を図示している。
【００２４】なお、本実施例は本発明をそれに限定する
ものではなく、例えば、プリントサーバとして、プリン
タにプリントデータを供給するものに限定せず、例えば
スキャナよりデータを取り込んで、逆にＬＡＮにデータ
を送出するものであってもよいし、両機能を兼ね備えた
ものであってもよい。また、１００Ｂａｓｅ−ＴＸのＦ
ａｓｔ Ｅｔｈｅｒｎｅｔに限らず、１０Ｂａｓｅ−Ｔ
や１０Ｂａｓｅ−２のＥｔｈｅｒｎｅｔあるいはＴｏｋ
ｅｎ Ｒｉｎｇ等どんなインタフェースのものであって
も構わない。また、ＬＡＮに限らず、ＩＳＤＮ等のＷＡ
Ｎ対応装置であっても構わない。また、プリンタ等のＯ
Ａ機器本体とのインタフェースが独自の拡張インタフェ
ースでなくとも、バイセントロニクスなどの汎用インタ
フェースでも構わず、また、プリンタ内部にスロットを
持つ内蔵タイプに限らず、ＯＡ機器本体の表面にあるコ
ネクタに直接装着されるプラグ型の装置であってもよい
し、ケーブルを介して接続されるものであってもよい。
ものではなく、例えば、プリントサーバとして、プリン
タにプリントデータを供給するものに限定せず、例えば
スキャナよりデータを取り込んで、逆にＬＡＮにデータ
を送出するものであってもよいし、両機能を兼ね備えた
ものであってもよい。また、１００Ｂａｓｅ−ＴＸのＦ
ａｓｔ Ｅｔｈｅｒｎｅｔに限らず、１０Ｂａｓｅ−Ｔ
や１０Ｂａｓｅ−２のＥｔｈｅｒｎｅｔあるいはＴｏｋ
ｅｎ Ｒｉｎｇ等どんなインタフェースのものであって
も構わない。また、ＬＡＮに限らず、ＩＳＤＮ等のＷＡ
Ｎ対応装置であっても構わない。また、プリンタ等のＯ
Ａ機器本体とのインタフェースが独自の拡張インタフェ
ースでなくとも、バイセントロニクスなどの汎用インタ
フェースでも構わず、また、プリンタ内部にスロットを
持つ内蔵タイプに限らず、ＯＡ機器本体の表面にあるコ
ネクタに直接装着されるプラグ型の装置であってもよい
し、ケーブルを介して接続されるものであってもよい。
【００２５】
【発明の効果】この様に本発明は、拡張インタフェース
制御部において、ＯＡ機器本体からの供給可能な電流容
量を前記ＯＡ機器に問い合わせ、その電流容量以内にネ
ットワーク・インタフェース装置の消費電流を抑えるべ
く、クロック周波数制御部にてクロックの周波数を制御
するので、例えばプリント速度４０枚／分の高速複写機
の様に、ネットワーク・インタフェース装置に高速性を
要求し、且つ、ネットワーク・インタフェース装置への
供給電流容量の高いＯＡ機器に対しては、クロック周波
数を高くして、処理能力を高くし、一方、小型低価格
で、プリント速度４枚／分の定速プリンタに対しては、
ネットワーク・インタフェース装置に要求される処理能
力を満たす範囲でクロック周波数を下げることによって
消費電流を下げることができる。
制御部において、ＯＡ機器本体からの供給可能な電流容
量を前記ＯＡ機器に問い合わせ、その電流容量以内にネ
ットワーク・インタフェース装置の消費電流を抑えるべ
く、クロック周波数制御部にてクロックの周波数を制御
するので、例えばプリント速度４０枚／分の高速複写機
の様に、ネットワーク・インタフェース装置に高速性を
要求し、且つ、ネットワーク・インタフェース装置への
供給電流容量の高いＯＡ機器に対しては、クロック周波
数を高くして、処理能力を高くし、一方、小型低価格
で、プリント速度４枚／分の定速プリンタに対しては、
ネットワーク・インタフェース装置に要求される処理能
力を満たす範囲でクロック周波数を下げることによって
消費電流を下げることができる。
【００２６】つまり、統一された拡張インタフェース仕
様を有する各種ＯＡ機器に対して、１種類のネットワー
ク・インタフェース装置で対応することができる。した
がって、速度以外の機能が同一で、消費電流と処理速度
が異なる複数のネットワーク・インタフェース装置を用
意する必要がなく、開発の無駄がなく、１種類の生産数
量も多くなり、コストの削減が可能となる。
様を有する各種ＯＡ機器に対して、１種類のネットワー
ク・インタフェース装置で対応することができる。した
がって、速度以外の機能が同一で、消費電流と処理速度
が異なる複数のネットワーク・インタフェース装置を用
意する必要がなく、開発の無駄がなく、１種類の生産数
量も多くなり、コストの削減が可能となる。
【図１】図１は、本発明の実施例のブロック図である。
【図２】図２は、本発明の実施例のクロック周波数の設
定を説明する表である。
定を説明する表である。
【図３】図３は、本発明の実施例のクロック周波数の制
御動作を説明するフロー図である。
御動作を説明するフロー図である。
【図４】図４は、クロック周波数制御部のブロック図で
ある。
ある。
【図５】図５は、クロック周波数制御部の動作を説明す
るタイミングチャートである。
るタイミングチャートである。
【符号の説明】 １ クロック周波数制御部 ２ 発信器 ３ 拡張インタフェース制御部 ４ 拡張インタフェース・コネクタ ５ ＣＰＵ ６ ＲＯＭ ７ ＤＲＡＭ ８ ＬＡＮコントローラ ９ ＰＨＹ １０ フィルタ １１ ＲＪ４５コネクタ １２ ＬＡＮ １３ システム・バス
Claims (2)
- 【請求項１】 ＯＡ機器と接続し、且つ電源供給を受け
て、前記ＯＡ機器にネットワーク・インタフェースを付
与するネットワーク・インタフェース装置において、 ＯＡ機器からの電源供給、前記ＯＡ機器とのデータの送
受を行うインタフェースの制御を行う拡張インタフェー
ス制御部と、 ＣＰＵ、ネットワーク・コントローラ、前記拡張インタ
フェース制御部へのクロック周波数を可変に制御するク
ロック周波数制御部とを有し、 前記拡張インタフェース制御部において、前記ＯＡ機器
からの供給可能な電流容量を前記ＯＡ機器に問い合わ
せ、その電流容量以内にネットワーク・インタフェース
装置の消費電流を抑えるべく、クロック周波数制御部に
てクロックの周波数を制御することを特徴とするネット
ワーク・インタフェース装置。 - 【請求項２】 請求項１記載のネット・ワークインタフ
ェース装置において、前記クロック周波数制御部は発振
器からのクロックを複数のクロック周波数に分周し、前
記拡張インタフェース制御部によって得たＯＡ機器の電
流容量に応じた制御信号によって所定のクロック周波数
を選択的に出力することを特徴とするネット・ワークイ
ンタフェース装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18439797A JP3472086B2 (ja) | 1997-06-25 | 1997-06-25 | ネットワーク・インタフェース装置およびネットワーク・インタフェース方法 |
| US09/100,400 US6304926B1 (en) | 1997-06-25 | 1998-06-19 | System for generating a selected clock frequency for a processing unit of an interface based upon the current capacity of an apparatus connected thereto |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18439797A JP3472086B2 (ja) | 1997-06-25 | 1997-06-25 | ネットワーク・インタフェース装置およびネットワーク・インタフェース方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1115551A true JPH1115551A (ja) | 1999-01-22 |
| JP3472086B2 JP3472086B2 (ja) | 2003-12-02 |
Family
ID=16152462
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18439797A Expired - Fee Related JP3472086B2 (ja) | 1997-06-25 | 1997-06-25 | ネットワーク・インタフェース装置およびネットワーク・インタフェース方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US6304926B1 (ja) |
| JP (1) | JP3472086B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002543513A (ja) * | 1999-04-30 | 2002-12-17 | インテル・コーポレーション | 低電力プロセッサの電力を動的に制御する方法および装置 |
| US8830505B2 (en) | 2010-06-03 | 2014-09-09 | Canon Kabushiki Kaisha | Apparatus that transmits job data to terminal, terminal device, control method, and storage medium |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000132355A (ja) * | 1998-10-28 | 2000-05-12 | Fujitsu Ltd | 情報処理装置及び情報処理方法並びにコンピュータ読み取り可能な記録媒体 |
| JP2007305062A (ja) * | 2006-05-15 | 2007-11-22 | Seiko Epson Corp | 電子制御装置、その制御方法及びそのプログラム |
| JP4775109B2 (ja) * | 2006-05-18 | 2011-09-21 | セイコーエプソン株式会社 | 印刷装置、その制御方法、そのプログラム及びネットワーク印刷システム |
| JP6394490B2 (ja) * | 2015-05-11 | 2018-09-26 | 京セラドキュメントソリューションズ株式会社 | 画像形成装置 |
| US10083381B2 (en) | 2016-09-30 | 2018-09-25 | Kyocera Document Solutions Inc. | Remote override of power saving mode |
| JP2020043513A (ja) * | 2018-09-12 | 2020-03-19 | ファナック株式会社 | 中継装置及び通信システム |
Family Cites Families (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5438165A (en) * | 1977-09-01 | 1979-03-22 | Seiko Instr & Electronics Ltd | Electronic watch |
| JPS635444A (ja) * | 1986-06-25 | 1988-01-11 | Hitachi Ltd | マイクロプロセツサ |
| US5133064A (en) * | 1987-04-27 | 1992-07-21 | Hitachi, Ltd. | Data processing system generating clock signal from an input clock, phase locked to the input clock and used for clocking logic devices |
| US5153535A (en) * | 1989-06-30 | 1992-10-06 | Poget Computer Corporation | Power supply and oscillator for a computer system providing automatic selection of supply voltage and frequency |
| CN1095164C (zh) * | 1994-06-07 | 2002-11-27 | 株式会社日立制作所 | 对多种运作模式进行选择后进行记录/再生的信息存储装置及其控制方法 |
| JP2793509B2 (ja) * | 1994-09-09 | 1998-09-03 | 佳能電産香港有限公司 | 印字装置付電子機器 |
| JPH08234865A (ja) * | 1995-02-24 | 1996-09-13 | Canon Inc | マイクロコンピュータを有する機器 |
| DE19522956C2 (de) * | 1995-06-23 | 1997-07-17 | Siemens Ag | Umrichter |
| IL117071A0 (en) * | 1996-02-07 | 1996-06-18 | Nice Systems Ltd | Facsimile long term storage and retrieval system |
| US5812004A (en) * | 1996-10-23 | 1998-09-22 | Dallas Semiconductor Corporation | Current compensated clock for a microcircuit |
| US5983353A (en) * | 1997-01-21 | 1999-11-09 | Dell Usa, L.P. | System and method for activating a deactivated device by standardized messaging in a network |
-
1997
- 1997-06-25 JP JP18439797A patent/JP3472086B2/ja not_active Expired - Fee Related
-
1998
- 1998-06-19 US US09/100,400 patent/US6304926B1/en not_active Expired - Lifetime
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002543513A (ja) * | 1999-04-30 | 2002-12-17 | インテル・コーポレーション | 低電力プロセッサの電力を動的に制御する方法および装置 |
| US8830505B2 (en) | 2010-06-03 | 2014-09-09 | Canon Kabushiki Kaisha | Apparatus that transmits job data to terminal, terminal device, control method, and storage medium |
Also Published As
| Publication number | Publication date |
|---|---|
| US6304926B1 (en) | 2001-10-16 |
| JP3472086B2 (ja) | 2003-12-02 |
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