JPH11145578A - 電子部品の実装構造、搭載用基板および電子部品の搭載方法 - Google Patents
電子部品の実装構造、搭載用基板および電子部品の搭載方法Info
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Abstract
(57)【要約】
【課題】 複数の電子部品の各々に所望の量の半田を供
給することができる電子部品の実装構造、搭載用基板お
よび電子部品の実装方法を提供する。 【解決手段】 プリント基板1と、このプリント基板
1の1つの主面に形成された複数の凹部21〜23と、
この複数の凹部21〜23の各々の底面に設けられた複
数のパッド41〜46と、この複数のパッド41〜46
の各々に設けられた半田91〜96と、それぞれが電極
を有し複数の凹部21〜23に対応して設けられ該電極
が対応する凹部のパッド41〜46と半田91〜96に
より接続された複数の電子部品とから構成する。
給することができる電子部品の実装構造、搭載用基板お
よび電子部品の実装方法を提供する。 【解決手段】 プリント基板1と、このプリント基板
1の1つの主面に形成された複数の凹部21〜23と、
この複数の凹部21〜23の各々の底面に設けられた複
数のパッド41〜46と、この複数のパッド41〜46
の各々に設けられた半田91〜96と、それぞれが電極
を有し複数の凹部21〜23に対応して設けられ該電極
が対応する凹部のパッド41〜46と半田91〜96に
より接続された複数の電子部品とから構成する。
Description
【0001】
【発明の属する技術分野】本発明は、電子部品の実装構
造、搭載用基板および電子部品の搭載方法に関し、特
に、スクリーン印刷により半田が塗布される電子部品の
実装構造、搭載用基板および電子部品の搭載方法に関す
る。
造、搭載用基板および電子部品の搭載方法に関し、特
に、スクリーン印刷により半田が塗布される電子部品の
実装構造、搭載用基板および電子部品の搭載方法に関す
る。
【0002】
【従来の技術】従来この種の電子部品の搭載方法では、
搭載用基板の平らな平面上にメタルマスクを置き、スク
リーン印刷により半田を供給している。搭載用基板上に
は半田量を多く必要とする電子部品と、半田量が少なく
て済む電子部品とが混在して搭載されるが、従来のスク
リーン印刷法では部品毎に所望量の半田を供給すること
ができないという問題があった。
搭載用基板の平らな平面上にメタルマスクを置き、スク
リーン印刷により半田を供給している。搭載用基板上に
は半田量を多く必要とする電子部品と、半田量が少なく
て済む電子部品とが混在して搭載されるが、従来のスク
リーン印刷法では部品毎に所望量の半田を供給すること
ができないという問題があった。
【0003】このような問題を解決するための電子部品
の搭載方法が特開昭62−181494号公報に開示さ
れている。該公報記載の搭載方法では、多量の半田を供
給する大きな窓および少量の半田を供給する小さな窓を
有する第1のマスクと、多量の半田を供給する大きな窓
を有する第2のマスクとを用意し、第1のマスクを用い
て搭載用基板上に半田を供給したのち、第2のマスクを
第1のマスクの上に重ねて搭載用基板上に半田を供給し
ている(以下、第1の従来技術という)。
の搭載方法が特開昭62−181494号公報に開示さ
れている。該公報記載の搭載方法では、多量の半田を供
給する大きな窓および少量の半田を供給する小さな窓を
有する第1のマスクと、多量の半田を供給する大きな窓
を有する第2のマスクとを用意し、第1のマスクを用い
て搭載用基板上に半田を供給したのち、第2のマスクを
第1のマスクの上に重ねて搭載用基板上に半田を供給し
ている(以下、第1の従来技術という)。
【0004】また、上記問題を解決するため、印刷用の
メタルマスクに複数の電子部品に対応して設けられた複
数の開口の径をそれぞれ調整することによって各電子部
品毎に半田量を異ならせて供給させる方法もある(以
下、第2の従来技術という)。
メタルマスクに複数の電子部品に対応して設けられた複
数の開口の径をそれぞれ調整することによって各電子部
品毎に半田量を異ならせて供給させる方法もある(以
下、第2の従来技術という)。
【0005】
【発明が解決しようとする課題】上述の第1の従来技術
では、各電子部品毎に必要な半田量に応じて複数のマス
クを用意しなければならないという問題がある。
では、各電子部品毎に必要な半田量に応じて複数のマス
クを用意しなければならないという問題がある。
【0006】また、上述の第2の従来技術では、メタル
マスクの厚さを一定にしなければならないため、いずれ
か一つの電子部品への半田供給に適した厚さにする必要
があり、この結果、各部品毎に適切な量の半田を供給す
ることができないという問題がある。
マスクの厚さを一定にしなければならないため、いずれ
か一つの電子部品への半田供給に適した厚さにする必要
があり、この結果、各部品毎に適切な量の半田を供給す
ることができないという問題がある。
【0007】さらに、従来の搭載用基板では基板の厚さ
が一定であるため、基板厚が大きくなってしまうとコネ
クタを設けることができなくなるという問題がある。
が一定であるため、基板厚が大きくなってしまうとコネ
クタを設けることができなくなるという問題がある。
【0008】本発明の目的は、複数の電子部品の各々に
応じて所望の量の半田を供給することができる電子部品
の実装構造、搭載用基板および電子部品の実装方法を提
供することにある。
応じて所望の量の半田を供給することができる電子部品
の実装構造、搭載用基板および電子部品の実装方法を提
供することにある。
【0009】また、本発明の他の目的は、搭載用基板の
側面に設けられるコネクタの選択の幅が狭まらない電子
部品の実装構造、搭載用基板および電子部品の実装方法
を提供することにある。
側面に設けられるコネクタの選択の幅が狭まらない電子
部品の実装構造、搭載用基板および電子部品の実装方法
を提供することにある。
【0010】
【課題を解決するための手段】上記課題を解決するため
に本発明の電子部品の実装構造は、搭載用基板と、この
搭載用基板の1つの主面に形成された凹部と、この凹部
の底面に設けられたパッドと、このパッドに設けられた
半田と、電極を有し該電極が前記半田により前記パッド
に接続された電子部品とを含む。
に本発明の電子部品の実装構造は、搭載用基板と、この
搭載用基板の1つの主面に形成された凹部と、この凹部
の底面に設けられたパッドと、このパッドに設けられた
半田と、電極を有し該電極が前記半田により前記パッド
に接続された電子部品とを含む。
【0011】また、本発明の他の電子部品の実装構造
は、搭載用基板と、この搭載用基板の1つの主面に形成
された複数の凹部と、この複数の凹部の各々の底面に設
けられた複数のパッドと、この複数のパッドの各々に設
けられた半田と、それぞれが電極を有し前記複数の凹部
に対応して設けられ、該電極が対応する前記凹部のパッ
ドと前記半田により接続された複数の電子部品とを含
む。
は、搭載用基板と、この搭載用基板の1つの主面に形成
された複数の凹部と、この複数の凹部の各々の底面に設
けられた複数のパッドと、この複数のパッドの各々に設
けられた半田と、それぞれが電極を有し前記複数の凹部
に対応して設けられ、該電極が対応する前記凹部のパッ
ドと前記半田により接続された複数の電子部品とを含
む。
【0012】さらに、本発明の他の電子部品の実装構造
は、前記複数の凹部の各々は対応する電子部品に応じた
大きさを有していることを特徴とする。
は、前記複数の凹部の各々は対応する電子部品に応じた
大きさを有していることを特徴とする。
【0013】また、本発明の他の電子部品の実装構造
は、前記複数の凹部の各々は対応する電子部品に応じた
深さを有していることを特徴とする。
は、前記複数の凹部の各々は対応する電子部品に応じた
深さを有していることを特徴とする。
【0014】さらに、本発明の他の電子部品の実装構造
は、前記複数の凹部の各々は対応する電子部品を搭載す
るために必要な半田量に応じた深さを有していることを
特徴とする。
は、前記複数の凹部の各々は対応する電子部品を搭載す
るために必要な半田量に応じた深さを有していることを
特徴とする。
【0015】また、本発明の他の電子部品の実装構造
は、前記複数のパッドの各々には対応する電子部品を搭
載するために必要な量の半田が供給されていることを特
徴とする。
は、前記複数のパッドの各々には対応する電子部品を搭
載するために必要な量の半田が供給されていることを特
徴とする。
【0016】さらに、本発明の他の電子部品の実装構造
は、搭載用基板と、この搭載用基板の縁に形成された凹
部と、この凹部の底面に設けられた第1のパッドと、前
記搭載用基板の下面の前記第1のパッドと対向する位置
に設けられた第2のパッドと、第1および第2の電極を
有し該第1および第2の電極がそれぞれ前記第1および
第2のパッドに接続された電子部品とを含む。
は、搭載用基板と、この搭載用基板の縁に形成された凹
部と、この凹部の底面に設けられた第1のパッドと、前
記搭載用基板の下面の前記第1のパッドと対向する位置
に設けられた第2のパッドと、第1および第2の電極を
有し該第1および第2の電極がそれぞれ前記第1および
第2のパッドに接続された電子部品とを含む。
【0017】本発明の搭載用基板は、少なくとも1つの
主面の部品搭載領域に設けられ、該部品に応じた大きさ
および深さを有する凹部を含む。
主面の部品搭載領域に設けられ、該部品に応じた大きさ
および深さを有する凹部を含む。
【0018】また、本発明の他の搭載用基板は、前記凹
部は該凹部に搭載される部品の接続に必要な半田量に応
じた深さを有していることを特徴とする。
部は該凹部に搭載される部品の接続に必要な半田量に応
じた深さを有していることを特徴とする。
【0019】さらに、本発明の他の搭載用基板は、前記
凹部が縁に接していることを特徴とする。
凹部が縁に接していることを特徴とする。
【0020】本発明の電子部品の搭載方法は、1つの主
面に形成された複数の凹部とこの複数の凹部の各々の底
面に設けられた複数のパッドとを有する搭載用基板に、
それぞれ電極を有する複数の電子部品を実装する電子部
品の実装方法において、前記複数のパッドに対応する位
置に複数の開口が形成されたメタルマスクを前記搭載用
基板の上に置く工程と、前記メタルマスクの前記複数の
開口を介して前記複数のパッドに半田を供給し該メタル
マスクを除去する工程と、前記複数の電子部品の各々を
それぞれの電極が対応する前記複数の凹部の前記パッド
に対向させて搭載する工程と、前記半田を溶融して前記
電子部品の前記電極と前記パッドとを接続する工程とを
含む。
面に形成された複数の凹部とこの複数の凹部の各々の底
面に設けられた複数のパッドとを有する搭載用基板に、
それぞれ電極を有する複数の電子部品を実装する電子部
品の実装方法において、前記複数のパッドに対応する位
置に複数の開口が形成されたメタルマスクを前記搭載用
基板の上に置く工程と、前記メタルマスクの前記複数の
開口を介して前記複数のパッドに半田を供給し該メタル
マスクを除去する工程と、前記複数の電子部品の各々を
それぞれの電極が対応する前記複数の凹部の前記パッド
に対向させて搭載する工程と、前記半田を溶融して前記
電子部品の前記電極と前記パッドとを接続する工程とを
含む。
【0021】
【発明の実施の形態】次に本発明の電子部品の実装構
造、搭載用基板および電子部品の搭載方法の実施の形態
について図面を参照して詳細に説明する。
造、搭載用基板および電子部品の搭載方法の実施の形態
について図面を参照して詳細に説明する。
【0022】図1を参照すると、本発明の電子部品の実
装構造および搭載用基板の搭載方法の第1の実施の形態
は、プリント基板1と、プリント基板1に設けられた凹
部21、22および23と、プリント基板1の周辺部に
設けられた凹部3とを含む。プリント基板1の主面に
は、複数のパッド41、42、43、44および45が
設けられている。プリント基板1は、例えば、ポリイミ
ド等のようなガラスエポキシ系樹脂からなる。プリント
基板1の厚さは2.5〜5ミリメートルであり、より好
ましくは、2.5ミリメートルである。
装構造および搭載用基板の搭載方法の第1の実施の形態
は、プリント基板1と、プリント基板1に設けられた凹
部21、22および23と、プリント基板1の周辺部に
設けられた凹部3とを含む。プリント基板1の主面に
は、複数のパッド41、42、43、44および45が
設けられている。プリント基板1は、例えば、ポリイミ
ド等のようなガラスエポキシ系樹脂からなる。プリント
基板1の厚さは2.5〜5ミリメートルであり、より好
ましくは、2.5ミリメートルである。
【0023】複数の凹部21、22および23の各々
は、プリント基板1に搭載される複数の電子部品の各々
の搭載位置に対応する位置に形成されている。複数の凹
部21、22および23の各々は、対応して搭載される
各電子部品に応じた大きさおよび深さを有している。よ
り詳細には、各凹部21、22および23の深さは各電
子部品を実装するために必要な半田量に応じて決められ
る。
は、プリント基板1に搭載される複数の電子部品の各々
の搭載位置に対応する位置に形成されている。複数の凹
部21、22および23の各々は、対応して搭載される
各電子部品に応じた大きさおよび深さを有している。よ
り詳細には、各凹部21、22および23の深さは各電
子部品を実装するために必要な半田量に応じて決められ
る。
【0024】複数の電子部品としては、例えば、チップ
部品5、Small Outline Package
(SOP)6、Ball Grid Array(BG
A)7および表面実装型Pin Grid Array
(PGA)8がある。
部品5、Small Outline Package
(SOP)6、Ball Grid Array(BG
A)7および表面実装型Pin Grid Array
(PGA)8がある。
【0025】チップ部品5は、チップコンデンサやチッ
プ抵抗であり、凹部に設けられない。チップ部品5の搭
載領域には複数のパッド41が設けられている。複数の
パッド41の各々は長方形状の形状を呈している。各パ
ッド41のピッチは0.4〜0.635ミリメートルで
ある。複数のパッド41の各々は、チップ部品5の各電
極と半田91によって接続される。半田91は複数のパ
ッド41とチップ部品5とを接続するのに適した量とな
っている。
プ抵抗であり、凹部に設けられない。チップ部品5の搭
載領域には複数のパッド41が設けられている。複数の
パッド41の各々は長方形状の形状を呈している。各パ
ッド41のピッチは0.4〜0.635ミリメートルで
ある。複数のパッド41の各々は、チップ部品5の各電
極と半田91によって接続される。半田91は複数のパ
ッド41とチップ部品5とを接続するのに適した量とな
っている。
【0026】SOP6は、凹部21に設けられている。
凹部21のプリント基板1の主面からの深さは、50〜
100ミクロンである。凹部21の底面には複数のパッ
ド42が設けられている。複数のパッド42の各々は長
方形状の形状を呈している。各パッド41のピッチは
0.4〜0.635ミリメートルである。複数のパッド
42の各々は、SOP6の各電極と半田92によって接
続される。半田92は複数のパッド42とSOP6とを
接続するのに適した量となっている。
凹部21のプリント基板1の主面からの深さは、50〜
100ミクロンである。凹部21の底面には複数のパッ
ド42が設けられている。複数のパッド42の各々は長
方形状の形状を呈している。各パッド41のピッチは
0.4〜0.635ミリメートルである。複数のパッド
42の各々は、SOP6の各電極と半田92によって接
続される。半田92は複数のパッド42とSOP6とを
接続するのに適した量となっている。
【0027】BGA7は、凹部22に設けられている。
凹部22のプリント基板1の主面からの深さは、100
〜150ミクロンである。凹部22の底面には複数のパ
ッド43が設けられている。複数のパッド43の各々
は、円形または円形と類似の形状を呈し、円またはパッ
ドを内包する円の直径は0.6〜0.7ミリメートルで
ある。各パッド43のピッチは約1.25ミリメートル
である。複数のパッド43の各々は、BGA7の各電極
と半田93によって接続される。半田93は複数のパッ
ド43とBGA7とを接続するのに適した量となってい
る。
凹部22のプリント基板1の主面からの深さは、100
〜150ミクロンである。凹部22の底面には複数のパ
ッド43が設けられている。複数のパッド43の各々
は、円形または円形と類似の形状を呈し、円またはパッ
ドを内包する円の直径は0.6〜0.7ミリメートルで
ある。各パッド43のピッチは約1.25ミリメートル
である。複数のパッド43の各々は、BGA7の各電極
と半田93によって接続される。半田93は複数のパッ
ド43とBGA7とを接続するのに適した量となってい
る。
【0028】表面実装型PGA8は、凹部23に設けら
れている。凹部23のプリント基板1の主面からの深さ
は、150〜250ミクロンである。凹部23の底部に
は複数のパッド44が設けられている。複数のパッド4
4の各々は、円形または円形と類似の形状を呈し、円ま
たはパッドを内包する円の直径は0.6〜0.7ミリメ
ートルである。各パッド44のピッチは約1.25ミリ
メートルである。複数のパッド44の各々は、表面実装
型PGA8の各電極と半田94によって接続される。半
田94は複数のパッド44と表面実装型PGA8とを接
続するのに適した量となっている。
れている。凹部23のプリント基板1の主面からの深さ
は、150〜250ミクロンである。凹部23の底部に
は複数のパッド44が設けられている。複数のパッド4
4の各々は、円形または円形と類似の形状を呈し、円ま
たはパッドを内包する円の直径は0.6〜0.7ミリメ
ートルである。各パッド44のピッチは約1.25ミリ
メートルである。複数のパッド44の各々は、表面実装
型PGA8の各電極と半田94によって接続される。半
田94は複数のパッド44と表面実装型PGA8とを接
続するのに適した量となっている。
【0029】凹部3は、プリント基板1の周辺部のコネ
クタ搭載領域に形成されている。凹部3のプリント基板
1の主面からの深さは、凹部3が形成されている領域の
プリント基板1の厚さが1.6〜2.2ミリメートルと
なるように調整される。凹部3には複数のパッド45が
設けられている。プリント基板1の下面に複数のパッド
46が設けられている。複数のパッド46の各々は複数
のパッド45の各々と対応する位置に設けられている。
クタ搭載領域に形成されている。凹部3のプリント基板
1の主面からの深さは、凹部3が形成されている領域の
プリント基板1の厚さが1.6〜2.2ミリメートルと
なるように調整される。凹部3には複数のパッド45が
設けられている。プリント基板1の下面に複数のパッド
46が設けられている。複数のパッド46の各々は複数
のパッド45の各々と対応する位置に設けられている。
【0030】プリント基板1の側面にコネクタ10が設
けられている。コネクタ10には2つのリード列10−
1および10−2が設けられており、凹部3が形成され
た部分を挟み込んでいる。リード列10−1は複数のパ
ッド45と半田95により接続され、リード列10−2
は複数のパッド46と半田96により接続されている。
けられている。コネクタ10には2つのリード列10−
1および10−2が設けられており、凹部3が形成され
た部分を挟み込んでいる。リード列10−1は複数のパ
ッド45と半田95により接続され、リード列10−2
は複数のパッド46と半田96により接続されている。
【0031】このように、本実施の形態では、プリント
基板1に複数の電子部品5、6、7および8の各々に対
応した凹部21、22および23を設けたため、複数の
電子部品の各々に応じて所望量の半田が供給され、この
結果、各電子部品と複数のパッドとの接続の信頼性を向
上させることができる。
基板1に複数の電子部品5、6、7および8の各々に対
応した凹部21、22および23を設けたため、複数の
電子部品の各々に応じて所望量の半田が供給され、この
結果、各電子部品と複数のパッドとの接続の信頼性を向
上させることができる。
【0032】次に、本発明の電子部品の実装方法につい
て図面を参照して詳細に説明する。
て図面を参照して詳細に説明する。
【0033】プリント基板1のコネクタ搭載領域に設け
られたパッド45および46には半田95および96が
供給されている。半田は、ディスペンスによる方法、ま
たは、局部的に印刷ができるような部分メタルマスクを
用いて印刷する方法により供給される。
られたパッド45および46には半田95および96が
供給されている。半田は、ディスペンスによる方法、ま
たは、局部的に印刷ができるような部分メタルマスクを
用いて印刷する方法により供給される。
【0034】図2を参照すると、プリント基板1上に半
田印刷用のメタルマスク11が置かれる。メタルマスク
11の厚さは、プリント基板1に設けられた凹部21、
22および23に応じて部分毎に変えられている。具体
的には、メタルマスクの厚さはそれぞれ、チップ部品2
の搭載領域では約50〜150マイクロメートル、SO
Pの搭載領域では約100〜150マイクロメートル、
BGAの搭載領域では約150〜200マイクロメート
ル、表面実装型PGAの搭載領域では約200〜300
マイクロメートルである。メタルマスク11には複数の
開口12が設けられている。
田印刷用のメタルマスク11が置かれる。メタルマスク
11の厚さは、プリント基板1に設けられた凹部21、
22および23に応じて部分毎に変えられている。具体
的には、メタルマスクの厚さはそれぞれ、チップ部品2
の搭載領域では約50〜150マイクロメートル、SO
Pの搭載領域では約100〜150マイクロメートル、
BGAの搭載領域では約150〜200マイクロメート
ル、表面実装型PGAの搭載領域では約200〜300
マイクロメートルである。メタルマスク11には複数の
開口12が設けられている。
【0035】図3を参照すると、複数のパッド41、4
2、43および44が設けられたプリント基板1上に半
田が印刷される。ソルダーペーストがメタルマスク11
上に供給されスキージにより移動される。これにより、
半田がメタルマスク11の開口12に充填され、プリン
ト基板1上に塗布される。複数のパッド41、42、4
3および44の各々には所望量の半田が供給される。供
給された半田の高さは、メタルマスク11の厚さとプリ
ント基板1の凹部21、22および23とにより、全て
のパッド41、42、43および44において同一かま
たは類似の高さに形成されている。メタルマスク11は
半田印刷後に除去される。
2、43および44が設けられたプリント基板1上に半
田が印刷される。ソルダーペーストがメタルマスク11
上に供給されスキージにより移動される。これにより、
半田がメタルマスク11の開口12に充填され、プリン
ト基板1上に塗布される。複数のパッド41、42、4
3および44の各々には所望量の半田が供給される。供
給された半田の高さは、メタルマスク11の厚さとプリ
ント基板1の凹部21、22および23とにより、全て
のパッド41、42、43および44において同一かま
たは類似の高さに形成されている。メタルマスク11は
半田印刷後に除去される。
【0036】図4を参照すると、プリント基板1の複数
のパッド41、42、43および44に電子部品が装着
される。チップ部品5、SOP6、BGA7および表面
実装型PGA8が自動装着機(マウンタ)により装着さ
れる。Quad FlatPackage(QFP)や
Plastic Leaded Chip Carri
er(PLCC)等のような電子部品も装着することが
できる。
のパッド41、42、43および44に電子部品が装着
される。チップ部品5、SOP6、BGA7および表面
実装型PGA8が自動装着機(マウンタ)により装着さ
れる。Quad FlatPackage(QFP)や
Plastic Leaded Chip Carri
er(PLCC)等のような電子部品も装着することが
できる。
【0037】コネクタ6は、手動または治具により装着
される。
される。
【0038】図1を参照すると、各電子部品5、6、7
および8がリフローにより半田付けされる。リフロー方
式は、Vapour Phase Soldering
(VPS)方式が用いられる。VPS方式は被加熱物の
形状や大きさに関係なく、全体が均一に加熱されるた
め、半田付けが良好となる。特に、各パッド7にはそれ
ぞれ所望量の半田が設けられるため、半田のフィレット
形状がよく、品質が良好となる。
および8がリフローにより半田付けされる。リフロー方
式は、Vapour Phase Soldering
(VPS)方式が用いられる。VPS方式は被加熱物の
形状や大きさに関係なく、全体が均一に加熱されるた
め、半田付けが良好となる。特に、各パッド7にはそれ
ぞれ所望量の半田が設けられるため、半田のフィレット
形状がよく、品質が良好となる。
【0039】このように、本実施の形態では、プリント
基板1に複数の電子部品5、6、7および8の各々に対
応した凹部21、22および23を設けるとともに、半
田印刷に用いられるメタルマスク11の厚さを各電子部
品5、6、7および8の搭載領域に応じて異ならせたた
め、複数の電子部品の各々に対応する各パッドに所望の
量の半田を供給することができる。
基板1に複数の電子部品5、6、7および8の各々に対
応した凹部21、22および23を設けるとともに、半
田印刷に用いられるメタルマスク11の厚さを各電子部
品5、6、7および8の搭載領域に応じて異ならせたた
め、複数の電子部品の各々に対応する各パッドに所望の
量の半田を供給することができる。
【0040】本実施の形態では、プリント基板1の一方
の主面に凹部3を設けるようにしたが、プリント基板1
の両主面にそれぞれ凹部を設けるようにしてもよい。こ
のとき、凹部が形成されたプリント基板1の厚さは1.
6〜2.2ミリメートルになるように調整される。各凹
部には複数のパッドが設けられ、コネクタのリード列と
接続される。
の主面に凹部3を設けるようにしたが、プリント基板1
の両主面にそれぞれ凹部を設けるようにしてもよい。こ
のとき、凹部が形成されたプリント基板1の厚さは1.
6〜2.2ミリメートルになるように調整される。各凹
部には複数のパッドが設けられ、コネクタのリード列と
接続される。
【0041】また、本実施の形態では、パッド45およ
び46にそれぞれ半田95および96を供給したのち
に、メタルマスク11を用いた半田印刷を行うようにし
たが、メタルマスク11を用いた半田印刷後にパッド4
5および46への半田供給を行うようにしてもよい。
び46にそれぞれ半田95および96を供給したのち
に、メタルマスク11を用いた半田印刷を行うようにし
たが、メタルマスク11を用いた半田印刷後にパッド4
5および46への半田供給を行うようにしてもよい。
【0042】さらに、本実施の形態において、メタルマ
スク11の厚さだけでなく開口12の径をも電子部品の
接続に必要な半田量に応じて調整するようにしてもよ
い。
スク11の厚さだけでなく開口12の径をも電子部品の
接続に必要な半田量に応じて調整するようにしてもよ
い。
【0043】
【発明の効果】以上の説明で明らかなように、本発明で
は、搭載用基板に複数の電子部品の各々に対応した複数
の凹部を設けるとともに、半田印刷に用いられるメタル
マスクの厚さを各電子部品の搭載領域に応じて異ならせ
たため、複数の電子部品の各々に対応する各パッドに所
望の量の半田を供給することができる。
は、搭載用基板に複数の電子部品の各々に対応した複数
の凹部を設けるとともに、半田印刷に用いられるメタル
マスクの厚さを各電子部品の搭載領域に応じて異ならせ
たため、複数の電子部品の各々に対応する各パッドに所
望の量の半田を供給することができる。
【図1】本発明の第1の実施の形態の断面図である。
【図2】本発明の第1の実施の形態の実装方法を示す断
面図である。
面図である。
【図3】本発明の第1の実施の形態の実装方法を示す断
面図である。
面図である。
【図4】本発明の第1の実施の形態の実装方法を示す断
面図である。
面図である。
1 プリント配線板 21、22、23 凹部 3 凹部 41、42、43、44、45、46 半田 5 チップ部品 6 SOP 7 BGA 8 表面実装型PGA 91、92、93、94、95、96 半田 10 コネクタ
Claims (11)
- 【請求項1】 搭載用基板と、 この搭載用基板の1つの主面に形成された凹部と、 この凹部の底面に設けられたパッドと、 このパッドに設けられた半田と、 電極を有し該電極が前記半田により前記パッドに接続さ
れた電子部品とを含むことを特徴とする電子部品の実装
構造。 - 【請求項2】 搭載用基板と、 この搭載用基板の1つの主面に形成された複数の凹部
と、 この複数の凹部の各々の底面に設けられた複数のパッド
と、 この複数のパッドの各々に設けられた半田と、 それぞれが電極を有し前記複数の凹部に対応して設けら
れ、該電極が対応する前記凹部のパッドと前記半田によ
り接続された複数の電子部品とを含むことを特徴とする
電子部品の実装構造。 - 【請求項3】 前記複数の凹部の各々は対応する電子部
品に応じた大きさを有していることを特徴とする請求項
2記載の電子部品の実装構造。 - 【請求項4】 前記複数の凹部の各々は対応する電子部
品に応じた深さを有していることを特徴とする請求項2
記載の電子部品の実装構造。 - 【請求項5】 前記複数の凹部の各々は対応する電子部
品を搭載するために必要な半田量に応じた深さを有して
いることを特徴とする請求項2記載の電子部品の実装構
造。 - 【請求項6】 前記複数のパッドの各々には対応する電
子部品を搭載するために必要な量の半田が供給されてい
ることを特徴とする請求項2記載の電子部品の実装構
造。 - 【請求項7】 搭載用基板と、 この搭載用基板の縁に形成された凹部と、 この凹部の底面に設けられた第1のパッドと、 前記搭載用基板の下面の前記第1のパッドと対向する位
置に設けられた第2のパッドと、 第1および第2の電極を有し該第1および第2の電極が
それぞれ前記第1および第2のパッドに接続された電子
部品とを含むことを特徴とする電子部品の実装構造。 - 【請求項8】 少なくとも1つの主面の部品搭載領域に
設けられ、該部品に応じた大きさおよび深さを有する凹
部を含むことを特徴とする搭載用基板。 - 【請求項9】 前記凹部は該凹部に搭載される部品の接
続に必要な半田量に応じた深さを有していることを特徴
とする請求項8記載の搭載用基板。 - 【請求項10】 前記凹部が縁に接していることを特徴
とする請求項8記載の搭載用基板。 - 【請求項11】 1つの主面に形成された複数の凹部と
この複数の凹部の各々の底面に設けられた複数のパッド
とを有する搭載用基板に、それぞれ電極を有する複数の
電子部品を実装する電子部品の実装方法において、 前記複数のパッドに対応する位置に複数の開口が形成さ
れたメタルマスクを前記搭載用基板の上に置く工程と、 前記メタルマスクの前記複数の開口を介して前記複数の
パッドに半田を供給し該メタルマスクを除去する工程
と、 前記複数の電子部品の各々をそれぞれの電極が対応する
前記複数の凹部の前記パッドに対向させて搭載する工程
と、 前記半田を溶融して前記電子部品の前記電極と前記パッ
ドとを接続する工程とを含むことを特徴とする電子部品
の実装方法。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9303061A JP3063709B2 (ja) | 1997-11-05 | 1997-11-05 | 電子部品の実装構造、搭載用基板および電子部品の搭載方法 |
DE69833401T DE69833401T2 (de) | 1997-11-05 | 1998-11-04 | Oberflächenmontierte Anordnung von elektronischen Bauteilen |
EP98120662A EP0915641B1 (en) | 1997-11-05 | 1998-11-04 | Surface mount assembly for electronic components |
CA002252866A CA2252866C (en) | 1997-11-05 | 1998-11-05 | Surface mount assembly for electronic components |
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
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Publication Number | Publication Date |
---|---|
JPH11145578A true JPH11145578A (ja) | 1999-05-28 |
JP3063709B2 JP3063709B2 (ja) | 2000-07-12 |
Family
ID=17916442
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP9303061A Expired - Fee Related JP3063709B2 (ja) | 1997-11-05 | 1997-11-05 | 電子部品の実装構造、搭載用基板および電子部品の搭載方法 |
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Country | Link |
---|---|
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EP (1) | EP0915641B1 (ja) |
JP (1) | JP3063709B2 (ja) |
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DE (1) | DE69833401T2 (ja) |
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---|---|---|---|---|
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JP3822040B2 (ja) * | 2000-08-31 | 2006-09-13 | 株式会社ルネサステクノロジ | 電子装置及びその製造方法 |
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JPS5877074A (ja) | 1981-10-30 | 1983-05-10 | テ−プセ−バ−・インコ−ポレ−テツド | 磁気テ−プカセツト用保護部材 |
JPS59182545A (ja) | 1983-03-31 | 1984-10-17 | Nec Home Electronics Ltd | 混成集積回路 |
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- 1997-11-05 JP JP9303061A patent/JP3063709B2/ja not_active Expired - Fee Related
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1998
- 1998-11-04 EP EP98120662A patent/EP0915641B1/en not_active Expired - Lifetime
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