JPH11102646A - プラズマ表示パネル及びその駆動方法 - Google Patents

プラズマ表示パネル及びその駆動方法

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JPH11102646A JP10105076A JP10507698A JPH11102646A JP H11102646 A JPH11102646 A JP H11102646A JP 10105076 A JP10105076 A JP 10105076A JP 10507698 A JP10507698 A JP 10507698A JP H11102646 A JPH11102646 A JP H11102646A
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Abstract

(57)【要約】 【課題】 従来の方式より輝度を増加させ、水平走査線
数が増加しても輝度の減少が無いようにする３電極構造
ＡＣ型プラズマ表示パネルの電極結線構造及び電圧印加
方法を改善したプラズマ表示パネル及びその駆動方法を
提供する。 【解決手段】 既知の３電極構造ＡＣ型プラズマ表示パ
ネルに対して、放電維持パルスと放電維持パルスの間に
複数個のデータパルスよりなるアドレスタイムスロット
を設定し、二つの電極よりなる水平電極対をこのアドレ
スタイムスロットの個数と同じ個数の電極対を一群とす
る複数個の群に分けて、この水平電極対の中で一つの電
極は各々の群毎に共通に結線し、他方の電極は各々独立
的に結線したプラズマ表示パネル構造において、個々の
群内のアドレスタイムスロットは順次走査し、この群を
アドレッシング及び持続同時駆動方式に適用する。

Description

【発明の詳細な説明】
【０００１】
【発明が属する技術分野】本発明はＡＣ型面放電構造の
プラズマ表示パネル及びその駆動方法に係り、詳細には
電極結線構造による面放電構造プラズマ表示パネル及び
その階調表示のための駆動方法に関する。
【０００２】
【従来の技術】プラズマ表示パネルは複数個の放電管を
マトリックス形状に配列してこれを選択的に発光させる
ことによって、電気信号で入力された画像データを復元
させる表示素子の一つである。このプラズマ表示パネル
の駆動方式は、放電を維持させるために印加するパルス
電圧の極性が時間によって変化するか否かによりＤＣ駆
動方式とＡＣ駆動方式とに大別される。
【０００３】図２８はＤＣ型対向放電構造プラズマ表示
パネルの断面図で、図２９及び図３０は各々ＡＣ型面放
電構造プラズマ表示パネルの断面図及び分解斜視図であ
る。
【０００４】図示したように、ＤＣ型対向放電構造プラ
ズマ表示パネルでもＡＣ型面放電構造プラズマ表示パネ
ルでも、上板ガラス１、７と下板ガラス４、１２の中に
放電空間を形成するようになることは同一である。ただ
し、ＤＣ型プラズマ表示パネルは走査電極２とアドレス
電極５が直接放電空間３に露出されていて、二つの電極
中、陰極から供給される電子の流れが放電を維持させる
主なエネルギー源になる反面、ＡＣ型プラズマ表示パネ
ルは放電を維持させる走査電極６ａと共通電極６ｂが誘
電層８の内において電気的に放電空間１０と隔離される
相違点がある。
【０００５】ＡＣ型プラズマ表示パネルの場合、放電は
よく知られた壁電荷効果により維持される。即ち、放電
開始電圧は壁電圧と印加電圧の和になるので、壁電荷が
存在する所だけ放電が起こる。この放電は再び壁電荷を
蓄積させるので、一度放電が起こった所では反復されて
放電が維持される。
【０００６】また、放電を発生させる電極の構成方法に
より対向放電構造と面放電構造の二種に分類される。即
ち、対向放電構造は図２８に示したように放電を発生さ
せる電極がお互い他の平面、即ち対向面に各々配置され
た構造であり、面放電構造は放電を発生させる電極が図
２９に示したように同一平面上に配置された構造であ
る。そして、各構造は放電現象を容易に具現するために
設置される電極の数によって２電極構造、３電極構造等
に分かれる。
【０００７】図３０は既に常用化されたプラズマ表示パ
ネルの３電極面放電構造を示したもので、隔壁で形成さ
れた放電空間の中に並べて形成された２個の表示電極の
走査電極６ａ及び共通電極６ｂと向き合って交差するア
ドレス電極１１が設置される。この構造はアドレス電極
１１と走査電極６ａの間で画素を選択するために壁電荷
を生成させる放電が起こり、その後走査電極６ａと共通
電極６ｂの間で画像表示をするための放電が一定時間反
復して起こる。隔壁１７は放電空間を形成する機能と共
に放電時発生した光を遮断して近隣の画素にクロストー
ク（ｃｒｏｓｓｔａｌｋ）を発生させることを防止する
役割をする。
【０００８】このような単位構造を一枚の基板上にマト
リックス状に複数個形成し、各単位構造に蛍光物質を塗
布して一つの画素を構成し、この画素が集まって一つの
プラズマ表示パネルになる。現在常用化されているプラ
ズマ表示パネルは各画素の中で放電を起こし、放電によ
り発生した紫外線が画素の内壁に塗布されている蛍光物
質を励起させて望む色を具現するようになる。
【０００９】プラズマ表示パネルがカラー表示素子とし
ての機能を示すためには階調を具現する必要があるが、
現在この具現方法として１ＴＶフィールドを複数個の補
助フィールドに分けて、これを時分割制御する階調具現
方法が使われている。
【００１０】図３１は現在商品に適用されているＡＣ型
プラズマ表示パネルの階調表示方法を説明するための図
面である。これは６ビット階調表示方法として一つの映
像（ＴＶ）フィールドを６個の補助フィールドに分けて
いるし、各補助フィールド毎にアドレス期間Ａ１、Ａ
２、…Ａ６と放電維持期間Ｓ１、Ｓ２、Ｓ３、…Ｓ６に
分離されて構成されている。
【００１１】ここで、アドレス期間Ａ１、Ａ２、…Ａ６
に表示パネルの画素を選択し、放電維持期間Ｓ１、Ｓ
２、Ｓ３、…Ｓ６の組合せでアドレス期間に選択された
画素の階調を表示する。この方法で２6 ＝６４の階調が
表示できる。
【００１２】即ち、４８０個の走査ラインＹ１、Ｙ２、
…Ｙ４８０よりなるプラズマ表示パネルから選択された
画素の階調は０レベルから６３レベルまで総数６４個の
階調を作るようになる。
【００１３】たとえば、０（０Ｔ）、１（１Ｔ）、２
（２Ｔ）、３（１Ｔ＋２Ｔ）、４（４Ｔ）、５（１Ｔ＋
４Ｔ）、６（２Ｔ＋４Ｔ）、７（１Ｔ＋２Ｔ＋４Ｔ）、
８（８Ｔ）、９（１Ｔ＋８Ｔ）、…、２７（１Ｔ＋２Ｔ
＋８Ｔ＋１６Ｔ）、…６３（１Ｔ＋２Ｔ＋４Ｔ＋８Ｔ＋
１６Ｔ＋３２Ｔ）のような方法で階調が表示される。
【００１４】図３２は常用化されたＡＣ型プラズマ表示
パネルの電極結線構造の一例を示す図面で、水平方向に
向き合って平行した二つの電極対（Ｘ、Ｙ電極対）とこ
れに垂直のアドレス電極２１よりなる。ここで二つの水
平電極対の中で共通に結線されている電極が共通電極
（Ｘ電極）であり、また片方の電極は走査電極（Ｙ電
極）である。このような結線構造のＡＣ型プラズマ表示
パネルを駆動するための駆動信号の波形図が図３３に示
されている。
【００１５】この駆動信号はアドレス放電及び維持放電
を分離（ＡＤＳ）して駆動する方法である。図３３には
各々アドレス電極駆動信号Ａ、走査電極駆動信号Ｙ１、
Ｙ２、…Ｙ４８０及び共通電極駆動信号の波形（タイミ
ング）Ｘが示されている。ここには第１サブフィールド
ＳＦ１の信号だけ示されている。
【００１６】Ａ１は第１アドレス期間を示し、Ｓ１は第
１放電維持期間を示す。アドレス期間（第１アドレス期
間）は全面消去期間Ａ１１、全面記入期間Ａ１２及び全
面消去期間Ａ１３の消去期間と、実際に画素を選択する
実際のアドレス期間Ａ１４よりなる。
【００１７】消去期間Ａ１１、Ａ１２、Ａ１３は正確な
階調表示のために弱い放電を起こして以前の放電による
壁電荷を全面消去（Ａ１１）し、全面記入（Ａ１２）し
た後、適切な壁電荷だけ残るように壁電荷量を調節する
全面消去（Ａ１３）を実施して、次の補助フィールドの
動作を円滑にする。アドレス期間Ａ１４は交差されたア
ドレス電極と走査電極の間に記入パルスによる選択的放
電によって、プラズマ表示パネルの全画面の中で選択さ
れた場所の走査電極に壁電荷を形成させて電気信号化さ
れた情報を書き込む作用をする。
【００１８】放電維持期間Ｓ１は連続した放電維持パル
スによる放電によって、実際画面上に映像情報を実際階
調の通りに具現する発光を維持する期間である。
【００１９】しかし、このように常用化したプラズマ表
示パネルの階調具現方法は、アドレス放電と維持放電を
分離して駆動する方法を適用した関係で、放電維持期間
は６ビット階調のＮＴＳＣ級基準に１フレーム映像表示
期間の３０％以下しか割当できない。
【００２０】従って、輝度が非常に低く、一般的な表示
素子としては大きな制約になっていた。しかもＨＤ（Ｈ
ｉｇｈ Ｄｅｆｉｎｉｔｉｏｎ）級の表示素子に適用す
る場合、維持放電期間は現在の１〜２水準に低くなり輝
度低下がさらに深化する。また階調の段階を増加させる
と放電維持期間はさらに減って、輝度の減少はさらにひ
どく現れる。
【００２１】これに対して輝度性能を向上させるために
放電維持パルスの周波数を大きくし、放電維持パルスの
幅を狭くして１サブフィールド（ｓｕｂ−ｆｉｅｌｄ）
の内に相対的に多いパルス熱を取り入れるという方法も
ある。
【００２２】しかしながら、放電維持パルスの周波数を
大きくする場合には時間的に放電維持パルスの熱が隣接
するようになって、先行したパルスが起こした放電によ
る空間電荷が直後の放電の放電特性に影響を及ぼして放
電が不安定になることにより、輝度上昇は飽和特性を有
することになる。また放電維持パルスの幅を小さくする
場合には、放電直後発生した空間電荷を壁電荷に転換で
きる時間が相対的に短くなり、結果的に放電維持電圧を
上昇させるようになる。
【００２３】このような問題点を回避するために、アド
レス放電と維持放電を分離して駆動する代わりに、図３
４に示したような全画面同時アドレス放電及び維持放電
具現方法がある。
【００２４】これは各走査電極Ｙ１、Ｙ２、Ｙ３に印加
される放電維持パルス３２の間の期間にアドレスパルス
２９ａ、２９ｂ、２９ｃを印加し、走査電極Ｙ１、Ｙ
２、Ｙ３の側に各放電維持パルス３２の間に初期化のた
めの消去パルス３１ａ、３１ｂ及びアドレス放電のため
の走査パルス３３ａ、３３ｂ、３３ｃを印加し、その後
一定期間の放電維持期間を設定する。
【００２５】この方法における階調表示は図３５に示し
たように、補助フレームＳＦ１乃至ＳＦ８を分割して１
ＴＶフレーム全体を維持放電に使用する方法である。
【００２６】しかし、この方法はアドレスパルスを放電
維持パルスと放電維持パルスの間に挿入することで、ア
ドレスパルスの挿入タイミングを決定することに多くの
制約がある。従って、実際表示できる走査線数には制限
があって、これもまた高画質ＨＤ水準の駆動には多くの
無理がある。従って、この克服のためには倍速駆動、３
倍速駆動等の高速駆動をする必要があるが、この場合に
も前述したように周波数上昇による放電不安定及び放電
維持パルス幅の縮少による放電維持電圧の上昇などを避
けることはできない。
【００２７】
【発明が解決しようとする課題】本発明は前記のような
従来の問題点を改善するために創案されたもので、放電
維持パルスと放電維持パルスの間に複数個のデータパル
スよりなるアドレスタイムスロット期間を設定し、この
アドレスタイムスロット期間のデータパルスの個数と同
じ個数の二つの電極よりなる水平電極対を一群とする複
数個の群に分けて駆動し、各群内の水平電極対にアドレ
スタイムスロット期間の各データパルスに対応する走査
パルスは順次走査し、この群をアドレッシング及び持続
同時駆動方式に適用することによって、放電維持パルス
と放電維持パルスの間に挿入されるアドレスパルスの挿
入タイミングに余裕があり、周波数上昇あるいは放電維
持パルスの電圧上昇を避けうるプラズマ表示パネル及び
その駆動方法を提供することにその目的がある。
【００２８】
【課題を解決するための手段】前記のような目的を達成
するために、請求項１に記載の発明は、対向する二枚の
基板の一側対向面上に平行の第１電極及び第２電極の電
極対がストライプ状にｋ個配置され、前記二枚の基板の
他側対向面上に前記第１電極及び第２電極の電極対と交
差する方向のストライプ状にｎ個配置されたｋｘｎマト
リックスＡＣ型プラズマ表示パネルにおいて、前記第１
電極及び第２電極の電極対から前記第２電極をｍ個ずつ
合わせてｐ個の共通結線群を作り、前記第１電極は各々
個別的に設置されたことを特徴とする。
【００２９】また、請求項２に記載の発明は、請求項１
に記載の発明において、前記第１電極及び第２電極の電
極対の総数ｋ＝ｍ×ｐの関係が成立することを特徴とす
る。
【００３０】また、請求項３に記載の発明は、請求項１
に記載の発明において、前記ｐ個の共通電極群から同じ
順序で各々一つずつの電極を取って共通結線することに
よって、ｍ個の共通結線群を形成したことを特徴とす
る。
【００３１】また、請求項４に記載の発明は、対向する
二枚の基板の一側対向面上に平行した第１電極及び第２
電極の電極対がストライプ状にｋ個配置され、前記二つ
の基板の他側対向面上に前記第１電極及び第２電極の電
極対と交差する方向のストライプ状に第３電極がｎ個配
置されたｋｘｎマトリックスＡＣ型プラズマ表示パネル
で、前記第１電極及び第２電極の電極対から前記第２電
極をｍ個ずつ合わせてｐ個の共通結線群を作り、前記第
１電極は各々個別的に設置し、前記第２電極に結線され
た電極を共通電極とし、前記個別的に設置された第１電
極を走査電極とする時、一つの水平同期時間を複数個の
期間に相異なる個数の放電維持パルスを順次に印加し
て、前記複数の期間を選択的に発光させて前記第１電極
及び第２電極別に階調を具現して、一つのフレームの画
像を駆動するＡＣ型プラズマ表示パネルの駆動方法にお
いて、（１）前記放電維持パルスの非印加期間にアドレ
スタイムスロット期間を設定し、前記各アドレスタイム
スロット期間の間アドレス電極に複数個のデータパルス
を印加する段階と、（２）前記各複数個のデータパルス
に相応するように前記共通電極群を一つずつ選択して、
前記選択された共通電極群の共通電極と対を成す前記各
走査電極に、前記複数個のデータパルスの各々に対応す
る走査パルスを順次に印加する段階と、を含むことを特
徴とする。
【００３２】また、請求項５に記載の発明は、請求項４
に記載の発明において、前記アドレス電極には設定され
た基準階調ビット数と同数の前記アドレスタイムスロッ
トが前記各水平同期時間に対応して反復的に印加され、
前記各アドレスタイムスロットに対応して前記各走査電
極を順次に選択して、各々選択された走査電極の階調表
示期間は直前の前記選択された走査電極の階調表示期間
より１ビットずつ先行して選択することを特徴とする。
【００３３】また、請求項６に記載の発明は、請求項４
に記載の発明において、前記複数個のデータパルスは負
パルスで、前記放電維持パルスは正パルスであることを
特徴とする。
【００３４】また、請求項７に記載の発明は、請求項４
に記載の発明において、前記複数個のデータパルスは負
パルスで、前記放電維持パルスは負パルスであることを
特徴とする。
【００３５】また、請求項８に記載の発明は、請求項４
に記載の発明において、前記複数個のデータパルスは正
パルスで、前記放電維持パルスは正パルスであることを
特徴とする。
【００３６】また、請求項９に記載の発明は、請求項４
に記載の発明において、前記複数個のデータパルスは正
パルスで、前記放電維持パルスは負パルスであることを
特徴とする。
【００３７】また、請求項１０に記載の発明は、請求項
４に記載の発明において、前記アドレスタイムスロット
期間に前記選択された共通電極群に障壁電圧を印加し
て、アドレス効率を高めることを特徴とする。
【００３８】また、請求項１１に記載の発明は、請求項
４乃至１０のいずれか一つに記載の発明において、前記
データパルスの幅は２μｓ以下であることを特徴とす
る。
【００３９】また、請求項１２に記載の発明は、請求項
４に記載の発明において、前記アドレスタイムスロット
は前記共通電極と走査電極に印加される放電維持パルス
との間の非印加期間の位相関係を対称にし、前記二つの
放電維持パルス非印加期間中前記走査電極に印加される
放電維持パルスを基準に前記走査パルスより先行する非
印加期間あるいは前記走査パルスより遅れる非印加期間
にだけ備わることを特徴とする。
【００４０】また、請求項１３に記載の発明は、請求項
１２に記載の発明において、前記複数個のデータパルス
は負パルスで、前記放電維持パルスは正パルスであるこ
とを特徴とする。
【００４１】また、請求項１４に記載の発明は、請求項
１２に記載の発明において、前記複数個のデータパルス
は負パルスで、前記放電維持パルスは負パルスであるこ
とを特徴とする。
【００４２】また、請求項１５に記載の発明は、請求項
１２に記載の発明において、前記複数個のデータパルス
は正パルスで、前記放電維持パルスは正パルスであるこ
とを特徴とする。
【００４３】また、請求項１６に記載の発明は、請求項
１２に記載の発明において、前記複数個のデータパルス
は正パルスで、前記放電維持パルスは負パルスであるこ
とを特徴とする。
【００４４】また、請求項１７に記載の発明は、請求項
４に記載の発明において、前記アドレスタイムスロット
は前記共通電極と走査電極に印加される放電維持パルス
との間の非印加期間の位相関係を対称にし、前記二つの
放電維持パルス非印加期間中前記走査電極に印加される
放電維持パルスを基準として、前記走査パルスより先行
する非印加期間及び前記走査パルスより遅れる非印加期
間の全てに備わることを特徴とする。
【００４５】また、請求項１８に記載の発明は、請求項
１７に記載の発明において、前記複数個のデータパルス
は負パルスで、前記放電維持パルスは正パルスであるこ
とを特徴とする。
【００４６】また、請求項１９に記載の発明は、請求項
１７に記載の発明において、前記複数個のデータパルス
は負パルスで、前記放電維持パルスは負パルスであるこ
とを特徴とする。
【００４７】また、請求項２０に記載の発明は、請求項
１７に記載の発明において、前記複数個のデータパルス
は正パルスで、前記放電維持パルスは正パルスであるこ
とを特徴とする。
【００４８】また、請求項２１に記載の発明は、請求項
１７に記載の発明において、前記複数個のデータパルス
は正パルスで、前記放電維持パルスは負パルスであるこ
とを特徴とする。
【００４９】また、請求項２２に記載の発明は、請求項
４に記載の発明において、前記共通電極と走査電極に印
加される放電維持パルスの間の位相関係を非対称にし
て、前記放電維持パルスの非印加期簡が長い方にアドレ
スタイムスロットを具備したことを特徴とする。
【００５０】また、請求項２３に記載の発明は、請求項
２２に記載の発明において、前記複数個のデータパルス
は負パルスで、前記放電維持パルスは正パルスであるこ
とを特徴とする。
【００５１】また、請求項２４に記載の発明は、請求項
２２に記載の発明において、前記複数個のデータパルス
は負パルスで、前記放電維持パルスは負パルスであるこ
とを特徴とする。
【００５２】また、請求項２５に記載の発明は、請求項
２２に記載の発明において、前記複数個のデータパルス
は正パルスで、前記放電維持パルスは正パルスであるこ
とを特徴とする。
【００５３】また、請求項２６に記載の発明は、請求項
２２に記載の発明において、前記複数個のデータパルス
は正パルスで、前記放電維持パルスは負パルスであるこ
とを特徴とする。
【００５４】また、請求項２７に記載の発明は、請求項
４に記載の発明において、前記アドレスタイムスロット
期間に前記選択された共通電極群に障壁電圧を印加して
アドレス効率を高めることを特徴とする。
【００５５】また、請求項２８に記載の発明は、請求項
４に記載の発明において、前記（１）段階の先に、前記
アドレス機能を遂行する前に前記第１及び第２電極対に
初期化パルスを印加して、前記第１及び第２電極対の全
体に壁電荷を形成させる段階と、前記アドレス電極と前
記走査電極に各々アドレスパルス及び走査パルスを選択
的に印加して選択された画素にだけ壁電荷を消去する段
階と、をさらに含むことを特徴とする。
【００５６】また、請求項２９に記載の発明は、請求項
２８に記載の発明において、前記各階調表示パルスの中
で最終放電維持パルスの幅を他の放電維持パルスの幅よ
り相対的に狭くして壁電荷を形成させないようにして、
以前の階調表示期間に生成された壁電荷を消去すること
を特徴とする。
【００５７】また、請求項３０に記載の発明は、請求項
２９に記載の発明において、前記表示放電維持パルスの
最終パルスはパルスの幅が２μｓより小さいことを特徴
とする。
【００５８】また、請求項３１に記載の発明は、請求項
２８に記載の発明において、各階調表示期間中、最終放
電維持パルスの後に１００μｓｅｃ以下の期間をおい
て、壁電荷を自然減少させることを特徴とする。
【００５９】また、請求項３２に記載の発明は、請求項
４に記載の発明において、前記（１）段階の先に、前記
アドレス機能を遂行する前に前記第１及び第２電極対に
初期化パルスを印加して前記第１及び第２電極対の全体
に壁電荷を消去する段階と、前記アドレス電極と前記走
査電極に各々データパルス及び走査パルスを選択的に印
加して、選択された画素にだけ壁電荷を形成させる段階
と、をさらに含むことを特徴とする。
【００６０】また、請求項３３に記載の発明は、請求項
３２に記載の発明において、前記各階調表示パルスの中
で最終放電維持パルスの幅を、他の放電維持パルスの幅
より相対的に狭くして壁電荷を形成させないことによっ
て、直前の階調表示期間に生成された壁電荷を消去させ
ることを特徴とする。
【００６１】また、請求項３４に記載の発明は、請求項
３３に記載の発明において、前記最終放電維持パルスは
幅が２μｓより小さいことを特徴とする。
【００６２】また、請求項３５に記載の発明は、請求項
３３に記載の発明において、各階調表示期間中、最終放
電維持パルスの後に１００μｓｅｃ以下の期間をおい
て、壁電荷を自然減少させることを特徴とする。
【００６３】また、請求項３６に記載の発明は、請求項
４に記載の発明において、前記アドレスタイムスロット
と前記アドレスタイムスロットに印加される複数個のデ
ータパルスを無効化させる休止スロットを交番に具備
し、前記休止スロットは前記共通電極に印加される初期
化パルス期間に具備して、前記アドレスタイムスロット
に印加されたアドレスパルスと同時に印加させないこと
を特徴とする。
【００６４】
【発明の実施の形態】以下、添付した図面を参照して本
発明に係わるプラズマ表示パネル及びその駆動方法の実
施形態を詳細に説明する。
【００６５】本発明は従来の方式より輝度を増加させ、
水平走査線数が増加しても輝度の減少が無いようにする
３電極構造ＡＣ型プラズマ表示パネルの電極結線構造及
び電圧印加方法を改善したことを特徴とする。
【００６６】即ち、本発明は既知の３電極構造ＡＣ型プ
ラズマ表示パネルに対して、放電維持パルスと放電維持
パルスの間に複数個のデータパルスよりなるアドレスタ
イムスロットを設定し、二つの電極よりなる水平電極対
をこのアドレスタイムスロットの個数と同じ個数の電極
対を一群とする複数個の群に分けて、この水平電極対の
中で一つの電極は各々の群毎に共通に結線し、他方の電
極は各々独立的に結線したプラズマ表示パネル構造にお
いて、個々の群内のアドレスタイムスロットは順次走査
し、この群をアドレッシング及び持続同時駆動方式に適
用したことを主特徴とする。このような構造のプラズマ
表示パネル及びその駆動方法を詳細に説明すると次の通
りである。
【００６７】図１及び図２は本発明の基本電極駆動方式
を説明するための電極駆動信号の波形図であって、図３
０に示したような走査電極及び共通電極の対よりなる放
電維持電極と、この放電維持電極と交差する方向のアド
レス電極を有する３電極構造ＡＣ型プラズマ表示パネル
を駆動する電極駆動信号の波形図である。
【００６８】ここで、便宜上放電維持電極の中で共通電
極をＸ電極と称し、走査電極をＹ電極と称する。本発明
によるプラズマ表示パネルの駆動方法は、既知の技術の
消去アドレス方式を適用するために放電維持電極に記入
放電を起こし、その後アドレスタイムスロットと指称し
た放電維持パルス等の間に複数個のデータパルスを印加
する。
【００６９】この際、アドレスパルスと同期させて走査
電極に順次に走査パルスを印加することによって、アド
レスタイムスロットに印加されるデータパルスの個数だ
け高速アドレッシングができるようにし、これにより水
平走査線数を増加させることができる駆動方法である。
【００７０】図１及び図２では消去アドレッシングをす
るために、ｉ番目の共通電極Ｘｉとｉ＋ｍ番目の共通電
極Ｘｉ＋ｍに一つの放電維持パルス（負（正）パルス）
３５を選定し、これと同じタイミングのｉ番目の走査電
極Ｙｉとｉ＋ｍ番目の走査電極Ｙｉ＋ｍに正（負）の初
期化（ｉｇｎｉｔｅ）パルス３８ａを印加して記入放電
を起こしてＸｉ、Ｙｉ電極対及びＸｉ＋ｍ、Ｙｉ＋ｍ電
極対に壁電荷を形成させる。
【００７１】その後アドレスタイムスロットに印加され
た一番目のデータパルス３４ａ、３４ｃと各々同じタイ
ミングで共通電極Ｘｉ及びＸｉ＋ｍに順次に走査パルス
３７ａ、３７ｃを印加する。この走査放電により不必要
な画素の壁電荷が消去され、壁電荷が消去されない画素
だけが次いで印加される放電維持パルス３５により放電
する。
【００７２】ここで、走査電極ＹｉとＹｉ＋ｍは同じ波
形のパルス（初期化パルス３８ａ、３８ｃ及び放電維持
パルス３６）が印加されるので一つの共通電極結線とす
ることができる。
【００７３】次にｉ＋１番目の共通電極Ｘｉ＋１と走査
電極Ｙｉ＋１の対及びｉ＋ｍ＋１番目の共通電極Ｘｉ＋
ｍ＋１と走査電極Ｙｉ＋ｍ＋１の対では、二番目のデー
タパルス３４ｂ、３４ｄのタイミングでＸｉ＋１及びＸ
ｉ＋ｍ＋１に正（負）の初期化（ｉｇｎｉｔｅ）パルス
を印加して、Ｙｉ＋１及びＹｉ＋ｍ＋１の放電維持パル
ス３６のように消去アドレッシングのための記入放電を
起こす。
【００７４】その後、アドレスタイムスロットに印加さ
れたデータパルス３４ｂ、３４ｄと同じタイミングで走
査電極Ｙｉ＋１及びＹｉ＋ｍ＋１に走査パルス３７ｂ、
３７ｄを順次に印加する。
【００７５】この後の過程は前述した場合と同一であ
る。この場合には共通電極Ｘｉ＋ｍ及びＸｉ＋ｍ＋１に
同じ波形のパルスが印加されるので、これを共通に結線
する。
【００７６】この過程を交代に遂行しながら走査をす
る。その結果アドレスタイムスロットに挿入されるデー
タパルスの個数だけ従来より高速アドレッシングが可能
で走査できる走査線数も増加する。
【００７７】図３は本発明を実施するためのプラズマ表
示パネルの結線図の一例である。上述した方法は電圧の
印加方法が複雑であるので、実際に具現するために次の
ような結線構造を採用する。
【００７８】対向する二枚の基板上の一側対向面上に配
置された走査及び共通電極対（第１及び第２電極対）の
中で共通電極（第２電極）をｍ（４）個ずつ取って共通
結線することで複数個（４個）の共通電極群ＸＸ１、Ｘ
Ｘ２、ＸＸ３、ＸＸ４を形成する。このように形成され
た共通電極群はｎ個（４）が生じるが、これは総走査線
数（共通電極数）をｋとする時ｍ（４）×ｎ（４）＝ｋ
（１６）の関係を有する。この際、この電極を共通電極
（Ｘ電極）といい、共通に結線されない方向の電極を走
査電極（Ｙ電極）という。
【００７９】図４乃至図７は本発明による電極駆動方法
に適用される電極駆動信号の基本的な波形図であって、
図３に示したような構造で結線されたプラズマ表示パネ
ルにおける共通電極ＸＸ１の放電維持パルス４６ａと、
次いで印加される走査電極Ｙ１〜Ｙ４の放電維持パルス
４６ｂとの間に複数個のデータパルス４２を印加するこ
とを示す。この放電維持パルス４６ａと放電維持パルス
４６ｂの間をアドレスタイムスロットといい、このアド
レスタイムスロット期間内に印加されたデータパルス４
２と１：１に対応して走査電極に順次に走査パルス４５
が印加される。
【００８０】図４乃至図７は共通電極群ＸＸ１に印加さ
れる放電維持パルス４６ａを基準として、走査電極Ｙ１
〜Ｙ４に印加される放電維持パルス４６ｂの両側間の期
間を対称構造にする。すなわち、対称構造のアドレスタ
イムスロットを設置して、この中で片方のアドレスタイ
ムスロットに各々４個ずつのアドレスパルス４２を印加
する場合である。
【００８１】この場合は、図示したように、後側のアド
レスタイムスロットにアドレスパルス４２を印加してい
る。また、ここでは４個のデータパルス４２を一つのア
ドレスタイムスロットに印加し、このデータパルス４２
の個数（４個）と同じ数の走査電極及び共通電極の対を
一つの電極群として、一つの共通電極群ＸＸ１と４個の
走査電極Ｙ１、Ｙ２、Ｙ３、Ｙ４よりなる。
【００８２】図４はデータパルス４２に負パルスを適用
して放電維持パルス４６ａ、４６ｂに正パルスを適用し
た場合であり、図５はデータパルス４２に負パルスを適
用して放電維持パルス４６ａ、４６ｂに負パルスを適用
した場合であり、図６はデータパルス４２に正パルスを
適用して放電維持パルス４６ａ、４６ｂに正パルスを適
用した場合であり、図７はデータパルス４２に正パルス
を適用して放電維持パルス４６ａ、４６ｂに負パルスを
適用した場合である。
【００８３】ここで、部材番号４３及び４４は各々消去
パルスと初期化パルスであり、これに対しては次のよう
に説明する。このような電極駆動原理を実際８ビット基
準階調表示（実際２8 ＝２５６階調表示）に各々適用し
たことが図８乃至図１１に示したようなプラズマ表示パ
ネルの電極駆動信号の波形図である。
【００８４】図８乃至図１１に示したようなアドレス方
法は消去アドレス方法を使用して一つの電極群を同時発
光させて、その群に属する全ての走査電極Ｙ及び共通電
極Ｘの対に空間電荷を形成し、電極群ＸＸ１、Ｙ１、Ｙ
２、Ｙ３、Ｙ４、ＸＸ２、Ｙ５、Ｙ６、Ｙ７、Ｙ８の中
に含まれている走査電極Ｙ１〜Ｙ４、Ｙ５〜Ｙ８に順次
に走査パルス４９ａ、４９ｂ、４９ｃを印加し、これと
各々対応して印加されたアドレスパルス４７ａ、４７
ｂ、４７ｃによる放電が選択的に必要ない画素の壁電荷
を消すことである。
【００８５】このように一つのアドレススロットの中で
多数個の順次走査を行った後放電維持パルス５０を印加
する。この方法は階調を示すために１水平同期期間を複
数の補助水平同期期間に分ける。
【００８６】ここでは総２５６階調を８ビット１：２：
４：８：１６：３２：６４：１２８基準階調の組合せで
示すために、１水平同期１Ｈを８補助水平同期ＳＨ１〜
ＳＨ８に分けて各ビットの明るさに相応する放電維持期
間を有する。
【００８７】この例では最下位ビットが３個の放電維持
パルスを有することを基準とする場合、各基準ビット階
調には３、６、１２、２４、４８、９６、１９２、３８
４個の放電維持パルスが対応される。
【００８８】１フレームの画像を複数個の部分画像に分
けて示すが、複数個の部分画像の階調表示は部分画像の
個数に対応する複数個の電極群ＸＸ１、Ｙ１、Ｙ２、Ｙ
３、Ｙ４、ＸＸ２、Ｙ５、Ｙ６、Ｙ７、Ｙ８、ＸＸ３、
Ｙ９、…で階調を示す。
【００８９】各電極群で表示される部分画像を示すため
には多数個の補助水平同期ＳＨ１〜ＳＨ８が必要なの
で、各補助水平同期のアドレス１〜８が重複されないよ
うに補助水平同期の配列する方法を備えるべきである。
ここでは既知の方法［参考文献参照］である１ビット先
行順次配列方法を使用する。
【００９０】一つの共通及び走査線群ＸＸ１、Ｙ１〜Ｙ
４には８個のアドレススロット１〜８を含む複数個の期
間、即ちセットに分割された走査電極駆動信号及び共通
電極駆動信号が印加されるようにし、最初のセットの１
番目のビット、２番目のセットの２番目のビット…の順
に補助水平同期４９ａ、４９ｂ…；走査パルスを配列す
る。
【００９１】その後、共通及び走査線群ＸＸ２、Ｙ５〜
Ｙ８には１セット遅延させて二番目のセットに前記と同
じ方法で最初のセットの１番目のビット、２番目のセッ
トの２番目のビット…順序で配列する。こうすると各々
の補助水平同期（４９ｃ、…；走査パルス）は同じセッ
トで１アドレススロットずつ先行して配列されるので、
各々のアドレスパルスが重複することはない。
【００９２】ここで、図８乃至図１１は各々図４乃至図
７の場合に対応する正パルス及び負パルスの組合せより
なる。
【００９３】図１２はこのような電極駆動方法を１ＴＶ
フレームに適用したことで、水平走査線数が４８０ライ
ンの場合を８ビットの基準階調の組合せで総２５６階調
を表示する方法を示す。
【００９４】この場合、アドレススロットに４個のアド
レスパルスを印加すると４個ずつの走査電極を一つの電
極群として全体水平走査線群は１２０個になり、各々の
休止期、アドレス期間及び放電維持期間の配列は図示し
た通りである。この図面で、横には６番目のビット及び
７番目のビットは省略されていて、縦には第１６電極群
から第１２０電極群は省略されている。
【００９５】本発明の他の実施形態として図１３に示し
たようにプラズマ表示パネルの結線方法を変更して複数
本のラインを飛ばして走査すると、アドレススロットの
期間の短さによる近隣ラインとのクロストークが防止で
きる。
【００９６】即ち、データパルスの個数だけの共通電極
を一つの共通電極群ＸＸ１、ＸＸ２、ＸＸ３、ＸＸ４で
結線し、共通で結線される各共通電極５２ｂは形成され
る共通電極群の個数だけの離隔された所の共通電極を取
る。一つの共通電極群ＸＸ１、ＸＸ２、ＸＸ３、ＸＸ４
に属する走査電極５２ａに順次に印加される走査パルス
とアドレス電極５１に印加される複数個のデータパルス
によるアドレッシングにより選択された画素に壁電荷が
生成され、不要な画素の壁電荷を消去することによって
画像が形成される。
【００９７】図１４乃至図１７は走査電極Ｙ１〜Ｙ８に
印加される共通電極群ＸＸ１に印加される放電維持パル
ス５８ａを基準として走査電極Ｙ１〜Ｙ８に印加される
放電維持パルス５８ｂの両側間の期間を対称構造に作る
が、即ち対称構造のアドレスタイムスロットを設置して
この両アドレスタイムスロット全部に各々４個ずつのア
ドレスパルス５４ａ、５４ｂを印加する場合である（図
４乃至図７及び図８乃至図１１の場合は対称構造のアド
レススロットの片方にだけ複数個のデータパルスを印加
した場合である）。この場合、全体共通及び走査電極群
の個数が半分に減るので、より少ない駆動回路で駆動で
きる。
【００９８】図１８はこの実施形態を具現するためのプ
ラズマ表示パネルの電極結線図であり、図１９はこの実
施形態の中で図１４の場合を用いた実際階調具現方法を
示した電極駆動信号の波形図である。
【００９９】即ち、図１８の場合、４個のデータパルス
が対称構造のアドレスタイムスロットの両側に入り込む
ので、８個の共通電極６０ｂが各々の共通電極群ＸＸ
１、ＸＸ２で結線され、アドレス電極５９に印加される
８個のデータパルスと一つの共通電極群と結びついた走
査電極６０ａに順次に印加される走査パルスにより選択
された画素がアドレスされる。
【０１００】このような結線構造による図１９の実際階
調表示方法によれば、アドレス電極Ａには対称構造のア
ドレスタイムスロットの両側に４個ずつのデータパルス
を印加して全部で８個ずつのアドレスパルスを放電維持
パルス間の各々の非印加期間毎に印加する。
【０１０１】従って、第１電極群ＸＸ１、Ｙ１〜Ｙ８で
は各セット別に初期化パルス６３ａ、６３ｂが印加され
た後に印加されるデータパルス６２ａ、６２ｂと、この
データパルス６２ａ、６２ｂと対応して走査電極Ｙ１〜
Ｙ８に順次に印加される走査パルス６５ａ、６５ｂによ
りアドレッシングされ、第２電極群ＸＸ２、Ｙ１〜Ｙ１
６では各セット別に初期化パルス６３ｃが印加された後
印加されるデータパルス６２ｃと、このデータパルス６
２ｃと対応して走査電極Ｙ９〜Ｙ１６に順次に印加され
る走査パルス６５ｃによりアドレッシングされる。
【０１０２】また、図１９の実際階調表示方法では、ア
ドレスの正確度を高めるために、走査電極の放電維持パ
ルス列が終了した後に狭パルス（図示せず）を挿入して
残余壁電荷を消去する駆動方式を使用したり、各階調表
示期間中最終放電維持パルスの後に１００μｓｅｃ以下
の期間をおいて壁電荷を自然減少させたりする。
【０１０３】図２０はやはりクロストークを減らすため
に対称構造のアドレスタイムスロットに、アドレス電極
６７に印加される８個のデータパルスに対応する走査パ
ルスを、走査電極６８ａに飛越走査を通じてプラズマ表
示パネル６９を駆動させた電極結線図である。従って、
数個ずつ飛ばして選択された共通電極Ｘが取られて結線
される。
【０１０４】図２１乃至図２４は本発明のさらに他の実
施形態であって、共通電極群ＸＸ１に印加される放電維
持パルス７４ａを基準として、前後に走査電極Ｙ１〜Ｙ
８に印加される放電維持パルス７４ｂとの期間を非対称
として一側アドレススロットを拡張したものである。
【０１０５】即ち、共通電極群ＸＸ１に印加される放電
維持パルス７４ａを基準として走査電極Ｙ１〜Ｙ８に印
加される放電維持パルス７４ｂの両側間の期間を非対称
構造にして非対称構造のアドレスタイムスロットを設置
した後、この中で大きい方のアドレスタイムスロットに
８個ずつのデータパルス７０を印加する場合である。
【０１０６】ここでは共通電極群ＸＸ１に印加される放
電維持パルス７４ａを基準として後側の間の期間を拡張
した非対称アドレススロットに８個のアドレスパルスが
印加される。この場合にも前記した実施形態と同一に駆
動回路数を半分に減少させうる。
【０１０７】図２１はデータパルス７０で負パルスを適
用し、放電維持パルス７４ａ、７４ｂで正パルスを適用
した場合であり、図２２はデータパルス７０で負パルス
を適用し、放電維持パルス７４ａ、７４ｂで負パルスを
適用した場合であり、図２３はデータパルス７０で正パ
ルスを適用し、放電維持パルス７４ａ、７４ｂで正パル
スを適用した場合であり、図２４はデータパルス７０で
正パルスを適用し、放電維持パルス７４ａ、７４ｂで負
パルスを適用した場合である。
【０１０８】図２５は図２１の駆動方法を実際に利用し
て具現した電極駆動信号の波形図である。ここで、デー
タパルス７５ａ、７５ｂは各々第１セットと第２セット
で、第１電極群ＸＸ１に対応する走査電極Ｙ１〜Ｙ８に
順次に印加される走査パルス７７ａ、７７ｂと対応して
アドレッシングを行ない、第２共通電極群ＸＸ２に対応
する走査電極Ｙ９〜Ｙ１６に順次に印加される走査パル
ス７７ｃは、第２セットの最初１のデータパルスと対応
してアドレッシングを行なう。この場合もやはりアドレ
スの正確度を上げるために走査電極の放電維持パルス列
７８が終了した後壁電荷消去用の狭パルス７９ａ、７９
ｂを印加することもでき、各階調表示期間中、最終放電
維持パルスの後に１００μｓｅｃ以下の期間をおいて壁
電荷を自然減少させることもできる。部材番号７６ａ、
７６ｂ、７６ｃは各々のセットからアドレッシングする
前に印加される初期化パルスである。
【０１０９】図２６は図２５の実施形態より多い走査線
数を駆動するために非対称アドレススロットの中にさら
に多いアドレスパルスを挿入したことで、１０２４（２
10）個の共通電極及び走査電極を駆動するために１０個
のアドレスパルス８０ａ、８０ｂ、８０ｃを各々の非対
称アドレススロットの中に印加する場合である。
【０１１０】また、この場合は各電極群毎に各セットの
補助水平同期の前に初期化パルス８１ａ、８１ｂ、８１
ｃ及び消去パルス８３ａ、８３ｂ、８３ｃを導入して、
同時消去及び同時記入の機能を有する複数個の放電を起
こして残余壁電荷を消去し、その後に選択された画素に
だけ記入放電を隨行させる方法で、各水平走査線群別に
分離アドレス分離表示放電方法を混合して適用する。
【０１１１】それからアドレス期間の中で共通電極群Ｘ
Ｘ１、ＸＸ２…に電圧障壁８２ａ、８２ｂ、８２ｃを印
加して、正の壁電荷（例えばＡｒ+ ）を走査電極Ｙの方
に誘導してアドレス効率をさらに向上させうる。このよ
うな書込みアドレッシング方法は前述した消去アドレッ
シング方法を使用した実施形態の場合でも応用できる。
この場合もやはりアドレスの正確度を高めるために、共
通電極群ＸＸ１、ＸＸ２、…の放電維持パルス列８５が
終了した後壁電荷消去用の狭パルス８６ａ、８６ｂを印
加することもでき、各階調表示期間の中で最終放電維持
パルスの後に１００μｓｅｃ以下の期間をおいて壁電荷
を自然減少させることもできる。
【０１１２】図２７は本発明のさらに他の実施形態であ
って、アドレスタイムスロットが共通電極の初期化放電
期間６３ｃと重なる場合、データパルスによる干渉を除
去する目的に２個のアドレスタイムスロットずつに飛ば
して補助水平同期の番号１、２、…、８を附与する方式
である。
【０１１３】図２７でアドレススロットは、図１９に示
したように、対称構造のアドレススロットの両側の全部
にデータパルスが印加される場合である。アドレスパル
スが印加されないアドレスタイムスロットの区間ＮＡ
で、共通電極ＸＸ２は初期化放電（初期化パルス６３ｃ
により）をするのでアドレスパルスによる放電干渉はな
くなる。
【０１１４】
【発明の効果】以上述べたように、本発明によるＡＣ型
面放電プラズマ表示パネルの駆動方法は、アドレスと放
電維持を分離する分離駆動に比べて輝度特性に優れると
知られたアドレスと放電維持を併行する併行駆動方式を
利用し、従来のアドレスと放電維持併行駆動方法が有し
ている欠点の走査できる水平走査線数の制約を解決する
ために、走査電極及び共通電極に印加される放電維持パ
ルス等の間をアドレスタイムスロットとし、このアドレ
スタイムスロット期間に複数個のデータパルスを印加
し、このデータパルスの個数だけの共通電極を各々一つ
の共通電極群で結線して駆動する方法を使用する。この
ような放電維持併行駆動方法によると、例えば８ビット
階調で走査線数が１０００ラインまで増加する場合で
も、アドレスと放電維持併行駆動方法を使用することが
できる。
【図面の簡単な説明】
【図１】本発明によるアドレス電極及び走査電極同時駆
動方式の原理的な電極駆動波形図。
【図２】同じく本発明によるアドレス電極及び走査電極
同時駆動方式の原理的な電極駆動波形図。
【図３】本発明によるアドレス電極及び走査電極同時駆
動方式の原理を適用して画像を具現するための、ＡＣ型
プラズマ表示パネルの電極結線図。
【図４】図３の電極結線構造によって図１及び図２のア
ドレス電極及び走査電極同時駆動方式の原理を適用し
た、ＡＣ型プラズマ表示パネルの電極駆動波形図。
【図５】同じく図３の電極結線構造によって図１及び図
２のアドレス電極及び走査電極同時駆動方式の原理を適
用した、ＡＣ型プラズマ表示パネルの電極駆動波形図。
【図６】同じく図３の電極結線構造によって図１及び図
２のアドレス電極及び走査電極同時駆動方式の原理を適
用した、ＡＣ型プラズマ表示パネルの電極駆動波形図。
【図７】同じく図３の電極結線構造によって図１及び図
２のアドレス電極及び走査電極同時駆動方式の原理を適
用した、ＡＣ型プラズマ表示パネルの電極駆動波形図。
【図８】図４の電極駆動波形の詳細波形図。
【図９】図５の電極駆動波形の詳細波形図。
【図１０】図６の電極駆動波形の詳細波形図。
【図１１】図７の電極駆動波形の詳細波形図。
【図１２】図１及び図２の電極駆動原理を適用したＡＣ
型プラズマ表示パネルの階調表示方法を説明するための
説明図。
【図１３】図１及び図２のアドレス電極及び走査電極同
時駆動方式の原理を適用して画像を具現するための、Ａ
Ｃ型プラズマ表示パネルのまた他の電極結線図。
【図１４】図１及び図２のアドレス電極及び走査電極同
時駆動方式の原理を適用して画像を具現するための、Ａ
Ｃ型プラズマ表示パネルの８電極グループ駆動波形図。
【図１５】同じく図１及び図２のアドレス電極及び走査
電極同時駆動方式の原理を適用して画像を具現するため
の、ＡＣ型プラズマ表示パネルの８電極グループ駆動波
形図。
【図１６】同じく図１及び図２のアドレス電極及び走査
電極同時駆動方式の原理を適用して画像を具現するため
の、ＡＣ型プラズマ表示パネルの８電極グループ駆動波
形図。
【図１７】同じく図１及び図２のアドレス電極及び走査
電極同時駆動方式の原理を適用して画像を具現するため
の、ＡＣ型プラズマ表示パネルの８電極グループ駆動波
形図。
【図１８】図４乃至図１７の８電極グループ駆動信号を
適用するためのＡＣ型プラズマ表示パネルの８電極グル
ープ電極結線図。
【図１９】図１４の８電極グループ駆動のための電極駆
動信号の詳細な波形図。
【図２０】図１４及び図１５のアドレス電極及び走査電
極同時駆動方式の原理を適用して画像を具現するための
ＡＣ型プラズマ表示パネルの８電極グループ駆動波形を
適用するためのＡＣ型プラズマ表示パネルの８電極グル
ープ電極のさらに他の結線図。
【図２１】図１及び図２のアドレス電極及び走査電極同
時駆動方式の原理を適用した非対称パルス印加方式のＡ
Ｃ型プラズマ表示パネルの電極駆動波形図。
【図２２】同じく図１及び図２のアドレス電極及び走査
電極同時駆動方式の原理を適用した非対称パルス印加方
式のＡＣ型プラズマ表示パネルの電極駆動波形図。
【図２３】同じく図１及び図２のアドレス電極及び走査
電極同時駆動方式の原理を適用した非対称パルス印加方
式のＡＣ型プラズマ表示パネルの電極駆動波形図。
【図２４】同じく図１及び図２のアドレス電極及び走査
電極同時駆動方式の原理を適用した非対称パルス印加方
式のＡＣ型プラズマ表示パネルの電極駆動波形図。
【図２５】図２１の非対称パルス印加方式の電極駆動信
号の詳細な波形図。
【図２６】図２５の非対称パルス印加方式を適用したア
ドレス駆動方式の電極駆動信号の詳細な波形図。
【図２７】図１９の８電極グループ駆動信号の他の実施
形態を示す詳細な波形図。
【図２８】一般的なＤＣ型対向放電構造プラズマ表示パ
ネルの概略的な垂直断面図。
【図２９】一般的なＡＣ型面放電構造プラズマ表示パネ
ルの概略的な垂直断面図。
【図３０】図２９のＡＣ型面放電構造プラズマ表示パネ
ルの分解斜視図。
【図３１】図２９のＡＣ型面放電構造プラズマ表示パネ
ルの階調表示方法を説明するための説明図。
【図３２】従来のＡＣ型面放電構造プラズマ表示パネル
の電極結線構造を示す図面。
【図３３】図３２のＡＣ型面放電プラズマ表示パネルの
電極結線構造に従う駆動信号の波形図。
【図３４】アドレス電極及び走査電極同時駆動方式の駆
動波形図。
【図３５】図３４のアドレス電極及び走査電極同時駆動
方式の階調表示方法を説明するための説明図。
【符号の説明】
Ｘｉ 共通電極（Ｘ電極） Ｙｉ 走査電極（Ｙ電極） ＸＸ１、ＸＸ２、ＸＸ３、ＸＸ４ 共通電極群 ３４ａ、３４ｂ、３４ｃ、３４ｄ データパルス ３５ 放電維持パルス（負（正）パルス） ３６ 放電維持パルス ３７ａ、３７ｂ、３７ｃ、３７ｄ 走査パルス ３８ａ、３８ｃ 初期化（ｉｇｎｉｔｅ）パルス

Claims (36)

    【特許請求の範囲】
  1. 【請求項１】 対向する二枚の基板の一側対向面上に平
    行の第１電極及び第２電極の電極対がストライプ状にｋ
    個配置され、前記二枚の基板の他側対向面上に前記第１
    電極及び第２電極の電極対と交差する方向のストライプ
    状にｎ個配置されたｋｘｎマトリックスＡＣ型プラズマ
    表示パネルにおいて、 前記第１電極及び第２電極の電極対から前記第２電極を
    ｍ個ずつ合わせてｐ個の共通結線群を作り、前記第１電
    極は各々個別的に設置されたことを特徴とするＡＣ型プ
    ラズマ表示パネル。
  2. 【請求項２】 前記第１電極及び第２電極の電極対の総
    数ｋ＝ｍ×ｐの関係が成立することを特徴とする請求項
    １に記載のＡＣ型プラズマ表示パネル。
  3. 【請求項３】 前記ｐ個の共通電極群から同じ順序で各
    々一つずつの電極を取って共通結線することによって、
    ｍ個の共通結線群を形成したことを特徴とする請求項１
    に記載のＡＣ型プラズマ表示パネル。
  4. 【請求項４】 対向する二枚の基板の一側対向面上に平
    行した第１電極及び第２電極の電極対がストライプ状に
    ｋ個配置され、前記二つの基板の他側対向面上に前記第
    １電極及び第２電極の電極対と交差する方向のストライ
    プ状に第３電極がｎ個配置されたｋｘｎマトリックスＡ
    Ｃ型プラズマ表示パネルで、前記第１電極及び第２電極
    の電極対から前記第２電極をｍ個ずつ合わせてｐ個の共
    通結線群を作り、前記第１電極は各々個別的に設置し、
    前記第２電極に結線された電極を共通電極とし、前記個
    別的に設置された第１電極を走査電極とする時、一つの
    水平同期時間を複数個の期間に相異なる個数の放電維持
    パルスを順次に印加して、前記複数の期間を選択的に発
    光させて前記第１電極及び第２電極別に階調を具現し
    て、一つのフレームの画像を駆動するＡＣ型プラズマ表
    示パネルの駆動方法において、 （１）前記放電維持パルスの非印加期間にアドレスタイ
    ムスロット期間を設定し、前記各アドレスタイムスロッ
    ト期間の間アドレス電極に複数個のデータパルスを印加
    する段階と、 （２）前記各複数個のデータパルスに相応するように前
    記共通電極群を一つずつ選択して、前記選択された共通
    電極群の共通電極と対を成す前記各走査電極に、前記複
    数個のデータパルスの各々に対応する走査パルスを順次
    に印加する段階と、 を含むことを特徴とするＡＣ型プラズマ表示パネルの駆
    動方法。
  5. 【請求項５】 前記アドレス電極には設定された基準階
    調ビット数と同数の前記アドレスタイムスロットが前記
    各水平同期時間に対応して反復的に印加され、前記各ア
    ドレスタイムスロットに対応して前記各走査電極を順次
    に選択して、各々選択された走査電極の階調表示期間は
    直前の前記選択された走査電極の階調表示期間より１ビ
    ットずつ先行して選択することを特徴とする請求項４に
    記載のＡＣ型プラズマ表示パネルの駆動方法。
  6. 【請求項６】 前記複数個のデータパルスは負パルス
    で、前記放電維持パルスは正パルスであることを特徴と
    する請求項４に記載のＡＣ型プラズマ表示パネルの駆動
    方法。
  7. 【請求項７】 前記複数個のデータパルスは負パルス
    で、前記放電維持パルスは負パルスであることを特徴と
    する請求項４に記載のＡＣ型プラズマ表示パネルの駆動
    方法。
  8. 【請求項８】 前記複数個のデータパルスは正パルス
    で、前記放電維持パルスは正パルスであることを特徴と
    する請求項４に記載のＡＣ型プラズマ表示パネルの駆動
    方法。
  9. 【請求項９】 前記複数個のデータパルスは正パルス
    で、前記放電維持パルスは負パルスであることを特徴と
    する請求項４に記載のＡＣ型プラズマ表示パネルの駆動
    方法。
  10. 【請求項１０】 前記アドレスタイムスロット期間に前
    記選択された共通電極群に障壁電圧を印加して、アドレ
    ス効率を高めることを特徴とする請求項４に記載のＡＣ
    型プラズマ表示パネルの駆動方法。
  11. 【請求項１１】 前記データパルスの幅は２μｓ以下で
    あることを特徴とする請求項４乃至１０のいずれか一つ
    に記載のＡＣ型プラズマ表示パネルの駆動方法。
  12. 【請求項１２】 前記アドレスタイムスロットは前記共
    通電極と走査電極に印加される放電維持パルスとの間の
    非印加期間の位相関係を対称にし、前記二つの放電維持
    パルス非印加期間中前記走査電極に印加される放電維持
    パルスを基準に前記走査パルスより先行する非印加期間
    あるいは前記走査パルスより遅れる非印加期間にだけ備
    わることを特徴とする請求項４に記載のＡＣ型プラズマ
    表示パネルの駆動方法。
  13. 【請求項１３】 前記複数個のデータパルスは負パルス
    で、前記放電維持パルスは正パルスであることを特徴と
    する請求項１２に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  14. 【請求項１４】 前記複数個のデータパルスは負パルス
    で、前記放電維持パルスは負パルスであることを特徴と
    する請求項１２に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  15. 【請求項１５】 前記複数個のデータパルスは正パルス
    で、前記放電維持パルスは正パルスであることを特徴と
    する請求項１２に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  16. 【請求項１６】 前記複数個のデータパルスは正パルス
    で、前記放電維持パルスは負パルスであることを特徴と
    する請求項１２に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  17. 【請求項１７】 前記アドレスタイムスロットは前記共
    通電極と走査電極に印加される放電維持パルスとの間の
    非印加期間の位相関係を対称にし、前記二つの放電維持
    パルス非印加期間中前記走査電極に印加される放電維持
    パルスを基準として、前記走査パルスより先行する非印
    加期間及び前記走査パルスより遅れる非印加期間の全て
    に備わることを特徴とする請求項４に記載のＡＣ型プラ
    ズマ表示パネルの駆動方法。
  18. 【請求項１８】 前記複数個のデータパルスは負パルス
    で、前記放電維持パルスは正パルスであることを特徴と
    する請求項１７に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  19. 【請求項１９】 前記複数個のデータパルスは負パルス
    で、前記放電維持パルスは負パルスであることを特徴と
    する請求項１７に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  20. 【請求項２０】 前記複数個のデータパルスは正パルス
    で、前記放電維持パルスは正パルスであることを特徴と
    する請求項１７に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  21. 【請求項２１】 前記複数個のデータパルスは正パルス
    で、前記放電維持パルスは負パルスであることを特徴と
    する請求項１７に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  22. 【請求項２２】 前記共通電極と走査電極に印加される
    放電維持パルスの間の位相関係を非対称にして、前記放
    電維持パルスの非印加期簡が長い方にアドレスタイムス
    ロットを具備したことを特徴とする請求項４に記載のＡ
    Ｃ型プラズマ表示パネルの駆動方法。
  23. 【請求項２３】 前記複数個のデータパルスは負パルス
    で、前記放電維持パルスは正パルスであることを特徴と
    する請求項２２に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  24. 【請求項２４】 前記複数個のデータパルスは負パルス
    で、前記放電維持パルスは負パルスであることを特徴と
    する請求項２２に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  25. 【請求項２５】 前記複数個のデータパルスは正パルス
    で、前記放電維持パルスは正パルスであることを特徴と
    する請求項２２に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  26. 【請求項２６】 前記複数個のデータパルスは正パルス
    で、前記放電維持パルスは負パルスであることを特徴と
    する請求項２２に記載のＡＣ型プラズマ表示パネルの駆
    動方法。
  27. 【請求項２７】 前記アドレスタイムスロット期間に前
    記選択された共通電極群に障壁電圧を印加してアドレス
    効率を高めることを特徴とする請求項４に記載のＡＣ型
    プラズマ表示パネルの駆動方法。
  28. 【請求項２８】 前記（１）段階の先に、 前記アドレス機能を遂行する前に前記第１及び第２電極
    対に初期化パルスを印加して、前記第１及び第２電極対
    の全体に壁電荷を形成させる段階と、 前記アドレス電極と前記走査電極に各々アドレスパルス
    及び走査パルスを選択的に印加して選択された画素にだ
    け壁電荷を消去する段階と、 をさらに含むことを特徴とする請求項４に記載のＡＣ型
    プラズマ表示パネルの駆動方法。
  29. 【請求項２９】 前記各階調表示パルスの中で最終放電
    維持パルスの幅を他の放電維持パルスの幅より相対的に
    狭くして壁電荷を形成させないようにして、以前の階調
    表示期間に生成された壁電荷を消去することを特徴とす
    る請求項２８に記載のＡＣ型プラズマ表示パネルの駆動
    方法。
  30. 【請求項３０】 前記表示放電維持パルスの最終パルス
    はパルスの幅が２μｓより小さいことを特徴とする請求
    項２９に記載のＡＣ型プラズマ表示パネルの駆動方法。
  31. 【請求項３１】 各階調表示期間中、最終放電維持パル
    スの後に１００μｓｅｃ以下の期間をおいて、壁電荷を
    自然減少させることを特徴とする請求項２８に記載のＡ
    Ｃ型プラズマ表示パネルの駆動方法。
  32. 【請求項３２】 前記（１）段階の先に、 前記アドレス機能を遂行する前に前記第１及び第２電極
    対に初期化パルスを印加して前記第１及び第２電極対の
    全体に壁電荷を消去する段階と、 前記アドレス電極と前記走査電極に各々データパルス及
    び走査パルスを選択的に印加して、選択された画素にだ
    け壁電荷を形成させる段階と、 をさらに含むことを特徴とする請求項４に記載のＡＣ型
    プラズマ表示パネルの駆動方法。
  33. 【請求項３３】 前記各階調表示パルスの中で最終放電
    維持パルスの幅を、他の放電維持パルスの幅より相対的
    に狭くして壁電荷を形成させないことによって、直前の
    階調表示期間に生成された壁電荷を消去させることを特
    徴とする請求項３２に記載のＡＣ型プラズマ表示パネル
    の駆動方法。
  34. 【請求項３４】 前記最終放電維持パルスは幅が２μｓ
    より小さいことを特徴とする請求項３３に記載のＡＣ型
    プラズマ表示パネルの駆動方法。
  35. 【請求項３５】 各階調表示期間中、最終放電維持パル
    スの後に１００μｓｅｃ以下の期間をおいて、壁電荷を
    自然減少させることを特徴とする請求項３３に記載のＡ
    Ｃ型プラズマ表示パネルの駆動方法。
  36. 【請求項３６】 前記アドレスタイムスロットと前記ア
    ドレスタイムスロットに印加される複数個のデータパル
    スを無効化させる休止スロットを交番に具備し、前記休
    止スロットは前記共通電極に印加される初期化パルス期
    間に具備して、前記アドレスタイムスロットに印加され
    たアドレスパルスと同時に印加させないことを特徴とす
    る請求項４に記載のＡＣ型プラズマ表示パネルの駆動方
    法。
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