JPH10303802A - 通信制御装置および方法 - Google Patents

通信制御装置および方法

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JPH10303802A
JPH10303802A JP10121689A JP12168998A JPH10303802A JP H10303802 A JPH10303802 A JP H10303802A JP 10121689 A JP10121689 A JP 10121689A JP 12168998 A JP12168998 A JP 12168998A JP H10303802 A JPH10303802 A JP H10303802A
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communication
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    • H04W52/0287—Power saving arrangements in terminal devices managing power supply demand, e.g. depending on battery level changing the clock frequency of a controller in the equipment
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    • Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
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Abstract

(57)【要約】 【課題】 電子デバイスにおいて用いる通信制御装置を
提供する。 【解決手段】 この通信制御装置は、デバイス，第１お
よび第２通信ライン，およびコントローラを含む。デバ
イスおよびコントローラは、コントローラによって駆動
される第１および第２通信ライン，によって相互接続さ
れる。第１および第２通信ラインは異なる容量を有し、
第１通信ラインはディセーブルされることがある。コン
トローラは、ディセーブルする前に第１通信ラインを利
用してデバイスをプログラムし、また第１通信ラインが
ディセーブル中に、第２通信ラインを介してデバイスを
プログラムする。装置は、マスタ・クロックを含む電子
装置の部分を周期的にパワーオフ状態にすることがで
き、このパワーオフ状態からパワーオン状態に戻ること
が可能である。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、一般に電子デバイスに
関し、さらに詳しくは、電子デバイス内の通信制御に関
する。
【０００２】
【従来の技術】多くの電子デバイスは、バッテリによっ
て駆動される。電力消費を最小限に抑え、かつバッテリ
電力を節約するこれらのバッテリ駆動型電子デバイス
は、電子デバイスの動作時間を延長するのに役立つため
商業的な優位性を有する。従って、バッテリ駆動型デバ
イスによって消費されるエネルギ量を低減するために、
かなりの量の資本と努力が費やされる。
【０００３】無線電話は、バッテリ駆動電子デバイスの
一種類である。時分割多元接続（ＴＤＭＡ）規格に従っ
て動作するような無線装置は、２つの動作モード、すな
わち、制御モードと通信モードとを採用する。制御モー
ドのアクティブな状態では、無線電話は、発呼または着
呼して、通信モードに入るのを待つ間、リモート・デバ
イスからのページング情報を間欠的に受信する。無線電
話が制御モードで（すなわち、アイドル中に）ページン
グ情報を受信しないと、スタンバイ・モードになり、こ
のとき無線電話の一部は電力消費を低減するためにパワ
ーオフ状態にされる。
【０００４】一般にパワーオフ状態にされない無線電話
の一つの部分に、マスタ・クロックがある。マスタ・ク
ロックは、高容量バス上でプログラミングを無線電話の
他の集積回路に通信するために、無線電話におけるコン
トローラによって用いられる高速タイミング基準を与え
る。マスタ・クロックをパワーオフ状態にすると、この
ようなプログラミングをディセーブルし、実際に、無線
電話をディセーブルする。マスタ・クロックがオフのと
き、コントローラは、例えば、スタンバイ状態から抜け
るときにパワー・オン状態に戻るために、プログラミン
グを他の集積回路に通信できない。
【０００５】
【発明が解決しようとする課題】一方、当業者であれ
ば、マスタ・クロックは大きな電力消費の源であること
が理解される。例えば、１３ＭＨｚで動作するシステム
・クロックは、ページング情報を受信しないアイドル期
間中に、１ｍＡもの電流を消費する。従って、電力消費
の節減を最大限にするためには、マスタ・クロックなど
の回路の周期的なパワーオフを可能にする、電子デバイ
スにおける通信制御のための装置および方法が必要とさ
れる。
【０００６】
【実施例】電子デバイスで用いられる通信制御装置は、
デバイスと、第１および第２通信ラインと、コントロー
ラとを含む。集積回路でもよいデバイスと、コントロー
ラとは、コントローラによって駆動される第１および第
２通信ラインによって相互接続される。第１および第２
通信ラインは異なる容量を有し、第１通信ラインはディ
セーブルされることがある。コントローラは、ディセー
ブルする前にこの第１通信ラインを利用してデバイスを
プログラムし、また第１通信ラインがディセーブル中
に、第２通信ラインを介してデバイスをプログラムす
る。このような通信ラインの構成を利用することによ
り、通信制御装置は、マスタ・クロックを含む通信装置
の部分を周期的にパワーオフ状態にすることができ、こ
のパワーオフ状態からパワーオン状態に戻ることが可能
である。
【０００７】図１に示す通信システム１００は、通信リ
ンク１０３を介して通信するリモート通信デバイス１０
１とローカル通信デバイス１０２とによって構成され
る。図示の実施例では、リモートおよびローカル・デバ
イス１０１，１０２は、それぞれ基地局および無線電話
であり、リンク１０３は無線周波数（ＲＦ）信号をな
す。ローカル・デバイス１０２は、アンテナ１０４，Ｒ
Ｆ部１０５，制御部１０６および電源部１０７を含み、
この電源部１０７は好ましくは電源をローカル・デバイ
ス１０２に供給する１つまたはそれ以上のバッテリから
なる。ローカル・デバイス１０２の制御モードおよび通
信モードのアクティブ状態では、リンク１０３のＲＦ信
号はアンテナ１０４で受信され、ＲＦ部１０５によって
受信データおよび音声信号に変換されて、制御部１０６
によって処理され、また制御部１０６において生成され
た送信データおよび音声信号は、ＲＦ部１０５によって
ＲＦ送信信号に変換されて、アンテナ１０４によってリ
ンク１０３のＲＦ信号として発信される。ローカル・デ
バイス１０２の制御モードのスタンバイ状態では、電力
消費を節減するため、制御部１０６およびＲＦ部１０５
の一部がパワーダウンまたはパワーオフ状態にされる ローカル・デバイス１０２は、通信制御装置１０８を含
む。通信制御装置１０８は、ＲＦ部１０５のＲＦトラン
シーバＩＣ１０９と、制御部１０６のコントローラ１１
０と、制御部１０６の電力制御ＩＣ１１１とを含む。Ｒ
ＦトランシーバＩＣ１０９は、リンク１０３のＲＦ信号
の送受信で用いられる合成周波数を生成する。ＲＦトラ
ンシーバＩＣ１０９は、外部から結合された水晶１１３
によって供給されるマスタ・クロック１１２を含む。マ
スタ・クロック１１２は、コントローラ１１０に結合さ
れたライン１１４上で、マスタ・クロック基準ＭＣ＿Ｒ
ＥＦを生成する高速クロックである。図示の実施例で
は、マスタ・クロック１１２によって生成されるマスタ
・クロック基準ＭＣ＿ＲＥＦは、１３ＭＨｚのクロック
信号である。マスタ・クロック１１２を含むＲＦトラン
シーバＩＣ１０９には電源が供給され、電源ライン１１
５を介して電力制御ＩＣ１１１によってパワーオン状態
またはパワーオフ状態にされる。マスタ・クロック１１
２および水晶１１３は、図面ではＲＦトランシーバＩＣ
１０９に内蔵されて示されるが、電力制御ＩＣ１１１に
よって給電される単独の基準発振器回路でも構成できる
ことが当業者に理解される。ＲＦトランシーバＩＣ１０
９は、好ましくはＡＳＩＣ(application specific IC)
デバイスであるが、適切なディスクリート・デバイスに
よって構成してもよい。
【０００８】コントローラ１１０は、ローカル・デバイ
ス１０２の動作を制御するためにプログラミングを通信
する。コントローラ１１０は、好ましくは、Motorola,
Incよって製造・販売される６８３３８マイクロコント
ローラなど、プログラム済みマイクロコントローラ・デ
バイスであるが、他の適切なマイクロプロセッサまたは
ＡＳＩＣデバイスによって構成してもよい。コントロー
ラ１１０は、バス１１６および制御ライン１１７を含む
複数の通信ラインを駆動することによってプログラミン
グを通信する。コントローラ１１０は、ライン１１４を
介して受け取られるマスタ・クロック基準ＭＣ＿ＲＥＦ
によって設定されるレートあるいはマスタ基準クロック
ＭＣ＿ＲＥＦから導出されるレートにて、バス１１６お
よび制御ライン１１７を駆動する。バス１１６は、比較
的大量のプログラミングをＩＣまたは他のデバイスに高
速で通信するのに適した高容量の通信ラインである。図
示の実施例では、バス１１６は、Motorola, Inc.によっ
て製造・販売される無線電話において採用されるような
シリアル・プログラミング・インタフェース（ＳＰＩ：
Serial Programming Interface）をサポートする、３Ｍ
ｂｉｔｓ／秒の容量を有する多重ライン・バスである。
あるいはバス１１６はパラレル・バスでもよいことが当
業者に理解される。マスタ・クロック１１２がパワーオ
フ状態にされ、かつマスタ・クロック基準ＭＣ＿ＲＥＦ
がコントローラ１１０によって用いるためにライン１１
４上にない場合、バス１１６はディセーブルされ、プロ
グラミングを通信するために利用できなくなる。
【０００９】制御ライン１１７は、比較的少量のプログ
ラミングを低速度で通信するのに適した低容量の通信ラ
インである。図示の実施例では、制御ライン１１７は、
スタンバイ制御信号ＳＴＡＮＤＢＹ専用の単一のライン
である。スタンバイ制御信号ＳＴＡＮＤＢＹは、コント
ローラ１１０によってプログラムされることで、論理高
レベルまたは論理低レベルを有する。ＲＦトランシーバ
ＩＣ１０９がパワーオフ状態にされ、かつマスタ・クロ
ック基準ＭＣ＿ＲＥＦがライン１１４上にない場合、コ
ントローラ１１０は、ライン１１８を介して電力制御Ｉ
Ｃ１１１から受けるリアルタイム・クロック基準ＲＴＣ
＿ＲＥＦによって設定されるレートあるいはリアルタイ
ム・クロック基準ＲＴＣ＿ＲＥＦから導出されるレート
にて、制御ライン１１７を介してスタンバイ制御信号Ｓ
ＴＡＮＤＢＹのプログラミングを実行する。
【００１０】電力制御ＩＣ１１１は、一般にレギュレー
タ機能をローカル・デバイス１０２に与える。電力制御
ＩＣ１１１は、バス・インタフェース１２０，リアル・
タイム・クロック回路１３０，レギュレータ１４０，１
４１，レギュレータ制御回路１５０，スイッチング・レ
ギュレータ回路１６５およびスイッチング・レギュレー
タ制御回路１８０を含む。電力制御ＩＣ１１１は、好ま
しくはＡＳＩＣデバイスであるが、適切なディスクリー
ト・デバイスによって構成してもよい。
【００１１】バス・インタフェース１２０は、電力制御
ＩＣ１１１用のプログラミングを受けるためにバス１１
６に結合される。バス・インタフェース１２０は、バス
１１６を介して受けたプログラミングを、電力制御ＩＣ
１１１の内部のバス１２１およびライン１２２，１２
３，１２４，１２５上で出力する。図示の実施例では、
バス１２１はバス１１６と実質的に同様であり、ライン
１２２，１２３，１２４，１２５は、それぞれレギュレ
ータ・スタンバイ信号ＳＴＲ，レギュレータ・イネーブ
ル信号ＥＮＲ，スイッチング・レギュレータ・スタンバ
イ信号ＳＴＳＲおよびスイッチング・レギュレータ・イ
ネーブル信号ＥＮＳＲ専用の単一のラインである。各信
号ＳＴＲ，ＥＮＲ，ＳＴＳＲ，ＥＮＳＲは、論理高レベ
ルまたは論理低レベルを有するようにプログラムされ
る。バス・インタフェース１２０は、シリアル・インタ
フェース，パラレル・インタフェースまたはバス１１６
と整合性のある他のインタフェースである。
【００１２】リアルタイム・クロック回路１３０は、ラ
イン１１８上でリアルタイム・クロック基準ＲＴＣ＿Ｒ
ＥＦを供給し、またライン１３２上で逓倍(multiplied)
リアルタイム・クロック基準ＭＲＴＣ＿ＲＥＦを供給す
る。リアルタイム・クロック１３０は、電力制御ＩＣ１
１１に外部結合された水晶１３１によって供給される。
水晶１３１は、好ましくは、腕時計などで用いられるよ
うな低コストの水晶である。リアルタイム・クロック回
路１３０は、好ましくは、電源部１０７の専用の再充電
可能なコイン・セル型バッテリ（図示せず）によって給
電される。図示の実施例では、リアルタイム・クロック
基準ＲＴＣ＿ＲＥＦは３２ｋＨｚクロック信号であり、
逓倍リアルタイム・クロック基準ＭＲＴＣ＿ＲＥＦの周
波数は、リアルタイム・クロック基準ＲＴＣ＿ＲＥＦの
周波数の約８倍である。
【００１３】レギュレータ１４０，１４１は、電源部１
０７によって給電される線形レギュレータである。レギ
ュレータ１４０，１４１は、それぞれバス１２１に結合
されたプログラミング・ポート１４２，１４３と、それ
ぞれレギュレータ制御回路１５０に結合されたＯＮポー
ト１４４，１４５と、それぞれ電源部１０７に結合され
た電源ポート１４６，１４７と、それぞれ出力ポート１
４８，１４９とを含む。レギュレータ１４０，１４１
は、論理高レベルがＯＮポート１４４，１４５上に存在
するときに、パワーオン状態になる。パワーオン状態で
は、レギュレータ１４０，１４１は、プログラミング・
ポート１４２，１４３にて受けたプログラミングによっ
て構築される。いったん構築されると、レギュレータ１
４０，１４１は、電源ポート１４６，１４７にある入力
電圧ＶＩＮ１およびＶＩＮ２を、出力ポート１４８，１
４９にて調整電圧Ｖ１およびＶ２に変換する。調整電圧
Ｖ１は、ＲＦトランシーバＩＣ１０９と、そこにあるマ
スタ・クロック１１２とをパワーオン状態にするのに十
分な電力を与えるために、電源ライン１１５に結合され
る。調整電圧Ｖ２は、ローカル・デバイス１０２の他の
回路に給電するための追加電力を与える。レギュレータ
１４０，１４１は、論理低レベルがＯＮポート１４４，
１４６にある場合に、パワーオフ状態になる。パワーオ
フ状態では、レギュレータ１４０，１４１はディセーブ
ルされ、調整電圧Ｖ１，Ｖ２を供給しない。この状態で
は、ＲＦトランシーバＩＣ１０９と、そこにあるマスタ
・クロック１１２とはパワーオフ状態にされる。
【００１４】レギュレータ制御回路１５０は、レギュレ
ータ１４０，１４１を選択的にパワーオン状態またはパ
ワーオフ状態にするために、レギュレータ１４０，１４
１，制御ライン１１７およびライン１２２，１２３に結
合される。レギュレータ制御回路１５０は複数の論理ゲ
ートを有し、それにはＡＮＤゲート１５１，１５２およ
びＯＲゲート１５３が含まれる。ＡＮＤゲート１５１
は、スタンバイ制御信号ＳＴＡＮＤＢＹの補数を受ける
ために制御ライン１１７に結合された反転入力ポート１
５４と、レギュレータ・イネーブル信号ＥＮＲを受ける
ためにライン１２３に結合された入力ポート１５５と、
レギュレータ・スタンバイ信号ＳＴＲを受けるためにラ
イン１２２に結合された入力ポート１５６と、出力ポー
ト１５７とを有する。ＡＮＤゲート１５２は、レギュレ
ータ・スタンバイ信号ＳＴＲの補数を受けるためにライ
ン１２２に結合された反転入力ポート１５８と、レギュ
レータ・イネーブル信号ＥＮＲを受けるためにライン１
２３に結合された入力ポート１５９と、出力ポート１６
０とを有する。ＯＲゲート１５３は、ＡＮＤゲート１５
１，１５２の出力ポート１５７，１６０にそれぞれ結合
された入力ポート１６１，１６２と、レギュレータ電源
状態信号ＰＳＲを与えるためにレギュレータ１４０，１
４１のＯＮポート１４４，１４５に結合された出力ポー
ト１６３とを有する。
【００１５】レギュレータ制御回路１５０は、次式によ
って定義される：
【００１６】
【数１】ＰＳＲ＝ＳＴＡＮＤＢＹ反転・ＥＮＲ・ＳＴＲ
＋ＳＴＲ反転・ＥＮＲ 数１は、レギュレータ・イネーブル信号ＥＮＲが論理高
レベルを有し、かつレギュレータ・スタンバイ信号ＳＴ
Ｒが論理低レベルを有するか、スタンバイ制御信号ＳＴ
ＡＮＤＢＹが論理低レベルを有し、かつレギュレータ・
スタンバイ信号ＳＴＲが論理高レベルを有する場合に、
レギュレータ電源状態信号ＰＳＲは論理高レベルを有す
ることを表す。それ以外の場合には、レギュレータ電源
状態信号ＰＳＲは論理低レベルを有する。
【００１７】レギュレータ制御回路１５０は、２つのモ
ードのうちの一方で動作するように構成可能である。第
１モードは、好ましくは、ローカル・デバイス１０２の
制御モード中に採用される。この第１モードでは、レギ
ュレータ制御回路１５０のＡＮＤゲート１５１は、主に
レギュレータ１４０，１４１の制御を促進する。制御モ
ードのアクティブ状態に入ると、レギュレータ１４０，
１４１はコントローラ１１０によってアクティブにさ
れ、コントローラ１１０は、スタンバイ制御信号ＳＴＡ
ＮＤＢＹを論理低レベルに設定する制御ライン１１７を
介し、かつバス１１６，バス・インタフェース１２０お
よびライン１２２，１２３によって定められる経路であ
って、レギュレータ・スタンバイ信号ＳＴＲおよびレギ
ュレータ・イネーブル信号ＥＮＲをそれぞれ論理高レベ
ルに設定する経路を介して、プログラミングをレギュレ
ータ制御回路１５０に通信する。これは、レギュレータ
電源状態信号ＰＳＲを論理高レベルに設定する。
【００１８】制御モードのアクティブ状態からスタンバ
イ状態に遷移すると、コントローラ１１０は、マスタ・
クロック基準ＭＣ＿ＲＥＦによって設定されるレートに
て、制御ライン１１７上のスタンバイ制御信号ＳＴＡＮ
ＤＢＹを論理高レベルに設定する。レギュレータ電源状
態信号ＰＳＲは論理低レベルになり、レギュレータ１４
０，１４１ならびにそれによって給電されるＲＦトラン
シーバＩＣ１０９およびマスタ・クロック１１２をパワ
ーオフ状態にする。マスタ・クロック１１２がパワーオ
フ状態になると、コントローラ１１０はバス１１６を介
して高容量でプログラミングを通信できなくなる。
【００１９】スタンバイ状態からアクティブ状態に遷移
すると、コントローラ１１０は、リアルタイム・クロッ
ク基準ＲＴＣ＿ＲＥＦによって設定されるレートにて、
制御ライン１１７上のスタンバイ制御信号ＳＴＡＮＤＢ
Ｙを論理低レベルに設定する。レギュレータ電源状態信
号ＰＳＲは論理高レベルになり、レギュレータ１４０，
１４１およびＲＦトランシーバＩＣ１０９をパワーオン
状態にする。マスタ・クロック１１２はリスタートさ
れ、バス１１６を介した高容量のプログラミングはイネ
ーブルされる。従って、レギュレータ制御ライン１５０
とともに制御ライン１１７を採用することにより、レギ
ュレータ１４０，１４１と、マスタ・クロック１１２を
含むＲＦトランシーバＩＣ１０９とは、周期的にパワー
オフ状態にすることができ、ローカル・デバイス１０２
の動作に悪影響を及ぼさずに電力消費を節減できる。
【００２０】ローカル・デバイスの通信モード中など、
スタンバイ制御信号ＳＴＡＮＤＢＹから独立して動作す
ることが望ましい場合、レギュレータ制御回路１５０は
第２動作モードを採用する。この第２モードでは、ＡＮ
Ｄゲート１５２はレギュレータ１４０，１４１の制御を
促進する。このモードでは、バス１１６，バス・インタ
フェース１２０およびライン１２２，１２３を介してレ
ギュレータ・イネーブル信号ＥＮＲを論理高レベルにプ
ログラムし、かつレギュレータ・スタンバイ信号ＳＴＲ
を論理低レベルにプログラムすることにより、コントロ
ーラ１１０がレギュレータ電源状態信号ＰＳＲを論理高
レベルに設定すると、レギュレータ１４０，１４１はパ
ワーオン状態にされる。また、レギュレータ・イネーブ
ル信号ＥＮＲを論理低レベルにプログラムし、かつレギ
ュレータ・スタンバイ信号ＳＴＲを論理低レベルにプロ
グラムすることにより、コントローラ１１０がレギュレ
ータ電源状態信号ＰＳＲを論理低レベルに設定すると、
レギュレータはパワーオフ状態にされる。
【００２１】バス１１６および制御ライン１１７の二重
通信経路は、スイッチング・レギュレータ回路１６５で
も有利に利用できる。スイッチング・レギュレータ回路
１６５は、スイッチャ１６６，同期整流器(synchronous
rectifier) １６７，ｐチャネルＭＯＳＦＥＴ(Metal-O
xide-Semiconductor Field-Effect Transistor) １７５
およびショットキー・ダイオード(Schottky diode)／イ
ンダクタ／キャパシタ回路網１７７を含む。スイッチャ
１６６，ＭＯＳＦＥＴ１７５およびショットキー・ダイ
オード／インダクタ／キャパシタ回路網１７７は、全体
でスイッチング・レギュレータを構成する。スイッチャ
１６６は、バス１２１に結合されたプログラミング・ポ
ート１６８と、ライン１３２に結合されたクロック・ポ
ート１７０と、ＭＯＳＦＥＴ１７５に結合された制御ポ
ート１７１と、同期整流器１６７に結合された制御ポー
ト１７２と、スイッチング・レギュレータ回路１６５の
出力ポート１７４に結合されたフィードバック・ポート
１７３とを有する。同期整流器１６７は、制御ポート１
７２に結合されたゲートと、ＭＯＳＦＥＴ１７５に結合
されたドレインと、電力制御ＩＣ１１１の外部の電気グ
ランドに結合されたソースとを有するｎチャネルＭＯＳ
ＦＥＴ１７６によって構成される。ｐチャネルＭＯＳＦ
ＥＴ１７５は、制御ポート１７１に結合されたゲート
と、入力電圧ＶＩＮ３を受けるために電源部１０７に結
合されたドレインと、ＭＯＳＦＥＴ１７５のドレインに
結合されたソースとを有する。電力制御ＩＣ１１１の外
部にあるショットキー・ダイオード／インダクタ／キャ
パシタ回路網１７７は、ＭＯＳＦＥＴ１７５，１７６の
ソース・ドレイン間接続と、スイッチング・レギュレー
タ回路１６５の出力ポート１７４との間で結合される。
【００２２】スイッチャ１６６は、プログラミング・ポ
ート１６８におけるプログラミングに応答して、スイッ
チング・レギュレータ回路１６５を通常モード（バック
・モード(buck mode) ）で動作させる。通常モードで
は、スイッチャ１６６は、ＭＯＳＦＥＴ１７５，１７６
をクロック・ポート１７０で受けた逓倍リアルタイム・
クロック基準ＭＲＴＣ＿ＲＥＦのレートにて交互に導通
するように駆動することによって、同期整流器１６７を
動作させる。これにより、出力電圧Ｖ３は、入力電圧Ｖ
ＩＮ３と、制御ポート１７１において存在する制御信号
のデューティ・サイクルとを乗じたものに等しくなる。
フィードバック・ポート１７３において受けた調整出力
電圧Ｖ３に応答して、スイッチャ１６６は、出力電圧Ｖ
３の所望の電圧レベルを得るために、制御ポート１７１
におけるデューティ・サイクルを調整する。スイッチャ
１６６は、より高い電流レベルにおいて効率を改善し、
かつスイッチング・レギュレータ回路１６５がパルスを
スキップして、スプリアス・エネルギを音声バンド内に
出力することを防ぐために、同期整流器１６７を連続的
に動作させる。このようなスプリアス・エネルギは、ロ
ーカル・デバイス１０２の通信モード中に送受信される
音声信号と干渉する。
【００２３】ローカル・デバイス１０２がスタンバイ状
態のとき、音声信号は送受信されず、従ってスプリアス
・エネルギが干渉するものがないので、同期整流器１６
７は動作させる必要はない。スタンバイ・モード中に電
力消費をさらに抑えるために、スイッチャ１６６は、ス
イッチング・レギュレータ制御回路１８０に結合された
ＯＮポート１６９を含む。スイッチャ１６６は、論理低
レベルがＯＮポート１６９上にある場合に、同期整流器
１６７を連続的に動作させる。スイッチャ１６６は、論
理高レベルがＯＮポート１６９上にある場合に、同期整
流器１６７の動作を中止する。
【００２４】スイッチング・レギュレータ制御回路１８
０は、同期整流器１６７を通常モードで選択的に動作さ
せるために、スイッチング・レギュレータ回路１６５，
制御ライン１７７およびライン１２４，１２５に結合さ
れる。スイッチング・レギュレータ制御回路１８０は、
ＡＮＤゲート１８１，１８２およびＯＲゲート１８３を
含む複数の論理ゲートを有する。ＡＮＤゲート１８１
は、スタンバイ制御信号ＳＴＡＮＤＢＹを受けるために
制御ライン１１７に結合された入力ポート１８４と、ス
イッチング・レギュレータ・スタンバイ信号ＳＴＳＲを
受けるためにライン１２４に結合された入力ポート１８
５と、出力ポート１８６とを有する。ＡＮＤゲート１８
２は、スイッチング・レギュレータ・スタンバイ信号Ｓ
ＴＳＲの補数を受けるためにライン１２４に結合された
反転入力ポート１８７と、スイッチング・レギュレータ
・イネーブル信号ＥＮＳＲを受けるためにライン１２５
に結合された入力ポート１８８と、出力ポート１８９と
を有する。ＯＲゲート１８３は、ＡＮＤゲート１８１，
１８２の出力ポート１８６，１８９にそれぞれ結合され
た入力ポート１９０，１９１と、スイッチング・レギュ
レータ電源状態信号ＰＳＳＲを与えるためにスイッチャ
１６６のＯＮポート１６９に結合された出力ポート１９
２とを有する。
【００２５】スイッチング・レギュレータ制御回路１８
０は、次式によって定義される：
【００２６】
【数２】ＰＳＳＲ＝ＳＴＡＮＤＢＹ・ＳＴＳＲ＋ＥＮＳ
Ｒ・ＳＴＳＲ反転 数２は、スタンバイ制御信号ＳＴＡＮＤＢＹが論理高レ
ベルを有し、かつレギュレータ・スタンバイ信号ＳＴＳ
Ｒが論理高レベルを有し、あるいはスイッチング・レギ
ュレータ・イネーブル信号ＥＮＳＲが論理高レベルを有
し、かつスイッチング・レギュレータ・スタンバイ信号
ＳＴＳＲが論理低レベルを有する場合に、スイッチング
・レギュレータ電源状態信号ＰＳＳＲは論理高レベルを
有することを表す。それ以外の場合には、スイッチング
・レギュレータ電源状態信号ＰＳＳＲは論理低レベルを
有する。
【００２７】スイッチング・レギュレータ制御回路１８
０は、２つのモードのうちの一方で動作するように構成
可能である。ローカル・デバイス１０２の制御モード中
に好ましくは採用される第１モードでは、ＡＮＤゲート
１８１はスイッチング・レギュレータ回路１６５の制御
を促進する。コントローラ１１０は、スタンバイ制御信
号ＳＴＡＮＤＢＹを論理低レベルに設定する制御ライン
１１７を介し、かつバス１１６，バス・インタフェース
１２０およびライン１２４よって定められる経路であっ
て、スイッチング・レギュレータ・スタンバイ信号ＳＴ
ＳＲを論理高レベルに設定する経路を介して、プログラ
ミングをスイッチング・レギュレータ制御回路１８０に
通信する。これは、スイッチング・レギュレータ電源状
態信号ＰＳＳＲを論理低レベルに設定し、これは同期整
流器１６７をパワーオン状態にして、同期整流器１６７
が動作することを可能にする。上で説明したように、ス
タンバイ状態に入るために、コントローラ１１０が制御
ライン１１７上のスタンバイ制御信号ＳＴＡＮＤＢＹを
論理高レベルに設定すると、スイッチング・レギュレー
タ電源状態信号ＰＳＳＲは論理高レベルになる。これ
は、同期整流器１６７をパワーオフ状態にし、パルス・
スキップを可能にする。上で説明したように、スタンバ
イ状態から出るために、コントローラ１１０が制御ライ
ン１１７上のスタンバイ制御信号ＳＴＡＮＤＢＹを論理
低レベルに設定すると、スイッチング・レギュレータ電
源状態信号ＰＳＳＲは論理高レベルになり、同期整流器
１６７は動作する。従って、スイッチング・レギュレー
タ制御回路１８０とともに制御ライン１１７を利用する
ことによって、同期整流器１６７は周期的にパワーオフ
状態にすることができ、ローカル・デバイス１０２の動
作に悪影響を及ぼさずに電力消費を節減できる。
【００２８】ローカル・デバイスの通信モード中など、
スタンバイ制御信号ＳＴＡＮＤＢＹから独立して動作す
ることが望ましい場合、スイッチング・レギュレータ制
御回路１８０は第２動作モードを採用する。第２モード
では、ＡＮＤゲート１８２はスイッチング・レギュレー
タ回路１６５の制御を促進する。このモードでは、バス
１１６，バス・インタフェース１２０およびライン１２
４，１２５を介してスイッチング・レギュレータ・イネ
ーブル信号ＥＮＲを論理高レベルにプログラムし、かつ
スイッチング・レギュレータ・スタンバイ信号ＳＴＲを
論理低レベルにプログラムすることによって、コントロ
ーラ１１０がスイッチング・レギュレータ電源状態信号
ＰＳＳＲを論理高レベルに設定すると、同期整流器１６
７はパワーオフ状態にされる。また、スイッチング・レ
ギュレータ・イネーブル信号ＥＮＲを論理低レベルにプ
ログラムし、かつスイッチング・レギュレータ・スタン
バイ信号ＳＴＲを論理低レベルにプログラムすることに
より、コントローラ１１０がスイッチング・レギュレー
タ電源状態信号ＰＳＳＲを論理低レベルに設定すると、
同期整流器１６７はパワーオン状態にされる。
【００２９】以上、高容量ラインがディセーブルされる
ときに、プログラミングを低容量ライン上で通信するこ
とにより、通信制御装置は電子デバイスの節電を向上で
きることがわかる。一つまたはそれ以上のレギュレー
タ，マスタ・クロックおよび同期整流器を含む電子デバ
イスの部分は、パワーオフ状態にすることができ、この
パワーオフ状態からパワーオン状態に戻ることは、電子
デバイスの動作を中断せずに可能である。
【図面の簡単な説明】
【図１】通信制御装置を利用する電子デバイスを採用す
る通信システムを示す部分的なブロック図および部分的
な概略図である。
【符号の説明】
１００ 通信システム １０１ リモート通信デバイス １０２ ローカル通信デバイス １０３ 通信リンク １０４ アンテナ １０５ ＲＦ部 １０６ 制御部 １０７ 電源部 １０８ 通信制御装置 １０９ ＲＦトランシーバＩＣ １１０ コントローラ １１１ 電力制御ＩＣ １１２ マスタ・クロック １１３ 水晶 １１４ ライン １１５ 電源ライン １１６ バス １１７ 制御ライン １１８ ライン １２０ バス・インタフェース １２１ バス １２２，１２３，１２４，１２５ ライン １３０ リアル・タイム・クロック回路 １３１ 水晶 １３２ ライン １４０，１４１ レギュレータ １４２，１４３ プログラミング・ポート １４４，１４５ ＯＮポート １４６，１４７ 電源ポート １４８，１４９ 出力ポート １５０ レギュレータ制御回路 １５１，１５２ ＡＮＤゲート １５３ ＯＲゲート １５４ 反転入力ポート １５５，１５６ 入力ポート １５７ 出力ポート １５８ 反転入力ポート １５９ 入力ポート １６０ 出力ポート １６１，１６２ 入力ポート １６３ 出力ポート １６５ スイッチング・レギュレータ回路 １６６ スイッチャ １６７ 同期整流器 １６８ プログラミング・ポート １６９ ＯＮポート １７０ クロック・ポート １７１，１７２ 制御ポート １７３ フィードバック・ポート １７４ 出力ポート １７５ ｐチャネルＭＯＳＦＥＴ １７６ ｎチャネルＭＯＳＦＥＴ １７７ ショットキー・ダイオード／インダクタ／キャ
パシタ回路網 １８０ スイッチング・レギュレータ制御回路 １８１，１８２ ＡＮＤゲート １８３ ＯＲゲート １８４，１８５ 入力ポート １８６ 出力ポート １８７ 反転入力ポート １８８ 入力ポート １８９ 出力ポート １９０，１９１ 入力ポート １９２ 出力ポート

Claims (10)

    【特許請求の範囲】
  1. 【請求項１】 通信制御装置（１０８）であって：デバ
    イス（１１１）；前記デバイスに結合された第１通信ラ
    イン（１１６）であって、第１容量を有し、かつディセ
    ーブルされることがある第１通信ライン（１１６）；前
    記デバイスに結合された第２通信ライン（１１７）であ
    って、前記第１容量とは異なる第２容量を有する第２通
    信ライン（１１７）；および前記第１および第２通信ラ
    インを駆動するコントローラ（１１０）であって、前記
    コントローラは、前記第１通信ラインをディセーブルす
    る前に前記第１通信ラインを介して前記デバイスをプロ
    グラムし、かつ前記コントローラは、前記第１通信ライ
    ンがディセーブル中に、前記第２通信ラインを介して前
    記デバイスをプログラムする、コントローラ（１１
    ０）；によって構成されることを特徴とする通信制御装
    置（１０８）。
  2. 【請求項２】 前記第１通信ラインは、多重ライン・バ
    スであり、および前記第２通信ラインは、単一のライン
    であることを特徴とする請求項１記載の装置。
  3. 【請求項３】 前記デバイスは：レギュレータ（１４
    ０）と、 前記レギュレータ，前記第１通信ラインおよび前記第２
    通信ラインに結合されたレギュレータ制御回路（１５
    ０）であって、前記レギュレータ制御回路は、前記第１
    および第２通信ライン上のプログラミングに応答して、
    前記レギュレータをパワーオフ状態にし、かつ前記レギ
    ュレータ制御回路は、前記第２通信ラインを介するプロ
    グラミングに応答して、前記レギュレータをパワーオン
    状態にする、レギュレータ制御回路（１５０）；によっ
    て構成されることを特徴とする請求項１記載の装置。
  4. 【請求項４】 前記レギュレータ制御回路は、第１およ
    び第２ＡＮＤゲート（１５１，１５２）と、ＯＲゲート
    （１５３）とによって構成され、前記第１ＡＮＤゲート
    は、第１，第２および第３入力（１５４〜１５６）と、
    第１出力（１５７）とを有し、前記第１入力は反転さ
    れ、かつ前記第２通信ラインに結合され、前記第２入力
    はスタンバイ信号を受けるために前記第１通信ラインに
    結合され、前記第３入力はイネーブル信号を受けるため
    に前記第１通信ラインに結合され、また第２ＡＮＤゲー
    トは、第４および第５入力（１５８，１５９）と、第２
    出力（１６０）とを有し、前記第４入力は反転され、か
    つ前記第３入力に結合され、前記第５入力は前記第２入
    力に結合され、前記ＯＲゲートは、第６および第７入力
    （１６１，１６２）と、第３出力（１６３）とを有し、
    前記第６入力は前記第１出力に結合され、前記第７入力
    は前記第２出力に結合され、前記第３出力は前記レギュ
    レータに結合されることを特徴とする請求項１記載の装
    置。
  5. 【請求項５】 前記デバイスはレギュレータ（１４０）
    からなり、さらに、前記コントローラおよび前記レギュ
    レータに結合された第１クロック（１１２）であって、
    前記レギュレータによって電力が供給される、第１クロ
    ック（１１２）と、 前記コントローラに結合された第２クロック（１３０）
    と、 を含んで構成されることを特徴とする請求項１記載の装
    置。
  6. 【請求項６】 前記レギュレータは、前記第１および第
    ２通信ラインに結合され、および前記コントローラは、
    前記第１クロックをパワーオフ状態にするために、前記
    第１クロックによって設定されるレートにて前記第１お
    よび第２通信ライン上でプログラミングを通信し、その
    後、前記コントローラは、前記第１クロックをパワーオ
    ン状態にするために、前記第２クロックによって設定さ
    れるレートにて前記第２通信ライン上でプログラミング
    を通信することを特徴とする請求項５記載の装置。
  7. 【請求項７】 前記デバイスは、 同期整流器（１６７）を有するスイッチング・レギュレ
    ータ回路（１６５）と、 前記スイッチング・レギュレータ回路，前記第１通信ラ
    インおよび前記第２通信ラインに結合されたスイッチン
    グ・レギュレータ制御回路（１８０）であって、前記ス
    イッチング・レギュレータ制御回路は、前記第１および
    第２通信ライン上のプログラミングに応答して、同期整
    流器をパワーオフ状態にし、また前記スイッチング・レ
    ギュレータ制御回路は、前記第２通信ラインを介するプ
    ログラミングに応答して、前記同期整流器をパワーオン
    状態にする、スイッチング・レギュレータ制御回路（１
    ８０）とによって構成されることを特徴とする請求項１
    記載の装置。
  8. 【請求項８】 前記スイッチング・レギュレータ制御回
    路は、第１および第２ＡＮＤゲート（１８１，１８２）
    と、ＯＲゲート（１８３）とによって構成され、前記第
    １ＡＮＤゲートは、第１および第２入力（１８４，１８
    ５）と、第１出力（１８６）とを有し、前記第１入力は
    前記第２通信ラインに結合され、前記第２入力はスタン
    バイ信号を受けるために前記第１通信ラインに結合さ
    れ、前記第２ＡＮＤゲートは、第３および第４入力（１
    ８７，１８８）と、第２入力（１８９）とを有し、前記
    第３入力は反転され、かつ前記第２入力に結合され、前
    記第４入力はイネーブル信号を受けるために前記第１通
    信ラインに結合され、前記ＯＲゲートは第５および第６
    入力（１９０，１９１）と、第３入力（１９２）とを有
    し、前記第５入力は前記第１出力に結合され、前記第６
    入力は前記第２出力に結合され、前記第３出力は前記ス
    イッチング・レギュレータ回路に結合されることを特徴
    とする請求項７記載の装置。
  9. 【請求項９】 通信制御方法であって：第１容量を有す
    る第１通信ライン（１１６）上で通信する段階；前記第
    １通信ラインをディセーブルする段階；および前記第１
    容量とは異なる第２容量を有する第２通信ライン（１１
    ７）上で通信する段階；によって構成されることを特徴
    とする方法。
  10. 【請求項１０】 前記第１通信ライン上で通信する前記
    段階は、第１クロック（１１２）によって設定される第
    １レートにて前記第１通信ライン上で通信するサブ段階
    からなり、および前記第２通信ライン上で通信する前記
    段階は、第２クロック（１３０）によって設定される第
    ２レートにて前記第２通信ライン上で通信するサブ段階
    であって、前記第２レートは前記第１レートとは異な
    る、サブ段階からなることを特徴とする請求項９記載の
    方法。
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