JPH098580A - 再生イコライザ回路 - Google Patents
再生イコライザ回路Info
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- JPH098580A JPH098580A JP7175375A JP17537595A JPH098580A JP H098580 A JPH098580 A JP H098580A JP 7175375 A JP7175375 A JP 7175375A JP 17537595 A JP17537595 A JP 17537595A JP H098580 A JPH098580 A JP H098580A
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Abstract
(57)【要約】
【目的】 半導体集積回路化を実現した再生イコライザ
回路を提供する。 【構成】 磁気ヘッドからの音声再生信号を受ける第１
の演算増幅回路の帰還ループに、第２の演算増幅回路を
用いて構成された容量増倍回路を設けて再生イコライザ
回路を構成する。 【効果】 再生イコライザ回路を帰還回路を含めて半導
体集積回路に内蔵させることができる。
回路を提供する。 【構成】 磁気ヘッドからの音声再生信号を受ける第１
の演算増幅回路の帰還ループに、第２の演算増幅回路を
用いて構成された容量増倍回路を設けて再生イコライザ
回路を構成する。 【効果】 再生イコライザ回路を帰還回路を含めて半導
体集積回路に内蔵させることができる。
Description
【０００１】
【産業上の利用分野】この発明は、再生イコライザ回路
に関し、特にカセットテープレコーダにおける磁気ヘッ
ドからの音声信号の信号処理を行う再生系の半導体集積
回路装置に搭載される再生イコライザ回路に利用して有
効な技術に関するものである。
に関し、特にカセットテープレコーダにおける磁気ヘッ
ドからの音声信号の信号処理を行う再生系の半導体集積
回路装置に搭載される再生イコライザ回路に利用して有
効な技術に関するものである。
【０００２】
【従来の技術】カセットテープレコーダにおいては、再
生イコライザ回路が設けられる。この再生イコライザ回
路においては、磁気ヘッド１からの信号が演算増幅回路
の非反転入力端子（＋）に供給され、かかる演算増幅回
路の非反転入力端子（−）と出力との間には、直流的な
利得設定を行う抵抗Ｒ１とＲ２からなる帰還回路が設け
られる。また、ノーマルテープ及びクロム／メタルテー
プに応じてイコライジング特性を実現するために抵抗と
コンデンサとからなる交流的な帰還回路が設けられる。
生イコライザ回路が設けられる。この再生イコライザ回
路においては、磁気ヘッド１からの信号が演算増幅回路
の非反転入力端子（＋）に供給され、かかる演算増幅回
路の非反転入力端子（−）と出力との間には、直流的な
利得設定を行う抵抗Ｒ１とＲ２からなる帰還回路が設け
られる。また、ノーマルテープ及びクロム／メタルテー
プに応じてイコライジング特性を実現するために抵抗と
コンデンサとからなる交流的な帰還回路が設けられる。
【０００３】上記のような再生信号は、音声信号のよう
に比較的低い周波数であるために、上記抵抗とコンデン
サとらなる時定数回路は比較的大きくされる。すなわ
ち、低域時定数を３１８０μｓｅｃ、高域時定数を１２
０μｓｅｃといったノーマルテープに適したイコライジ
ング特性を得る場合、１２ＫΩの抵抗と０．０１μＦの
コンデンサが必要になる。上記のような比較的大きな容
量値のコンデンサを半導体集積回路に内蔵させることは
実質的に不可能となり、外付部品点数とそれに対応した
ピン数が増大してしまうという問題がある。一般にカセ
ットテープレコーダは、ステレオ再生を行うので上記外
付部品点数が２倍にもなり、それに伴い実装スペースや
組み立て工数の増加ももたらしてしまう。
に比較的低い周波数であるために、上記抵抗とコンデン
サとらなる時定数回路は比較的大きくされる。すなわ
ち、低域時定数を３１８０μｓｅｃ、高域時定数を１２
０μｓｅｃといったノーマルテープに適したイコライジ
ング特性を得る場合、１２ＫΩの抵抗と０．０１μＦの
コンデンサが必要になる。上記のような比較的大きな容
量値のコンデンサを半導体集積回路に内蔵させることは
実質的に不可能となり、外付部品点数とそれに対応した
ピン数が増大してしまうという問題がある。一般にカセ
ットテープレコーダは、ステレオ再生を行うので上記外
付部品点数が２倍にもなり、それに伴い実装スペースや
組み立て工数の増加ももたらしてしまう。
【０００４】この発明の目的は、半導体集積回路化を実
現した再生イコライザ回路を提供することにある。この
発明の前記ならびにそのほかの目的と新規な特徴は、本
明細書の記述および添付図面から明らかになるであろ
う。
現した再生イコライザ回路を提供することにある。この
発明の前記ならびにそのほかの目的と新規な特徴は、本
明細書の記述および添付図面から明らかになるであろ
う。
【０００５】
【課題を解決するための手段】本願において開示される
発明のうち代表的なものの概要を簡単に説明すれば、下
記の通りである。すなわち、磁気ヘッドからの音声再生
信号を受ける第１の演算増幅回路の帰還ループに、第２
の演算増幅回路を用いて構成された容量増倍回路を設け
て再生イコライザ回路を構成する。
発明のうち代表的なものの概要を簡単に説明すれば、下
記の通りである。すなわち、磁気ヘッドからの音声再生
信号を受ける第１の演算増幅回路の帰還ループに、第２
の演算増幅回路を用いて構成された容量増倍回路を設け
て再生イコライザ回路を構成する。
【０００６】
【作用】上記した手段によれば、再生イコライザ回路を
帰還回路を含めて半導体集積回路に内蔵させることがで
きる。
帰還回路を含めて半導体集積回路に内蔵させることがで
きる。
【０００７】
【実施例】図１には、この発明に係る再生イコライザ回
路の一実施例の概略回路図が示されている。同図の各回
路素子は、ノイズリダクション回路等の信号処理を行う
回路とともに公知の半導体集積回路の製造技術により、
単結晶シリコンのような１個の半導体基板上において形
成される。
路の一実施例の概略回路図が示されている。同図の各回
路素子は、ノイズリダクション回路等の信号処理を行う
回路とともに公知の半導体集積回路の製造技術により、
単結晶シリコンのような１個の半導体基板上において形
成される。
【０００８】同図において、１は磁気ヘッドであり、当
然に外付部品により構成される。この磁気ヘッドは外部
端子Ｐ１を介して半導体集積回路内に形成された第１の
演算増幅回路２の非反転入力端子（＋）に接続される。
この演算増幅回路２の反転入力端子（−）と出力端子Ｏ
ＵＴとの間には、直流利得を設定するための抵抗Ｒ１と
Ｒ２が設けられる。つまり、上記反転入力端子（−）と
回路の接地電位との間には、基準抵抗Ｒ１が設けられ、
上記反転入力端子（−）と出力端子ＯＵＴとの間には帰
還抵抗Ｒ２が設けられる。
然に外付部品により構成される。この磁気ヘッドは外部
端子Ｐ１を介して半導体集積回路内に形成された第１の
演算増幅回路２の非反転入力端子（＋）に接続される。
この演算増幅回路２の反転入力端子（−）と出力端子Ｏ
ＵＴとの間には、直流利得を設定するための抵抗Ｒ１と
Ｒ２が設けられる。つまり、上記反転入力端子（−）と
回路の接地電位との間には、基準抵抗Ｒ１が設けられ、
上記反転入力端子（−）と出力端子ＯＵＴとの間には帰
還抵抗Ｒ２が設けられる。
【０００９】この実施例では、上記のような帰還抵抗Ｒ
１やＲ２とともに、所望のイコライジング特性を得るた
めに、上記演算増幅回路２の反転入力端子（−）と出力
端子ＯＵＴとの間には、交流帰還回路３が設けられる。
この交流帰還回路３は、半導体集積回路に形成可能な素
子を用いて上記音声信号に対応した比較的大きな時定数
を実現するために、抵抗Ｒ３と容量増倍回路５が用いら
れる。例えば、前記のようなノーマルテープに適したイ
コライジング特性を得る場合、低域時定数が３１８０μ
ｓｅｃとなり、高域時定数が１２０μｓｅｃとなるよう
に抵抗Ｒ３の抵抗値と容量倍増回路５による等価容量値
とが設定される。
１やＲ２とともに、所望のイコライジング特性を得るた
めに、上記演算増幅回路２の反転入力端子（−）と出力
端子ＯＵＴとの間には、交流帰還回路３が設けられる。
この交流帰還回路３は、半導体集積回路に形成可能な素
子を用いて上記音声信号に対応した比較的大きな時定数
を実現するために、抵抗Ｒ３と容量増倍回路５が用いら
れる。例えば、前記のようなノーマルテープに適したイ
コライジング特性を得る場合、低域時定数が３１８０μ
ｓｅｃとなり、高域時定数が１２０μｓｅｃとなるよう
に抵抗Ｒ３の抵抗値と容量倍増回路５による等価容量値
とが設定される。
【００１０】なお、上記のように再生イコライザ回路に
おいて、ノーマルテープとクロム／メタルテープとの両
方に適用できるようにするためには、後述するようにク
ロム／メタルテープに対応した低域時定数と高域時定数
とを持つような交流帰還回路が設けられ、スイッチによ
り切り替えられるようにされる。
おいて、ノーマルテープとクロム／メタルテープとの両
方に適用できるようにするためには、後述するようにク
ロム／メタルテープに対応した低域時定数と高域時定数
とを持つような交流帰還回路が設けられ、スイッチによ
り切り替えられるようにされる。
【００１１】図２には、上記容量増倍回路の一実施例の
回路図が示されている。入力端子Ｖinの信号は、一方に
おいて抵抗Ｒ５とキャパシタ（コンデンサ）Ｃ２からな
る時定数回路を介して第２の演算増幅回路６の非反転入
力端子（＋）に供給される。この演算増幅回路の出力Ｖ
out と反転入力端子（−）との間は直接接続されて、１
００％の負帰還がかけられる。そして、上記入力端子Ｖ
inの信号は他方において抵抗Ｒ４を介して上記演算増幅
回路６の反転入力端子（−）に伝えられる。上記抵抗Ｒ
４，Ｒ５及びキャパシタＣ２は、演算増幅回路とともに
半導体集積回路に形成される。
回路図が示されている。入力端子Ｖinの信号は、一方に
おいて抵抗Ｒ５とキャパシタ（コンデンサ）Ｃ２からな
る時定数回路を介して第２の演算増幅回路６の非反転入
力端子（＋）に供給される。この演算増幅回路の出力Ｖ
out と反転入力端子（−）との間は直接接続されて、１
００％の負帰還がかけられる。そして、上記入力端子Ｖ
inの信号は他方において抵抗Ｒ４を介して上記演算増幅
回路６の反転入力端子（−）に伝えられる。上記抵抗Ｒ
４，Ｒ５及びキャパシタＣ２は、演算増幅回路とともに
半導体集積回路に形成される。
【００１２】この実施例の容量増倍回路における容量増
倍の原理は次の通りである。入力端子Ｖinから見たイン
ピーダンスをＺとおくと、次式（１）と（２）が成立す
る。演算増幅回路６においてはその非反転入力端子
（＋）の信号電圧と反転入力端子（−）の信号電圧とは
等しくなるように動作し、上記のように反転入力端子
（−）には、出力電圧Ｖout が１００％帰還されるか
ら、 （Ｖin−Ｖout ）／Ｒ５＝ｊω・Ｃ２・Ｖout ・・・・・・・・（１） Ｖin／Ｚ＝（Ｖin−Ｖout ）／Ｒ４＋（Ｖin−Ｖout ）／Ｒ５ ・・（２） 上記式（１）と（２）からＺは、次式（３）で表すこと
ができる。 Ｚ＝（Ｒ４・Ｒ５）／（Ｒ４＋Ｒ５）＋Ｒ４／ｊω・Ｃ２・（Ｒ４＋Ｒ５） ・・（３） したがって、入力端子ＶinからみたインピーダンスＺ
は、等価直列抵抗Ｒ４・Ｒ５／（Ｒ４＋Ｒ５）を有し、
容量Ｃ２が等価的に（Ｒ４＋Ｒ５）／Ｒ４倍されたもの
となる。
倍の原理は次の通りである。入力端子Ｖinから見たイン
ピーダンスをＺとおくと、次式（１）と（２）が成立す
る。演算増幅回路６においてはその非反転入力端子
（＋）の信号電圧と反転入力端子（−）の信号電圧とは
等しくなるように動作し、上記のように反転入力端子
（−）には、出力電圧Ｖout が１００％帰還されるか
ら、 （Ｖin−Ｖout ）／Ｒ５＝ｊω・Ｃ２・Ｖout ・・・・・・・・（１） Ｖin／Ｚ＝（Ｖin−Ｖout ）／Ｒ４＋（Ｖin−Ｖout ）／Ｒ５ ・・（２） 上記式（１）と（２）からＺは、次式（３）で表すこと
ができる。 Ｚ＝（Ｒ４・Ｒ５）／（Ｒ４＋Ｒ５）＋Ｒ４／ｊω・Ｃ２・（Ｒ４＋Ｒ５） ・・（３） したがって、入力端子ＶinからみたインピーダンスＺ
は、等価直列抵抗Ｒ４・Ｒ５／（Ｒ４＋Ｒ５）を有し、
容量Ｃ２が等価的に（Ｒ４＋Ｒ５）／Ｒ４倍されたもの
となる。
【００１３】図３には、この発明に係る再生イコライザ
回路の一実施例の具体的回路図が示されている。この実
施例の各回路素子における数値は、前記ノーマルテープ
に向けられたイコライジング特性に合わせて設定された
場合である。抵抗Ｒ１とＲ２は、３３０ＫΩと１７０Ω
とされて直流利得が設定される。また、上記容量増倍回
路５は、抵抗Ｒ４が２ＫΩ、Ｒ５が５８ＫΩ、キャパシ
タＣ２が３３３ｐＦに設定される。このように容量Ｃ２
が３３３ｐＦのように、前記のような０．０１μＦのコ
ンデンサに比べて１／３０のような小さな容量値を用い
つつ、上記抵抗（Ｒ４＋Ｒ５）／Ｒ４により３０倍に増
倍するとともに、上記の等価直列抵抗（Ｒ４・Ｒ５）／
（Ｒ４＋Ｒ５）が１．９９３ＫΩであることから、抵抗
Ｒ３を１０．０７ＫΩとして前記１２ＫΩの抵抗値を得
るものである。これにより、半導体集積回路に形成され
た抵抗を用いつつ、前記同様に低域時定数を３１８０μ
ｓｅｃに、高域時定数を１２０μｓｅｃにすることがで
きる。
回路の一実施例の具体的回路図が示されている。この実
施例の各回路素子における数値は、前記ノーマルテープ
に向けられたイコライジング特性に合わせて設定された
場合である。抵抗Ｒ１とＲ２は、３３０ＫΩと１７０Ω
とされて直流利得が設定される。また、上記容量増倍回
路５は、抵抗Ｒ４が２ＫΩ、Ｒ５が５８ＫΩ、キャパシ
タＣ２が３３３ｐＦに設定される。このように容量Ｃ２
が３３３ｐＦのように、前記のような０．０１μＦのコ
ンデンサに比べて１／３０のような小さな容量値を用い
つつ、上記抵抗（Ｒ４＋Ｒ５）／Ｒ４により３０倍に増
倍するとともに、上記の等価直列抵抗（Ｒ４・Ｒ５）／
（Ｒ４＋Ｒ５）が１．９９３ＫΩであることから、抵抗
Ｒ３を１０．０７ＫΩとして前記１２ＫΩの抵抗値を得
るものである。これにより、半導体集積回路に形成され
た抵抗を用いつつ、前記同様に低域時定数を３１８０μ
ｓｅｃに、高域時定数を１２０μｓｅｃにすることがで
きる。
【００１４】図４には、この発明に係る再生イコライザ
回路の他の一実施例の概略回路図が示されている。カセ
ットテープレコーダに搭載される再生イコライザ回路で
は、ノーマルテープとクロム／メタルテープの両方に適
用できるように設計されるのが一般的である。それ故、
ノーマルテープ用の帰還回路３ａとクロム／メタルテー
プ用の帰還回路３ｂが設けられる。そして、スイッチＳ
Ｗによりノーマルテープからの再生信号ではスイッチＳ
Ｗを接点ａ側に接続してノーマルテープ用のイコライジ
ング特性を実現し、クロム／メタルテープからの再生信
号ではスイッチＳＷを接点ｂ側に切り替えてクロム／メ
タルテープ用のイコライジング特性を実現するものであ
る。
回路の他の一実施例の概略回路図が示されている。カセ
ットテープレコーダに搭載される再生イコライザ回路で
は、ノーマルテープとクロム／メタルテープの両方に適
用できるように設計されるのが一般的である。それ故、
ノーマルテープ用の帰還回路３ａとクロム／メタルテー
プ用の帰還回路３ｂが設けられる。そして、スイッチＳ
Ｗによりノーマルテープからの再生信号ではスイッチＳ
Ｗを接点ａ側に接続してノーマルテープ用のイコライジ
ング特性を実現し、クロム／メタルテープからの再生信
号ではスイッチＳＷを接点ｂ側に切り替えてクロム／メ
タルテープ用のイコライジング特性を実現するものであ
る。
【００１５】このように出力側にスイッチを設けるもの
他に、入力側にスイッチを設けて切り替えを行うもの、
あるいは入力側と出力側の両方にスイッチを設けてそれ
ぞれ切り替えるようにするものであってもよい。あるい
は、固定的に形成された帰還回路に、並列的に帰還回路
を接続して上記のような２通りの周波数特性を実現する
ようにしてもよい。
他に、入力側にスイッチを設けて切り替えを行うもの、
あるいは入力側と出力側の両方にスイッチを設けてそれ
ぞれ切り替えるようにするものであってもよい。あるい
は、固定的に形成された帰還回路に、並列的に帰還回路
を接続して上記のような２通りの周波数特性を実現する
ようにしてもよい。
【００１６】上記のように直流利得を決定する抵抗Ｒ
１，Ｒ２を含めて帰還回路を構成する素子を半導体集積
回路に内蔵するようにしたことにより、再生イコライザ
回路での外付部品点数を無くすことができる。これに伴
い、外部端子も磁気ヘッドを接続するための入力端子Ｐ
１のみとなる。このような部品点数の削減により、実装
スペースの小型化、組み立て工数の削減等が相乗的に作
用してカセットテープレコーダ等の大幅な小型軽量化と
コストの低減が期待できる。特に、イヤホーンで再生音
を聞くポータブル型の再生専用装置においては、カセッ
トテープとほぼ同じ大きさの極限まで小型軽量化が望ま
れているから、上記のような再生イコライザ回路が半導
体集積回路に全て内蔵できることの意義は大きくなる。
１，Ｒ２を含めて帰還回路を構成する素子を半導体集積
回路に内蔵するようにしたことにより、再生イコライザ
回路での外付部品点数を無くすことができる。これに伴
い、外部端子も磁気ヘッドを接続するための入力端子Ｐ
１のみとなる。このような部品点数の削減により、実装
スペースの小型化、組み立て工数の削減等が相乗的に作
用してカセットテープレコーダ等の大幅な小型軽量化と
コストの低減が期待できる。特に、イヤホーンで再生音
を聞くポータブル型の再生専用装置においては、カセッ
トテープとほぼ同じ大きさの極限まで小型軽量化が望ま
れているから、上記のような再生イコライザ回路が半導
体集積回路に全て内蔵できることの意義は大きくなる。
【００１７】上記の実施例から得られる作用効果は、下
記の通りである。すなわち、 （１） 磁気ヘッドからの音声再生信号を受ける第１の
演算増幅回路の帰還ループに、第２の演算増幅回路を用
いて構成された容量増倍回路を設けて再生イコライザ回
路を構成することにより、再生イコライザ回路を帰還回
路を含めて半導体集積回路に内蔵させることができると
いう効果が得られる。
記の通りである。すなわち、 （１） 磁気ヘッドからの音声再生信号を受ける第１の
演算増幅回路の帰還ループに、第２の演算増幅回路を用
いて構成された容量増倍回路を設けて再生イコライザ回
路を構成することにより、再生イコライザ回路を帰還回
路を含めて半導体集積回路に内蔵させることができると
いう効果が得られる。
【００１８】（２） 上記容量増倍回路として、入力信
号が第１の抵抗とキャパシタにより形成された積分回路
を介して上記第２の演算増幅回路の非反転入力端子に供
給され、上記入力信号が第２の抵抗を介して上記演算増
幅回路の反転入力端子に供給され、上記第２の演算増幅
回路の反転入力端子には出力信号がそのまま帰還させる
回路を用いることにより、半導体集積回での高い精度の
抵抗比に従って容量を倍増できること、及び等価直列抵
抗も合わせて形成することができるという効果が得られ
る。
号が第１の抵抗とキャパシタにより形成された積分回路
を介して上記第２の演算増幅回路の非反転入力端子に供
給され、上記入力信号が第２の抵抗を介して上記演算増
幅回路の反転入力端子に供給され、上記第２の演算増幅
回路の反転入力端子には出力信号がそのまま帰還させる
回路を用いることにより、半導体集積回での高い精度の
抵抗比に従って容量を倍増できること、及び等価直列抵
抗も合わせて形成することができるという効果が得られ
る。
【００１９】（３） 上記により、直流利得を決定する
抵抗を含めて帰還回路を構成する素子を半導体集積回路
に内蔵するようにしたことにより、再生イコライザ回路
での外付部品点数を無くすことができ、かかる部品点数
の削減とそれに伴う実装スペースの小型化や組み立て工
数の削減等が相乗的に作用してカセットテープレコーダ
等の大幅な小型軽量化とコストの低減が実現できるとい
う効果が得られる。
抵抗を含めて帰還回路を構成する素子を半導体集積回路
に内蔵するようにしたことにより、再生イコライザ回路
での外付部品点数を無くすことができ、かかる部品点数
の削減とそれに伴う実装スペースの小型化や組み立て工
数の削減等が相乗的に作用してカセットテープレコーダ
等の大幅な小型軽量化とコストの低減が実現できるとい
う効果が得られる。
【００２０】以上本発明者よりなされた発明を実施例に
基づき具体的に説明したが、本願発明は前記実施例に限
定されるものではなく、その要旨を逸脱しない範囲で種
々変更可能であることはいうまでもない。例えば、容量
増倍回路としては、ミラー積分回路を利用するものであ
ってもよい。必要に応じて、ステレオの２チャンネル分
を１つの半導体集積回路に内蔵したり、あるいは上記再
生イコライザ回路から後段の信号処理回路の全てを１つ
の半導体集積回路に形成するものであってもよい。再生
イコライザ回路は、使用するテープの種類がノーマルテ
ープ又はクロム／メタルテープのいずれかに限定された
ものであるなら、それに対応した回路が固定的に設けら
れる。この発明は、再生イコライザ回路として広く利用
できる。
基づき具体的に説明したが、本願発明は前記実施例に限
定されるものではなく、その要旨を逸脱しない範囲で種
々変更可能であることはいうまでもない。例えば、容量
増倍回路としては、ミラー積分回路を利用するものであ
ってもよい。必要に応じて、ステレオの２チャンネル分
を１つの半導体集積回路に内蔵したり、あるいは上記再
生イコライザ回路から後段の信号処理回路の全てを１つ
の半導体集積回路に形成するものであってもよい。再生
イコライザ回路は、使用するテープの種類がノーマルテ
ープ又はクロム／メタルテープのいずれかに限定された
ものであるなら、それに対応した回路が固定的に設けら
れる。この発明は、再生イコライザ回路として広く利用
できる。
【００２１】
【発明の効果】本願において開示される発明のうち代表
的なものによって得られる効果を簡単に説明すれば、下
記の通りである。すなわち、磁気ヘッドからの音声再生
信号を受ける第１の演算増幅回路の帰還ループに、第２
の演算増幅回路を用いて構成された容量増倍回路を設け
て再生イコライザ回路を構成することにより、再生イコ
ライザ回路を帰還回路を含めて半導体集積回路に内蔵さ
せることができる。
的なものによって得られる効果を簡単に説明すれば、下
記の通りである。すなわち、磁気ヘッドからの音声再生
信号を受ける第１の演算増幅回路の帰還ループに、第２
の演算増幅回路を用いて構成された容量増倍回路を設け
て再生イコライザ回路を構成することにより、再生イコ
ライザ回路を帰還回路を含めて半導体集積回路に内蔵さ
せることができる。
【００２２】上記容量増倍回路として、入力信号が第１
の抵抗とキャパシタにより形成された積分回路を介して
上記第２の演算増幅回路の非反転入力端子に供給され、
上記入力信号が第２の抵抗を介して上記演算増幅回路の
反転入力端子に供給され、上記第２の演算増幅回路の反
転入力端子には出力信号がそのまま帰還させる回路を用
いることにより、半導体集積回での高い精度の抵抗比に
従って容量を倍増できること、及び等価直列抵抗も合わ
せて形成することができる。
の抵抗とキャパシタにより形成された積分回路を介して
上記第２の演算増幅回路の非反転入力端子に供給され、
上記入力信号が第２の抵抗を介して上記演算増幅回路の
反転入力端子に供給され、上記第２の演算増幅回路の反
転入力端子には出力信号がそのまま帰還させる回路を用
いることにより、半導体集積回での高い精度の抵抗比に
従って容量を倍増できること、及び等価直列抵抗も合わ
せて形成することができる。
【００２３】直流利得を決定する抵抗を含めて帰還回路
を構成する素子を半導体集積回路に内蔵するようにした
ことにより、再生イコライザ回路での外付部品点数を無
くすことができ、かかる部品点数の削減とそれに伴う実
装スペースの小型化や組み立て工数の削減等が相乗的に
作用してカセットテープレコーダ等の大幅な小型軽量化
とコストの低減が実現できる。
を構成する素子を半導体集積回路に内蔵するようにした
ことにより、再生イコライザ回路での外付部品点数を無
くすことができ、かかる部品点数の削減とそれに伴う実
装スペースの小型化や組み立て工数の削減等が相乗的に
作用してカセットテープレコーダ等の大幅な小型軽量化
とコストの低減が実現できる。
【図１】この発明に係る再生イコライザ回路の一実施例
を示す概略回路図である。
を示す概略回路図である。
【図２】この発明に係る再生イコライザ回路に用いられ
る容量増倍回路の一実施例を示す回路図である。
る容量増倍回路の一実施例を示す回路図である。
【図３】この発明に係る再生イコライザ回路の一実施例
を示す具体的回路図である。
を示す具体的回路図である。
【図４】この発明に係る再生イコライザ回路の他の一実
施例を示す概略回路図である。
施例を示す概略回路図である。
１…磁気ヘッド、２…第１の演算増幅回路、３，３ａ，
３ｂ…交流帰還回路、５…容量増倍回路、６…第２の演
算増幅回路、Ｐ１…外部端子、Ｒ１〜Ｒ５…抵抗、Ｃ２
…キャパシタ（コンデンサ）。
３ｂ…交流帰還回路、５…容量増倍回路、６…第２の演
算増幅回路、Ｐ１…外部端子、Ｒ１〜Ｒ５…抵抗、Ｃ２
…キャパシタ（コンデンサ）。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 川本 幹彦 東京都小平市上水本町５丁目22番１号 株 式会社日立マイコンシステム内
Claims (2)
- 【請求項１】 半導体集積回路装置により構成された信
号処理回路に内蔵され、磁気ヘッドからの音声再生信号
を受ける第１の演算増幅回路と、かかる第１の演算増幅
回路の帰還ループに設けられ、第２の演算増幅回路を用
いて構成された容量増倍回路とを備えてなることを特徴
とする再生イコライザ回路。 - 【請求項２】 上記容量増倍回路は、入力信号が第１の
抵抗とキャパシタにより形成された積分回路を介して上
記第２の演算増幅回路の非反転入力端子に供給され、上
記入力信号が第２の抵抗を介して上記演算増幅回路の反
転入力端子に供給され、上記第２の演算増幅回路の反転
入力端子には出力信号がそのまま帰還されるものである
ことを特徴とする請求項１の再生イコライザ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7175375A JPH098580A (ja) | 1995-06-19 | 1995-06-19 | 再生イコライザ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7175375A JPH098580A (ja) | 1995-06-19 | 1995-06-19 | 再生イコライザ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH098580A true JPH098580A (ja) | 1997-01-10 |
Family
ID=15995010
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7175375A Pending JPH098580A (ja) | 1995-06-19 | 1995-06-19 | 再生イコライザ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH098580A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| AT515558A4 (de) * | 2014-07-21 | 2015-10-15 | Heiligenmann Barbara | Segelkatamaran |
-
1995
- 1995-06-19 JP JP7175375A patent/JPH098580A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| AT515558A4 (de) * | 2014-07-21 | 2015-10-15 | Heiligenmann Barbara | Segelkatamaran |
| AT515558B1 (de) * | 2014-07-21 | 2015-10-15 | Heiligenmann Barbara | Segelkatamaran |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20040730 |
|
| A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A711 Effective date: 20050315 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20050908 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20051228 |