JPH0812888B2 - 半導体装置用パツケ−ジ - Google Patents
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- JPH0812888B2 JPH0812888B2 JP60207503A JP20750385A JPH0812888B2 JP H0812888 B2 JPH0812888 B2 JP H0812888B2 JP 60207503 A JP60207503 A JP 60207503A JP 20750385 A JP20750385 A JP 20750385A JP H0812888 B2 JPH0812888 B2 JP H0812888B2
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Description
【発明の詳細な説明】 〔概要〕 超高周波用半導体装置に使用するパッケージにおい
て、 側壁の一部を金属にして接地用外部リード端子を導出
させ、更に底板の中央部を含む領域を金属にしてその上
に半導体チップをボンディングさせることにより、 実用可能な周波数の上限を高め且つ半導体チップに対
する放熱性を向上させたものである。
て、 側壁の一部を金属にして接地用外部リード端子を導出
させ、更に底板の中央部を含む領域を金属にしてその上
に半導体チップをボンディングさせることにより、 実用可能な周波数の上限を高め且つ半導体チップに対
する放熱性を向上させたものである。
本発明は、半導体装置用パッケージに係り、特に、超
高周波用半導体装置に使用されるパッケージの構成に関
す。
高周波用半導体装置に使用されるパッケージの構成に関
す。
超高周波用半導体装置例えばガリウム砒素(GaAs)系
電界効果トランジスタ(FET)を備えGHz帯で動作する
半導体装置は、半導体チップの性能向上に伴い使用され
るパッケージもそのチップの性能を発揮出来るように改
良されることが必要である。
電界効果トランジスタ(FET)を備えGHz帯で動作する
半導体装置は、半導体チップの性能向上に伴い使用され
るパッケージもそのチップの性能を発揮出来るように改
良されることが必要である。
超高周波用半導体装置に使用される従来のパッケージ
例の要部構成は第2図の平面図(a)と部分断面側面図
(b)(c)に示す如くである。
例の要部構成は第2図の平面図(a)と部分断面側面図
(b)(c)に示す如くである。
同図において、1は角板状をなすセラミックの底板、
2は底板1上にあり角枠状をなすセラミックの側壁、3
は底板1および側壁2の一辺において底板1の上面、側
面、底面および側壁2の外側面に互いに連通して被着さ
れた金属例えばタングステンの接地用メタライズ膜、4
は底板1の一辺において上面、側面、底面に互いに連通
して被着されメタライズ膜3と同様な入出力端用メタラ
イズ膜、5は側壁2の上面にメタライズ膜3に連通して
被着されメタライズ膜3と同様な蓋シール用メタライズ
膜、である。
2は底板1上にあり角枠状をなすセラミックの側壁、3
は底板1および側壁2の一辺において底板1の上面、側
面、底面および側壁2の外側面に互いに連通して被着さ
れた金属例えばタングステンの接地用メタライズ膜、4
は底板1の一辺において上面、側面、底面に互いに連通
して被着されメタライズ膜3と同様な入出力端用メタラ
イズ膜、5は側壁2の上面にメタライズ膜3に連通して
被着されメタライズ膜3と同様な蓋シール用メタライズ
膜、である。
メタライズ膜3および4は、異なる辺でそれぞれ対向
して二個宛設けられ、底板1、側壁2、各メタライズ膜
3〜5は一緒に焼成されて一体に形成されている。
して二個宛設けられ、底板1、側壁2、各メタライズ膜
3〜5は一緒に焼成されて一体に形成されている。
この焼成体のメタライズ膜3と4との底面部分にそれ
ぞれ金属例えばコバールの接地用外部リード端子6と入
出力端用外部リード端子7とがろう付けされ、金めっき
が施されてパッケージの本体が形成されている。
ぞれ金属例えばコバールの接地用外部リード端子6と入
出力端用外部リード端子7とがろう付けされ、金めっき
が施されてパッケージの本体が形成されている。
半導体チップCの搭載は、チップCを底板1上面の略
中央にボンディングし、メタライズ膜3と4の側壁2内
部に表出する部分をそれぞれ接地用内部接続端子8と入
出力端用内部接続端子9にして、チップCの各電極との
間をワイヤボンディングにより接続ワイヤWで接続して
行う。この後、例えばコバールなどからなる蓋10を側壁
2上にメタライズ膜5を介しろう付けしてパッケージの
封止を完了する。
中央にボンディングし、メタライズ膜3と4の側壁2内
部に表出する部分をそれぞれ接地用内部接続端子8と入
出力端用内部接続端子9にして、チップCの各電極との
間をワイヤボンディングにより接続ワイヤWで接続して
行う。この後、例えばコバールなどからなる蓋10を側壁
2上にメタライズ膜5を介しろう付けしてパッケージの
封止を完了する。
この構成のパッケージは、接地用外部リード端子6か
ら接地用内部接続端子8および蓋シール用メタライズ膜
5に至る接続が接地用メタライズ膜3によってなされて
いる。そしてメタライズ膜3は、厚さが数μmの金属膜
であるため超高周波の周波数が高くなった場合にはイン
ダクタンス成分の作用が接地機能を低下させる。
ら接地用内部接続端子8および蓋シール用メタライズ膜
5に至る接続が接地用メタライズ膜3によってなされて
いる。そしてメタライズ膜3は、厚さが数μmの金属膜
であるため超高周波の周波数が高くなった場合にはイン
ダクタンス成分の作用が接地機能を低下させる。
このため、使用可能周波数が高くなった半導体チップ
Cを搭載して使用周波数を高くすると、所定の利得が得
られなかったり、メタライズ膜5や蓋10を介した出力か
ら入力への帰還により動作が不安定になったりして、半
導体チップCの性能を発揮させることが出来ない問題が
ある。
Cを搭載して使用周波数を高くすると、所定の利得が得
られなかったり、メタライズ膜5や蓋10を介した出力か
ら入力への帰還により動作が不安定になったりして、半
導体チップCの性能を発揮させることが出来ない問題が
ある。
またこの構成のパッケージは、半導体チップCをセラ
ミックの底板1にボンディングする。
ミックの底板1にボンディングする。
このためチップCは、十分な放熱性が得られずして使
用中の温度上昇が大きくなり、例えば寿命が短くなるな
ど半導体装置として信頼性が低下する問題がある。
用中の温度上昇が大きくなり、例えば寿命が短くなるな
ど半導体装置として信頼性が低下する問題がある。
第1図は本発明によるパッケージ実施例の平面図
(a)と部分断面側面図(b)(c)である。
(a)と部分断面側面図(b)(c)である。
上記問題点は、第1図に示される如く、側壁は周囲方
向に連接された金属壁2aおよび絶縁体壁2bからなって金
属壁2aは接地用外部リード端子6aを導出し、底板は中央
部をを含む領域を形成する金属底板1aおよびその他の領
域を形成する絶縁体底板1bからなって金属底板1a上に半
導体チップCがボンディングされる本発明の半導体装置
用パッケージによって解決される。
向に連接された金属壁2aおよび絶縁体壁2bからなって金
属壁2aは接地用外部リード端子6aを導出し、底板は中央
部をを含む領域を形成する金属底板1aおよびその他の領
域を形成する絶縁体底板1bからなって金属底板1a上に半
導体チップCがボンディングされる本発明の半導体装置
用パッケージによって解決される。
本発明の構成により、第2図図示従来例の接地用メタ
ライズ膜3は厚さが極めて厚くなった金属壁aに替わる
ので、その部分のインダクタンス成分が大幅に減少し使
用周波数が高くなっても十分な接地機能が確保されて、
利得の低減や出力から入力への帰還を抑制することが出
来る。
ライズ膜3は厚さが極めて厚くなった金属壁aに替わる
ので、その部分のインダクタンス成分が大幅に減少し使
用周波数が高くなっても十分な接地機能が確保されて、
利得の低減や出力から入力への帰還を抑制することが出
来る。
また、金属底板1aの存在により半導体チップCに対す
る放熱性が従来例より大幅に向上してチップCの温度上
昇が低減し、寿命が伸びるなど半導体装置としての信頼
性が向上する。
る放熱性が従来例より大幅に向上してチップCの温度上
昇が低減し、寿命が伸びるなど半導体装置としての信頼
性が向上する。
以下、第1図を用い実施例について説明する。なお第
1図の図(a)〜(c)はそれぞれ第2図の図(a)〜
(c)に対応する図である。
1図の図(a)〜(c)はそれぞれ第2図の図(a)〜
(c)に対応する図である。
第1図図示パッケージの第2図図示従来例との主な相
違の第一点は、セラミックで角枠状にした従来例側壁2
における接地用外部リード端子6導出側の辺を金属(金
属壁2a)にし、金属壁2aから接地用外部リード端子を導
出させた点であり、第二点は、従来例底板1における一
部を金属(金属底板1a)にし、金属底板1aに半導体チッ
プCをボンディングするようにした点である。なお第一
の相違点は本願発明者が先に特願昭60−015904号により
開示した構成と同様のものである。
違の第一点は、セラミックで角枠状にした従来例側壁2
における接地用外部リード端子6導出側の辺を金属(金
属壁2a)にし、金属壁2aから接地用外部リード端子を導
出させた点であり、第二点は、従来例底板1における一
部を金属(金属底板1a)にし、金属底板1aに半導体チッ
プCをボンディングするようにした点である。なお第一
の相違点は本願発明者が先に特願昭60−015904号により
開示した構成と同様のものである。
即ち第1図において、1aは金属例えば無酸素銅からな
り従来例底板1の中央部を形成する金属底板、1bはセラ
ミックからなり同じく周辺部を形成する絶縁体底板、2a
は金属例えば無酸素銅からなる従来例側壁2の接地用外
部リード端子6導出側辺部を形成する金属壁、2bはセラ
ミックからなり同じく入出力端用外部リード端子7導出
側辺部を形成する絶縁体壁である。金属壁2aは同一材料
の接地用外部リード端子6aおよび接地用内部接続端子8a
と一体に製造された端子ブロック11を形成している。
り従来例底板1の中央部を形成する金属底板、1bはセラ
ミックからなり同じく周辺部を形成する絶縁体底板、2a
は金属例えば無酸素銅からなる従来例側壁2の接地用外
部リード端子6導出側辺部を形成する金属壁、2bはセラ
ミックからなり同じく入出力端用外部リード端子7導出
側辺部を形成する絶縁体壁である。金属壁2aは同一材料
の接地用外部リード端子6aおよび接地用内部接続端子8a
と一体に製造された端子ブロック11を形成している。
また、12は絶縁体底板1bの金属底板1aとの接合面部に
被着された金属例えばタングステンの接合用メタライズ
膜、13および14はそれぞれ絶縁体底板1bおよび絶縁体壁
2bの端子ブロック11との接合部に被着されメタライズ膜
12と同様な接合用メタライズ膜、4aは従来例メタライズ
膜4に相当して絶縁体底板1bの上面と絶縁体壁2bの下面
に被着された入出力端用メタライズ膜、5aは従来例メタ
ライズ膜5と同様に絶縁体壁2b上に被着された接合用メ
タライズ膜である。
被着された金属例えばタングステンの接合用メタライズ
膜、13および14はそれぞれ絶縁体底板1bおよび絶縁体壁
2bの端子ブロック11との接合部に被着されメタライズ膜
12と同様な接合用メタライズ膜、4aは従来例メタライズ
膜4に相当して絶縁体底板1bの上面と絶縁体壁2bの下面
に被着された入出力端用メタライズ膜、5aは従来例メタ
ライズ膜5と同様に絶縁体壁2b上に被着された接合用メ
タライズ膜である。
絶縁体底板1b、絶縁体壁2b、各メタライズ膜4a、5aお
よび12〜14は一緒に焼成されて一体に形成されている。
よび12〜14は一緒に焼成されて一体に形成されている。
この焼成体の所定の位置に金属底板1aと端子ブロック
11が、また入出力端用メタライズ膜4aの絶縁体壁2b下部
に金属例えばコバールの入出力端用外部リード端子7a
が、更に金属壁2aおよび絶縁体壁2bの上に角環板状をな
す金属例えばコバールの蓋シール用金属環15がろう付け
され、金めっきが施されてパッケージの本体が形成され
ている。
11が、また入出力端用メタライズ膜4aの絶縁体壁2b下部
に金属例えばコバールの入出力端用外部リード端子7a
が、更に金属壁2aおよび絶縁体壁2bの上に角環板状をな
す金属例えばコバールの蓋シール用金属環15がろう付け
され、金めっきが施されてパッケージの本体が形成され
ている。
半導体チップCの搭載は、チップCのボンディング位
置が金属底板1a上に変わり、接地用内部接続端子8が8a
に替わるのみで従来例と同様にして行う。この後、従来
例と同様な蓋10を金属環15上にろう付けしてパッケージ
の封止を完了する。
置が金属底板1a上に変わり、接地用内部接続端子8が8a
に替わるのみで従来例と同様にして行う。この後、従来
例と同様な蓋10を金属環15上にろう付けしてパッケージ
の封止を完了する。
この構成のパッケージは、接地用外部リード端子6aか
ら接地用内部接続端子8aおよび蓋シール用金属環15に至
る接続が肉厚の金属壁2aによってなされるため、その部
分のインダクタンス成分が従来例より大幅に減少して、
使用する周波数が高くなっても接地機能が従来例のよう
に低下することがない。
ら接地用内部接続端子8aおよび蓋シール用金属環15に至
る接続が肉厚の金属壁2aによってなされるため、その部
分のインダクタンス成分が従来例より大幅に減少して、
使用する周波数が高くなっても接地機能が従来例のよう
に低下することがない。
ちなみに、従来例のパッケージを使用した際には実用
可能な周波数の上限が凡そ12GHzであったのに対し、実
施例のパッケージを使用すると凡そ20GHzまで高めるこ
とが出来る。
可能な周波数の上限が凡そ12GHzであったのに対し、実
施例のパッケージを使用すると凡そ20GHzまで高めるこ
とが出来る。
またこの構成のパッケージは、半導体チップCが金属
底板1aにボンディングされてチップCに対する放熱性を
従来例より大幅に向上させるため、使用中におけるチッ
プCの温度上昇が低減して、寿命が延びるなど半導体装
置としての信頼性を向上させる。
底板1aにボンディングされてチップCに対する放熱性を
従来例より大幅に向上させるため、使用中におけるチッ
プCの温度上昇が低減して、寿命が延びるなど半導体装
置としての信頼性を向上させる。
ちなみに本願発明者の一測定によれば、チップCにお
けるFET部の温度上昇は従来例の場合より凡そ100℃程度
低減した。これは寿命が3桁以上延びることに相当す
る。
けるFET部の温度上昇は従来例の場合より凡そ100℃程度
低減した。これは寿命が3桁以上延びることに相当す
る。
なお上述した実施例における金属底板1aは、端子ブロ
ック11から電気的に切り離すため底板の中央部のみを占
める大きさにしたが、金属底板1aと端子ブロック11との
接続が許されるならば、金属底板1aを接地用内部接続端
子8aとオーバラップするように大きくしても良い。その
場合半導体チップCに対する放熱性は更に大きくなる。
ック11から電気的に切り離すため底板の中央部のみを占
める大きさにしたが、金属底板1aと端子ブロック11との
接続が許されるならば、金属底板1aを接地用内部接続端
子8aとオーバラップするように大きくしても良い。その
場合半導体チップCに対する放熱性は更に大きくなる。
以上説明したように本発明の構成によれば、実用可能
な周波数の上限を高め且つ半導体チップに対する放熱性
を向上させた半導体装置用パッケージが提供出来て、超
高周波領域において使用可能周波数が高くなった半導体
チップの特性を発揮し且つ信頼性を高めた半導体装置の
提供を可能にさせる効果がある。
な周波数の上限を高め且つ半導体チップに対する放熱性
を向上させた半導体装置用パッケージが提供出来て、超
高周波領域において使用可能周波数が高くなった半導体
チップの特性を発揮し且つ信頼性を高めた半導体装置の
提供を可能にさせる効果がある。
第1図は本発明によるパッケージ実施例の平面図(a)
と部分断面側面図(b)(c)、 第2図は従来のパッケージ例の平面図(a)と部分断面
側面図(b)(c)、である。 図において、 1は底板、 1aは金属底板、 1bは絶縁体底板、 2は側壁、 2aは金属壁、 2bは絶縁体壁、 3は接地用メタライズ膜、 4、4aは入出力端用メタライズ膜、 5は蓋シール用メタライズ膜、 6、6aは接地用外部リード端子、 7、7aは入出力端用外部リード端子、 8、8aは接地用内部接続端子、 9は入出力端用内部接続端子、 10は蓋、 11は端子ブロック、 5a、12〜14は接合用メタライズ膜、 15は蓋シール用金属環、 Cは半導体チップ、 Wは接続ワイヤ、である。
と部分断面側面図(b)(c)、 第2図は従来のパッケージ例の平面図(a)と部分断面
側面図(b)(c)、である。 図において、 1は底板、 1aは金属底板、 1bは絶縁体底板、 2は側壁、 2aは金属壁、 2bは絶縁体壁、 3は接地用メタライズ膜、 4、4aは入出力端用メタライズ膜、 5は蓋シール用メタライズ膜、 6、6aは接地用外部リード端子、 7、7aは入出力端用外部リード端子、 8、8aは接地用内部接続端子、 9は入出力端用内部接続端子、 10は蓋、 11は端子ブロック、 5a、12〜14は接合用メタライズ膜、 15は蓋シール用金属環、 Cは半導体チップ、 Wは接続ワイヤ、である。
Claims (1)
- 【請求項1】側壁は周囲方向に連接された金属壁(2a)
および絶縁体壁(2b)からなって該金属壁(2a)は接地
用外部リード端子(6a)を導出し、底板は中央部を含む
領域を形成する金属底板(1a)およびその他の領域を形
成する絶縁体底板(1b)からなって該金属底板(1a)上
に半導体チップ(C)がボンディングされることを特徴
とする半導体装置用パッケージ。
Priority Applications (7)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60207503A JPH0812888B2 (ja) | 1985-09-19 | 1985-09-19 | 半導体装置用パツケ−ジ |
CA500274A CA1264380C (en) | 1985-01-30 | 1986-01-24 | SEMICONDUCTOR DEVICE BOX WITH INTEGRATED GROUNDING CONDUCTOR AND SIDEWALL |
DE8686400160T DE3688205T2 (de) | 1985-01-30 | 1986-01-28 | Packungsstruktur fuer einen halbleiterchip. |
EP86400160A EP0190077B1 (en) | 1985-01-30 | 1986-01-28 | A package structure for a semiconductor chip |
AU52794/86A AU564928B2 (en) | 1985-01-30 | 1986-01-29 | Package structure for ultra-high frequency semiconductor chip |
KR1019860000613A KR900001246B1 (ko) | 1985-01-30 | 1986-01-30 | 반도체장치 |
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