JPH06284470A - 時分割多重伝送システム - Google Patents
時分割多重伝送システムInfo
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- JPH06284470A JPH06284470A JP6892893A JP6892893A JPH06284470A JP H06284470 A JPH06284470 A JP H06284470A JP 6892893 A JP6892893 A JP 6892893A JP 6892893 A JP6892893 A JP 6892893A JP H06284470 A JPH06284470 A JP H06284470A
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- Japan
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- division multiplex
- multiplex transmission
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- Selective Calling Equipment (AREA)
Abstract
(57)【要約】
【目的】 配線が簡単で設置スペースが小さく、また、
より細かく正確な制御／監視が可能な時分割多重伝送シ
ステムを提供する。 【構成】 コントローラと複数の端末が、時分割多重伝
送ユニット１１を介して、時分割多重伝送線で接続され
た時分割多重伝送システムであって、時分割多重伝送ユ
ニット１１にはデータを処理し時分割多重伝送ユニット
１１を制御する制御ブロック１３を、上記コントローラ
にはコントローラ全体を制御し演算処理を行なうＣＰＵ
ユニット１０を各々備えて、制御ブロック１３はＣＰＵ
ユニット１０とデータの授受を行なう為のデュアルポー
トメモリ１５を有し、このデュアルポートメモリ１５が
ＣＰＵユニット１０とＩ／Ｏバス１６で接続された構成
となっている。
より細かく正確な制御／監視が可能な時分割多重伝送シ
ステムを提供する。 【構成】 コントローラと複数の端末が、時分割多重伝
送ユニット１１を介して、時分割多重伝送線で接続され
た時分割多重伝送システムであって、時分割多重伝送ユ
ニット１１にはデータを処理し時分割多重伝送ユニット
１１を制御する制御ブロック１３を、上記コントローラ
にはコントローラ全体を制御し演算処理を行なうＣＰＵ
ユニット１０を各々備えて、制御ブロック１３はＣＰＵ
ユニット１０とデータの授受を行なう為のデュアルポー
トメモリ１５を有し、このデュアルポートメモリ１５が
ＣＰＵユニット１０とＩ／Ｏバス１６で接続された構成
となっている。
Description
【０００１】
【産業上の利用分野】本発明は、ビルオートメーション
やホームオートメーション等の分野で使用される時分割
多重伝送システムの改良に関する。
やホームオートメーション等の分野で使用される時分割
多重伝送システムの改良に関する。
【０００２】
【従来技術】図６は従来の時分割多重伝送システムの一
例を示した図である。図において、５１はコントローラ
５０を制御し演算処理を行なうＣＰＵユニット、５２は
ＯＮ／ＯＦＦデータを出力するコントローラ５０の出力
ユニット、５３はＯＮ／ＯＦＦデータを入力するコント
ローラ５０の入力ユニット、５４は各端末と対応したア
ドレスを持ち、コントローラ５０からのＯＮ／ＯＦＦデ
ータを時分割多重伝送用のパルス信号に変換する一方、
時分割多重伝送用のパルス信号をコントローラ５０への
ＯＮ／ＯＦＦデータに変換するターミナルユニット（Ｔ
／Ｕ）、５５は各ターミナルユニット５４からのパルス
信号を当該端末（不図示）へ時分割多重伝送する一方、
各端末からのパルス信号を当該ターミナルユニット５４
へ振り分ける伝送ユニットである。
例を示した図である。図において、５１はコントローラ
５０を制御し演算処理を行なうＣＰＵユニット、５２は
ＯＮ／ＯＦＦデータを出力するコントローラ５０の出力
ユニット、５３はＯＮ／ＯＦＦデータを入力するコント
ローラ５０の入力ユニット、５４は各端末と対応したア
ドレスを持ち、コントローラ５０からのＯＮ／ＯＦＦデ
ータを時分割多重伝送用のパルス信号に変換する一方、
時分割多重伝送用のパルス信号をコントローラ５０への
ＯＮ／ＯＦＦデータに変換するターミナルユニット（Ｔ
／Ｕ）、５５は各ターミナルユニット５４からのパルス
信号を当該端末（不図示）へ時分割多重伝送する一方、
各端末からのパルス信号を当該ターミナルユニット５４
へ振り分ける伝送ユニットである。
【０００３】このような時分割多重伝送システムでは、
コントローラ５０が端末を制御する時は、制御したい端
末に対応したターミナルユニット５４と結線された出力
ユニット５２の接点に、ＯＮ／ＯＦＦデータを出力し、
これが当該ターミナルユニット５４でパルス信号に変換
されて、伝送ユニット５５により当該端末へ伝送され
る。また、コントローラ５０が端末を監視する時は、監
視される端末からのパルス信号を受信した伝送ユニット
５５が、当該端末に対応するターミナルユニット５４へ
上記のパルス信号を振り分け、このパルス信号を受けた
当該ターミナルユニット５４はこれをＯＮ／ＯＦＦデー
タに変換して、入力ユニット５３の当該接点へ入力して
いる。
コントローラ５０が端末を制御する時は、制御したい端
末に対応したターミナルユニット５４と結線された出力
ユニット５２の接点に、ＯＮ／ＯＦＦデータを出力し、
これが当該ターミナルユニット５４でパルス信号に変換
されて、伝送ユニット５５により当該端末へ伝送され
る。また、コントローラ５０が端末を監視する時は、監
視される端末からのパルス信号を受信した伝送ユニット
５５が、当該端末に対応するターミナルユニット５４へ
上記のパルス信号を振り分け、このパルス信号を受けた
当該ターミナルユニット５４はこれをＯＮ／ＯＦＦデー
タに変換して、入力ユニット５３の当該接点へ入力して
いる。
【０００４】
【発明が解決しようとする課題】ところが、このような
従来の時分割多重伝送システムでは、伝送ユニット５５
と各端末とは２線で接続されているが、コントローラ５
０と各ターミナルユニット５４とは（ターミナルユニッ
ト５４の台数）×２本の配線がそのまま配線されてお
り、コントローラ５０から見れば、配線数は時分割多重
伝送システム以前と変わっていなかった。また、端末の
台数分のターミナルユニット５４が必要であり、その設
置スペースを確保しなければならなかった。
従来の時分割多重伝送システムでは、伝送ユニット５５
と各端末とは２線で接続されているが、コントローラ５
０と各ターミナルユニット５４とは（ターミナルユニッ
ト５４の台数）×２本の配線がそのまま配線されてお
り、コントローラ５０から見れば、配線数は時分割多重
伝送システム以前と変わっていなかった。また、端末の
台数分のターミナルユニット５４が必要であり、その設
置スペースを確保しなければならなかった。
【０００５】その上、ターミナルユニット５４はＯＮ／
ＯＦＦデータしか扱えないので、データを受信していな
い時でも、ＯＦＦデータを受信したと認識してしまった
り、また、発信したデータが間違いなく当該端末に受信
されたか確認しようが無いなど、正確な制御／監視を行
なうには問題が有った。本発明は上記事情に鑑みてなさ
れたものであり、配線が簡単で設置スペースが小さく、
また、より細かく正確な制御／監視が可能な時分割多重
伝送システムを提供することを目的とする。
ＯＦＦデータしか扱えないので、データを受信していな
い時でも、ＯＦＦデータを受信したと認識してしまった
り、また、発信したデータが間違いなく当該端末に受信
されたか確認しようが無いなど、正確な制御／監視を行
なうには問題が有った。本発明は上記事情に鑑みてなさ
れたものであり、配線が簡単で設置スペースが小さく、
また、より細かく正確な制御／監視が可能な時分割多重
伝送システムを提供することを目的とする。
【０００６】
【課題を解決するための手段】上記目的を達成する為に
提案される請求項１に記載の本発明による時分割多重伝
送システムは、コントローラと複数の端末が、時分割多
重伝送ユニットを介して、時分割多重伝送線で接続され
た時分割多重伝送システムであって、上記時分割多重伝
送ユニットにはデータを処理し時分割多重伝送ユニット
を制御する制御ブロックを、上記コントローラにはコン
トローラ全体を制御し演算処理を行なうＣＰＵユニット
を各々備えて、上記制御ブロックは上記ＣＰＵユニット
とデータの授受を行なう為のデュアルポートメモリを有
し、このデュアルポートメモリが上記ＣＰＵユニットと
Ｉ／Ｏバスで接続された構成となっている。
提案される請求項１に記載の本発明による時分割多重伝
送システムは、コントローラと複数の端末が、時分割多
重伝送ユニットを介して、時分割多重伝送線で接続され
た時分割多重伝送システムであって、上記時分割多重伝
送ユニットにはデータを処理し時分割多重伝送ユニット
を制御する制御ブロックを、上記コントローラにはコン
トローラ全体を制御し演算処理を行なうＣＰＵユニット
を各々備えて、上記制御ブロックは上記ＣＰＵユニット
とデータの授受を行なう為のデュアルポートメモリを有
し、このデュアルポートメモリが上記ＣＰＵユニットと
Ｉ／Ｏバスで接続された構成となっている。
【０００７】請求項２に記載の本発明による時分割多重
伝送システムは、上記デュアルポートメモリが、制御エ
リア、監視エリア、割り込みエリア、伝送ブロックエリ
ア及び端末データエリア等の専用エリアに分割された構
成となっている。
伝送システムは、上記デュアルポートメモリが、制御エ
リア、監視エリア、割り込みエリア、伝送ブロックエリ
ア及び端末データエリア等の専用エリアに分割された構
成となっている。
【０００８】
【作用】請求項１に記載の本発明による時分割多重伝送
システムでは、時分割多重伝送ユニットにはデータを処
理し時分割多重伝送ユニットを制御する制御ブロック
を、コントローラにはコントローラ全体を制御し演算処
理を行なうＣＰＵユニットを各々備えて、上記制御ブロ
ックは上記ＣＰＵユニットとデータの授受を行なう為の
デュアルポートメモリを有し、このデュアルポートメモ
リが上記ＣＰＵユニットとＩ／Ｏバスで接続されている
ので、ターミナルユニットと入出力ユニットが省略出
来、配線が簡単になり、設置スペースを小さくできる。
システムでは、時分割多重伝送ユニットにはデータを処
理し時分割多重伝送ユニットを制御する制御ブロック
を、コントローラにはコントローラ全体を制御し演算処
理を行なうＣＰＵユニットを各々備えて、上記制御ブロ
ックは上記ＣＰＵユニットとデータの授受を行なう為の
デュアルポートメモリを有し、このデュアルポートメモ
リが上記ＣＰＵユニットとＩ／Ｏバスで接続されている
ので、ターミナルユニットと入出力ユニットが省略出
来、配線が簡単になり、設置スペースを小さくできる。
【０００９】請求項２に記載の本発明による時分割多重
伝送システムでは、上記デュアルポートメモリが、制御
エリア、監視エリア、割り込みエリア、伝送ブロックエ
リア及び端末データエリア等の専用エリアに分割されて
いるので、バイトデータを使用出来、より細かく正確な
制御／監視が可能となる。
伝送システムでは、上記デュアルポートメモリが、制御
エリア、監視エリア、割り込みエリア、伝送ブロックエ
リア及び端末データエリア等の専用エリアに分割されて
いるので、バイトデータを使用出来、より細かく正確な
制御／監視が可能となる。
【００１０】
【実施例】以下に、添付図を参照して本発明の実施例を
説明する。図１は、請求項１に記載の本発明による時分
割多重伝送システムの一実施例の要部構成例を示したブ
ロック図である。図において、１０はコントローラ（不
図示）を制御し演算処理を行なうＣＰＵユニット、１１
は時分割多重伝送ユニットであり、時分割多重伝送を行
なう伝送ブロック１２、伝送データを処理し時分割多重
伝送ユニット１１を制御する制御ブロック１３、伝送ブ
ロック１２と制御ブロック１３を接続する内部バス１
４、ＣＰＵユニット１０とデータの授受を行なう為のデ
ュアルポートメモリ１５、ＣＰＵユニット１０とデュア
ルポートメモリ１５を接続するＩ／Ｏバスにより構成さ
れている。
説明する。図１は、請求項１に記載の本発明による時分
割多重伝送システムの一実施例の要部構成例を示したブ
ロック図である。図において、１０はコントローラ（不
図示）を制御し演算処理を行なうＣＰＵユニット、１１
は時分割多重伝送ユニットであり、時分割多重伝送を行
なう伝送ブロック１２、伝送データを処理し時分割多重
伝送ユニット１１を制御する制御ブロック１３、伝送ブ
ロック１２と制御ブロック１３を接続する内部バス１
４、ＣＰＵユニット１０とデータの授受を行なう為のデ
ュアルポートメモリ１５、ＣＰＵユニット１０とデュア
ルポートメモリ１５を接続するＩ／Ｏバスにより構成さ
れている。
【００１１】図２は上記のような構成の時分割多重伝送
システムの外観例を示したもので、コントローラ１７と
時分割多重伝送ユニット１１が配線を介さずに接続され
ている。このような時分割多重伝送システムの動作を以
下に説明する。コントローラ１７が端末を制御する時
は、ＣＰＵユニット１０が制御したい端末のアドレスと
共に制御データをＩ／Ｏバス１６を介して出力すると、
これらはデュアルポートメモリ１５に一旦記憶される。
デュアルポートメモリ１５に記憶されたアドレスと制御
データは、制御ブロック１３に読み出されて、内部バス
１４を介して伝送ブロック１２へ送られ、この伝送ブロ
ック１２により当該端末へ伝送される。
システムの外観例を示したもので、コントローラ１７と
時分割多重伝送ユニット１１が配線を介さずに接続され
ている。このような時分割多重伝送システムの動作を以
下に説明する。コントローラ１７が端末を制御する時
は、ＣＰＵユニット１０が制御したい端末のアドレスと
共に制御データをＩ／Ｏバス１６を介して出力すると、
これらはデュアルポートメモリ１５に一旦記憶される。
デュアルポートメモリ１５に記憶されたアドレスと制御
データは、制御ブロック１３に読み出されて、内部バス
１４を介して伝送ブロック１２へ送られ、この伝送ブロ
ック１２により当該端末へ伝送される。
【００１２】コントローラ１７が端末を監視する時は、
監視される端末からの状態データ（端末のアドレスを含
む）はコントローラ１７のアドレスと共に伝送ブロック
１２で受信され、内部バス１４を介して制御ブロック１
３へ送られて、デュアルポートメモリ１５に一旦記憶さ
れる。デュアルポートメモリ１５に記憶された状態デー
タは、Ｉ／Ｏバス１６を介してＣＰＵユニット１０へ読
み出される。
監視される端末からの状態データ（端末のアドレスを含
む）はコントローラ１７のアドレスと共に伝送ブロック
１２で受信され、内部バス１４を介して制御ブロック１
３へ送られて、デュアルポートメモリ１５に一旦記憶さ
れる。デュアルポートメモリ１５に記憶された状態デー
タは、Ｉ／Ｏバス１６を介してＣＰＵユニット１０へ読
み出される。
【００１３】図３は上記の時分割多重伝送システムを照
明制御システムに使用した例を示したである。スイッチ
である端末１９が操作されると、その操作データ（端末
のアドレスを含む）はコントローラ１７のアドレスと共
に伝送ブロック１２で受信され、内部バス１４を介して
制御ブロック１３へ送られて、デュアルポートメモリ１
５に一旦記憶される。デュアルポートメモリ１５に記憶
された操作データは、Ｉ／Ｏバス１６を介してＣＰＵユ
ニット１０へ読み出される。
明制御システムに使用した例を示したである。スイッチ
である端末１９が操作されると、その操作データ（端末
のアドレスを含む）はコントローラ１７のアドレスと共
に伝送ブロック１２で受信され、内部バス１４を介して
制御ブロック１３へ送られて、デュアルポートメモリ１
５に一旦記憶される。デュアルポートメモリ１５に記憶
された操作データは、Ｉ／Ｏバス１６を介してＣＰＵユ
ニット１０へ読み出される。
【００１４】ＣＰＵユニット１０は、上記のスイッチで
ある端末１９のアドレスに対応した照明２０を、読み出
した操作データに従って、出力ユニット１８を介して制
御する。図４は、請求項２に記載の本発明による時分割
多重伝送システムのデュアルポートメモリ２１の一実施
例の分割例を示した図である。請求項２に記載の時分割
多重伝送システムのその他の構成は上記請求項１に記載
の時分割多重伝送システムと同様である。
ある端末１９のアドレスに対応した照明２０を、読み出
した操作データに従って、出力ユニット１８を介して制
御する。図４は、請求項２に記載の本発明による時分割
多重伝送システムのデュアルポートメモリ２１の一実施
例の分割例を示した図である。請求項２に記載の時分割
多重伝送システムのその他の構成は上記請求項１に記載
の時分割多重伝送システムと同様である。
【００１５】図４において、２２は端末のアドレスと制
御データを書き込む送信エリアと、端末のアドレスとエ
コーバック制御データと伝送ブロック１２からのリター
ンコードを書き込む受信エリアとからなる制御エリア、
２３は端末のアドレスと監視要求データを書き込む送信
エリアと、端末のアドレスと監視要求データと端末から
の監視入力データと伝送ブロック１２からのリターンコ
ードを書き込む受信エリアとからなる監視エリア、２４
は端末のアドレスと割り込みデータと伝送ブロック１２
からのリターンコードを書き込む割り込みエリアであ
る。
御データを書き込む送信エリアと、端末のアドレスとエ
コーバック制御データと伝送ブロック１２からのリター
ンコードを書き込む受信エリアとからなる制御エリア、
２３は端末のアドレスと監視要求データを書き込む送信
エリアと、端末のアドレスと監視要求データと端末から
の監視入力データと伝送ブロック１２からのリターンコ
ードを書き込む受信エリアとからなる監視エリア、２４
は端末のアドレスと割り込みデータと伝送ブロック１２
からのリターンコードを書き込む割り込みエリアであ
る。
【００１６】また、２５は伝送ブロック１２の各種設定
を行なうコマンドと端末のアドレスと設定データを書き
込む送信エリアと、コマンドと端末のアドレスとエコー
バック設定データと伝送ブロック１２からのリターンコ
ードを書き込む受信エリアとからなる伝送ブロックエリ
ア、２６は接続されている端末の種別と端末の接続／未
接続情報と各端末に対しての伝送エラー回数を書き込む
テーブルとなっている端末データエリアである。
を行なうコマンドと端末のアドレスと設定データを書き
込む送信エリアと、コマンドと端末のアドレスとエコー
バック設定データと伝送ブロック１２からのリターンコ
ードを書き込む受信エリアとからなる伝送ブロックエリ
ア、２６は接続されている端末の種別と端末の接続／未
接続情報と各端末に対しての伝送エラー回数を書き込む
テーブルとなっている端末データエリアである。
【００１７】このような構成のデュアルポートメモリ２
１を使用した時分割多重伝送システムの、デュアルポー
トメモリ２１を中心とした動作を以下に説明する。コン
トローラ１７のＣＰＵユニット１０が端末を制御する時
は、制御したい端末のアドレスと制御データを制御エリ
ア２２の送信エリアに書き込むと、その後は請求項１に
記載の時分割多重伝送システムと同様に、制御したい端
末迄制御データが伝送される。この伝送が正常に行えた
か否かは、受信エリアに書き込まれたリターンコードに
より判断出来る。
１を使用した時分割多重伝送システムの、デュアルポー
トメモリ２１を中心とした動作を以下に説明する。コン
トローラ１７のＣＰＵユニット１０が端末を制御する時
は、制御したい端末のアドレスと制御データを制御エリ
ア２２の送信エリアに書き込むと、その後は請求項１に
記載の時分割多重伝送システムと同様に、制御したい端
末迄制御データが伝送される。この伝送が正常に行えた
か否かは、受信エリアに書き込まれたリターンコードに
より判断出来る。
【００１８】コントローラ１７のＣＰＵユニット１０が
端末を監視する時は、監視したい端末のアドレスと監視
要求データを監視エリア２３の送信エリアに書き込む
と、その後は請求項１に記載の時分割多重伝送システム
と同様に、監視したい端末迄監視要求データが伝送され
て、端末からは監視入力データが伝送され、監視エリア
２３の受信エリアに書き込まれる。ＣＰＵユニット１０
はこの受信エリアに書き込まれた監視入力データを読み
出す。この監視入力データが正しいか否かは同じく受信
エリアに書き込まれたリターンコードによって判断出来
る。
端末を監視する時は、監視したい端末のアドレスと監視
要求データを監視エリア２３の送信エリアに書き込む
と、その後は請求項１に記載の時分割多重伝送システム
と同様に、監視したい端末迄監視要求データが伝送され
て、端末からは監視入力データが伝送され、監視エリア
２３の受信エリアに書き込まれる。ＣＰＵユニット１０
はこの受信エリアに書き込まれた監視入力データを読み
出す。この監視入力データが正しいか否かは同じく受信
エリアに書き込まれたリターンコードによって判断出来
る。
【００１９】端末から突然割り込んで来るデータは、割
り込みエリア２４の記憶内容から、どの端末からのどの
ようなデータかをＣＰＵユニット１０は判断出来る。ま
た、その割り込みデータが正しいか否かは、同じく割り
込みエリア２４に記憶されているリターンコードによっ
て判断出来る。コントローラ１７のＣＰＵユニット１０
が伝送ブロック１２の設定を行なう時は、当該端末のア
ドレスと設定データと図５の一覧表に示すような設定コ
マンドを、伝送ブロックエリア２５の送信エリアに書き
込むことで行える。この設定が正しく出来たか否かは、
伝送ブロックエリア２５の受信エリアに書き込まれたリ
ターンコードによって、ＣＰＵユニット１０が判断出来
る。
り込みエリア２４の記憶内容から、どの端末からのどの
ようなデータかをＣＰＵユニット１０は判断出来る。ま
た、その割り込みデータが正しいか否かは、同じく割り
込みエリア２４に記憶されているリターンコードによっ
て判断出来る。コントローラ１７のＣＰＵユニット１０
が伝送ブロック１２の設定を行なう時は、当該端末のア
ドレスと設定データと図５の一覧表に示すような設定コ
マンドを、伝送ブロックエリア２５の送信エリアに書き
込むことで行える。この設定が正しく出来たか否かは、
伝送ブロックエリア２５の受信エリアに書き込まれたリ
ターンコードによって、ＣＰＵユニット１０が判断出来
る。
【００２０】
【発明の効果】請求項１に記載の本発明による時分割多
重伝送システムによれば、ターミナルユニットと入出力
ユニットが省略出来、配線が簡単になり、設置スペース
を小さくできる。請求項２に記載の本発明による時分割
多重伝送システムでは、バイトデータを使用出来、より
細かく正確な制御／監視が可能となる。また、コントロ
ーラは行いたい処理のエリアにデータを書き込むだけ
で、端末との通信が可能となり、コントローラのソフト
変更が容易になる。
重伝送システムによれば、ターミナルユニットと入出力
ユニットが省略出来、配線が簡単になり、設置スペース
を小さくできる。請求項２に記載の本発明による時分割
多重伝送システムでは、バイトデータを使用出来、より
細かく正確な制御／監視が可能となる。また、コントロ
ーラは行いたい処理のエリアにデータを書き込むだけ
で、端末との通信が可能となり、コントローラのソフト
変更が容易になる。
【図１】請求項１に記載の本発明による時分割多重伝送
システムの一実施例の要部構成例を示したブロック図で
ある。
システムの一実施例の要部構成例を示したブロック図で
ある。
【図２】請求項１に記載の本発明による時分割多重伝送
システムの外観例を示した図である。
システムの外観例を示した図である。
【図３】請求項１に記載の本発明による時分割多重伝送
システムを照明制御システムに使用した例を示した図で
ある。
システムを照明制御システムに使用した例を示した図で
ある。
【図４】請求項２に記載の本発明による時分割多重伝送
システムのデュアルポートメモリの一実施例の分割例を
示した図である。
システムのデュアルポートメモリの一実施例の分割例を
示した図である。
【図５】請求項２に記載の本発明による時分割多重伝送
システムの伝送ブロックの設定コマンド例の一覧表であ
る。
システムの伝送ブロックの設定コマンド例の一覧表であ
る。
【図６】従来の時分割多重伝送システムの一例の構成例
を示した外観図である。
を示した外観図である。
１０・・・ＣＰＵユニット １１・・・時分割多重伝送ユニット １２・・・伝送ブロック １３・・・制御ブロック １５，２１・・・デュアルポートメモリ １６・・・Ｉ／Ｏバス １７・・・コントローラ ２２・・・制御エリア ２３・・・監視エリア ２４・・・割り込みエリア ２５・・・伝送ブロックエリア ２６・・・端末データエリア
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｊ 3/00 Ａ 8226−5Ｋ
Claims (2)
- 【請求項１】コントローラと複数の端末が、時分割多重
伝送ユニットを介して、時分割多重伝送線で接続された
時分割多重伝送システムであって、 上記時分割多重伝送ユニットにはデータを処理し時分割
多重伝送ユニットを制御する制御ブロックを、上記コン
トローラにはコントローラ全体を制御し演算処理を行な
うＣＰＵユニットを各々備えて、上記制御ブロックは上
記ＣＰＵユニットとデータの授受を行なう為のデュアル
ポートメモリを有し、このデュアルポートメモリが上記
ＣＰＵユニットとＩ／Ｏバスで接続されていることを特
徴とする時分割多重伝送システム。 - 【請求項２】上記デュアルポートメモリが、制御エリ
ア、監視エリア、割り込みエリア、伝送ブロックエリア
及び端末データエリア等の専用エリアに分割されている
ことを特徴とする請求項１に記載の時分割多重伝送シス
テム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6892893A JPH06284470A (ja) | 1993-03-26 | 1993-03-26 | 時分割多重伝送システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6892893A JPH06284470A (ja) | 1993-03-26 | 1993-03-26 | 時分割多重伝送システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06284470A true JPH06284470A (ja) | 1994-10-07 |
Family
ID=13387812
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6892893A Withdrawn JPH06284470A (ja) | 1993-03-26 | 1993-03-26 | 時分割多重伝送システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06284470A (ja) |
-
1993
- 1993-03-26 JP JP6892893A patent/JPH06284470A/ja not_active Withdrawn
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20000530 |