JPH0620408A - 磁気ディスク装置 - Google Patents
磁気ディスク装置Info
- Publication number
- JPH0620408A JPH0620408A JP5080107A JP8010793A JPH0620408A JP H0620408 A JPH0620408 A JP H0620408A JP 5080107 A JP5080107 A JP 5080107A JP 8010793 A JP8010793 A JP 8010793A JP H0620408 A JPH0620408 A JP H0620408A
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Abstract
(57)【要約】
【目的】 装置毎に理想的な目標シ―ク速度を、自動的
にかつ正確に設定することができ、しかもメカ的な経年
変化に応じた目標シ―ク速度の補正も行うことのできる
磁気ディスク装置の提供を目的としている。 【構成】 計時手段により計時されたシ―クタイムと基
準シ―クタイムテ―ブルに登録された基準シ―クタイム
またはこのテ―ブルに登録された計算式を用いて算出さ
れた基準シ―クタイムとを比較手段が比較し、この比較
の結果得られたシ―クタイムと基準シ―クタイムとの差
に基づいて、補正手段が、目標速度テ―ブルに登録され
た内容を補正する。
にかつ正確に設定することができ、しかもメカ的な経年
変化に応じた目標シ―ク速度の補正も行うことのできる
磁気ディスク装置の提供を目的としている。 【構成】 計時手段により計時されたシ―クタイムと基
準シ―クタイムテ―ブルに登録された基準シ―クタイム
またはこのテ―ブルに登録された計算式を用いて算出さ
れた基準シ―クタイムとを比較手段が比較し、この比較
の結果得られたシ―クタイムと基準シ―クタイムとの差
に基づいて、補正手段が、目標速度テ―ブルに登録され
た内容を補正する。
Description
【０００１】
【産業上の利用分野】本発明は、磁気ディスク装置に関
する。
する。
【０００２】
【従来の技術】従来から、磁気ディスク装置には、アク
チュエ―タにおけるシ―ク動作の高精度化を図るため
に、次のような速度制御回路が備えられている。図２は
この速度制御回路の構成を示している。同図において、
１はシ―ク速度を検出するシ―ク速度検出回路、２はシ
―ク速度検出回路１より出力された速度信号をゲイン調
整用抵抗３にて設定された利得で増幅する可変抵抗調整
型ゲインアンプである。また、４はシ―ク動作で目標と
すべき速度値が予め登録された目標シ―ク速度値テ―ブ
ル、５はシ―ク動作を開始するにあたって目標シ―ク速
度値テ―ブル４から該当する速度値を読出すＣＰＵ、６
はＣＰＵ５が読出した速度値をアナログ信号に変換する
Ｄ／Ａコンバ―タ、７はＤ／Ａコンバ―タ６より出力さ
れた信号をオフセット調整用抵抗８の利得で増幅して出
力する可変抵抗オフセット調整型ゲインアンプ、９はシ
―ク速度検出回路１より可変抵抗調整型ゲインアンプ３
を通して出力された検出速度信号とＣＰＵ５より可変抵
抗オフセット調整型ゲインアンプ８を通じて出力された
目標速度信号とを比較して、その差信号をアクトチュエ
―タへの速度制御信号として出力する減算器である。
チュエ―タにおけるシ―ク動作の高精度化を図るため
に、次のような速度制御回路が備えられている。図２は
この速度制御回路の構成を示している。同図において、
１はシ―ク速度を検出するシ―ク速度検出回路、２はシ
―ク速度検出回路１より出力された速度信号をゲイン調
整用抵抗３にて設定された利得で増幅する可変抵抗調整
型ゲインアンプである。また、４はシ―ク動作で目標と
すべき速度値が予め登録された目標シ―ク速度値テ―ブ
ル、５はシ―ク動作を開始するにあたって目標シ―ク速
度値テ―ブル４から該当する速度値を読出すＣＰＵ、６
はＣＰＵ５が読出した速度値をアナログ信号に変換する
Ｄ／Ａコンバ―タ、７はＤ／Ａコンバ―タ６より出力さ
れた信号をオフセット調整用抵抗８の利得で増幅して出
力する可変抵抗オフセット調整型ゲインアンプ、９はシ
―ク速度検出回路１より可変抵抗調整型ゲインアンプ３
を通して出力された検出速度信号とＣＰＵ５より可変抵
抗オフセット調整型ゲインアンプ８を通じて出力された
目標速度信号とを比較して、その差信号をアクトチュエ
―タへの速度制御信号として出力する減算器である。
【０００３】ここで、ゲイン調整用抵抗３およびオフセ
ット調整用抵抗８は、それぞれアクチュエ―タのメカ的
なバラツキによるシ―ク速度の補正や、往路および復路
方向のシ―ク速度のオフセットの補正のために用いられ
る。
ット調整用抵抗８は、それぞれアクチュエ―タのメカ的
なバラツキによるシ―ク速度の補正や、往路および復路
方向のシ―ク速度のオフセットの補正のために用いられ
る。
【０００４】次にこの回路の動作を説明する。まずシ―
ク速度検出回路１においてシ―ク速度が検出されると、
その速度信号は、可変抵抗調整型ゲインアンプ２によ
り、ゲイン調整用抵抗３の利得で増幅されて減算器９に
出力される。
ク速度検出回路１においてシ―ク速度が検出されると、
その速度信号は、可変抵抗調整型ゲインアンプ２によ
り、ゲイン調整用抵抗３の利得で増幅されて減算器９に
出力される。
【０００５】一方、ＣＰＵ５は、目標シ―ク速度値テ―
ブル４から、その速度値を読出し、これをＤ／Ａコンバ
―タ６を介してアナログ信号に変換した後、可変抵抗オ
フセット調整型ゲインアンプ７に出力する。可変抵抗オ
フセット調整型ゲインアンプ７は、入力信号をオフセッ
ト調整用抵抗８の利得で増幅してこれを減算器９に出力
する。
ブル４から、その速度値を読出し、これをＤ／Ａコンバ
―タ６を介してアナログ信号に変換した後、可変抵抗オ
フセット調整型ゲインアンプ７に出力する。可変抵抗オ
フセット調整型ゲインアンプ７は、入力信号をオフセッ
ト調整用抵抗８の利得で増幅してこれを減算器９に出力
する。
【０００６】減算器９は、可変抵抗調整型ゲインアンプ
３を通して出力された検出速度信号と可変抵抗オフセッ
ト調整型ゲインアンプ７を通して出力された目標速度信
号とを比較して、その差信号をアクチュエ―タへの速度
制御信号として出力する。
３を通して出力された検出速度信号と可変抵抗オフセッ
ト調整型ゲインアンプ７を通して出力された目標速度信
号とを比較して、その差信号をアクチュエ―タへの速度
制御信号として出力する。
【０００７】ところで、このような回路におけるゲイン
調整用抵抗３およびオフセット調整用抵抗８の利得は、
それぞれ磁気ディスク装置の製造段階で調整される。し
かしながら、メカ的なバラツキを有する装置毎に各調整
用抵抗３、８の利得を微妙に変えて調整する作業は、大
変に手間のかかる作業であった。また、このような調整
用抵抗３、８の利得調整だけでは、メカ的な経年変化に
は対応できないという問題もあった。
調整用抵抗３およびオフセット調整用抵抗８の利得は、
それぞれ磁気ディスク装置の製造段階で調整される。し
かしながら、メカ的なバラツキを有する装置毎に各調整
用抵抗３、８の利得を微妙に変えて調整する作業は、大
変に手間のかかる作業であった。また、このような調整
用抵抗３、８の利得調整だけでは、メカ的な経年変化に
は対応できないという問題もあった。
【０００８】
【発明が解決しようとする課題】本発明はこのような事
情に対処してなされたもので、装置毎に理想的な目標シ
―ク速度を、自動的にかつ正確に設定することができ、
しかもメカ的な経年変化に応じた目標シ―ク速度の補正
も行うことのできる磁気ディスク装置の提供を目的とし
ている。
情に対処してなされたもので、装置毎に理想的な目標シ
―ク速度を、自動的にかつ正確に設定することができ、
しかもメカ的な経年変化に応じた目標シ―ク速度の補正
も行うことのできる磁気ディスク装置の提供を目的とし
ている。
【０００９】
【課題を解決するための手段】本発明の磁気ディスク装
置は、シ―ク速度と目標シ―ク速度との差に基づいて、
アクチュエ―タの速度制御を行う磁気ディスク装置にお
いて、シ―クタイムを計時する計時手段と、基準となる
シ―クタイムまたはこの基準シ―クタイムを算出するた
めの計算式が登録された基準シ―クタイムテ―ブルと、
前記目標シ―ク速度の値またはこの値を算出するための
計算式が登録された目標速度テ―ブルと、前記計時手段
により計時されたシ―クタイムと前記基準シ―クタイム
テ―ブルに登録された基準シ―クタイムまたはこのテ―
ブルに登録された計算式を用いて算出された基準シ―ク
タイムとを比較する比較手段と、この比較手段の比較の
結果に基づいて、前記目標速度テ―ブルに登録された内
容を補正する補正手段とを具備する。
置は、シ―ク速度と目標シ―ク速度との差に基づいて、
アクチュエ―タの速度制御を行う磁気ディスク装置にお
いて、シ―クタイムを計時する計時手段と、基準となる
シ―クタイムまたはこの基準シ―クタイムを算出するた
めの計算式が登録された基準シ―クタイムテ―ブルと、
前記目標シ―ク速度の値またはこの値を算出するための
計算式が登録された目標速度テ―ブルと、前記計時手段
により計時されたシ―クタイムと前記基準シ―クタイム
テ―ブルに登録された基準シ―クタイムまたはこのテ―
ブルに登録された計算式を用いて算出された基準シ―ク
タイムとを比較する比較手段と、この比較手段の比較の
結果に基づいて、前記目標速度テ―ブルに登録された内
容を補正する補正手段とを具備する。
【００１０】
【作用】本発明の磁気ディスク装置では、計時手段によ
り計時されたシ―クタイムと基準シ―クタイムテ―ブル
に登録された基準シ―クタイムまたはこのテ―ブルに登
録された計算式を用いて算出された基準シ―クタイムと
を比較手段が比較し、この比較の結果得られたシ―クタ
イムと基準シ―クタイムとの差に基づいて、補正手段
が、目標速度テ―ブルに登録された内容を補正する。
り計時されたシ―クタイムと基準シ―クタイムテ―ブル
に登録された基準シ―クタイムまたはこのテ―ブルに登
録された計算式を用いて算出された基準シ―クタイムと
を比較手段が比較し、この比較の結果得られたシ―クタ
イムと基準シ―クタイムとの差に基づいて、補正手段
が、目標速度テ―ブルに登録された内容を補正する。
【００１１】したがって、この発明によれば、装置毎に
理想的な目標シ―ク速度を、自動的にかつ正確に設定す
ることができ、しかもメカ的な経年変化に応じた目標シ
―ク速度の補正も行うことができる。
理想的な目標シ―ク速度を、自動的にかつ正確に設定す
ることができ、しかもメカ的な経年変化に応じた目標シ
―ク速度の補正も行うことができる。
【００１２】
【実施例】以下、本発明の実施例を図面に基づいて説明
する。
する。
【００１３】図１は本発明に係る一実施例の磁気ディス
ク装置におけるアクチュエ―タの速度制御回路の構成を
説明するためのブロック図である。
ク装置におけるアクチュエ―タの速度制御回路の構成を
説明するためのブロック図である。
【００１４】同図において、１１はアクチュエ―タのシ
―ク速度を検出するシ―ク速度検出回路、１２はシ―ク
速度検出回路１１より出力された速度信号を、一定の利
得で増幅する第１のゲインアンプである。また、１３は
各種シ―ク動作の基準シ―クタイムが登録された基準シ
―クタイムテ―ブル、１４はシ―クコンプリ―ト信号か
ら一回のシ―ク動作のシ―クタイムを計時するカウンタ
である。さらに、１５は目標シ―ク速度補正値テ―ブル
群である。この目標シ―ク速度補正値テ―ブル群１５
は、 1回目のシ―ク動作の目標速度値が登録された第１
の目標シ―ク速度補正値テ―ブル１５ａと、 2回目以降
のアクチュエ―タの往路方向および復路方向のシ―ク動
作における速度補正値がそれぞれ登録された第２および
第３の目標シ―ク速度補正値テ―ブル１５ｂ、１５ｃか
らなっている。
―ク速度を検出するシ―ク速度検出回路、１２はシ―ク
速度検出回路１１より出力された速度信号を、一定の利
得で増幅する第１のゲインアンプである。また、１３は
各種シ―ク動作の基準シ―クタイムが登録された基準シ
―クタイムテ―ブル、１４はシ―クコンプリ―ト信号か
ら一回のシ―ク動作のシ―クタイムを計時するカウンタ
である。さらに、１５は目標シ―ク速度補正値テ―ブル
群である。この目標シ―ク速度補正値テ―ブル群１５
は、 1回目のシ―ク動作の目標速度値が登録された第１
の目標シ―ク速度補正値テ―ブル１５ａと、 2回目以降
のアクチュエ―タの往路方向および復路方向のシ―ク動
作における速度補正値がそれぞれ登録された第２および
第３の目標シ―ク速度補正値テ―ブル１５ｂ、１５ｃか
らなっている。
【００１５】また、１６はＣＰＵである。このＣＰＵ１
６は、目標シ―ク速度補正値テ―ブル群１５に登録され
た目標シ―ク速度を読出すとともに、カウンタ１４によ
り計時されたシ―クタイムと基準シ―クタイムテ―ブル
１３上の対応する基準シ―クタイムとを比較し、その比
較結果に基づいて、目標シ―ク速度補正値テ―ブル群１
５の登録内容を補正する。１７はＣＰＵ１６が目標シ―
ク速度補正値テ―ブル群１５から読出した速度補正値を
アナログ信号に変換するＤ／Ａコンバ―タ、１８はＤ／
Ａコンバ―タ１７より出力された目標速度信号を一定の
利得で増幅する第２のゲインアンプ、そして１９はシ―
ク速度検出回路１１から第１のゲインアンプ１２を通し
て出力された検出速度信号と、ＣＰＵ１６より第２のゲ
インアンプ１８を通して出力された目標速度信号とを比
較して、その差信号をアクチュエ―タへの速度制御信号
として出力する減算器である。
６は、目標シ―ク速度補正値テ―ブル群１５に登録され
た目標シ―ク速度を読出すとともに、カウンタ１４によ
り計時されたシ―クタイムと基準シ―クタイムテ―ブル
１３上の対応する基準シ―クタイムとを比較し、その比
較結果に基づいて、目標シ―ク速度補正値テ―ブル群１
５の登録内容を補正する。１７はＣＰＵ１６が目標シ―
ク速度補正値テ―ブル群１５から読出した速度補正値を
アナログ信号に変換するＤ／Ａコンバ―タ、１８はＤ／
Ａコンバ―タ１７より出力された目標速度信号を一定の
利得で増幅する第２のゲインアンプ、そして１９はシ―
ク速度検出回路１１から第１のゲインアンプ１２を通し
て出力された検出速度信号と、ＣＰＵ１６より第２のゲ
インアンプ１８を通して出力された目標速度信号とを比
較して、その差信号をアクチュエ―タへの速度制御信号
として出力する減算器である。
【００１６】次にこの実施例の動作を説明する。まず、
1回目のシ―ク動作では、ＣＰＵ１６は、第１の目標シ
―ク速度補正値テ―ブル１５ａから目標速度値を読出し
て、これをＤ／Ａコンバ―タ１７を介してアナログ信号
に変換した後、第２のゲインアンプ１８に出力する。第
２のゲインアンプ１８は、この信号を一定の利得で増幅
して減算器１９に送る。減算器１９は、入力された目標
速度信号をそのままアクチュエ―タへの速度制御信号と
して出力する。これにより 1回目のシ―ク動作が行われ
る。
1回目のシ―ク動作では、ＣＰＵ１６は、第１の目標シ
―ク速度補正値テ―ブル１５ａから目標速度値を読出し
て、これをＤ／Ａコンバ―タ１７を介してアナログ信号
に変換した後、第２のゲインアンプ１８に出力する。第
２のゲインアンプ１８は、この信号を一定の利得で増幅
して減算器１９に送る。減算器１９は、入力された目標
速度信号をそのままアクチュエ―タへの速度制御信号と
して出力する。これにより 1回目のシ―ク動作が行われ
る。
【００１７】ここで、ＣＰＵ１６は、カウンタ１４によ
り計時されたシ―クタイムと基準シ―クタイムテ―ブル
１３上の対応する基準シ―クタイムとを比較する。そし
てこの比較の結果、計時されたシ―クタイムが基準シ―
クタイムよりも短い場合は、第１の目標シ―ク速度補正
値テ―ブル１５ａの速度値を、その時間差に応じた分だ
け大きくする。また、計時されたシ―クタイムが基準シ
―クタイムよりも長い場合は、第１の目標シ―ク補正速
度値テ―ブル１５ａの速度値を、その時間差に応じた分
だけ小さくする。
り計時されたシ―クタイムと基準シ―クタイムテ―ブル
１３上の対応する基準シ―クタイムとを比較する。そし
てこの比較の結果、計時されたシ―クタイムが基準シ―
クタイムよりも短い場合は、第１の目標シ―ク速度補正
値テ―ブル１５ａの速度値を、その時間差に応じた分だ
け大きくする。また、計時されたシ―クタイムが基準シ
―クタイムよりも長い場合は、第１の目標シ―ク補正速
度値テ―ブル１５ａの速度値を、その時間差に応じた分
だけ小さくする。
【００１８】2回目以降のシ―ク動作は、往路方向およ
び復路方向のシ―ク動作毎に、第２の目標シ―ク速度補
正値テ―ブル１５ｂおよび第３の目標シ―ク速度補正値
テ―ブル１５ｃの速度値をそれぞれ読出すことにより行
われる。
び復路方向のシ―ク動作毎に、第２の目標シ―ク速度補
正値テ―ブル１５ｂおよび第３の目標シ―ク速度補正値
テ―ブル１５ｃの速度値をそれぞれ読出すことにより行
われる。
【００１９】そして、 3回目以降のシ―ク動作では、Ｃ
ＰＵ１６は、往路方向および復路方向のシ―ク動作毎
に、カウンタ１４により計時されたシ―クタイムと基準
シ―クタイムテ―ブル１３上の対応する基準シ―クタイ
ムとを比較し、その差に基づき、上述の動作と同様に、
第２および第３の目標シ―ク速度補正値テ―ブル１５
ｂ、１５ｃの速度値を変更する。つまり、シ―クタイム
が基準シ―クタイムより短ければ速度値を大きくし、逆
にシ―クタイムが基準シ―クタイムより長ければ速度値
を小さくする。
ＰＵ１６は、往路方向および復路方向のシ―ク動作毎
に、カウンタ１４により計時されたシ―クタイムと基準
シ―クタイムテ―ブル１３上の対応する基準シ―クタイ
ムとを比較し、その差に基づき、上述の動作と同様に、
第２および第３の目標シ―ク速度補正値テ―ブル１５
ｂ、１５ｃの速度値を変更する。つまり、シ―クタイム
が基準シ―クタイムより短ければ速度値を大きくし、逆
にシ―クタイムが基準シ―クタイムより長ければ速度値
を小さくする。
【００２０】そして、次回からのシ―ク動作は、これら
第２および第３の目標シ―ク速度補正値テ―ブル１５
ｂ、１５ｃの速度補正値を用いて行われる。
第２および第３の目標シ―ク速度補正値テ―ブル１５
ｂ、１５ｃの速度補正値を用いて行われる。
【００２１】かくしてこの実施例の磁気ディスク装置に
よれば、アクチュエ―タの速度制御回路において、装置
毎に理想的な目標シ―ク速度値を、自動的にかつ正確に
設定することができる。またメカ的な経年変化に応じた
目標シ―ク速度の補正も行うことができ、シ―ク精度の
向上を図ることができる。
よれば、アクチュエ―タの速度制御回路において、装置
毎に理想的な目標シ―ク速度値を、自動的にかつ正確に
設定することができる。またメカ的な経年変化に応じた
目標シ―ク速度の補正も行うことができ、シ―ク精度の
向上を図ることができる。
【００２２】なお、以上説明した実施例では、 3回目以
降のシ―ク動作から、徐々に目標シ―ク速度値が最適な
値に補正されて行くよう構成されているが、 1回目のシ
―ク時に数回のシ―ク動作を強制的に行わせて、この間
に目標シ―ク速度値の補正を行うようにすれば、 2回目
のシ―ク動作から精度の高いシ―ク動作を行うことがで
きる。
降のシ―ク動作から、徐々に目標シ―ク速度値が最適な
値に補正されて行くよう構成されているが、 1回目のシ
―ク時に数回のシ―ク動作を強制的に行わせて、この間
に目標シ―ク速度値の補正を行うようにすれば、 2回目
のシ―ク動作から精度の高いシ―ク動作を行うことがで
きる。
【００２３】また、上述の実施例は、基準シ―クタイム
テ―ブル１３に各種のシ―ク動作の基準シ―クタイムを
登録して、この基準シ―クタイムとカウンタ１４により
計時されたシ―クタイムとを比較するよう構成したが、
基準シ―クタイム算出用の計算式をテ―ブルに登録して
おき、この計算式で基準シ―クタイムを算出するように
してもよい。
テ―ブル１３に各種のシ―ク動作の基準シ―クタイムを
登録して、この基準シ―クタイムとカウンタ１４により
計時されたシ―クタイムとを比較するよう構成したが、
基準シ―クタイム算出用の計算式をテ―ブルに登録して
おき、この計算式で基準シ―クタイムを算出するように
してもよい。
【００２４】さらに、上述の実施例は、目標シ―ク速度
補正値テ―ブル群１５に目標シ―ク速度値を登録して、
これを計時されたシ―クタイムと基準シ―クタイムとの
差から補正するよう構成したが、目標シ―ク速度値算出
用の計算式をテ―ブルに登録しておき、この計算式で目
標シ―ク速度値を算出するようにしてもよい。
補正値テ―ブル群１５に目標シ―ク速度値を登録して、
これを計時されたシ―クタイムと基準シ―クタイムとの
差から補正するよう構成したが、目標シ―ク速度値算出
用の計算式をテ―ブルに登録しておき、この計算式で目
標シ―ク速度値を算出するようにしてもよい。
【００２５】
【発明の効果】以上説明したように本発明の磁気ディス
ク装置によれば、装置毎に理想的な目標シ―ク速度を、
自動的にかつ正確に設定することができ、しかもメカ的
な経年変化に応じた目標シ―ク速度の補正も行うことが
できる。
ク装置によれば、装置毎に理想的な目標シ―ク速度を、
自動的にかつ正確に設定することができ、しかもメカ的
な経年変化に応じた目標シ―ク速度の補正も行うことが
できる。
【図１】本発明に係る一実施例の磁気ディスク装置にお
けるアクチュエ―タ速度制御回路の構成を説明するため
のブロック図。
けるアクチュエ―タ速度制御回路の構成を説明するため
のブロック図。
【図２】従来の磁気ディスク装置におけるアクチュエ―
タ速度制御回路の構成を説明するためのブロック図。
タ速度制御回路の構成を説明するためのブロック図。
１１………シ―ク速度検出回路 １２………第１のゲインアンプ １３………基準シ―クタイムテ―ブル １４………カウンタ １５………目標シ―ク速度補正値テ―ブル群 １６………ＣＰＵ １７………Ｄ／Ａコンバ―タ １８………第２のゲインアンプ １９………減算器。
Claims (1)
- 【請求項１】 シ―ク速度と目標シ―ク速度との差に基
づいて、アクチュエ―タの速度制御を行う磁気ディスク
装置において、 シ―クタイムを計時する計時手段と、 基準となるシ―クタイムまたはこの基準シ―クタイムを
算出するための計算式が登録された基準シ―クタイムテ
―ブルと、 前記目標シ―ク速度の値またはこの値を算出するための
計算式が登録された目標速度テ―ブルと、 前記計時手段により計時されたシ―クタイムと前記基準
シ―クタイムテ―ブルに登録された基準シ―クタイムま
たはこのテ―ブルに登録された計算式を用いて算出され
た基準シ―クタイムとを比較する比較手段と、 この比較手段の比較の結果に基づいて、前記目標速度テ
―ブルに登録された内容を補正する補正手段とを具備す
ることを特徴とする磁気ディスク装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5080107A JPH0620408A (ja) | 1993-03-15 | 1993-03-15 | 磁気ディスク装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5080107A JPH0620408A (ja) | 1993-03-15 | 1993-03-15 | 磁気ディスク装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0620408A true JPH0620408A (ja) | 1994-01-28 |
Family
ID=13708967
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5080107A Pending JPH0620408A (ja) | 1993-03-15 | 1993-03-15 | 磁気ディスク装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0620408A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1996019804A1 (en) * | 1994-12-19 | 1996-06-27 | Seagate Technology, Inc. | A system and method for controlling a seek operation in a disk drive |
| US7561373B2 (en) | 2005-05-28 | 2009-07-14 | Samsung Electronics Co., Ltd. | Bias compensation method and appropriate bias force profile generation method, recording media and hard disk drive |
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Citations (3)
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| JPH01144280A (ja) * | 1987-11-30 | 1989-06-06 | Mitsubishi Electric Corp | 磁気ディスク装置 |
| JPH01162280A (ja) * | 1987-12-18 | 1989-06-26 | Mitsubishi Electric Corp | 磁気ディスク装置のシーク時間調整装置 |
-
1993
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