JPH06181291A - 精密抵抗器 - Google Patents
精密抵抗器Info
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- JPH06181291A JPH06181291A JP4256414A JP25641492A JPH06181291A JP H06181291 A JPH06181291 A JP H06181291A JP 4256414 A JP4256414 A JP 4256414A JP 25641492 A JP25641492 A JP 25641492A JP H06181291 A JPH06181291 A JP H06181291A
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L28/00—Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
- H01L28/20—Resistors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66083—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by variation of the electric current supplied or the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched, e.g. two-terminal devices
- H01L29/66166—Resistors with PN junction
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Abstract
(57)【要約】 (修正有)
【目的】半導体基板か、この基板上に形成される多結晶
シリコンまたは金属からなる層にストライプを描くこと
によって形成する抵抗の抵抗値を精密に規定する。 【構成】精密抵抗器は半導体基板8上に形成される。こ
の抵抗器は絶縁材料4上に配設される抵抗性導電材料
1、2からなる2本のストライプを含み、各ストライプ
は平方あたりの第1の抵抗Rp および正規幅Wp を有
し、半導体基板において、正規幅Wm を有し、かつマス
クとして抵抗性導電材料のストライプを使用することに
よってドープされ、かつ平方あたりの第2の抵抗Rm を
有する1本のストライプ6をそれらの間に規定する。2
つのメタライゼーションは3本のストライプの第1およ
び第2の先端をそれぞれ接続する。幅および平方あたり
の抵抗はRp Wp =2Rm Wm になるように選択され
る。
シリコンまたは金属からなる層にストライプを描くこと
によって形成する抵抗の抵抗値を精密に規定する。 【構成】精密抵抗器は半導体基板8上に形成される。こ
の抵抗器は絶縁材料4上に配設される抵抗性導電材料
1、2からなる2本のストライプを含み、各ストライプ
は平方あたりの第1の抵抗Rp および正規幅Wp を有
し、半導体基板において、正規幅Wm を有し、かつマス
クとして抵抗性導電材料のストライプを使用することに
よってドープされ、かつ平方あたりの第2の抵抗Rm を
有する1本のストライプ6をそれらの間に規定する。2
つのメタライゼーションは3本のストライプの第1およ
び第2の先端をそれぞれ接続する。幅および平方あたり
の抵抗はRp Wp =2Rm Wm になるように選択され
る。
Description
【0001】
【技術分野】この発明は集積回路の分野に関するもので
あり、より特定的には集積回路内の抵抗器の製造に関す
るものである。
あり、より特定的には集積回路内の抵抗器の製造に関す
るものである。
【0002】
【背景技術】従来、集積回路内の抵抗器は、半導体基板
か、この基板上に形成される多結晶シリコン、または金
属からなる層かにストライプを描くことによって形成さ
れ、ストライプの両端にはメタライゼーションが設けら
れる。したがって、抵抗値はストライプの形状と、それ
を構成する材料の抵抗率とに依存する。
か、この基板上に形成される多結晶シリコン、または金
属からなる層かにストライプを描くことによって形成さ
れ、ストライプの両端にはメタライゼーションが設けら
れる。したがって、抵抗値はストライプの形状と、それ
を構成する材料の抵抗率とに依存する。
【0003】集積回路の周知の利点は、同一の集積回路
に形成される2つの同じ抵抗器が同じ値を有すること
と、定められた幾何学比を有する2つの抵抗器が正確に
定められた値の比を有するであろうということとであ
る。しかし、欠点は絶対抵抗値が正確に定められないと
いうことである。実際、製造バッチによって、条件、特
にマスキングステップの後に基本領域の有効な幅および
長さを決定するレジストエッチング条件が変わるかもし
れない。したがって、様々な製造バッチにおいて同じマ
スクから形成される抵抗器は数%の値の変化を示し、こ
の変化は約20%まで達する傾向があるであろう。した
がって、集積回路の分野において、回路を設計する際、
回路の作動パラメータがトランジスタの抵抗器比、また
は表面比の関数として定められる。しかし、適当に定め
られた値を有する抵抗器を得ることが時には有用であろ
う。今までのところこのような抵抗器の形成は事実上不
可能であった。
に形成される2つの同じ抵抗器が同じ値を有すること
と、定められた幾何学比を有する2つの抵抗器が正確に
定められた値の比を有するであろうということとであ
る。しかし、欠点は絶対抵抗値が正確に定められないと
いうことである。実際、製造バッチによって、条件、特
にマスキングステップの後に基本領域の有効な幅および
長さを決定するレジストエッチング条件が変わるかもし
れない。したがって、様々な製造バッチにおいて同じマ
スクから形成される抵抗器は数%の値の変化を示し、こ
の変化は約20%まで達する傾向があるであろう。した
がって、集積回路の分野において、回路を設計する際、
回路の作動パラメータがトランジスタの抵抗器比、また
は表面比の関数として定められる。しかし、適当に定め
られた値を有する抵抗器を得ることが時には有用であろ
う。今までのところこのような抵抗器の形成は事実上不
可能であった。
【0004】
【発明の概要】したがってこの発明の目的は、製造パラ
メータの変動に関係なく、抵抗器が予め正確に定められ
た値を有するように、集積回路製造技術における抵抗器
構造を提供することである。
メータの変動に関係なく、抵抗器が予め正確に定められ
た値を有するように、集積回路製造技術における抵抗器
構造を提供することである。
【0005】この目的を達成するために、この発明は半
導体基板に形成される精密抵抗器を提供し、この抵抗器
は絶縁材料上に配設される抵抗性導電材料からなる2本
のストライプを含み、各ストライプは平方あたりの第1
の抵抗Rp および正規幅Wpを有し、マスクとして抵抗
性導電材料からなるストライプを使用することによって
ドープされた正規幅Wm を有し、かつ平方あたりの第2
の抵抗Rm を有する1本のストライプを半導体基板にお
いてそれらの間に規定し、2つのメタライゼーションは
3本のストライプの第1および第2の先端をそれぞれ接
続する。幅および平方あたりの抵抗はRp Wp =2Rm
Wm であるように定められる。
導体基板に形成される精密抵抗器を提供し、この抵抗器
は絶縁材料上に配設される抵抗性導電材料からなる2本
のストライプを含み、各ストライプは平方あたりの第1
の抵抗Rp および正規幅Wpを有し、マスクとして抵抗
性導電材料からなるストライプを使用することによって
ドープされた正規幅Wm を有し、かつ平方あたりの第2
の抵抗Rm を有する1本のストライプを半導体基板にお
いてそれらの間に規定し、2つのメタライゼーションは
3本のストライプの第1および第2の先端をそれぞれ接
続する。幅および平方あたりの抵抗はRp Wp =2Rm
Wm であるように定められる。
【0006】この発明の一実施例に従って、抵抗性導電
材料はドープされた多結晶シリコンである。
材料はドープされた多結晶シリコンである。
【0007】この発明の一実施例に従って、抵抗器はド
ープされたストライプがそこに延在する領域を取囲む厚
い酸化物領域によって描かれ、抵抗性導電材料のストラ
イプの各々は厚い酸化物のストライプ上に部分的に延在
し、かつ薄い酸化物層上に部分的に延在して、他方の厚
い酸化物のストライプの側に厚い酸化物ストライプの各
々を延長する。
ープされたストライプがそこに延在する領域を取囲む厚
い酸化物領域によって描かれ、抵抗性導電材料のストラ
イプの各々は厚い酸化物のストライプ上に部分的に延在
し、かつ薄い酸化物層上に部分的に延在して、他方の厚
い酸化物のストライプの側に厚い酸化物ストライプの各
々を延長する。
【0008】この発明の一実施例に従って、ドープされ
たストライプおよび抵抗性導電材料のストライプのアセ
ンブリは絶縁層で被覆され、メタライゼーションはコン
タクト開口を介してそれらの先端に達する。
たストライプおよび抵抗性導電材料のストライプのアセ
ンブリは絶縁層で被覆され、メタライゼーションはコン
タクト開口を介してそれらの先端に達する。
【0009】この発明はさらに精密抵抗器を製造するた
めの方法を提供し、この方法は薄い酸化物層で被覆され
た半導体基板のストライプをそれらの間に描く厚い酸化
物領域を形成するステップと、多結晶シリコン層で構造
を被覆するステップと、多結晶シリコン層に2本のスト
ライプをエッチングするステップと、多結晶シリコンの
ストライプの間に薄い酸化物層をエッチングするステッ
プと、多結晶シリコンのストライプおよび基板の見かけ
のストライプをドープするステップと、3本のストライ
プの両端でコンタクトを形成するステップとを含む。
めの方法を提供し、この方法は薄い酸化物層で被覆され
た半導体基板のストライプをそれらの間に描く厚い酸化
物領域を形成するステップと、多結晶シリコン層で構造
を被覆するステップと、多結晶シリコン層に2本のスト
ライプをエッチングするステップと、多結晶シリコンの
ストライプの間に薄い酸化物層をエッチングするステッ
プと、多結晶シリコンのストライプおよび基板の見かけ
のストライプをドープするステップと、3本のストライ
プの両端でコンタクトを形成するステップとを含む。
【0010】この発明の前述のおよび他の目的、特徴、
局面および利点は、添付の図面に関連して行なわれるこ
の発明の以下の詳細な説明から明らかになるであろう。
局面および利点は、添付の図面に関連して行なわれるこ
の発明の以下の詳細な説明から明らかになるであろう。
【0011】
【発明を実行するためのベストモード】図1および図2
(A)に示されるように、この発明は抵抗性導電材料か
らなる2本のストライプ1および2によって形成される
抵抗器を提供する。ストライプは半導体基板上の絶縁層
4上に形成される。ストライプ1および2の間には、予
め定められたドーピングレベルを有するストライプ6を
基板に形成するようにストライプ1および2をマスクと
して使用することによってドープされる基板部分が現わ
れる。むろん、基板8はストライプ6と反対のドーピン
グ型を有するか、同じドーピング型であるがより低いド
ーピングレベルを有するものであろう。ストライプ1、
2および6の第1の先端はメタライゼーション10を介
して相互接続され、ストライプの第2の先端はメタライ
ゼーション12を介して相互接続される。
(A)に示されるように、この発明は抵抗性導電材料か
らなる2本のストライプ1および2によって形成される
抵抗器を提供する。ストライプは半導体基板上の絶縁層
4上に形成される。ストライプ1および2の間には、予
め定められたドーピングレベルを有するストライプ6を
基板に形成するようにストライプ1および2をマスクと
して使用することによってドープされる基板部分が現わ
れる。むろん、基板8はストライプ6と反対のドーピン
グ型を有するか、同じドーピング型であるがより低いド
ーピングレベルを有するものであろう。ストライプ1、
2および6の第1の先端はメタライゼーション10を介
して相互接続され、ストライプの第2の先端はメタライ
ゼーション12を介して相互接続される。
【0012】この発明の好ましい実施例において、スト
ライプ6が形成される領域は薄い酸化物層によって延ば
される厚い酸化物層によって描かれ、各導電ストライプ
1および2は従来行なわれているように厚い酸化物およ
び薄い酸化物の両方を順に重ねるように形成され、他の
集積回路の構成要素からストライプ6を絶縁する。
ライプ6が形成される領域は薄い酸化物層によって延ば
される厚い酸化物層によって描かれ、各導電ストライプ
1および2は従来行なわれているように厚い酸化物およ
び薄い酸化物の両方を順に重ねるように形成され、他の
集積回路の構成要素からストライプ6を絶縁する。
【0013】この発明の好ましい実施例において、導電
ストライプ1および2はストライプ6と同じドーピング
ステップ中にドープされた多結晶シリコンからなる。
ストライプ1および2はストライプ6と同じドーピング
ステップ中にドープされた多結晶シリコンからなる。
【0014】図1および図2(A)に示される構造は以
下の連続ステップによって達成され得る。
下の連続ステップによって達成され得る。
【0015】半導体基板にストライプを規定する厚い酸
化物領域4を形成するステップ。厚い酸化物層をこのス
トライプ上に形成するステップ。
化物領域4を形成するステップ。厚い酸化物層をこのス
トライプ上に形成するステップ。
【0016】多結晶シリコン層で基板を被覆するステッ
プ。多結晶シリコンをエッチングして、ストライプ1お
よび2を規定するステップ。
プ。多結晶シリコンをエッチングして、ストライプ1お
よび2を規定するステップ。
【0017】薄い酸化物をエッチングして、基板がスト
ライプ1および2の間に現われるようにするステップ。
ライプ1および2の間に現われるようにするステップ。
【0018】ストライプ1および2と基板の見かけのス
トライプにドーパントを拡散、または注入して、ストラ
イプ6を形成するステップ。
トライプにドーパントを拡散、または注入して、ストラ
イプ6を形成するステップ。
【0019】以下、集積回路の分野において従来行なわ
れているように、平方毎の抵抗、すなわち四角形の層の
両側に形成される2つのメタライゼーション間の抵抗が
検討されるであろう。以下の説明において、当業者に周
知のエッジおよび形状効果は無視されるであろう。Rp
は多結晶シリコンストライプ1または2の平方あたりの
抵抗を示し、Rm は単結晶シリコン基板8に形成される
ドープされた領域6の平方あたりの抵抗を示す。図1に
示される構成要素の平方あたりの抵抗Rは次のとおりで
あろう。
れているように、平方毎の抵抗、すなわち四角形の層の
両側に形成される2つのメタライゼーション間の抵抗が
検討されるであろう。以下の説明において、当業者に周
知のエッジおよび形状効果は無視されるであろう。Rp
は多結晶シリコンストライプ1または2の平方あたりの
抵抗を示し、Rm は単結晶シリコン基板8に形成される
ドープされた領域6の平方あたりの抵抗を示す。図1に
示される構成要素の平方あたりの抵抗Rは次のとおりで
あろう。
【0020】1/R=2/Rp +1/Rm Rp およびRm の値がストライプ1および2の幅Wp 、
およびストライプ6の幅Wm に関して適切に選択される
と仮定すれば、製造パラメータの変化と実質的に関係な
く平方あたりの抵抗を有する抵抗器が得られることが論
証されるであろう。
およびストライプ6の幅Wm に関して適切に選択される
と仮定すれば、製造パラメータの変化と実質的に関係な
く平方あたりの抵抗を有する抵抗器が得られることが論
証されるであろう。
【0021】図2(B)は図2(A)の抵抗器と理論的
に同じように形成されるが、多結晶シリコンのストライ
プがより重くエッチングされるような、すなわちストラ
イプが前の場合より狭くなる程度にエッチングパラメー
タが変化した抵抗器を示す。したがって、ストライプ1
および2はこれよりW′p =Wp −2dWであるような
幅W′p を有するであろう。相互に、ストライプ6は幅
W′m =Wm +2dWを有するであろう。ストライプ
1、2および6を平行に含む図1に示される抵抗器の平
方あたりの抵抗R′は、
に同じように形成されるが、多結晶シリコンのストライ
プがより重くエッチングされるような、すなわちストラ
イプが前の場合より狭くなる程度にエッチングパラメー
タが変化した抵抗器を示す。したがって、ストライプ1
および2はこれよりW′p =Wp −2dWであるような
幅W′p を有するであろう。相互に、ストライプ6は幅
W′m =Wm +2dWを有するであろう。ストライプ
1、2および6を平行に含む図1に示される抵抗器の平
方あたりの抵抗R′は、
【0022】
【数1】
【0023】であり、すなわち、
【0024】
【数2】
【0025】である。もし乗算因子dWが0にされ、す
なわちもし Rp Wp =2Rm Wm であれば、等価抵抗R′の値は一定、かつ上記の値Rに
等しくされ得ることがわかる。
なわちもし Rp Wp =2Rm Wm であれば、等価抵抗R′の値は一定、かつ上記の値Rに
等しくされ得ることがわかる。
【0026】この関係は、多結晶シリコン層の厚さおよ
び/または値の比率Wm およびWpを適宜に選択するこ
とによっていかなる定められたドーピングレベルについ
ても容易に達成され得る。
び/または値の比率Wm およびWpを適宜に選択するこ
とによっていかなる定められたドーピングレベルについ
ても容易に達成され得る。
【0027】この発明はストライプ1および2が多結晶
シリコンのストライプである場合においてより特定的に
説明されてきたが、ストライプがいかなる他の選択され
た抵抗性材料、たとえば薄い金属層、高融点金属層また
は金属シリコン層によって構成されるときにも当てはま
ることが注目されるであろう。
シリコンのストライプである場合においてより特定的に
説明されてきたが、ストライプがいかなる他の選択され
た抵抗性材料、たとえば薄い金属層、高融点金属層また
は金属シリコン層によって構成されるときにも当てはま
ることが注目されるであろう。
【0028】さらに、用語「ストライプ」は電極10お
よび12の間に配設される抵抗領域を指定するために上
記の説明において使用されている。当業者はこれらのス
トライプが必ずしも直線ではなく、レイアウト要件のた
めにたとえばジグザグ形、円形または螺旋形のような他
のいかなるパターンも選択され得ることに注目するであ
ろう。
よび12の間に配設される抵抗領域を指定するために上
記の説明において使用されている。当業者はこれらのス
トライプが必ずしも直線ではなく、レイアウト要件のた
めにたとえばジグザグ形、円形または螺旋形のような他
のいかなるパターンも選択され得ることに注目するであ
ろう。
【0029】さらに、ストライプ1および2は必ずしも
等しい幅を有さない。他方、当業者はこの発明がたとえ
ば単結晶領域6の絶縁に関して抵抗器を製造するための
様々な既知の技術と組み合わされ得ることに注目するで
あろう。また、前述の全体構造はメタライゼーション1
0および12を形成する前に絶縁層で被覆され得、かつ
コンタクトは抵抗器のストライプの先端上で達成され
得、そのコンタクトはメタライゼーションによって相互
接続される。
等しい幅を有さない。他方、当業者はこの発明がたとえ
ば単結晶領域6の絶縁に関して抵抗器を製造するための
様々な既知の技術と組み合わされ得ることに注目するで
あろう。また、前述の全体構造はメタライゼーション1
0および12を形成する前に絶縁層で被覆され得、かつ
コンタクトは抵抗器のストライプの先端上で達成され
得、そのコンタクトはメタライゼーションによって相互
接続される。
【図1】この発明に従った精密抵抗器の一実施例の上面
図である。
図である。
【図2】図1の線I−Iに沿った断面図である。
1、2、6:ストライプ 4:絶縁材料 8:半導体基板 10、12:メタライゼーション
Claims (5)
- 【請求項1】 半導体基板(8)上に形成される精密抵
抗器であって、絶縁材料(4)上に配設される抵抗性導
電材料からなる2本のストライプ(1、2)を含み、各
ストライプは平方あたりの第1の抵抗Rp および正規幅
Wp を有し、前記半導体基板において正規幅Wm を有
し、かつマスクとして抵抗性導電材料のストライプを使
用することによってドープされ、かつ平方あたりの第2
の抵抗R m を有する1本のストライプ(6)をそれらの
間に規定し、2つのメタライゼーション(10、12)
は前記3本のストライプの前記第1および第2の先端を
それぞれ接続し、幅および平方あたりの抵抗はRp Wp
=2Rm Wm になるように選択される、精密抵抗器。 - 【請求項2】 前記抵抗性導電材料はドープされた多結
晶シリコンからなる、請求項1に記載の精密抵抗器。 - 【請求項3】 前記抵抗器は前記ドープされたストライ
プがそこに延在する領域を取囲む厚い酸化物領域(4)
によって描かれ、前記抵抗性導電材料からなるストライ
プの各々は厚い酸化物層上に部分的に延在し、かつ薄い
酸化物層上に部分的に延在して、厚い酸化物のストライ
プの各々を他方の厚い酸化物のストライプの側に延長す
る請求項1に記載の精密抵抗器。 - 【請求項4】 前記ドープされたストライプおよび前記
抵抗性導電材料からなるストライプのアセンブリは絶縁
層で被覆され、前記メタライゼーションは開口を介して
前記ストライプの先端に接触する、請求項1に記載の精
密抵抗器。 - 【請求項5】 精密抵抗器を製造するための方法であっ
て、 薄い酸化物層で被覆された半導体基板のストライプをそ
れらの間に描く厚い酸化物領域を形成するステップと、 多結晶シリコン層で構造を被覆するステップと、 多結晶シリコン層に2本のストライプ(1、2)をエッ
チングするステップと、 前記多結晶シリコンのストライプの間に前記薄い酸化物
層をエッチングするステップと、 前記多結晶シリコンのストライプと前記多結晶シリコン
のストライプの間の見かけの基板ストライプとをドープ
するステップと、 前記3本のストライプの両端上にコンタクトを形成する
ステップとを含む、方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR9112143A FR2681978B1 (fr) | 1991-09-26 | 1991-09-26 | Resistance de precision et procede de fabrication. |
FR91/12143 | 1991-09-26 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH06181291A true JPH06181291A (ja) | 1994-06-28 |
JP3403431B2 JP3403431B2 (ja) | 2003-05-06 |
Family
ID=9417524
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP25641492A Expired - Fee Related JP3403431B2 (ja) | 1991-09-26 | 1992-09-25 | 精密抵抗器およびその製造方法 |
Country Status (5)
Country | Link |
---|---|
US (2) | US5422298A (ja) |
EP (1) | EP0534872B1 (ja) |
JP (1) | JP3403431B2 (ja) |
DE (1) | DE69225761T2 (ja) |
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