JPH0566767B2 - - Google Patents
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- Publication number
- JPH0566767B2 JPH0566767B2 JP14693684A JP14693684A JPH0566767B2 JP H0566767 B2 JPH0566767 B2 JP H0566767B2 JP 14693684 A JP14693684 A JP 14693684A JP 14693684 A JP14693684 A JP 14693684A JP H0566767 B2 JPH0566767 B2 JP H0566767B2
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- JP
- Japan
- Prior art keywords
- circuit
- resistor network
- ladder resistor
- ladder
- input
- Prior art date
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- 239000000284 extract Substances 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 7
- 230000002238 attenuated effect Effects 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
- 238000013016 damping Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
- 102220264750 rs1305455942 Human genes 0.000 description 1
- 102220095236 rs876658436 Human genes 0.000 description 1
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は民生機器の音量調整、音質調整に用い
ることができる電子ボリユーム回路に関するもの
である。
ることができる電子ボリユーム回路に関するもの
である。
(従来例の構成とその問題点)
近年、民生機器分野では高機能化ならびに高級
化のためにその音量・音質調整の電子制御化が行
なわれている。また、民生機器の小型化・高性能
化に対応するために、デイジタル制御技術を応用
した電子制御化により、消費者に対してより使い
やすい音響システムの開発がなされてきている。
化のためにその音量・音質調整の電子制御化が行
なわれている。また、民生機器の小型化・高性能
化に対応するために、デイジタル制御技術を応用
した電子制御化により、消費者に対してより使い
やすい音響システムの開発がなされてきている。
以下、図面を参照しながら従来の本発明に関連
の深いデイジタル制御型電子ボリユーム回路につ
いて説明する。第1図は従来のデイジタル制御型
電子ボリユーム回路の構成図であり、1は入力端
子であり、2はR−2Rはしご形抵抗網である。
3はたとえばMOS型FETのアナログスイツチ群
で構成されるスイツチング回路である。4は帰還
抵抗RfBを有する演算増幅器などで構成される加
算回路である。5は出力端子である。
の深いデイジタル制御型電子ボリユーム回路につ
いて説明する。第1図は従来のデイジタル制御型
電子ボリユーム回路の構成図であり、1は入力端
子であり、2はR−2Rはしご形抵抗網である。
3はたとえばMOS型FETのアナログスイツチ群
で構成されるスイツチング回路である。4は帰還
抵抗RfBを有する演算増幅器などで構成される加
算回路である。5は出力端子である。
以上のように構成されたデイジタル制御型電子
ボリユーム回路についてその動作を以下に説明す
る。電流源として動作する入力信号はR−2Rは
しご形抵抗網2に入力され、このR−2Rはしご
形抵抗網2の各端子から得られる出力電流は外部
からのデイジタル制御信号によつて制御されるス
イツチング回路3により選択され、次の加算回路
4によつて電圧に変換される。R−2Rはしご形
抵抗網2の各端子から得られる出力電流は入力端
子1から遠ざかるにしたがつて入力電流の半分ず
つになり、つまり第n段目の出力電流は入力電流
の(1/2)nとなるため、スイツチング回路3に含
まれる各スイツチ素子をそれぞれ独立に制御する
ことにより任意の減衰量が得られる。
ボリユーム回路についてその動作を以下に説明す
る。電流源として動作する入力信号はR−2Rは
しご形抵抗網2に入力され、このR−2Rはしご
形抵抗網2の各端子から得られる出力電流は外部
からのデイジタル制御信号によつて制御されるス
イツチング回路3により選択され、次の加算回路
4によつて電圧に変換される。R−2Rはしご形
抵抗網2の各端子から得られる出力電流は入力端
子1から遠ざかるにしたがつて入力電流の半分ず
つになり、つまり第n段目の出力電流は入力電流
の(1/2)nとなるため、スイツチング回路3に含
まれる各スイツチ素子をそれぞれ独立に制御する
ことにより任意の減衰量が得られる。
しかしながら、上記のような構成においては任
意の減衰量を得るために複数個のスイツチ素子を
導通状態にしなければならず、このことにより、
このスイツチング回路3を制御するデイジタル制
御信号の発生回路が複雑なものになるという問題
点を有していた。
意の減衰量を得るために複数個のスイツチ素子を
導通状態にしなければならず、このことにより、
このスイツチング回路3を制御するデイジタル制
御信号の発生回路が複雑なものになるという問題
点を有していた。
(発明の目的)
本発明の目的は、簡単なデイジタル制御信号に
よつて制御可能で、かつ、任意の減衰特性が得ら
れる電子ボリユーム回路を提供することにある。
よつて制御可能で、かつ、任意の減衰特性が得ら
れる電子ボリユーム回路を提供することにある。
(発明の構成)
本発明の電子ボリユーム回路は、入力信号のレ
ベルを任意のレベルに減衰させるために適当な比
に抵抗分割された抵抗を含むR−2Rはしご形抵
抗網と、このはしご形抵抗網の出力のどれか1つ
をデイジタル制御信号により選択するスイツチン
グ回路と、このスイツチング回路の出力から信号
を取り出す緩衝増幅回路とから構成したものであ
り、これにより簡単なデイジタル制御信号によつ
て制御可能で、かつ、任意の減衰特性が得られる
ものである。
ベルを任意のレベルに減衰させるために適当な比
に抵抗分割された抵抗を含むR−2Rはしご形抵
抗網と、このはしご形抵抗網の出力のどれか1つ
をデイジタル制御信号により選択するスイツチン
グ回路と、このスイツチング回路の出力から信号
を取り出す緩衝増幅回路とから構成したものであ
り、これにより簡単なデイジタル制御信号によつ
て制御可能で、かつ、任意の減衰特性が得られる
ものである。
(実施例の説明)
以下、本発明の実施例について、図面を参照し
ながら説明する。
ながら説明する。
第2図は本発明の一実施例に係る電子ボリユー
ム回路の構成図を示すものである。第2図におい
て、6はR−2Rのはしご形抵抗網の抵抗Rを適
当な比に分割された2つの直列接続された抵抗を
含むR−2Rはしご形抵抗網、7はたとえばMOS
型FETのアナログスイツチ群で構成されるスイ
ツチング回路、8は演算増幅器などで構成される
緩衝増幅回路である。
ム回路の構成図を示すものである。第2図におい
て、6はR−2Rのはしご形抵抗網の抵抗Rを適
当な比に分割された2つの直列接続された抵抗を
含むR−2Rはしご形抵抗網、7はたとえばMOS
型FETのアナログスイツチ群で構成されるスイ
ツチング回路、8は演算増幅器などで構成される
緩衝増幅回路である。
以上のように構成された本実施例の電子ボリユ
ーム回路について以下その動作を説明する。ま
ず、電圧源として動作する入力信号は入力端子1
よりR−2Rはしご形抵抗網6に入力される。本
来R−2Rはしご形抵抗網の各端子から得られる
出力電圧は入力端子から遠ざかるにしたがつて入
力電圧の半分ずつになり、つまり入力電圧が6dB
ずつ減衰されるが、R−2Rはしご形抵抗網6の
ように抵抗Rの部分を適当な比に分割してそこに
新たに出力端子を設けることによつて、入力電圧
がたとえば29:21の比に分割した場合3dBずつ減
衰される。このR−2Rはしご形抵抗網6の出力
電圧は外部からのデイジタル制御信号によつてそ
のスイツチ素子のどれか1つが導通状態になるよ
うに制御されるスイツチング回路7により選択さ
れ、次の緩衝増幅回路8に入力された後、出力端
子5に出力される。したがつて、適当な比に抵抗
分割された抵抗を含むR−2Rはしご形抵抗網に
よつて、電子ボリユーム回路全体としては3dBス
テツプの減衰量が得られる。
ーム回路について以下その動作を説明する。ま
ず、電圧源として動作する入力信号は入力端子1
よりR−2Rはしご形抵抗網6に入力される。本
来R−2Rはしご形抵抗網の各端子から得られる
出力電圧は入力端子から遠ざかるにしたがつて入
力電圧の半分ずつになり、つまり入力電圧が6dB
ずつ減衰されるが、R−2Rはしご形抵抗網6の
ように抵抗Rの部分を適当な比に分割してそこに
新たに出力端子を設けることによつて、入力電圧
がたとえば29:21の比に分割した場合3dBずつ減
衰される。このR−2Rはしご形抵抗網6の出力
電圧は外部からのデイジタル制御信号によつてそ
のスイツチ素子のどれか1つが導通状態になるよ
うに制御されるスイツチング回路7により選択さ
れ、次の緩衝増幅回路8に入力された後、出力端
子5に出力される。したがつて、適当な比に抵抗
分割された抵抗を含むR−2Rはしご形抵抗網に
よつて、電子ボリユーム回路全体としては3dBス
テツプの減衰量が得られる。
以上のように本実施例によれば、R−2Rはし
ご形抵抗網の抵抗Rの部分を適当な比に分割した
R−2Rはしご形抵抗網6を用いることにより、
スイツチング回路7のスイツチ素子の1ケ所のみ
を導通状態にすることで3dBステツプの減衰量が
得られ、このことにより、デイジタル制御信号を
簡単なものとすることができる。
ご形抵抗網の抵抗Rの部分を適当な比に分割した
R−2Rはしご形抵抗網6を用いることにより、
スイツチング回路7のスイツチ素子の1ケ所のみ
を導通状態にすることで3dBステツプの減衰量が
得られ、このことにより、デイジタル制御信号を
簡単なものとすることができる。
なお、上の実施例ではR−2Rはしご形抵抗網
において入力信号を3dBステツプで減衰させると
したが、減衰ステツプは3dBに限定されるもので
なく、R−2Rはしご形抵抗網の抵抗Rの部分を
適当な比に分割して任意の値に減衰させるという
機能を有するものであれば何でもよい。例えばR
−2Rはしご形抵抗網の抵抗Rの部分を適当な比
に3つに分割した3つの直列接続された抵抗で
2dBステツプの減衰量が得られるR−2Rはしご
形抵抗網を用いることができる。
において入力信号を3dBステツプで減衰させると
したが、減衰ステツプは3dBに限定されるもので
なく、R−2Rはしご形抵抗網の抵抗Rの部分を
適当な比に分割して任意の値に減衰させるという
機能を有するものであれば何でもよい。例えばR
−2Rはしご形抵抗網の抵抗Rの部分を適当な比
に3つに分割した3つの直列接続された抵抗で
2dBステツプの減衰量が得られるR−2Rはしご
形抵抗網を用いることができる。
次に本発明の他の実施例について図面を参照し
ながら説明する。
ながら説明する。
第3図は本発明の他の実施例に係る電子ボリユ
ーム回路の構成図を示すものである。第3図にお
いて、9はR−2Rはしご形抵抗網の抵抗Rの部
分を入力端子1に近いところでは細かく、遠いと
ころでは大きく分割した抵抗を含むR−2Rはし
ご形抵抗網、7はスイツチング回路、8は緩衝増
幅回路である。はしご形抵抗網の抵抗Rの部分は
例えば、図のように、R1+R2=R,R3+R4+
R5+R6=R,R7+R8=R,R9+R10=R,R11
+R12=Rとなるよう分割する。
ーム回路の構成図を示すものである。第3図にお
いて、9はR−2Rはしご形抵抗網の抵抗Rの部
分を入力端子1に近いところでは細かく、遠いと
ころでは大きく分割した抵抗を含むR−2Rはし
ご形抵抗網、7はスイツチング回路、8は緩衝増
幅回路である。はしご形抵抗網の抵抗Rの部分は
例えば、図のように、R1+R2=R,R3+R4+
R5+R6=R,R7+R8=R,R9+R10=R,R11
+R12=Rとなるよう分割する。
以上のように構成された本実施例の電子ボリユ
ーム回路について以下その動作を説明する。ま
ず、電圧源として動作する入力信号は入力端子1
よりR−2Rはしご形抵抗網9に入力される。本
来R−2Rはしご形抵抗網の各端子から得られる
出力電圧は、入力電圧が6dBステツプで減衰した
ものであるが、R−2Rはしご形抵抗網9のよう
に抵抗Rの部分を入力端子1に近いところでは細
く、遠いところでは大きく分割して、適当な部分
に出力端子を設けることで、たとえばAカーブの
減衰特性が得られる。このR−2Rはしご形抵抗
網9の出力電圧は外部からのデイジタル制御信号
によつてそのスイツチ素子のどれか1つが導通状
態になるよう制御されるスイツチング回路7によ
り選択され、次の緩衝増幅回路8に入力された
後、出力端子5に出力される。したがつて、電子
ボリユーム回路全体としてはAカーブの減衰特性
を有している。
ーム回路について以下その動作を説明する。ま
ず、電圧源として動作する入力信号は入力端子1
よりR−2Rはしご形抵抗網9に入力される。本
来R−2Rはしご形抵抗網の各端子から得られる
出力電圧は、入力電圧が6dBステツプで減衰した
ものであるが、R−2Rはしご形抵抗網9のよう
に抵抗Rの部分を入力端子1に近いところでは細
く、遠いところでは大きく分割して、適当な部分
に出力端子を設けることで、たとえばAカーブの
減衰特性が得られる。このR−2Rはしご形抵抗
網9の出力電圧は外部からのデイジタル制御信号
によつてそのスイツチ素子のどれか1つが導通状
態になるよう制御されるスイツチング回路7によ
り選択され、次の緩衝増幅回路8に入力された
後、出力端子5に出力される。したがつて、電子
ボリユーム回路全体としてはAカーブの減衰特性
を有している。
以上のように本実施例によれば、R−2Rはし
ご形抵抗網の抵抗Rの部分を入力端子に近いとこ
ろでは細かく、遠いところでは大きく分割したR
−2Rはしご形抵抗網9を用いることにより、ス
イツチング回路7のスイツチ素子の1ケ所のみを
導通状態にすることでAカーブの減衰特性が得ら
れ、このことにより、デイジタル制御信号を簡単
なものとすることができる。
ご形抵抗網の抵抗Rの部分を入力端子に近いとこ
ろでは細かく、遠いところでは大きく分割したR
−2Rはしご形抵抗網9を用いることにより、ス
イツチング回路7のスイツチ素子の1ケ所のみを
導通状態にすることでAカーブの減衰特性が得ら
れ、このことにより、デイジタル制御信号を簡単
なものとすることができる。
なお、上の実施例ではR−2Rはしご形抵抗網
において入力信号をAカーブの減衰特性で減衰さ
せるとしたが、減衰特性はAカーブに限定される
ものでなく、R−2Rはしご形抵抗網の抵抗Rの
部分を適当な比に分割したものを適当に組み合わ
せることによつて任意の減衰特性を得るという機
能を有するものであれば何でもよい。
において入力信号をAカーブの減衰特性で減衰さ
せるとしたが、減衰特性はAカーブに限定される
ものでなく、R−2Rはしご形抵抗網の抵抗Rの
部分を適当な比に分割したものを適当に組み合わ
せることによつて任意の減衰特性を得るという機
能を有するものであれば何でもよい。
(発明の効果)
以上の説明から明らかなように、本発明はR−
2Rはしご形抵抗網の抵抗Rの部分を適当な値の
比に分割することによつて任意の減衰特性を得る
ことのできるR−2Rはしご形抵抗網によつて構
成しているので、簡単な回路によつて発生しうる
デイジタル制御信号によつて制御が可能で、か
つ、任意の減衰特性を有する電子ボリユーム回路
が得られるという優れた効果が得られる。
2Rはしご形抵抗網の抵抗Rの部分を適当な値の
比に分割することによつて任意の減衰特性を得る
ことのできるR−2Rはしご形抵抗網によつて構
成しているので、簡単な回路によつて発生しうる
デイジタル制御信号によつて制御が可能で、か
つ、任意の減衰特性を有する電子ボリユーム回路
が得られるという優れた効果が得られる。
第1図は従来のデイジタル制御型電子ボリユー
ム回路の構成図、第2図は本発明の一実施例に係
る電子ボリユーム回路の構成図、第3図は本発明
の他の実施例に係る電子ボリユーム回路の構成図
である。 1……入力端子、2,6,9……R−2Rはし
ご形抵抗網、3,7……スイツチング回路、4…
…加算回路、5……出力端子、8……緩衝増幅回
路。ただし、第1図、第2図、第3図の各部を示
す符号の中で同一の符号を有しているものは、同
一の機能を有することを示す。
ム回路の構成図、第2図は本発明の一実施例に係
る電子ボリユーム回路の構成図、第3図は本発明
の他の実施例に係る電子ボリユーム回路の構成図
である。 1……入力端子、2,6,9……R−2Rはし
ご形抵抗網、3,7……スイツチング回路、4…
…加算回路、5……出力端子、8……緩衝増幅回
路。ただし、第1図、第2図、第3図の各部を示
す符号の中で同一の符号を有しているものは、同
一の機能を有することを示す。
Claims (1)
- 1 入力信号のレベルを任意のレベルに減衰させ
るために適当な比に抵抗分割された抵抗を含むR
−2Rはしご形抵抗網と、このR−2Rはしご形抵
抗網の出力のどれか1つをデイジタル制御信号に
より選択するスイツチング回路と、このスイツチ
ング回路の出力から信号を取り出す緩衝増幅回路
とから構成したことを特徴とする電子ボリユーム
回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14693684A JPS6126315A (ja) | 1984-07-17 | 1984-07-17 | 電子ボリユ−ム回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14693684A JPS6126315A (ja) | 1984-07-17 | 1984-07-17 | 電子ボリユ−ム回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6126315A JPS6126315A (ja) | 1986-02-05 |
JPH0566767B2 true JPH0566767B2 (ja) | 1993-09-22 |
Family
ID=15418918
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP14693684A Granted JPS6126315A (ja) | 1984-07-17 | 1984-07-17 | 電子ボリユ−ム回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6126315A (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0321110A (ja) * | 1989-06-19 | 1991-01-29 | Hitachi Ltd | 利得制御回路 |
-
1984
- 1984-07-17 JP JP14693684A patent/JPS6126315A/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS6126315A (ja) | 1986-02-05 |
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