JPH0541404A - 熱硬化性樹脂シート及びそれを用いた半導体素子の実装方法 - Google Patents
熱硬化性樹脂シート及びそれを用いた半導体素子の実装方法Info
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Abstract
(57)【要約】
【目的】半導体素子と回路基板の実装の際、熱硬化性樹
脂シートの接着面積が小さくても、収縮力が大きく、接
触不良のない実装方法を提供する。 【構成】回路基板11の配線パターン13以外の部分に、熱
収縮性粒子21を分散含有させた熱硬化性樹脂シート20を
接着し、半導体素子10上のバンプ12と配線パターン13の
位置合わせを行なう。その後、樹脂シート20を硬化させ
る工程と収縮させる工程を施す。 【効果】熱収縮性粒子21の含有により収縮力が増加する
ため、半導体素子10上のバンプ数が増えても1バンプ当
たりに作用する収縮力が小さくなるようなことがなく、
バンプ12と配線パターン13の良好な押圧状態が維持で
き、実装の信頼性が向上する。
脂シートの接着面積が小さくても、収縮力が大きく、接
触不良のない実装方法を提供する。 【構成】回路基板11の配線パターン13以外の部分に、熱
収縮性粒子21を分散含有させた熱硬化性樹脂シート20を
接着し、半導体素子10上のバンプ12と配線パターン13の
位置合わせを行なう。その後、樹脂シート20を硬化させ
る工程と収縮させる工程を施す。 【効果】熱収縮性粒子21の含有により収縮力が増加する
ため、半導体素子10上のバンプ数が増えても1バンプ当
たりに作用する収縮力が小さくなるようなことがなく、
バンプ12と配線パターン13の良好な押圧状態が維持で
き、実装の信頼性が向上する。
Description
【0001】
【産業上の利用分野】本発明は、LSI等の半導体素子
のフェイスダウン方式の実装方法に関するものである。
のフェイスダウン方式の実装方法に関するものである。
【0002】
【従来の技術】SiやGaAsを材料に用いた半導体素
子を回路基板に実装する方法として、フリップチップ法
がある。これは、突起電極(以下「バンプ」と云う)が
形成された半導体素子をフェイスダウン方式で、回路基
板に接続する方法である。
子を回路基板に実装する方法として、フリップチップ法
がある。これは、突起電極(以下「バンプ」と云う)が
形成された半導体素子をフェイスダウン方式で、回路基
板に接続する方法である。
【0003】図1に、従来例を示す。同図は、半導体素
子10を回路基板11に実装した状態の断面図である。ここ
で、12は半導体素子10上にハンダや金などで形成された
バンプであり、回路基板11上のITO(Indium Tin Oxi
de)膜などで形成された配線パターン13と接続される。
14は半導体素子10と回路基板11を固定するための熱硬化
性樹脂シートである。この熱硬化性樹脂シート14は、加
熱により硬化し、その硬化に伴なう体積収縮によって、
半導体素子10と回路基板11を固定している。
子10を回路基板11に実装した状態の断面図である。ここ
で、12は半導体素子10上にハンダや金などで形成された
バンプであり、回路基板11上のITO(Indium Tin Oxi
de)膜などで形成された配線パターン13と接続される。
14は半導体素子10と回路基板11を固定するための熱硬化
性樹脂シートである。この熱硬化性樹脂シート14は、加
熱により硬化し、その硬化に伴なう体積収縮によって、
半導体素子10と回路基板11を固定している。
【0004】上述の実装方法の手順は、まず回路基板11
上に25μm程度の厚みの熱硬化性樹脂シート14を接着
する。続いて、半導体素子10をフェイスダウンで、バン
プ12と回路基板11上の配線パターン13の位置合わせを行
ないながら配置する。その後、加熱加圧装置(不図示)
により、バンプ12と配線パターン13を押圧した状態を保
ちつつ、熱硬化性樹脂シート14を硬化させる。
上に25μm程度の厚みの熱硬化性樹脂シート14を接着
する。続いて、半導体素子10をフェイスダウンで、バン
プ12と回路基板11上の配線パターン13の位置合わせを行
ないながら配置する。その後、加熱加圧装置(不図示)
により、バンプ12と配線パターン13を押圧した状態を保
ちつつ、熱硬化性樹脂シート14を硬化させる。
【0005】
【発明が解決しようとする課題】上述のように、熱硬化
性樹脂シート14の硬化時の体積収縮力を利用して、半導
体素子10上のバンプ12と回路基板11上の配線パターン13
を圧接するような場合、熱硬化性樹脂シート14は、通
常、半導体素子10の中心に存し、その部分のみでバンプ
12と配線パターン13の押圧状態を維持することになる。
しかしながら、熱硬化性樹脂シート14の貼付面積に対し
てバンプ数が多くなったときには、1バンプ当たりに作
用する樹脂の収縮力が小さくなってしまい、バンプ12と
配線パターン13の良好な押圧状態を維持できなくなる。
これにより、接続不良が発生するという問題が生じてい
た。本発明は、このような問題を解決し、熱硬化性樹脂
シートの接着面積が小さくても収縮力が大きく、バンプ
と配線パターン間で接触不良等が生じない実装方法を提
供することを目的とする。
性樹脂シート14の硬化時の体積収縮力を利用して、半導
体素子10上のバンプ12と回路基板11上の配線パターン13
を圧接するような場合、熱硬化性樹脂シート14は、通
常、半導体素子10の中心に存し、その部分のみでバンプ
12と配線パターン13の押圧状態を維持することになる。
しかしながら、熱硬化性樹脂シート14の貼付面積に対し
てバンプ数が多くなったときには、1バンプ当たりに作
用する樹脂の収縮力が小さくなってしまい、バンプ12と
配線パターン13の良好な押圧状態を維持できなくなる。
これにより、接続不良が発生するという問題が生じてい
た。本発明は、このような問題を解決し、熱硬化性樹脂
シートの接着面積が小さくても収縮力が大きく、バンプ
と配線パターン間で接触不良等が生じない実装方法を提
供することを目的とする。
【0006】
【課題を解決するための手段】上記目的を達成するた
め、本発明の実装方法は、半導体素子と回路基板の接続
を行なう実装方法であって、前記半導体素子上に形成さ
れたバンプと、前記回路基板上に形成された前記バンプ
と対向する配線パターンとを位置合わせし、前記半導体
素子と前記回路基板との間に、前記バンプと同程度の厚
みを持ち熱収縮性粒子を含有した熱硬化性樹脂シートを
介し、前記熱硬化性樹脂シートの硬化及び収縮を行なっ
ている。また、前記熱収縮性粒子の収縮温度は、前記熱
硬化性樹脂シートの硬化温度より高くなっており、前記
熱硬化性樹脂シートは、前記バンプと前記配線パターン
の間にない。
め、本発明の実装方法は、半導体素子と回路基板の接続
を行なう実装方法であって、前記半導体素子上に形成さ
れたバンプと、前記回路基板上に形成された前記バンプ
と対向する配線パターンとを位置合わせし、前記半導体
素子と前記回路基板との間に、前記バンプと同程度の厚
みを持ち熱収縮性粒子を含有した熱硬化性樹脂シートを
介し、前記熱硬化性樹脂シートの硬化及び収縮を行なっ
ている。また、前記熱収縮性粒子の収縮温度は、前記熱
硬化性樹脂シートの硬化温度より高くなっており、前記
熱硬化性樹脂シートは、前記バンプと前記配線パターン
の間にない。
【0007】
【作用】このようにすると、半導体素子と回路基板の実
装の際、従来の熱硬化性樹脂シートの収縮力に、熱収縮
性粒子による収縮力が加わるので、シートとしての収縮
力が増す。従って、半導体素子のバンプと回路基板の配
線パターン間で接触不良が生じず、実装の信頼性の向上
が図れる。
装の際、従来の熱硬化性樹脂シートの収縮力に、熱収縮
性粒子による収縮力が加わるので、シートとしての収縮
力が増す。従って、半導体素子のバンプと回路基板の配
線パターン間で接触不良が生じず、実装の信頼性の向上
が図れる。
【0008】
【実施例】以下、本発明の実施例を図面を参照しつつ、
説明する。図2に、本発明を実施した実装構造を示す。
ここで使用されているシート20は、熱硬化性樹脂シート
に熱収縮性粒子21を含有したもので、例えば、従来から
用いられているエポキシ樹脂に直径5〜20μmのPV
C(ポリビニルクロライド:塩化ビニル)の粒子を分散
含有したものである。エポキシ樹脂が最大5%程度の体
積収縮率であるのに対し、PVCは最大50%の体積収
縮率を有している。この約10倍の体積収縮率を、厚さ
方向のみで考えると、約 2.15倍となる。即ち、熱収
縮性粒子としてPVCを体積比10%で添加すると、樹
脂シートとしては約20%収縮力が増加することにな
り、同一形状のシートの場合、バンプ数を20%増加さ
せても、従来のバンプと配線パターンの押圧状態が維持
できることになる。
説明する。図2に、本発明を実施した実装構造を示す。
ここで使用されているシート20は、熱硬化性樹脂シート
に熱収縮性粒子21を含有したもので、例えば、従来から
用いられているエポキシ樹脂に直径5〜20μmのPV
C(ポリビニルクロライド:塩化ビニル)の粒子を分散
含有したものである。エポキシ樹脂が最大5%程度の体
積収縮率であるのに対し、PVCは最大50%の体積収
縮率を有している。この約10倍の体積収縮率を、厚さ
方向のみで考えると、約 2.15倍となる。即ち、熱収
縮性粒子としてPVCを体積比10%で添加すると、樹
脂シートとしては約20%収縮力が増加することにな
り、同一形状のシートの場合、バンプ数を20%増加さ
せても、従来のバンプと配線パターンの押圧状態が維持
できることになる。
【0009】図2に戻って、本発明の実装方法を用い
た、半導体素子10と回路基板11の実装について説明す
る。まず、回路基板11の配線パターン13以外の部分に、
厚さ20〜25μmのPVCを含有したエポキシ樹脂シ
ート20を仮接着する。続いて、半導体素子10上に形成さ
れたバンプ12と、回路基板11上に形成された配線パター
ン13とを位置合わせして、半導体素子10をフェイスダウ
ンで配置する。次に、加熱加圧装置(不図示)により、
半導体素子10の裏面より加熱加圧する。ここでは、温度
は60〜80゜c、圧力は60〜80g/バンプ、時間
は30〜60秒としている。樹脂シート20に含有されて
いる熱収縮性粒子21(PVC)は約100゜cで収縮を
開始するため、この加熱加圧時には、エポキシ樹脂の硬
化のみで熱収縮性粒子21(PVC)の収縮は生じない。
その後、半導体素子10が接続された回路基板11を120
゜cのオーブン中に1〜2分投入し、熱収縮性粒子21
(PVC)を収縮させて、実装を完了させる。図2で
は、バンプ数が同じである図1の場合と較べ、半導体素
子10のバンプ12と回路基板11上の配線パターン13との接
触の強度が違う。図2の方が圧接された状態であり、よ
り強度が大きい。従って、バンプ数が増加しても、バン
プと配線パターンの押圧状態は良好である。
た、半導体素子10と回路基板11の実装について説明す
る。まず、回路基板11の配線パターン13以外の部分に、
厚さ20〜25μmのPVCを含有したエポキシ樹脂シ
ート20を仮接着する。続いて、半導体素子10上に形成さ
れたバンプ12と、回路基板11上に形成された配線パター
ン13とを位置合わせして、半導体素子10をフェイスダウ
ンで配置する。次に、加熱加圧装置(不図示)により、
半導体素子10の裏面より加熱加圧する。ここでは、温度
は60〜80゜c、圧力は60〜80g/バンプ、時間
は30〜60秒としている。樹脂シート20に含有されて
いる熱収縮性粒子21(PVC)は約100゜cで収縮を
開始するため、この加熱加圧時には、エポキシ樹脂の硬
化のみで熱収縮性粒子21(PVC)の収縮は生じない。
その後、半導体素子10が接続された回路基板11を120
゜cのオーブン中に1〜2分投入し、熱収縮性粒子21
(PVC)を収縮させて、実装を完了させる。図2で
は、バンプ数が同じである図1の場合と較べ、半導体素
子10のバンプ12と回路基板11上の配線パターン13との接
触の強度が違う。図2の方が圧接された状態であり、よ
り強度が大きい。従って、バンプ数が増加しても、バン
プと配線パターンの押圧状態は良好である。
【0010】
【発明の効果】以上説明したように、本発明によれば、
半導体素子と回路基板の実装の際、熱硬化性樹脂シート
に熱収縮性粒子を含有させることによって、その収縮力
を増加させることができる。従って、半導体素子のバン
プ数が増えても1バンプ当たりに作用する樹脂シートの
収縮力が小さくならず、接触不良等が生じることがない
ので、実装の信頼性が向上する。
半導体素子と回路基板の実装の際、熱硬化性樹脂シート
に熱収縮性粒子を含有させることによって、その収縮力
を増加させることができる。従って、半導体素子のバン
プ数が増えても1バンプ当たりに作用する樹脂シートの
収縮力が小さくならず、接触不良等が生じることがない
ので、実装の信頼性が向上する。
【図1】 従来の実装構造を説明するための図。
【図2】 本発明を実施した実装構造を示す図。
10 半導体素子 11 回路基板 12 バンプ 13 配線パターン 14 熱硬化性樹脂シート 20 熱収縮性粒子を含有させた熱硬化性樹脂シート 21 熱収縮性粒子
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成4年11月5日
【手続補正2】
【補正対象書類名】明細書
【補正対象項目名】発明の名称
【補正方法】変更
【補正内容】
【発明の名称】 熱硬化性樹脂シート及びそれを用
いた半導体素子の実装方法
いた半導体素子の実装方法
【手続補正3】
【補正対象書類名】明細書
【補正対象項目名】特許請求の範囲
【補正方法】変更
【補正内容】
【特許請求の範囲】
【手続補正4】
【補正対象書類名】明細書
【補正対象項目名】0005
【補正方法】変更
【補正内容】
【0005】
【発明が解決しようとする課題】上述のように、熱硬化
性樹脂シート14の硬化時の体積収縮力を利用して、半導
体素子10上のバンプ12と回路基板11上の配線パターン13
を圧接するような場合、熱硬化性樹脂シート14は、通
常、半導体素子10の中心に存し、その部分のみでバンプ
12と配線パターン13の押圧状態を維持することになる。
しかしながら、熱硬化性樹脂シート14の貼付面積に対し
てバンプ数が多くなったときには、1バンプ当たりに作
用する樹脂の収縮力が小さくなってしまい、バンプ12と
配線パターン13の良好な押圧状態を維持できなくなる。
これにより、接続不良が発生するという問題が生じてい
た。本発明は、このような問題を解決し、接着面積が小
さくても収縮力が大きく、バンプと配線パターン間で接
触不良等が生じない熱硬化性樹脂シート及びそれを用い
た実装方法を提供することを目的とする。
性樹脂シート14の硬化時の体積収縮力を利用して、半導
体素子10上のバンプ12と回路基板11上の配線パターン13
を圧接するような場合、熱硬化性樹脂シート14は、通
常、半導体素子10の中心に存し、その部分のみでバンプ
12と配線パターン13の押圧状態を維持することになる。
しかしながら、熱硬化性樹脂シート14の貼付面積に対し
てバンプ数が多くなったときには、1バンプ当たりに作
用する樹脂の収縮力が小さくなってしまい、バンプ12と
配線パターン13の良好な押圧状態を維持できなくなる。
これにより、接続不良が発生するという問題が生じてい
た。本発明は、このような問題を解決し、接着面積が小
さくても収縮力が大きく、バンプと配線パターン間で接
触不良等が生じない熱硬化性樹脂シート及びそれを用い
た実装方法を提供することを目的とする。
【手続補正5】
【補正対象書類名】明細書
【補正対象項目名】0006
【補正方法】変更
【補正内容】
【0006】
【課題を解決するための手段】上記目的を達成するた
め、本発明の熱硬化性樹脂シートは、半導体素子と回路
基板の接続を行なうとき使用する熱硬化性樹脂シートで
あって、熱収縮性粒子を含有している。そして、前記熱
収縮性粒子の収縮温度が、前記熱硬化性樹脂シート本体
の硬化温度より高くなっている。また、本発明の実装方
法は、半導体素子と回路基板の接続を行なう実装方法で
あって、前記半導体素子上に形成されたバンプと、前記
回路基板上に形成された前記バンプと対向する配線パタ
ーンとを位置合わせし、前記半導体素子と前記回路回路
基板との間に、前記バンプと同程度の厚みを持ち熱収縮
性粒子を含有した熱硬化性樹脂シートを介し、前記熱硬
化性樹脂シートの硬化及び収縮を行なっている。そし
て、前記熱硬化性樹脂シートは、前記バンプと前記配線
パターンの間にない。
め、本発明の熱硬化性樹脂シートは、半導体素子と回路
基板の接続を行なうとき使用する熱硬化性樹脂シートで
あって、熱収縮性粒子を含有している。そして、前記熱
収縮性粒子の収縮温度が、前記熱硬化性樹脂シート本体
の硬化温度より高くなっている。また、本発明の実装方
法は、半導体素子と回路基板の接続を行なう実装方法で
あって、前記半導体素子上に形成されたバンプと、前記
回路基板上に形成された前記バンプと対向する配線パタ
ーンとを位置合わせし、前記半導体素子と前記回路回路
基板との間に、前記バンプと同程度の厚みを持ち熱収縮
性粒子を含有した熱硬化性樹脂シートを介し、前記熱硬
化性樹脂シートの硬化及び収縮を行なっている。そし
て、前記熱硬化性樹脂シートは、前記バンプと前記配線
パターンの間にない。
Claims (3)
- 【請求項1】 半導体素子と回路基板の接続を行なう実
装方法であって、 前記半導体素子上に形成された突起電極と、前記回路基
板上に形成された前記突起電極と対向する配線パターン
とを位置合わせし、 前記半導体素子と前記回路基板との間に、前記突起電極
と同程度の厚みを持ち熱収縮性粒子を含有した熱硬化性
樹脂シートを介し、前記熱硬化性樹脂シートの硬化及び
収縮を行なうことを特徴とする半導体素子の実装方法。 - 【請求項2】 前記熱収縮性粒子の収縮温度が、前記熱
硬化性樹脂シートの硬化温度より高いことを特徴とする
請求項1に記載の半導体素子の実装方法。 - 【請求項3】 前記熱硬化性樹脂シートが、前記突起電
極と前記配線パターンの間にないことを特徴とする請求
項1に記載の半導体素子の実装方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22101091A JP3225062B2 (ja) | 1991-08-05 | 1991-08-05 | 熱硬化性樹脂シート及びそれを用いた半導体素子の実装方法 |
US07/924,703 US5210938A (en) | 1991-08-05 | 1992-08-04 | Method of assembling an electronic part device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22101091A JP3225062B2 (ja) | 1991-08-05 | 1991-08-05 | 熱硬化性樹脂シート及びそれを用いた半導体素子の実装方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0541404A true JPH0541404A (ja) | 1993-02-19 |
JP3225062B2 JP3225062B2 (ja) | 2001-11-05 |
Family
ID=16760066
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP22101091A Expired - Fee Related JP3225062B2 (ja) | 1991-08-05 | 1991-08-05 | 熱硬化性樹脂シート及びそれを用いた半導体素子の実装方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US5210938A (ja) |
JP (1) | JP3225062B2 (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5846853A (en) * | 1991-12-11 | 1998-12-08 | Mitsubishi Denki Kabushiki Kaisha | Process for bonding circuit substrates using conductive particles and back side exposure |
JP2000114786A (ja) * | 1998-09-30 | 2000-04-21 | Matsushita Electric Ind Co Ltd | Icチップ実装機 |
US6076284A (en) * | 1994-03-18 | 2000-06-20 | Ballet Makers, Inc. | Shoe with split sole and mid-section reinforcement |
JP4958363B2 (ja) * | 2000-03-10 | 2012-06-20 | スタッツ・チップパック・インコーポレイテッド | パッケージング構造及び方法 |
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US5386624A (en) * | 1993-07-06 | 1995-02-07 | Motorola, Inc. | Method for underencapsulating components on circuit supporting substrates |
US5820716A (en) | 1993-11-05 | 1998-10-13 | Micron Technology, Inc. | Method for surface mounting electrical components to a substrate |
US5639011A (en) * | 1995-02-02 | 1997-06-17 | Jacks; David C. | Attaching components and reworking circuit boards |
US6651320B1 (en) | 1997-10-02 | 2003-11-25 | Matsushita Electric Industrial Co., Ltd. | Method for mounting semiconductor element to circuit board |
US6324069B1 (en) | 1997-10-29 | 2001-11-27 | Hestia Technologies, Inc. | Chip package with molded underfill |
US6495083B2 (en) * | 1997-10-29 | 2002-12-17 | Hestia Technologies, Inc. | Method of underfilling an integrated circuit chip |
JPH11219984A (ja) * | 1997-11-06 | 1999-08-10 | Sharp Corp | 半導体装置パッケージおよびその製造方法ならびにそのための回路基板 |
US6243944B1 (en) * | 1997-12-08 | 2001-06-12 | Unisys Corporation | Residue-free method of assembling and disassembling a pressed joint with low thermal resistance |
US10388626B2 (en) * | 2000-03-10 | 2019-08-20 | STATS ChipPAC Pte. Ltd. | Semiconductor device and method of forming flipchip interconnect structure |
US6815252B2 (en) | 2000-03-10 | 2004-11-09 | Chippac, Inc. | Method of forming flip chip interconnection structure |
US6780682B2 (en) | 2001-02-27 | 2004-08-24 | Chippac, Inc. | Process for precise encapsulation of flip chip interconnects |
US6737295B2 (en) * | 2001-02-27 | 2004-05-18 | Chippac, Inc. | Chip scale package with flip chip interconnect |
US6940178B2 (en) * | 2001-02-27 | 2005-09-06 | Chippac, Inc. | Self-coplanarity bumping shape for flip chip |
DE10204959A1 (de) * | 2002-02-06 | 2003-08-14 | Endress & Hauser Gmbh & Co Kg | Leiterplatte mit einem Bauteil |
JP4928172B2 (ja) * | 2006-06-15 | 2012-05-09 | 株式会社クボタ | モーア |
CN101141027B (zh) * | 2007-09-20 | 2012-02-29 | 友达光电(苏州)有限公司 | 平面显示器基板的电路连接结构与其连接方法 |
US10104772B2 (en) * | 2014-08-19 | 2018-10-16 | International Business Machines Incorporated | Metallized particle interconnect with solder components |
JP6753725B2 (ja) * | 2016-08-08 | 2020-09-09 | 株式会社フジクラ | 実装体 |
CN112786555A (zh) * | 2021-01-12 | 2021-05-11 | 杰群电子科技(东莞)有限公司 | 一种功率模块封装结构及功率模块制造方法 |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
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JPS54105774A (en) * | 1978-02-08 | 1979-08-20 | Hitachi Ltd | Method of forming pattern on thin film hybrid integrated circuit |
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-
1991
- 1991-08-05 JP JP22101091A patent/JP3225062B2/ja not_active Expired - Fee Related
-
1992
- 1992-08-04 US US07/924,703 patent/US5210938A/en not_active Expired - Lifetime
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Also Published As
Publication number | Publication date |
---|---|
JP3225062B2 (ja) | 2001-11-05 |
US5210938A (en) | 1993-05-18 |
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