JPH05216549A - 定電圧回路 - Google Patents
定電圧回路Info
- Publication number
- JPH05216549A JPH05216549A JP1738692A JP1738692A JPH05216549A JP H05216549 A JPH05216549 A JP H05216549A JP 1738692 A JP1738692 A JP 1738692A JP 1738692 A JP1738692 A JP 1738692A JP H05216549 A JPH05216549 A JP H05216549A
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- JP
- Japan
- Prior art keywords
- resistor
- constant voltage
- resistance
- voltage circuit
- amplification factor
- Prior art date
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- Continuous-Control Power Sources That Use Transistors (AREA)
Abstract
(57)【要約】
【目的】トランジスタのベース，エミッタ間電圧を用い
た定電圧回路において、出力電圧がトランジスタの電流
増幅率の影響をほとんど受けることのない定電圧回路を
得る。 【構成】ＮＰＮバイポーラトランジスタＱ1 のベース・
エミッタ間に抵抗６を接続し、ベース・コレクタ間に抵
抗５を接続し、第２電源端子２と出力端子３との間に電
流源４を接続し、トランジスタＱ1 のエミッタを第１電
源端子１に接続し、抵抗５の両端にピンチ抵抗７を接続
する。抵抗５を流れる電流とピンチ抵抗７の抵抗値と
は、トランジスタＱ1 の電流増幅率の変化に対して互い
に逆の挙動を示すので、出力電圧Ｖout は、電流増幅率
の影響を受けない。
た定電圧回路において、出力電圧がトランジスタの電流
増幅率の影響をほとんど受けることのない定電圧回路を
得る。 【構成】ＮＰＮバイポーラトランジスタＱ1 のベース・
エミッタ間に抵抗６を接続し、ベース・コレクタ間に抵
抗５を接続し、第２電源端子２と出力端子３との間に電
流源４を接続し、トランジスタＱ1 のエミッタを第１電
源端子１に接続し、抵抗５の両端にピンチ抵抗７を接続
する。抵抗５を流れる電流とピンチ抵抗７の抵抗値と
は、トランジスタＱ1 の電流増幅率の変化に対して互い
に逆の挙動を示すので、出力電圧Ｖout は、電流増幅率
の影響を受けない。
Description
【０００１】
【産業上の利用分野】本発明は定電圧回路に関し、特
に、バイポーラトランジスタを用いた定電圧回路に関す
る。
に、バイポーラトランジスタを用いた定電圧回路に関す
る。
【０００２】
【従来の技術】図２に従来の定電圧回路の回路図を示
す。図２において、ＮＰＮバイポーラトランジスタ（以
下トランジスタと記す）Ｑ1 は、コレクタが出力端子３
と電流源４の一端に接続され、さらに抵抗５を介してベ
ースに接続されている。また、電流源４の他端は第２電
源端子に接続されている。トランジスタＱ1 のベースは
抵抗６を介して第１電源端子１に接続され、エミッタは
第１電源端子１に接続されている。
す。図２において、ＮＰＮバイポーラトランジスタ（以
下トランジスタと記す）Ｑ1 は、コレクタが出力端子３
と電流源４の一端に接続され、さらに抵抗５を介してベ
ースに接続されている。また、電流源４の他端は第２電
源端子に接続されている。トランジスタＱ1 のベースは
抵抗６を介して第１電源端子１に接続され、エミッタは
第１電源端子１に接続されている。
【０００３】このような構成の定電圧回路において、第
１電源電圧を接地電位とし、出力端子の電圧をＶout 、
トランジスタＱ1 のベース・エミッタ間電圧をＶBE、コ
レクタ電流をＩC 、抵抗５の抵抗値をＲ1 、抵抗６の抵
抗値をＲ2 とし、トランジスタＱ1 の電流増幅率をβと
すると、トランジスタＱ1 のベース電流はＩC ／βとな
る。また、抵抗６にはＶBE／Ｒ2 なる電流が流れるの
で、抵抗５には（ＩC ／β＋ＶBE／Ｒ2 ）なる電流が流
れる。このため、出力端子３には Ｖout ＝ＶBE＋Ｒ1 （ＩC ／β＋ＶBE／Ｒ2 ） なる電圧が発生する。
１電源電圧を接地電位とし、出力端子の電圧をＶout 、
トランジスタＱ1 のベース・エミッタ間電圧をＶBE、コ
レクタ電流をＩC 、抵抗５の抵抗値をＲ1 、抵抗６の抵
抗値をＲ2 とし、トランジスタＱ1 の電流増幅率をβと
すると、トランジスタＱ1 のベース電流はＩC ／βとな
る。また、抵抗６にはＶBE／Ｒ2 なる電流が流れるの
で、抵抗５には（ＩC ／β＋ＶBE／Ｒ2 ）なる電流が流
れる。このため、出力端子３には Ｖout ＝ＶBE＋Ｒ1 （ＩC ／β＋ＶBE／Ｒ2 ） なる電圧が発生する。
【０００４】
【発明が解決しようとする課題】上述した従来の定電圧
回路による出力電圧Ｖout は、式に示すように、第２
項に（ＩC ／β＋ＶBE／Ｒ2 ）という電流増幅率βを含
んだ項をもっている。このため、たとえば電流増幅率β
が低下したとすると、（ＩC ／β＋ＶBE／Ｒ2 ）の項が
増加してしまう。つまり、定電圧回路を構成するトラン
ジスタの電流増幅率βが製造条件の変動などによりばら
つくと、出力電圧が著しくばらつくという欠点があっ
た。
回路による出力電圧Ｖout は、式に示すように、第２
項に（ＩC ／β＋ＶBE／Ｒ2 ）という電流増幅率βを含
んだ項をもっている。このため、たとえば電流増幅率β
が低下したとすると、（ＩC ／β＋ＶBE／Ｒ2 ）の項が
増加してしまう。つまり、定電圧回路を構成するトラン
ジスタの電流増幅率βが製造条件の変動などによりばら
つくと、出力電圧が著しくばらつくという欠点があっ
た。
【０００５】
【課題を解決するための手段】本発明の定電圧回路は、
エミッタが第１の電源端子に接続されたＮＰＮバイポー
ラトランジスタと第２の電源端子に接続された電流源と
を有し、前記電流源の他端は出力端子に接続され、前記
ＮＰＮバイポーラトランジスタのコレクタは前記出力端
子に接続され、前記ＮＰＮバイポーラトランジスタのベ
ースは第１の抵抗と第２の抵抗に接続され、前記第１の
抵抗の他端は前記出力端子に接続され、前記第２の抵抗
の他端は第２の電源端子に接続される定電圧回路におい
て、前記第１の抵抗と並列にピンチ抵抗が接続されたこ
とを特徴としている。
エミッタが第１の電源端子に接続されたＮＰＮバイポー
ラトランジスタと第２の電源端子に接続された電流源と
を有し、前記電流源の他端は出力端子に接続され、前記
ＮＰＮバイポーラトランジスタのコレクタは前記出力端
子に接続され、前記ＮＰＮバイポーラトランジスタのベ
ースは第１の抵抗と第２の抵抗に接続され、前記第１の
抵抗の他端は前記出力端子に接続され、前記第２の抵抗
の他端は第２の電源端子に接続される定電圧回路におい
て、前記第１の抵抗と並列にピンチ抵抗が接続されたこ
とを特徴としている。
【０００６】
【実施例】次に本発明の最適な実施例について、図面を
参照して説明する。図１（ａ）は、本発明の第１の実施
例の回路図である。この第１の実施例では、図２に示す
従来の定電圧回路と比較して、ピンチ抵抗７が抵抗５に
並列に接続されている。図１（ａ）において、従来の定
電圧回路と同様に、第１電源端子１を接地とし、出力端
子の電圧をＶout 、トランジスタＱ1 のベース・エミッ
タ間電圧をＶBE、コレクタ電流をＩC 、抵抗５の抵抗値
をＲ1 、抵抗６の抵抗値をＲ2 、ピンチ抵抗７の抵抗値
をＲ3 、トランジスタＱ1 の電流増幅率をβとすると、
トランジスタＱ1 のベース電流はＩC ／βとなる。ま
た、抵抗６にはＶBE／Ｒ2 なる電流が流れるので、抵抗
５には（ＩC ／β＋ＶBE／Ｒ2 ）なる電流が流れる。こ
のため、出力端子３には
参照して説明する。図１（ａ）は、本発明の第１の実施
例の回路図である。この第１の実施例では、図２に示す
従来の定電圧回路と比較して、ピンチ抵抗７が抵抗５に
並列に接続されている。図１（ａ）において、従来の定
電圧回路と同様に、第１電源端子１を接地とし、出力端
子の電圧をＶout 、トランジスタＱ1 のベース・エミッ
タ間電圧をＶBE、コレクタ電流をＩC 、抵抗５の抵抗値
をＲ1 、抵抗６の抵抗値をＲ2 、ピンチ抵抗７の抵抗値
をＲ3 、トランジスタＱ1 の電流増幅率をβとすると、
トランジスタＱ1 のベース電流はＩC ／βとなる。ま
た、抵抗６にはＶBE／Ｒ2 なる電流が流れるので、抵抗
５には（ＩC ／β＋ＶBE／Ｒ2 ）なる電流が流れる。こ
のため、出力端子３には
【０００７】
【０００８】なる電圧が発生する。
【０００９】ところで、一般にピンチ抵抗はベース拡散
がエミッタ拡散によってピンチされる構造であるので、
ＮＰＮバイポーラトランジスタの電流増幅率βとピンチ
抵抗の抵抗値とは正比例の関係にある。従って、今、ピ
ンチ抵抗７の抵抗値Ｒ3 を、 Ｒ3 ＝Ａβ（ただしＡは比例係数） とすると、式は
がエミッタ拡散によってピンチされる構造であるので、
ＮＰＮバイポーラトランジスタの電流増幅率βとピンチ
抵抗の抵抗値とは正比例の関係にある。従って、今、ピ
ンチ抵抗７の抵抗値Ｒ3 を、 Ｒ3 ＝Ａβ（ただしＡは比例係数） とすると、式は
【００１０】
【００１１】となる。ここで電流増幅率βが製造条件の
変動などによりばらついた場合を考える。たとえば電流
増幅率βが低下したとすると、式の第２項のうち（Ｉ
C ／β＋ＶBE／Ｒ2 ）の項は従来例と同様増加する。し
かし式の第２項のうちＡＲ1／（Ａ＋Ｒ1 ／β）の項
は逆に減少する。このため、式と出力電圧Ｖout は電
流増幅率βがばらついてもほぼ一定に保たれ、従来例と
比較して電流増幅率βのばらつきの影響を著しく低減で
きる。たとえば、Ｒ1 ＝２０ＫΩ，Ｒ2 ＝２０ＫΩ，Ｉ
C ＝１００μＡ，ＶBE＝０．６８５Ｖとして電流増幅率
βの変動による出力電圧Ｖout の変動を、従来の定電圧
回路と本実施例のそれぞれについて求めてみると以下の
ようになる。
変動などによりばらついた場合を考える。たとえば電流
増幅率βが低下したとすると、式の第２項のうち（Ｉ
C ／β＋ＶBE／Ｒ2 ）の項は従来例と同様増加する。し
かし式の第２項のうちＡＲ1／（Ａ＋Ｒ1 ／β）の項
は逆に減少する。このため、式と出力電圧Ｖout は電
流増幅率βがばらついてもほぼ一定に保たれ、従来例と
比較して電流増幅率βのばらつきの影響を著しく低減で
きる。たとえば、Ｒ1 ＝２０ＫΩ，Ｒ2 ＝２０ＫΩ，Ｉ
C ＝１００μＡ，ＶBE＝０．６８５Ｖとして電流増幅率
βの変動による出力電圧Ｖout の変動を、従来の定電圧
回路と本実施例のそれぞれについて求めてみると以下の
ようになる。
【００１２】従来の定電圧回路では、式から β＝１００の時、Ｖout ＝１，３９０Ｖ β＝５０の時、 Ｖout ＝１，４１０Ｖ となり、約２０ｍＶの誤差が生じる。
【００１３】これに対して、本実施例では、式よりβ
＝１００の時、Ｒ3 ＝６８０ＫΩとすればＶout ＝１，
３７０Ｖであり、β＝５０の時、Ｒ3 ＝３４０ＫΩとす
ればＶout ＝１，３７０Ｖであり、出力電圧Ｖout はほ
とんど変化しない。
＝１００の時、Ｒ3 ＝６８０ＫΩとすればＶout ＝１，
３７０Ｖであり、β＝５０の時、Ｒ3 ＝３４０ＫΩとす
ればＶout ＝１，３７０Ｖであり、出力電圧Ｖout はほ
とんど変化しない。
【００１４】次に本発明の第２の実施例について説明す
る。図１（ｂ）は、本発明の第２の実施例の回路図であ
る。本実施例においては、ピンチ抵抗７は分割された抵
抗５の一方の抵抗に並列に接続されている。本実施例の
基本的な動作は第１の実施例と同じであるが、ピンチ抵
抗７の抵抗値と抵抗５の抵抗値及び分割比の選び方によ
って、電流増幅率βの補償特性をさらに微調整できると
いう利点がある。
る。図１（ｂ）は、本発明の第２の実施例の回路図であ
る。本実施例においては、ピンチ抵抗７は分割された抵
抗５の一方の抵抗に並列に接続されている。本実施例の
基本的な動作は第１の実施例と同じであるが、ピンチ抵
抗７の抵抗値と抵抗５の抵抗値及び分割比の選び方によ
って、電流増幅率βの補償特性をさらに微調整できると
いう利点がある。
【００１５】
【発明の効果】以上説明したように、本発明は、定電圧
回路の出力電圧の電流増幅率の変動によるばらつきに対
して、ピンチ抵抗を用いて出力電圧の補償を行っている
ので、製造条件などのばらつきによって個々の定電圧回
路ごとにトランジスタの電流増幅率がばらついても、出
力電圧にはほとんどばらつきが生じないという効果を有
する。さらに、請求項２記載の発明によれば、ピンチ抵
抗による補償特性をより精度よく調整することができ
る。
回路の出力電圧の電流増幅率の変動によるばらつきに対
して、ピンチ抵抗を用いて出力電圧の補償を行っている
ので、製造条件などのばらつきによって個々の定電圧回
路ごとにトランジスタの電流増幅率がばらついても、出
力電圧にはほとんどばらつきが生じないという効果を有
する。さらに、請求項２記載の発明によれば、ピンチ抵
抗による補償特性をより精度よく調整することができ
る。
【図１】分図（ａ）は、本発明の第１の実施例の回路図
である。分図（ｂ）は、本発明の第２の実施例の回路図
である。
である。分図（ｂ）は、本発明の第２の実施例の回路図
である。
【図２】従来の定電圧回路の回路図である。
１ 第１電源端子 ２ 第２電源端子 ３ 出力端子 ４ 電流源 ５，６ 抵抗 ７ ピンチ抵抗
Claims (2)
- 【請求項１】 エミッタが第１の電源端子に接続された
ＮＰＮバイポーラトランジスタと第２の電源端子に接続
された電流源とを有し、前記電流源の他端は出力端子に
接続され、前記ＮＰＮバイポーラトランジスタのコレク
タは前記出力端子に接続され、前記ＮＰＮバイポーラト
ランジスタのベースは第１の抵抗と第２の抵抗とに接続
され、前記第１の抵抗の他端は前記出力端子に接続さ
れ、前記第２の抵抗の他端は前記第１の電源端子に接続
される定電圧回路において、 前記第１の抵抗と並列にピンチ抵抗が接続されているこ
とを特徴とする定電圧回路。 - 【請求項２】 請求項１記載の定電圧回路において、 前記第１の抵抗は直列に分割され、前記ピンチ抵抗は前
記第１の抵抗の分割された一方の抵抗に並列に接続され
ていることを特徴とする定電圧回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1738692A JPH05216549A (ja) | 1992-02-03 | 1992-02-03 | 定電圧回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1738692A JPH05216549A (ja) | 1992-02-03 | 1992-02-03 | 定電圧回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05216549A true JPH05216549A (ja) | 1993-08-27 |
Family
ID=11942564
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1738692A Withdrawn JPH05216549A (ja) | 1992-02-03 | 1992-02-03 | 定電圧回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05216549A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0642218A1 (de) * | 1993-09-02 | 1995-03-08 | TEMIC TELEFUNKEN microelectronic GmbH | Schaltungsanordnung mit gesteuerten Pinch-Widerständen |
| US11735902B2 (en) | 2020-03-24 | 2023-08-22 | Analog Devices International Unlimited Company | Bipolar junction transistor heater circuit |
-
1992
- 1992-02-03 JP JP1738692A patent/JPH05216549A/ja not_active Withdrawn
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0642218A1 (de) * | 1993-09-02 | 1995-03-08 | TEMIC TELEFUNKEN microelectronic GmbH | Schaltungsanordnung mit gesteuerten Pinch-Widerständen |
| US11735902B2 (en) | 2020-03-24 | 2023-08-22 | Analog Devices International Unlimited Company | Bipolar junction transistor heater circuit |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990518 |