JPH0446512B2 - - Google Patents
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- Publication number
- JPH0446512B2 JPH0446512B2 JP58181696A JP18169683A JPH0446512B2 JP H0446512 B2 JPH0446512 B2 JP H0446512B2 JP 58181696 A JP58181696 A JP 58181696A JP 18169683 A JP18169683 A JP 18169683A JP H0446512 B2 JPH0446512 B2 JP H0446512B2
- Authority
- JP
- Japan
- Prior art keywords
- ram
- input
- window function
- fourier transform
- fast fourier
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Circuit For Audible Band Transducer (AREA)
Description
【発明の詳細な説明】
［発明の技術分野］
この発明は、デジタルイコライザに関するもの
で、特に自由な特性を与えるデジタルオーデイオ
方式のデジタルイコライザに関するものである。
で、特に自由な特性を与えるデジタルオーデイオ
方式のデジタルイコライザに関するものである。
［従来技術］
第１図は、従来の方式によるグラフイツクイコ
ライザの回路図である。入力端子１に入力された
音響信号は、各々異なる中心周波数をもつｎ個の
バンドパスフイルタ２ａ，２ｂ，…２ｎにより周
波数分割された後、グラフイツクイコライザの特
性が所望の特性になるように、ｎ個のゲインコン
トローラ３ａ，３ｂ…，３ｎにより、周波数分割
された各帯域の信号の振幅が調整された後加算器
４により加算され、この加算器の出力は出力端子
５より出力される。かかる方式のグラフイツクイ
コライザでは素子値の偏差および素子値の温度変
動等により周波数特性によりリツプルを生ずるな
どの欠点をもつていた。
ライザの回路図である。入力端子１に入力された
音響信号は、各々異なる中心周波数をもつｎ個の
バンドパスフイルタ２ａ，２ｂ，…２ｎにより周
波数分割された後、グラフイツクイコライザの特
性が所望の特性になるように、ｎ個のゲインコン
トローラ３ａ，３ｂ…，３ｎにより、周波数分割
された各帯域の信号の振幅が調整された後加算器
４により加算され、この加算器の出力は出力端子
５より出力される。かかる方式のグラフイツクイ
コライザでは素子値の偏差および素子値の温度変
動等により周波数特性によりリツプルを生ずるな
どの欠点をもつていた。
［発明の概要］
それゆえに、この発明の主たる目的は、所望の
周波数時性を持ち得るデジタルイコライザを提供
することである。
周波数時性を持ち得るデジタルイコライザを提供
することである。
この発明に係るデジタルイコライザは、所望の
周波数特性を入力するための周波数特性入力手段
と、入力された周波数特性を逆高速フーリエ変換
する逆高速フーリエ変換手段と、デジタル入力信
号に窓関数を乗算する窓関数乗算手段と、逆高速
フーリエ変換手段および窓関数乗算手段からの出
力信号に畳み込み演算を施す畳み込み演算手段と
を含む。
周波数特性を入力するための周波数特性入力手段
と、入力された周波数特性を逆高速フーリエ変換
する逆高速フーリエ変換手段と、デジタル入力信
号に窓関数を乗算する窓関数乗算手段と、逆高速
フーリエ変換手段および窓関数乗算手段からの出
力信号に畳み込み演算を施す畳み込み演算手段と
を含む。
この発明におけるデジタルイコライザでは、周
波数特性入力手段を介して入力された所望の周波
数特性が逆高速フーリエ変換された後、窓関数が
乗じられたデジタル入力信号と畳み込み演算が施
される。したがつて、所望の周波数特性を有する
出力信号が得られる。
波数特性入力手段を介して入力された所望の周波
数特性が逆高速フーリエ変換された後、窓関数が
乗じられたデジタル入力信号と畳み込み演算が施
される。したがつて、所望の周波数特性を有する
出力信号が得られる。
この発明の上述の目的およびその他の目的と特
徴は以下に図面を参照して行なう詳細な説明から
一層明らかとなろう。
徴は以下に図面を参照して行なう詳細な説明から
一層明らかとなろう。
［発明の実施例］
第２図は、この発明の一実施例の外観図であ
る。図において、機器本体９の前面には、CRT
６と操作ボタン類８が設けられており、ライトペ
ン７は、機器本体９に接続されている。CTR６
上にライトペン７で所望の周波数特性を入力する
ことにより、周波数特性がこの入力された所望の
周波数特性に変化する増幅器と考えることができ
る。
る。図において、機器本体９の前面には、CRT
６と操作ボタン類８が設けられており、ライトペ
ン７は、機器本体９に接続されている。CTR６
上にライトペン７で所望の周波数特性を入力する
ことにより、周波数特性がこの入力された所望の
周波数特性に変化する増幅器と考えることができ
る。
一方、デジタルフイルタのうちFIR型フイルタ
はその係数は入力された所望の周波数特性を逆フ
ーリエ変換（通常は高速フーリエ変換）をして得
られたインパルス応答がそのまま使えるという特
徴があり、この発明はかかる特質を有効に利用し
たものである。
はその係数は入力された所望の周波数特性を逆フ
ーリエ変換（通常は高速フーリエ変換）をして得
られたインパルス応答がそのまま使えるという特
徴があり、この発明はかかる特質を有効に利用し
たものである。
第３図はこの発明の一実施例の回路図である。
図において、ライトペン７は、画像入力部１１に
接続されている。ライトペン７で所望の周波数特
性をCRT６上に入力する。画像入力部１１は、
その出力を記憶する第１のRAM１２に接続され
ている。入力された所望の周波数特性である図形
は、デジタイズされて第１のRAM１２に記憶さ
れる。CRT６を駆動するためのCRT駆動部１０
は、第１のRAM１２に接続されている。CRT駆
動部１０は第１のRAM１２より情報を受けて
CRT６上に入力された図形を表示する。ライト
ペン７と、画像入力部１１と、CRT６と、CRT
駆動部１０は、線画像をデジタル化するデジタイ
ザを構成する。第１のRAM１２は、FFT部１３
に接続され、FFT部１３は第２のRAM１４に接
続されている。第１のRAM１２に記憶されたカ
ーブは、FFT部１３で逆高速フーリエ変換され、
FFT部１３の出力は第２のRAM１４に記憶され
る。デジタイザと、第１のRAM１２と、FFT部
１３と、第２のRAM１４はFIR型フイルタを構
成し、FFT部１３の出力は、イコライズする特
性をもつFIR型フイルタの係数となる。
図において、ライトペン７は、画像入力部１１に
接続されている。ライトペン７で所望の周波数特
性をCRT６上に入力する。画像入力部１１は、
その出力を記憶する第１のRAM１２に接続され
ている。入力された所望の周波数特性である図形
は、デジタイズされて第１のRAM１２に記憶さ
れる。CRT６を駆動するためのCRT駆動部１０
は、第１のRAM１２に接続されている。CRT駆
動部１０は第１のRAM１２より情報を受けて
CRT６上に入力された図形を表示する。ライト
ペン７と、画像入力部１１と、CRT６と、CRT
駆動部１０は、線画像をデジタル化するデジタイ
ザを構成する。第１のRAM１２は、FFT部１３
に接続され、FFT部１３は第２のRAM１４に接
続されている。第１のRAM１２に記憶されたカ
ーブは、FFT部１３で逆高速フーリエ変換され、
FFT部１３の出力は第２のRAM１４に記憶され
る。デジタイザと、第１のRAM１２と、FFT部
１３と、第２のRAM１４はFIR型フイルタを構
成し、FFT部１３の出力は、イコライズする特
性をもつFIR型フイルタの係数となる。
一方、デジタイズされたオーデイオ信号は、入
力端子１５より入力される。入力端子１５は窓関
数発生部２４に接続され、窓関数発生部２４は第
３のRAM１６に接続されている。デジタイズさ
れたオーデイオ信号は、窓関数発生部２４にて窓
関数Ｗ(t)が乗算されて第３のRAM１６に記憶さ
れる。
力端子１５より入力される。入力端子１５は窓関
数発生部２４に接続され、窓関数発生部２４は第
３のRAM１６に接続されている。デジタイズさ
れたオーデイオ信号は、窓関数発生部２４にて窓
関数Ｗ(t)が乗算されて第３のRAM１６に記憶さ
れる。
第２のRAM１４と第３のRAM１６は乗算器
１７に接続され、乗算器１７は加算器１８に接続
されている。第１のRAM１４および第３の
RAM１６に記憶された情報は乗算器１７で順次
乗算され、加算器１８は乗算器１７の出力を加算
する。加算器１８は、加算器１８にて加算する際
一時乗算結果を記憶する第４のRAM１９に接続
され、第４のRAM１９は、演算結果を出力する
出力端子２０に接続されている。
１７に接続され、乗算器１７は加算器１８に接続
されている。第１のRAM１４および第３の
RAM１６に記憶された情報は乗算器１７で順次
乗算され、加算器１８は乗算器１７の出力を加算
する。加算器１８は、加算器１８にて加算する際
一時乗算結果を記憶する第４のRAM１９に接続
され、第４のRAM１９は、演算結果を出力する
出力端子２０に接続されている。
今、所望の周波数特性が与えられた場合、この
所望の周波数特性をもつFIR型フイルタの出力信
号は、入力信号とこのフイルタのインパルス応答
つまりフイルタの周波数特性の逆フーリエ変換さ
れた信号とのコンボリユーシヨン（畳み込み）に
より与えられる。
所望の周波数特性をもつFIR型フイルタの出力信
号は、入力信号とこのフイルタのインパルス応答
つまりフイルタの周波数特性の逆フーリエ変換さ
れた信号とのコンボリユーシヨン（畳み込み）に
より与えられる。
CRT６により入力されたフイルタの周波数特
性をh′（ω）とするとこのフイルタのインパルス
応答Ｈ(t)は次の(1)式により与えられる。
性をh′（ω）とするとこのフイルタのインパルス
応答Ｈ(t)は次の(1)式により与えられる。
Ｈ(t)＝F-1｛h′（ω）｝
＝１／√〓2π∫∞ -∞h′（ω）ejwtdw…(1)
FFT部１３の出力は、デジタイズされた入力
波形の逆高速フーリエ変換（逆FFT）されたも
のであるからｈ(n)となる。入力信号をｘ(n)とする
と、出力信号ｙ(n)は次の（２ａ）式により与えら
れる。ここで、ｎはサンプルの番号、Ｎは入力さ
れたサンプルの総点数である。
波形の逆高速フーリエ変換（逆FFT）されたも
のであるからｈ(n)となる。入力信号をｘ(n)とする
と、出力信号ｙ(n)は次の（２ａ）式により与えら
れる。ここで、ｎはサンプルの番号、Ｎは入力さ
れたサンプルの総点数である。
また、ｈ(n)，ｘ(n)，ｙ(n)のＺ変換を各々Ｈ(Z)，
Ｘ(Z)，Ｙ(Z)とすると、Ｙ(Z)は次の（２ｂ）式によ
り与えられる。
Ｘ(Z)，Ｙ(Z)とすると、Ｙ(Z)は次の（２ｂ）式によ
り与えられる。
Ｙ(Z)＝Ｘ(Z)・Ｈ(Z) …（２ｂ）
ここでＨ(Z)をＺの中心値に対して前後対称にす
れば、フイルタの位相特性は直線になる。かかる
場合はＨ(Z)の対称性を利用して回路を簡単にする
ことができる。
れば、フイルタの位相特性は直線になる。かかる
場合はＨ(Z)の対称性を利用して回路を簡単にする
ことができる。
第４図は、この発明による位相特性が直線的で
ある場合の他の実施例の回路図である。なお、第
４図において、第３図と同様の部分には同じ参照
番号を付している。図において、第３のRAM１
６に演算部２１を付加し次の(3)式で示される演算
を行なう。ここでＮは入力されたサンプルの総点
数である。
ある場合の他の実施例の回路図である。なお、第
４図において、第３図と同様の部分には同じ参照
番号を付している。図において、第３のRAM１
６に演算部２１を付加し次の(3)式で示される演算
を行なう。ここでＮは入力されたサンプルの総点
数である。
一方、第２のRAM１４に蓄積するFIR型フイ
ルタの係数の点数も第３図の実施例の場合ではＮ
点であつたが、この実施例ではＮ／２＋１点のみ
蓄積しx′(n)とFFT部１３の出力ｈ(n)とを演算し、
この乗算されたものを加算する。
ルタの係数の点数も第３図の実施例の場合ではＮ
点であつたが、この実施例ではＮ／２＋１点のみ
蓄積しx′(n)とFFT部１３の出力ｈ(n)とを演算し、
この乗算されたものを加算する。
上記実施例では、第２のRAM１４に記憶され
た波形は入力波形１つ分のみであつたが、第２の
RAM１４の容量をさらに何倍かに増して、たと
えば、 (1) 過去の周波数特性設定例を記憶し、必要に応
じて選択的に呼出す。
た波形は入力波形１つ分のみであつたが、第２の
RAM１４の容量をさらに何倍かに増して、たと
えば、 (1) 過去の周波数特性設定例を記憶し、必要に応
じて選択的に呼出す。
(2) 少しずつ異なる周波数特性を多数記憶してお
き、時間的に少しずつ離れた間隔で呼出すこと
により、あたかも時間とともに変化する周波数
特性を実現する。
き、時間的に少しずつ離れた間隔で呼出すこと
により、あたかも時間とともに変化する周波数
特性を実現する。
ことができる。
第５図は、この発明による周波数特性を記憶す
るRAMの容量を大きくした場合のさらに他の実
施例の回路図である。なお、第５図において、第
２図、第３図および第４図と同様の部分には同じ
参照番号を付している。記憶容量を大きくした
RAM１４０にRAMコントローラ２２および操
作ボタン２３を接続しRAMコントローラ２２に
よりRAM１４０の内容を適宜読出すことができ
る。
るRAMの容量を大きくした場合のさらに他の実
施例の回路図である。なお、第５図において、第
２図、第３図および第４図と同様の部分には同じ
参照番号を付している。記憶容量を大きくした
RAM１４０にRAMコントローラ２２および操
作ボタン２３を接続しRAMコントローラ２２に
よりRAM１４０の内容を適宜読出すことができ
る。
上記実施例では、CRTとライトペンを波形入
力装置として使用したが、図形をデジタイズでき
るものであれば、他のもの、たとえば、タブレツ
ト、またはラインセンサを備えたフアクシミリの
入力部などでもよいことはいうまでもない。
力装置として使用したが、図形をデジタイズでき
るものであれば、他のもの、たとえば、タブレツ
ト、またはラインセンサを備えたフアクシミリの
入力部などでもよいことはいうまでもない。
［発明の効果］
以上のように、この発明によれば、所望の周波
数特性を入力するための周波数特性入力手段が設
けられ、入力された周波数特性に基づく出力信号
が得られるので、所望の周波数特性を持ち得るデ
ジタルイコライザが得られた。
数特性を入力するための周波数特性入力手段が設
けられ、入力された周波数特性に基づく出力信号
が得られるので、所望の周波数特性を持ち得るデ
ジタルイコライザが得られた。
第１図は従来の方式によるグラフイツクイコラ
イザの回路図である。第２図はこの発明の一実施
例の外観図である。第３図はこの発明による一実
施例の回路図である。第４図はこの発明による位
相特性が直線である場合の実施例の他の回路図で
ある。第５図はこの発明による周波数特性を記憶
するRAMの容量を大きくした場合のさらに他の
実施例の回路図である。 図において、６はCRT、７はライトペン、１
０はCRT駆動部、１１は画像入力部、１２は第
１のRAM、１３はFFT部、１４は第２のRAM、
１４０は記憶容量を大きくした第２のRAM、１
６は第３のRAM、１７は乗算器、１８は加算
器、１９は第４のRAM、２０は出力端子、２１
は演算部、２２はRAMコントローラである。
イザの回路図である。第２図はこの発明の一実施
例の外観図である。第３図はこの発明による一実
施例の回路図である。第４図はこの発明による位
相特性が直線である場合の実施例の他の回路図で
ある。第５図はこの発明による周波数特性を記憶
するRAMの容量を大きくした場合のさらに他の
実施例の回路図である。 図において、６はCRT、７はライトペン、１
０はCRT駆動部、１１は画像入力部、１２は第
１のRAM、１３はFFT部、１４は第２のRAM、
１４０は記憶容量を大きくした第２のRAM、１
６は第３のRAM、１７は乗算器、１８は加算
器、１９は第４のRAM、２０は出力端子、２１
は演算部、２２はRAMコントローラである。
Claims (1)
- 【特許請求の範囲】 １ 所望の周波数特性を入力するための周波数特
性入力手段と、 前記周波数特性入力手段に接続され、入力され
た周波数特性を逆高速フーリエ変換する逆高速フ
ーリエ変換手段と、 デジタル入力信号に窓関数を乗算する窓関数乗
算手段と、 前記逆高速フーリエ変換手段および前記窓関数
乗算手段に接続され、前記逆高速フーリエ変換手
段および前記窓関数乗算手段からの出力信号に畳
み込み演算を施す畳み込み演算手段とを含む、デ
ジタルイコライザ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58181696A JPS6070498A (ja) | 1983-09-27 | 1983-09-27 | デジタルイコライザ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58181696A JPS6070498A (ja) | 1983-09-27 | 1983-09-27 | デジタルイコライザ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6070498A JPS6070498A (ja) | 1985-04-22 |
| JPH0446512B2 true JPH0446512B2 (ja) | 1992-07-30 |
Family
ID=16105259
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58181696A Granted JPS6070498A (ja) | 1983-09-27 | 1983-09-27 | デジタルイコライザ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6070498A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20130055261A (ko) * | 2011-11-18 | 2013-05-28 | 삼성디스플레이 주식회사 | 박막 트랜지스터, 그 제조방법 및 이를 포함하는 유기 발광 표시장치 |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2895072B2 (ja) * | 1988-10-27 | 1999-05-24 | ローランド株式会社 | パラメトリックイコライザ |
| JPH0316761U (ja) * | 1989-07-03 | 1991-02-19 |
-
1983
- 1983-09-27 JP JP58181696A patent/JPS6070498A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20130055261A (ko) * | 2011-11-18 | 2013-05-28 | 삼성디스플레이 주식회사 | 박막 트랜지스터, 그 제조방법 및 이를 포함하는 유기 발광 표시장치 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6070498A (ja) | 1985-04-22 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |