JPH04373181A - フォトカプラ - Google Patents
フォトカプラInfo
- Publication number
- JPH04373181A JPH04373181A JP3175855A JP17585591A JPH04373181A JP H04373181 A JPH04373181 A JP H04373181A JP 3175855 A JP3175855 A JP 3175855A JP 17585591 A JP17585591 A JP 17585591A JP H04373181 A JPH04373181 A JP H04373181A
- Authority
- JP
- Japan
- Prior art keywords
- photodiode
- film
- photocoupler
- layer
- light
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 abstract description 20
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- 229910052906 cristobalite Inorganic materials 0.000 abstract description 10
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Landscapes
- Photo Coupler, Interrupter, Optical-To-Optical Conversion Devices (AREA)
- Light Receiving Elements (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】本発明は、LEDと、フォトダイ
オードを含む受光ICとが対向配置されてなるフォトカ
プラに関し、特にフォトダイオ−ドが透光性導電膜によ
ってシールドされているフォトカプラに関する。
オードを含む受光ICとが対向配置されてなるフォトカ
プラに関し、特にフォトダイオ−ドが透光性導電膜によ
ってシールドされているフォトカプラに関する。
【0002】
【従来の技術】図3は、この種フォトカプラの等価回路
図である。同図に示されるように、フォトカプラはLE
D14とフォトダイオードPDを内蔵した受光IC15
とが同一パッケージ内に、フォトダイオードPDとLE
D14とが対向するように配置して構成される。
図である。同図に示されるように、フォトカプラはLE
D14とフォトダイオードPDを内蔵した受光IC15
とが同一パッケージ内に、フォトダイオードPDとLE
D14とが対向するように配置して構成される。
【0003】LED14から放出された光はフォトダイ
オードPDで受光され、その光電流は増幅器A、トラン
ジスタQで増幅された後、出力端子VOUT から出力
される。このようにフォトカプラでは、電気的に絶縁さ
れた2つの回路間での信号の授受が可能になされている
。
オードPDで受光され、その光電流は増幅器A、トラン
ジスタQで増幅された後、出力端子VOUT から出力
される。このようにフォトカプラでは、電気的に絶縁さ
れた2つの回路間での信号の授受が可能になされている
。
【0004】而して、フォトダイオードPDとLED1
4とは近接配置されるため、両者間には結合容量が形成
されるが、この結合容量Cが大きい場合、入力側にdv
/dtなるノイズが発生した場合、このとき発光側のL
EDが点灯していなくとも、結合容量CによりCdv/
dtなる電流が受光側に伝達され、受光側ではこれを光
電流と識別することができないため、出力が誤動作する
という問題がある。従来この問題を解決するために、即
ち、同相信号除去能力を高めるために、フォトダイオー
ドを透光性導電膜によってシールドし、LEDとフォト
ダイオードとの結合を弱めることが行われてきた。
4とは近接配置されるため、両者間には結合容量が形成
されるが、この結合容量Cが大きい場合、入力側にdv
/dtなるノイズが発生した場合、このとき発光側のL
EDが点灯していなくとも、結合容量CによりCdv/
dtなる電流が受光側に伝達され、受光側ではこれを光
電流と識別することができないため、出力が誤動作する
という問題がある。従来この問題を解決するために、即
ち、同相信号除去能力を高めるために、フォトダイオー
ドを透光性導電膜によってシールドし、LEDとフォト
ダイオードとの結合を弱めることが行われてきた。
【0005】図4は、その対策が講じられた従来の受光
ICの受光部の断面図である。同図において、1はp型
半導体基板、2はn+ 型埋め込み層、3はフォトダイ
オードのカソード領域となるn− 型エピタキシャル層
、4はn+ 型カソード引き出し領域、5はフォトダイ
オードのアノード領域となるp+ 型拡散層、6aはフ
ォトダイオードの周囲を囲むとともにその上表面を覆う
SiO2 膜、9はシールド用透光性導電膜であるポリ
シリコン層、6bはポリシコン層9の表面を覆うSiO
2 膜、10は第1層Al配線、11は層間絶縁膜、1
2は第2層Al配線、13はSi3 N4 膜からなる
パシベーション膜である。
ICの受光部の断面図である。同図において、1はp型
半導体基板、2はn+ 型埋め込み層、3はフォトダイ
オードのカソード領域となるn− 型エピタキシャル層
、4はn+ 型カソード引き出し領域、5はフォトダイ
オードのアノード領域となるp+ 型拡散層、6aはフ
ォトダイオードの周囲を囲むとともにその上表面を覆う
SiO2 膜、9はシールド用透光性導電膜であるポリ
シリコン層、6bはポリシコン層9の表面を覆うSiO
2 膜、10は第1層Al配線、11は層間絶縁膜、1
2は第2層Al配線、13はSi3 N4 膜からなる
パシベーション膜である。
【0006】ポリシリコン層9は第2層Al配線12を
介して接地されている。従って、ポリシリコン層9はシ
ールド層として機能し、このポリシリコン層が存在する
ことによって、フォトカプラの同相信号除去能力が高め
られている。
介して接地されている。従って、ポリシリコン層9はシ
ールド層として機能し、このポリシリコン層が存在する
ことによって、フォトカプラの同相信号除去能力が高め
られている。
【0007】
【発明が解決しようとする課題】上述した従来の受光I
Cの構成では、フォトダイオードのアノードと接地され
たポリシリコンとが薄い(1000Å程度)SiO2
膜を介して接しているので、ここに大きな寄生容量CP
Dが形成される。この寄生容量CPDは、図3の回路図
に示されるように、増幅器の入力端子と接地間に接続さ
れることになるため、フォトカプラの高速スイッチング
動作が阻害される。
Cの構成では、フォトダイオードのアノードと接地され
たポリシリコンとが薄い(1000Å程度)SiO2
膜を介して接しているので、ここに大きな寄生容量CP
Dが形成される。この寄生容量CPDは、図3の回路図
に示されるように、増幅器の入力端子と接地間に接続さ
れることになるため、フォトカプラの高速スイッチング
動作が阻害される。
【0008】よって、本発明の目的とするところは、フ
ォトダイオードがシールドされた受光ICを用いたフォ
トカプラにおいて、フォトダイオードと接地間の寄生容
量を低減して高速スイッチング動作を可能ならしめるこ
とである。
ォトダイオードがシールドされた受光ICを用いたフォ
トカプラにおいて、フォトダイオードと接地間の寄生容
量を低減して高速スイッチング動作を可能ならしめるこ
とである。
【0009】
【課題を解決するための手段】本発明のフォトカプラで
は、上記目的を達成するために、フォトダイオードとこ
れをシールドする透光性導電膜との間に厚い絶縁膜を介
在せしめる。
は、上記目的を達成するために、フォトダイオードとこ
れをシールドする透光性導電膜との間に厚い絶縁膜を介
在せしめる。
【0010】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。図1は、本発明の第1の実施例の受光IC
の受光部の断面図である。同図において、図4の従来例
の部分と同等の部分には同一の参照番号が付されている
ので、重複した説明は省略する。
て説明する。図1は、本発明の第1の実施例の受光IC
の受光部の断面図である。同図において、図4の従来例
の部分と同等の部分には同一の参照番号が付されている
ので、重複した説明は省略する。
【0011】この実施例の受光素子を製造するには、フ
ォトダイオードの作り込まれた半導体基板をSiO2
膜6aで覆った後、その上全面にSi3 N4 膜7と
厚いSiO2 膜8aとを成長させる。そして、SiO
2 膜8aをp+ 型拡散層5上のみに残して他をエッ
チング除去する。このとき、Si3 N4 膜7はスト
ッパとして機能する。その後は従来例と同様の工程を経
て本実施例の受光ICが製造される。
ォトダイオードの作り込まれた半導体基板をSiO2
膜6aで覆った後、その上全面にSi3 N4 膜7と
厚いSiO2 膜8aとを成長させる。そして、SiO
2 膜8aをp+ 型拡散層5上のみに残して他をエッ
チング除去する。このとき、Si3 N4 膜7はスト
ッパとして機能する。その後は従来例と同様の工程を経
て本実施例の受光ICが製造される。
【0012】上記構成において、SiO2 膜8aは、
5000〜7000Å程度の膜厚になされる。従来、こ
こには膜厚1000ÅのSiO2膜6aが存在している
のみであったので、フォトダイオードの対接地容量は大
幅に削減される。例えば、フォトダイオードの面積を5
00μm×500μmとした場合、従来例で120pF
程度であった寄生容量CPDが24〜17pF程度とな
り、10Mbps程度のフォトカプラで使用される受光
ICにおいては、問題にならないレベルにまで低減せし
められている。
5000〜7000Å程度の膜厚になされる。従来、こ
こには膜厚1000ÅのSiO2膜6aが存在している
のみであったので、フォトダイオードの対接地容量は大
幅に削減される。例えば、フォトダイオードの面積を5
00μm×500μmとした場合、従来例で120pF
程度であった寄生容量CPDが24〜17pF程度とな
り、10Mbps程度のフォトカプラで使用される受光
ICにおいては、問題にならないレベルにまで低減せし
められている。
【0013】図2は、本発明の第2の実施例における受
光ICの受光部の断面図である。本実施例の図1に示さ
れた先の実施例と相違する点は、全面に形成するSi3
N4 膜7を用いないで、SiO2 膜6a上に直接厚
いSi3 N4 膜8bを形成した点である。
光ICの受光部の断面図である。本実施例の図1に示さ
れた先の実施例と相違する点は、全面に形成するSi3
N4 膜7を用いないで、SiO2 膜6a上に直接厚
いSi3 N4 膜8bを形成した点である。
【0014】上記構成により本実施例は先の実施例と同
様の効果を奏することができる外、薄い窒化膜を形成し
なくても済むことにより工程が先の実施例の場合より簡
素化されている。
様の効果を奏することができる外、薄い窒化膜を形成し
なくても済むことにより工程が先の実施例の場合より簡
素化されている。
【0015】
【発明の効果】以上説明したように、本発明は、透光性
導電膜でシールドされた受光素子を有する受光ICとL
EDとを対向配置したフォトカプラにおいて、透光性導
電膜と受光素子との間に厚い絶縁膜を介在せしめたもの
であるので、本発明によれば、入出力間の結合を抑制し
つつ受光素子の寄生容量を削減することができる。した
がって、本発明によれば、同相信号除去能力が高くかつ
高速スイッチング動作が可能なフォトカプラを提供する
ことができる。
導電膜でシールドされた受光素子を有する受光ICとL
EDとを対向配置したフォトカプラにおいて、透光性導
電膜と受光素子との間に厚い絶縁膜を介在せしめたもの
であるので、本発明によれば、入出力間の結合を抑制し
つつ受光素子の寄生容量を削減することができる。した
がって、本発明によれば、同相信号除去能力が高くかつ
高速スイッチング動作が可能なフォトカプラを提供する
ことができる。
【図1】 本発明の第1の実施例の受光ICの部分断
面図。
面図。
【図2】 本発明の第2の実施例の受光ICの部分断
面図。
面図。
【図3】 フォトカプラの等価回路図。
【図4】 従来例の受光ICの部分断面図。
1…p型半導体基板、 2…n+ 型埋め込み層
、 3…n− 型エピタキシャル層(カソード)
、 4…n+ 型カソード引き出し領域、
5…p+ 型拡散層(アノード)、 6a、6
b、8a…SiO2 膜、 7、8b…Si3N
4 膜、 9…ポリシリコン層、 10…
第1層Al配線、 11…層間絶縁膜、
12…第2層Al配線、 13…パシベーション
膜、 14…LED、 15…受光IC。
、 3…n− 型エピタキシャル層(カソード)
、 4…n+ 型カソード引き出し領域、
5…p+ 型拡散層(アノード)、 6a、6
b、8a…SiO2 膜、 7、8b…Si3N
4 膜、 9…ポリシリコン層、 10…
第1層Al配線、 11…層間絶縁膜、
12…第2層Al配線、 13…パシベーション
膜、 14…LED、 15…受光IC。
Claims (1)
- 【請求項1】 発光素子と、透光性導電膜によってシ
ールドされている受光素子を有する受光ICとが対向配
置されているフォトカプラにおいて、前記受光素子と前
記透光性導電膜との間には厚い絶縁膜が介在しているこ
とを特徴とするフォトカプラ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3175855A JPH04373181A (ja) | 1991-06-21 | 1991-06-21 | フォトカプラ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3175855A JPH04373181A (ja) | 1991-06-21 | 1991-06-21 | フォトカプラ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04373181A true JPH04373181A (ja) | 1992-12-25 |
Family
ID=16003380
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3175855A Pending JPH04373181A (ja) | 1991-06-21 | 1991-06-21 | フォトカプラ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04373181A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012089796A (ja) * | 2010-10-22 | 2012-05-10 | Asahi Kasei Electronics Co Ltd | 受光素子及び受光素子の製造方法、半導体装置 |
JP2015056590A (ja) * | 2013-09-13 | 2015-03-23 | 株式会社東芝 | 受光素子および光結合型信号絶縁装置 |
JP2019216270A (ja) * | 2014-04-23 | 2019-12-19 | 株式会社半導体エネルギー研究所 | 撮像装置 |
-
1991
- 1991-06-21 JP JP3175855A patent/JPH04373181A/ja active Pending
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012089796A (ja) * | 2010-10-22 | 2012-05-10 | Asahi Kasei Electronics Co Ltd | 受光素子及び受光素子の製造方法、半導体装置 |
JP2015056590A (ja) * | 2013-09-13 | 2015-03-23 | 株式会社東芝 | 受光素子および光結合型信号絶縁装置 |
US9379272B2 (en) | 2013-09-13 | 2016-06-28 | Kabushiki Kaisha Toshiba | Light receiving element and optically coupled insulating device |
JP2019216270A (ja) * | 2014-04-23 | 2019-12-19 | 株式会社半導体エネルギー研究所 | 撮像装置 |
JP2020077889A (ja) * | 2014-04-23 | 2020-05-21 | 株式会社半導体エネルギー研究所 | 半導体装置 |
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