JPH04322161A - スイッチングレギュレータ制御方式 - Google Patents
スイッチングレギュレータ制御方式Info
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- JPH04322161A JPH04322161A JP8709191A JP8709191A JPH04322161A JP H04322161 A JPH04322161 A JP H04322161A JP 8709191 A JP8709191 A JP 8709191A JP 8709191 A JP8709191 A JP 8709191A JP H04322161 A JPH04322161 A JP H04322161A
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- JP
- Japan
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- output
- clock signal
- regulator
- switching regulator
- converter
- Prior art date
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- Pending
Links
- 238000005070 sampling Methods 0.000 claims abstract description 10
- 238000000034 method Methods 0.000 claims description 12
- 230000010355 oscillation Effects 0.000 abstract description 8
- 239000003990 capacitor Substances 0.000 abstract description 6
- 230000001052 transient effect Effects 0.000 abstract description 6
- 238000010586 diagram Methods 0.000 description 4
- 238000001514 detection method Methods 0.000 description 3
- 230000003111 delayed effect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000012935 Averaging Methods 0.000 description 1
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
Landscapes
- Control Of Voltage And Current In General (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、スイッチングレギュレ
ータの出力と基準電圧との差をとってディジタルデータ
化し、帰還量を所定クロック信号で処理したのちアナロ
グレベルに変換し、このレベルに応じたパルス幅で前記
スイッチングレギュレータを駆動するスイッチングレギ
ュレータ制御方式に関する。
ータの出力と基準電圧との差をとってディジタルデータ
化し、帰還量を所定クロック信号で処理したのちアナロ
グレベルに変換し、このレベルに応じたパルス幅で前記
スイッチングレギュレータを駆動するスイッチングレギ
ュレータ制御方式に関する。
【０００２】
【従来の技術】従来、この種のスイッチングレギュレー
タ制御方式は、出力電圧と基準電圧との差分を増幅した
電圧を一定周波数でサンプリング処理し、ディジタル化
して帰還量を設定処理して、駆動出力に必要なパルス幅
を決定していた。
タ制御方式は、出力電圧と基準電圧との差分を増幅した
電圧を一定周波数でサンプリング処理し、ディジタル化
して帰還量を設定処理して、駆動出力に必要なパルス幅
を決定していた。
【０００３】これについて、図２を参照して説明する。
図２は従来の一例を示す機能ブロック図である。
【０００４】図２において、レギュレータ１の出力を入
力とする差動増幅器２は、他方に基準電圧供給回路３の
出力である基準電圧を入力し、差分を増幅してＡ／Ｄコ
ンバータ４へ送出する。
力とする差動増幅器２は、他方に基準電圧供給回路３の
出力である基準電圧を入力し、差分を増幅してＡ／Ｄコ
ンバータ４へ送出する。
【０００５】Ａ／Ｄコンバータ４は発振回路９が発生す
る一定周波数のクロック信号９１でサンプリング処理を
実行し、この処理結果の電圧レベルをディジタル変換し
、ディジタルデータとして帰還量演算回路５へ送信する
。
る一定周波数のクロック信号９１でサンプリング処理を
実行し、この処理結果の電圧レベルをディジタル変換し
、ディジタルデータとして帰還量演算回路５へ送信する
。
【０００６】帰還量演算回路５は、入力するディジタル
データを、発振回路９が発生する一定周波数のクロック
信号９１と同期して、平均値演算などの処理をしたのち
、この処理データをＤ／Ａコンバータ６へ送信する。
データを、発振回路９が発生する一定周波数のクロック
信号９１と同期して、平均値演算などの処理をしたのち
、この処理データをＤ／Ａコンバータ６へ送信する。
【０００７】Ｄ／Ａコンバータ６は、発振回路９が発生
する一定周波数のクロック信号９１で、入力するディジ
タルデータをサンプリング処理してアナログレベルに変
換し、ドライブ回路７へ送信する。
する一定周波数のクロック信号９１で、入力するディジ
タルデータをサンプリング処理してアナログレベルに変
換し、ドライブ回路７へ送信する。
【０００８】ドライブ回路７は入力レベルに応じたパル
ス幅を生成して、レギュレータ１へ送信することにより
、レギュレータ１を調整して一定出力を保持させる。 この回路では、急激な大幅な差分が生じたとき、クロッ
ク信号の時間間隔により処理が遅れるので、レギュレー
タの出力部に配備される出力コンデンサ１１の容量を大
きくする対策がとられる。
ス幅を生成して、レギュレータ１へ送信することにより
、レギュレータ１を調整して一定出力を保持させる。 この回路では、急激な大幅な差分が生じたとき、クロッ
ク信号の時間間隔により処理が遅れるので、レギュレー
タの出力部に配備される出力コンデンサ１１の容量を大
きくする対策がとられる。
【０００９】
【発明が解決しようとする課題】上述した従来のスイッ
チングレギュレータ制御方式は、レギュレータの出力を
基準電圧と比較して差分を帰還させるとき、一定周波数
のクロック信号でサンプリング処理および平均値演算処
理などを実行するため、急激に大幅な差分が生じたとき
一定周波数によるクロック信号の時間間隔により処理が
遅れ、従って過度応答特性が悪いという問題点があった
。
チングレギュレータ制御方式は、レギュレータの出力を
基準電圧と比較して差分を帰還させるとき、一定周波数
のクロック信号でサンプリング処理および平均値演算処
理などを実行するため、急激に大幅な差分が生じたとき
一定周波数によるクロック信号の時間間隔により処理が
遅れ、従って過度応答特性が悪いという問題点があった
。
【００１０】また、過度応答特性の悪さ改善のため、レ
ギュレータの出力部に配備される出力コンデンサの容量
を増加させるとき、レギュレータはハードウェアが大き
くなるだけでなく、出力コンデンサにより経済性も悪化
するという問題点があった。
ギュレータの出力部に配備される出力コンデンサの容量
を増加させるとき、レギュレータはハードウェアが大き
くなるだけでなく、出力コンデンサにより経済性も悪化
するという問題点があった。
【００１１】本発明の目的は、レギュレータの出力の変
動量に応じてサンプリング用のクロック信号を変化させ
、サンプリング周期を高くすることにより、上記問題点
を解決するスイッチングレギュレータ制御方式を提供す
ることにある。
動量に応じてサンプリング用のクロック信号を変化させ
、サンプリング周期を高くすることにより、上記問題点
を解決するスイッチングレギュレータ制御方式を提供す
ることにある。
【００１２】
【課題を解決するための手段】本発明によるスイッチン
グレギュレータ制御方式は、スイッチングレギュレータ
の出力と基準電圧との差をとってディジタルデータ化し
、帰還量を所定クロック信号で処理したのちアナログレ
ベルに変換し、このレベルに応じたパルス幅で前記スイ
ッチングレギュレータを駆動するスイッチングレギュレ
ータ制御方式において、前記レギュレータの出力および
前記基準電圧との差分状態を検出し、この差分状態に応
じてサンプリング周波数を変調して生成するクロック信
号を、前記所定クロック信号として供給するクロック信
号供給部を有する。
グレギュレータ制御方式は、スイッチングレギュレータ
の出力と基準電圧との差をとってディジタルデータ化し
、帰還量を所定クロック信号で処理したのちアナログレ
ベルに変換し、このレベルに応じたパルス幅で前記スイ
ッチングレギュレータを駆動するスイッチングレギュレ
ータ制御方式において、前記レギュレータの出力および
前記基準電圧との差分状態を検出し、この差分状態に応
じてサンプリング周波数を変調して生成するクロック信
号を、前記所定クロック信号として供給するクロック信
号供給部を有する。
【００１３】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明のスイッチングレギュレータ制御方式
の一実施例を示す機能ブロック図である。
る。図１は本発明のスイッチングレギュレータ制御方式
の一実施例を示す機能ブロック図である。
【００１４】図１において、既述の図２と同一の構成要
素には同一の番号符号を付与して説明は省略する。
素には同一の番号符号を付与して説明は省略する。
【００１５】図１と図２との相違点は、Ａ／Ｄコンバー
タ４、帰還量演算回路５およびＤ／Ａコンバータ６に供
給するクロック信号８０を発生するクロック信号供給部
８にある。
タ４、帰還量演算回路５およびＤ／Ａコンバータ６に供
給するクロック信号８０を発生するクロック信号供給部
８にある。
【００１６】クロック信号供給部８は、一定周波数のク
ロック信号の発生回路ではなく、差動増幅器２の出力を
入力して状態を検出する状態検出回路８１が、検出状態
を発振周波数変調回路８２に通知するので差動増幅器２
の出力の変動、すなわちレギュレータ１の出力の変動量
によって出力するクロック信号８０の周期（間隔）を変
化させることができる。
ロック信号の発生回路ではなく、差動増幅器２の出力を
入力して状態を検出する状態検出回路８１が、検出状態
を発振周波数変調回路８２に通知するので差動増幅器２
の出力の変動、すなわちレギュレータ１の出力の変動量
によって出力するクロック信号８０の周期（間隔）を変
化させることができる。
【００１７】すなわち、急激な変化を生じる過度応答時
には高い周波数、安定なときには低い周波数が発振周波
数変調回路８２によって選択され、クロック信号８０と
してＡ／Ｄコンバータ４，帰還量演算回路５、およびＤ
／Ａコンバータ６へ出力される。
には高い周波数、安定なときには低い周波数が発振周波
数変調回路８２によって選択され、クロック信号８０と
してＡ／Ｄコンバータ４，帰還量演算回路５、およびＤ
／Ａコンバータ６へ出力される。
【００１８】従って、レギュレータ１の出力の変化が激
しいときは短期間で出力の変化をドライブ回路７に伝え
、かつ適切なパルス幅でレギュレータ１の入力を駆動で
きるので、急激な変化にも追従することができる。
しいときは短期間で出力の変化をドライブ回路７に伝え
、かつ適切なパルス幅でレギュレータ１の入力を駆動で
きるので、急激な変化にも追従することができる。
【００１９】
【発明の効果】以上説明したように、本発明は、スイッ
チングレギュレータの出力状態を検出回路により検出し
、検出した状態に応じてサンプリング周波数を変化させ
てスイッチングレギュレータの入力へ帰還させる回路構
成としたので、出力の過度応答にも十分対応でき、出力
コンデンサの容量を小さくしても、なだらかで安定した
出力が得られるという効果を有する。
チングレギュレータの出力状態を検出回路により検出し
、検出した状態に応じてサンプリング周波数を変化させ
てスイッチングレギュレータの入力へ帰還させる回路構
成としたので、出力の過度応答にも十分対応でき、出力
コンデンサの容量を小さくしても、なだらかで安定した
出力が得られるという効果を有する。
【００２０】従って、出力コンデンサの小型化、小容量
化で、コストの低減もできるという効果もある。
化で、コストの低減もできるという効果もある。
【図１】本発明のスイッチングレギュレータ制御方式の
一実施例を示す機能ブロック図である。
一実施例を示す機能ブロック図である。
【図２】従来の一例を示す機能ブロック図である。
１ レギュレータ
２ 差動増幅器
３ 基準電圧供給回路
４ Ａ／Ｄコンバータ
５ 帰還量演算回路
６ Ｄ／Ａコンバータ
７ ドライブ回路
８ クロック信号供給部
８０ クロック信号
８１ 状態検出回路
８２ 発振周波数変調回路
Claims (1)
- 【請求項１】 スイッチングレギュレータの出力と基
準電圧との差をとってディジタルデータ化し、帰還量を
所定クロック信号で処理したのちアナログレベルに変換
し、このレベルに応じたパルス幅で前記スイッチングレ
ギュレータを駆動するスイッチングレギュレータ制御方
式において、前記レギュレータの出力および前記基準電
圧との差分状態を検出し、この差分状態に応じてサンプ
リング周波数を変調して生成するクロック信号を、前記
所定クロック信号として供給するクロック信号供給部を
有することを特徴とするスイッチングレギュレータ制御
方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8709191A JPH04322161A (ja) | 1991-04-19 | 1991-04-19 | スイッチングレギュレータ制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8709191A JPH04322161A (ja) | 1991-04-19 | 1991-04-19 | スイッチングレギュレータ制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04322161A true JPH04322161A (ja) | 1992-11-12 |
Family
ID=13905285
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8709191A Pending JPH04322161A (ja) | 1991-04-19 | 1991-04-19 | スイッチングレギュレータ制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04322161A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7292081B2 (en) | 2003-05-22 | 2007-11-06 | Densei-Lambda Kabushiki Kaisha | Pulse generator |
| DE102007036700A1 (de) * | 2007-08-03 | 2009-02-05 | Semikron Elektronik Gmbh & Co. Kg | Treiberschaltung für einen Stromrichter mit Zwischenkreis |
| JP5527397B1 (ja) * | 2012-12-20 | 2014-06-18 | Ｔｄｋ株式会社 | パルス生成器 |
| TWI571037B (zh) * | 2012-04-23 | 2017-02-11 | 崇貿科技股份有限公司 | 功率轉換器的切換式控制電路 |
-
1991
- 1991-04-19 JP JP8709191A patent/JPH04322161A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7292081B2 (en) | 2003-05-22 | 2007-11-06 | Densei-Lambda Kabushiki Kaisha | Pulse generator |
| DE102007036700A1 (de) * | 2007-08-03 | 2009-02-05 | Semikron Elektronik Gmbh & Co. Kg | Treiberschaltung für einen Stromrichter mit Zwischenkreis |
| TWI571037B (zh) * | 2012-04-23 | 2017-02-11 | 崇貿科技股份有限公司 | 功率轉換器的切換式控制電路 |
| US9762144B2 (en) | 2012-04-23 | 2017-09-12 | Semiconductor Components Industries, Llc | Switching control circuit with signal process to accommodate the synchronous rectifier of power converters |
| US10141867B2 (en) | 2012-04-23 | 2018-11-27 | Semiconductor Components Industries, Llc | Switching control circuit with signal process to accommodate the synchronous rectifier of power converters |
| JP5527397B1 (ja) * | 2012-12-20 | 2014-06-18 | Ｔｄｋ株式会社 | パルス生成器 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19991109 |