JPH04307470A - デジタル記録再生機器 - Google Patents
デジタル記録再生機器Info
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- JPH04307470A JPH04307470A JP7153391A JP7153391A JPH04307470A JP H04307470 A JPH04307470 A JP H04307470A JP 7153391 A JP7153391 A JP 7153391A JP 7153391 A JP7153391 A JP 7153391A JP H04307470 A JPH04307470 A JP H04307470A
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- Japan
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- circuit
- clock signal
- clock
- digital
- signal
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- 230000010355 oscillation Effects 0.000 claims description 57
- 238000005070 sampling Methods 0.000 claims description 14
- 230000001360 synchronised effect Effects 0.000 claims description 12
- 239000013078 crystal Substances 0.000 claims description 3
- 230000005236 sound signal Effects 0.000 description 11
- 238000010586 diagram Methods 0.000 description 6
- 238000001228 spectrum Methods 0.000 description 4
- 230000002452 interceptive effect Effects 0.000 description 3
- 230000007257 malfunction Effects 0.000 description 2
- 230000002123 temporal effect Effects 0.000 description 2
- 238000012544 monitoring process Methods 0.000 description 1
- 238000002360 preparation method Methods 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、デジタル信号の記録再
生が可能な回転ヘッド方式のディジタルオーディオ・テ
ープレコーダ等のＤＡコンバータを内蔵したデジタル記
録再生機器に関するものである。
生が可能な回転ヘッド方式のディジタルオーディオ・テ
ープレコーダ等のＤＡコンバータを内蔵したデジタル記
録再生機器に関するものである。
【０００２】
【従来の技術】近年、ＤＡコンバータを備えたオーディ
オ機器では、高Ｓ／Ｎ，高歪率等の性能を高めるため、
ＤＡコンバータに供給するクロック信号の安定化が重要
とされている。
オ機器では、高Ｓ／Ｎ，高歪率等の性能を高めるため、
ＤＡコンバータに供給するクロック信号の安定化が重要
とされている。
【０００３】以下、図面を参照しながら従来のデジタル
記録再生機器について説明する。図３は従来のデジタル
記録再生機器を示すものである。図３において、１は磁
気テープ、２は再生ヘッド、３は再生アンプ、４はデジ
タル信号の誤り訂正や時間的な並びを元に戻すディイン
ターリーブ処理などを行なうデジタル信号処理回路、５
はＤＡコンバータ、６はアナログ出力アンプ、７はアナ
ログ出力端子、８はサンプリング周波数３２ＫＨｚの基
準クロック信号を供給する第１の発振回路、９はサンプ
リング周波数４４．１ＫＨｚの基準クロック信号を供給
する第２の発振回路、１０はサンプリング周波数４８Ｋ
Ｈｚの基準クロック信号を供給する第３の発振回路、１
１は第１，第２，第３の発振回路８，９，１０から生成
されたクロック信号を選択するセレクタ、１２は選択さ
れたクロック信号からＬＲクロック信号を生成する第１
の分周回路、１３は選択されたクロック信号からビット
クロック信号を生成する第２の分周回路、１５はデジタ
ル入力端子、１６はサンプリング周波数に同期したデジ
タル信号を出力する同期回路、１７はデジタル信号処理
回路を駆動するためのクロックを供給するデジタル信号
処理用発振回路である。
記録再生機器について説明する。図３は従来のデジタル
記録再生機器を示すものである。図３において、１は磁
気テープ、２は再生ヘッド、３は再生アンプ、４はデジ
タル信号の誤り訂正や時間的な並びを元に戻すディイン
ターリーブ処理などを行なうデジタル信号処理回路、５
はＤＡコンバータ、６はアナログ出力アンプ、７はアナ
ログ出力端子、８はサンプリング周波数３２ＫＨｚの基
準クロック信号を供給する第１の発振回路、９はサンプ
リング周波数４４．１ＫＨｚの基準クロック信号を供給
する第２の発振回路、１０はサンプリング周波数４８Ｋ
Ｈｚの基準クロック信号を供給する第３の発振回路、１
１は第１，第２，第３の発振回路８，９，１０から生成
されたクロック信号を選択するセレクタ、１２は選択さ
れたクロック信号からＬＲクロック信号を生成する第１
の分周回路、１３は選択されたクロック信号からビット
クロック信号を生成する第２の分周回路、１５はデジタ
ル入力端子、１６はサンプリング周波数に同期したデジ
タル信号を出力する同期回路、１７はデジタル信号処理
回路を駆動するためのクロックを供給するデジタル信号
処理用発振回路である。
【０００４】以上のように構成されたデジタル記録再生
機器について、以下動作を説明する。
機器について、以下動作を説明する。
【０００５】テープを再生出力する場合、磁気テープ１
に記録された信号を再生ヘッド２が再生し、再生アンプ
３，デジタル信号処理回路４を経て、オーディオ信号の
デジタル信号をＤＡコンバータ５に入力し、アナログの
オーディオ信号としてアナログ出力アンプ６を経てアナ
ログ出力端子７から出力する。サンプリング周波数のマ
スタークロック信号は、デジタル信号処理回路４がデジ
タル信号から第１の発振回路，第２の発振回路，第３の
発振回路から生成されたクロック信号のうち１つを選択
し、ＤＡコンバータ５にマスタークロック信号及び分周
されたＬＲクロック、ビットクロックを供給する。
に記録された信号を再生ヘッド２が再生し、再生アンプ
３，デジタル信号処理回路４を経て、オーディオ信号の
デジタル信号をＤＡコンバータ５に入力し、アナログの
オーディオ信号としてアナログ出力アンプ６を経てアナ
ログ出力端子７から出力する。サンプリング周波数のマ
スタークロック信号は、デジタル信号処理回路４がデジ
タル信号から第１の発振回路，第２の発振回路，第３の
発振回路から生成されたクロック信号のうち１つを選択
し、ＤＡコンバータ５にマスタークロック信号及び分周
されたＬＲクロック、ビットクロックを供給する。
【０００６】また、デジタル入力の録音モニタの場合、
デジタル入力端子１５から入力された信号をデジタル信
号同期回路１６，デジタル信号処理回路４を経て、オー
ディオ信号のデジタル信号をＤＡコンバータ５に入力し
、アナログのオーディオ信号としてアナログ出力アンプ
６を経てアナログ出力端子７から出力する。サンプリン
グ周波数のマスタークロック信号は、デジタル信号同期
回路１６からマスタークロック信号に同期させたクロッ
ク信号をデジタル信号処理回路４を経て、ＤＡコンバー
タ５にマスタークロック信号及び分周したＬＲクロック
，ビットクロックを供給する。また、この状態では、デ
ジタル信号同期回路１６で同期がはずれた場合に備え、
第１の発振回路，第２の発振回路，第３の発振回路を発
振状態にし、同期がはずれた時にデジタル信号処理回路
４はデジタル入力時のクロック信号と同一のクロック信
号を使用し、デジタル信号処理回路４内部でのクロック
信号の変動による誤動作を防いでいる。
デジタル入力端子１５から入力された信号をデジタル信
号同期回路１６，デジタル信号処理回路４を経て、オー
ディオ信号のデジタル信号をＤＡコンバータ５に入力し
、アナログのオーディオ信号としてアナログ出力アンプ
６を経てアナログ出力端子７から出力する。サンプリン
グ周波数のマスタークロック信号は、デジタル信号同期
回路１６からマスタークロック信号に同期させたクロッ
ク信号をデジタル信号処理回路４を経て、ＤＡコンバー
タ５にマスタークロック信号及び分周したＬＲクロック
，ビットクロックを供給する。また、この状態では、デ
ジタル信号同期回路１６で同期がはずれた場合に備え、
第１の発振回路，第２の発振回路，第３の発振回路を発
振状態にし、同期がはずれた時にデジタル信号処理回路
４はデジタル入力時のクロック信号と同一のクロック信
号を使用し、デジタル信号処理回路４内部でのクロック
信号の変動による誤動作を防いでいる。
【０００７】図４に各回路におけるマスタークロックの
スペクトラム図を示す。第１の発振回路，第２の発振回
路，第３の発振回路の発振状態を図４（ａ）に、デジタ
ル信号から第１の発振回路，第２の発振回路，第３の発
振回路から生成されたクロック信号のうち１つを選択し
、デジタル信号処理回路の内部で各発振回路から生成さ
れるクロック信号間の干渉が発生した状態を図４（ｂ）
に、基準クロック信号が各発振回路から生成されるクロ
ック信号に変調されＤＡコンバータに入力された状態を
図４（ｃ）に示す。
スペクトラム図を示す。第１の発振回路，第２の発振回
路，第３の発振回路の発振状態を図４（ａ）に、デジタ
ル信号から第１の発振回路，第２の発振回路，第３の発
振回路から生成されたクロック信号のうち１つを選択し
、デジタル信号処理回路の内部で各発振回路から生成さ
れるクロック信号間の干渉が発生した状態を図４（ｂ）
に、基準クロック信号が各発振回路から生成されるクロ
ック信号に変調されＤＡコンバータに入力された状態を
図４（ｃ）に示す。
【０００８】
【発明が解決しようとする課題】しかしながら、上記の
従来装置では、ＤＡコンバータに供給されるマスターク
ロック信号にデジタル信号処理回路の内部で各発振回路
から生成されるクロック信号間の干渉、デジタル信号処
理用発振回路から生成されたクロック信号との干渉があ
り、ＤＡコンバータの性能を十分に生かせないという問
題点を有していた。
従来装置では、ＤＡコンバータに供給されるマスターク
ロック信号にデジタル信号処理回路の内部で各発振回路
から生成されるクロック信号間の干渉、デジタル信号処
理用発振回路から生成されたクロック信号との干渉があ
り、ＤＡコンバータの性能を十分に生かせないという問
題点を有していた。
【０００９】本発明は、上記問題点にかえりみ、各発振
回路から生成されるクロック信号間の干渉、デジタル信
号処理回路から生じるクロック信号との干渉をすること
なしにクロック信号をＤＡコンバータに供給することが
できるデジタル記録再生機器を提供するものである。
回路から生成されるクロック信号間の干渉、デジタル信
号処理回路から生じるクロック信号との干渉をすること
なしにクロック信号をＤＡコンバータに供給することが
できるデジタル記録再生機器を提供するものである。
【００１０】
【課題を解決するための手段】上記問題点を解決するた
め本発明のデジタル記録再生機器は、複数の水晶発振回
路を有し、複数の発振回路から生成されたクロック信号
を選択するセレクタと発振回路から生成されたクロック
信号から１サンプリング同期及びＬ／Ｒを区別するＬＲ
クロック信号を生成する分周回路と、発振回路から生成
されたクロック信号からデイジタルオーディオデータ転
送用のビットクロック信号を生成する分周回路を備えた
デジタル信号処理回路を有し、各発振回路から生成され
たクロック信号間の干渉を受けにくい低周波のＬＲクロ
ックを逓倍しマスタークロックを生成する同期回路を備
え、前記同期回路によって生成されたマスタークロック
信号をＤＡコンバータに供給するという構成を備えたも
のである。
め本発明のデジタル記録再生機器は、複数の水晶発振回
路を有し、複数の発振回路から生成されたクロック信号
を選択するセレクタと発振回路から生成されたクロック
信号から１サンプリング同期及びＬ／Ｒを区別するＬＲ
クロック信号を生成する分周回路と、発振回路から生成
されたクロック信号からデイジタルオーディオデータ転
送用のビットクロック信号を生成する分周回路を備えた
デジタル信号処理回路を有し、各発振回路から生成され
たクロック信号間の干渉を受けにくい低周波のＬＲクロ
ックを逓倍しマスタークロックを生成する同期回路を備
え、前記同期回路によって生成されたマスタークロック
信号をＤＡコンバータに供給するという構成を備えたも
のである。
【００１１】
【作用】本発明は上記した構成によって、テープを再生
出力する場合及びデジタル入力の録音録音モニタの場合
に、各発振回路から生成されるクロック信号間の干渉と
デジタル信号処理回路から生じるクロック信号との干渉
をすることなしにクロック信号をＤＡコンバータに供給
でき、ＤＡコンバータの性能を十分に生かすことができ
る。
出力する場合及びデジタル入力の録音録音モニタの場合
に、各発振回路から生成されるクロック信号間の干渉と
デジタル信号処理回路から生じるクロック信号との干渉
をすることなしにクロック信号をＤＡコンバータに供給
でき、ＤＡコンバータの性能を十分に生かすことができ
る。
【００１２】
【実施例】以下本発明の一実施例のデジタル記録再生装
置について、図面を参照しながら説明する。
置について、図面を参照しながら説明する。
【００１３】図１において、１は磁気テープ、２は再生
ヘッド、３は再生アンプ、４はデジタル信号の誤り訂正
や時間的な並びを元に戻すディインターリーブ処理など
を行なうデジタル信号処理回路、５はＤＡコンバータ、
６はアナログ出力アンプ、７はアナログ出力端子、８は
サンプリング周波数３２ＫＨｚの基準クロック信号を供
給する第１の発振回路、９はサンプリング周波数４４．
１ＫＨｚの基準クロック信号を供給する第２の発振回路
、１０はサンプリング周波数４８ＫＨｚの基準クロック
信号を供給する第３の発振回路、１１は第１，第２，第
３の発振回路８，９，１０から生成されたクロック信号
を選択するセレクタ、１２は選択されたクロック信号か
らＬＲクロック信号を生成する第１の分周回路、１３は
選択されたクロック信号からビットクロック信号を生成
する第２の分周回路、１４はＬＲクロックを逓倍しマス
タークロックを生成する同期回路、１５はデジタル入力
端子、１６はサンプリング周波数に同期したデジタル信
号を出力する同期回路、１７はデジタル信号処理回路を
駆動するためのクロックを供給するデジタル信号処理用
発振回路である。
ヘッド、３は再生アンプ、４はデジタル信号の誤り訂正
や時間的な並びを元に戻すディインターリーブ処理など
を行なうデジタル信号処理回路、５はＤＡコンバータ、
６はアナログ出力アンプ、７はアナログ出力端子、８は
サンプリング周波数３２ＫＨｚの基準クロック信号を供
給する第１の発振回路、９はサンプリング周波数４４．
１ＫＨｚの基準クロック信号を供給する第２の発振回路
、１０はサンプリング周波数４８ＫＨｚの基準クロック
信号を供給する第３の発振回路、１１は第１，第２，第
３の発振回路８，９，１０から生成されたクロック信号
を選択するセレクタ、１２は選択されたクロック信号か
らＬＲクロック信号を生成する第１の分周回路、１３は
選択されたクロック信号からビットクロック信号を生成
する第２の分周回路、１４はＬＲクロックを逓倍しマス
タークロックを生成する同期回路、１５はデジタル入力
端子、１６はサンプリング周波数に同期したデジタル信
号を出力する同期回路、１７はデジタル信号処理回路を
駆動するためのクロックを供給するデジタル信号処理用
発振回路である。
【００１４】以上のように構成されたデジタル記録再生
装置について、以下動作を説明する。
装置について、以下動作を説明する。
【００１５】テープを再生出力する場合、磁気テープ１
に記録された信号を再生ヘッド２が再生し、再生アンプ
３，デジタル信号処理回路４を経て、オーディオ信号の
デジタル信号をＤＡコンバータ５に入力し、アナログの
オーディオ信号としてアナログ出力アンプ６を経て、ア
ナログ出力端子１０から出力する。サンプリング周波数
のマスタークロック信号は、デジタル信号処理回路４が
デジタル信号から第１の発振回路，第２の発振回路，第
３の発振回路から生成されたクロック信号のうちの１つ
を選択する。選択されたクロック信号を分周回路１２に
て１／Ｎに分周しＬＲクロック信号を生成し、分周回路
１２のクロック信号の出力を同期回路１４でＮ倍に逓倍
し、マスタークロック信号を生成させ、ＤＡコンバータ
５に供給する。
に記録された信号を再生ヘッド２が再生し、再生アンプ
３，デジタル信号処理回路４を経て、オーディオ信号の
デジタル信号をＤＡコンバータ５に入力し、アナログの
オーディオ信号としてアナログ出力アンプ６を経て、ア
ナログ出力端子１０から出力する。サンプリング周波数
のマスタークロック信号は、デジタル信号処理回路４が
デジタル信号から第１の発振回路，第２の発振回路，第
３の発振回路から生成されたクロック信号のうちの１つ
を選択する。選択されたクロック信号を分周回路１２に
て１／Ｎに分周しＬＲクロック信号を生成し、分周回路
１２のクロック信号の出力を同期回路１４でＮ倍に逓倍
し、マスタークロック信号を生成させ、ＤＡコンバータ
５に供給する。
【００１６】また、デジタル入力の録音モニタの場合、
デジタル入力端子１５から入力された信号をデジタル信
号同期回路１６，デジタル信号処理回路４を経て、オー
ディオ信号のデジタル信号をＤＡコンバータ５に入力し
、アナログのオーディオ信号としてアナログ出力アンプ
６を経てアナログ出力端子７から出力する。サンプリン
グ周波数のマスタークロック信号は、デジタル信号同期
回路１６からマスタークロック信号に同期させたクロッ
ク信号をデジタル信号処理回路４に供給する。選択され
たクロック信号を分周回路１２にて１／Ｎに分周しＬＲ
クロック信号を生成し、分周回路１２のクロック信号の
出力を同期回路１４でＮ倍に逓倍し、マスタークロック
信号を生成させ、ＤＡコンバータ５に供給する。また、
この状態では、デジタル信号同期回路１６で同期がはず
れた場合に備え、第１の発振回路，第２の発振回路，第
３の発振回路を発振状態にし、同期がはずれた時にデジ
タル信号処理回路４はデジタル入力時のクロック信号と
同一のクロック信号を使用し、デジタル信号処理回路４
内部でのクロック信号の変動による誤動作を防いでいる
。
デジタル入力端子１５から入力された信号をデジタル信
号同期回路１６，デジタル信号処理回路４を経て、オー
ディオ信号のデジタル信号をＤＡコンバータ５に入力し
、アナログのオーディオ信号としてアナログ出力アンプ
６を経てアナログ出力端子７から出力する。サンプリン
グ周波数のマスタークロック信号は、デジタル信号同期
回路１６からマスタークロック信号に同期させたクロッ
ク信号をデジタル信号処理回路４に供給する。選択され
たクロック信号を分周回路１２にて１／Ｎに分周しＬＲ
クロック信号を生成し、分周回路１２のクロック信号の
出力を同期回路１４でＮ倍に逓倍し、マスタークロック
信号を生成させ、ＤＡコンバータ５に供給する。また、
この状態では、デジタル信号同期回路１６で同期がはず
れた場合に備え、第１の発振回路，第２の発振回路，第
３の発振回路を発振状態にし、同期がはずれた時にデジ
タル信号処理回路４はデジタル入力時のクロック信号と
同一のクロック信号を使用し、デジタル信号処理回路４
内部でのクロック信号の変動による誤動作を防いでいる
。
【００１７】図２に各回路におけるマスタークロックの
スペクトラム図を示す。第１の発振回路，第２の発振回
路，第３の発振回路の発振状態を図２（ａ）に、デジタ
ル信号処理回路で各発振回路から生成されるクロック信
号間の干渉を受けにくい低周波のＬＲクロック信号を分
周回路にて１／Ｎにクロック信号を分周して生成させた
状態を図２（ｂ）に、分周されたＬＲクロック信号を同
期回路でＮ倍に逓倍しマスタークロック信号を生成させ
た状態を図２（ｃ）に、デジタル信号処理回路内で生じ
る発振回路から生成されたクロック信号との干渉をする
ことなしにマスタークロック信号をＤＡコンバータに供
給した状態を図２（ｄ）に示す。
スペクトラム図を示す。第１の発振回路，第２の発振回
路，第３の発振回路の発振状態を図２（ａ）に、デジタ
ル信号処理回路で各発振回路から生成されるクロック信
号間の干渉を受けにくい低周波のＬＲクロック信号を分
周回路にて１／Ｎにクロック信号を分周して生成させた
状態を図２（ｂ）に、分周されたＬＲクロック信号を同
期回路でＮ倍に逓倍しマスタークロック信号を生成させ
た状態を図２（ｃ）に、デジタル信号処理回路内で生じ
る発振回路から生成されたクロック信号との干渉をする
ことなしにマスタークロック信号をＤＡコンバータに供
給した状態を図２（ｄ）に示す。
【００１８】以上のように本実施例によれば、分周され
たＬＲクロック信号を逓倍しマスタークロック信号を生
成する同期回路を備えることにより、デジタル信号処理
回路内で生じる発振回路から生成されたクロック信号と
の干渉をすることなしにマスタークロック信号をＤＡコ
ンバータに供給できる。
たＬＲクロック信号を逓倍しマスタークロック信号を生
成する同期回路を備えることにより、デジタル信号処理
回路内で生じる発振回路から生成されたクロック信号と
の干渉をすることなしにマスタークロック信号をＤＡコ
ンバータに供給できる。
【００１９】また、デジタル入力時にも同様に第１，第
２，第３の発振回路から生成されたクロック信号間との
干渉をすることなしにクロック信号をＤＡコンバータに
供給できる。
２，第３の発振回路から生成されたクロック信号間との
干渉をすることなしにクロック信号をＤＡコンバータに
供給できる。
【００２０】
【発明の効果】以上のように本発明は、複数の水晶発振
回路を有し、複数の発振回路から生成されたクロック信
号を選択するセレクタと発振回路から生成されたクロッ
ク信号からＬＲクロック信号，ビットクロック信号を生
成する分周回路を備えたデジタル信号処理回路を有し、
各発振回路から生成されたクロック信号間の干渉を受け
にくい低周波のＬＲクロックを逓倍しマスタークロック
を生成する同期回路を備え、デジタル信号処理回路内で
生じる発振回路から生成されたクロック信号との干渉を
することなしにマスタークロック信号をＤＡコンバータ
に供給できる。
回路を有し、複数の発振回路から生成されたクロック信
号を選択するセレクタと発振回路から生成されたクロッ
ク信号からＬＲクロック信号，ビットクロック信号を生
成する分周回路を備えたデジタル信号処理回路を有し、
各発振回路から生成されたクロック信号間の干渉を受け
にくい低周波のＬＲクロックを逓倍しマスタークロック
を生成する同期回路を備え、デジタル信号処理回路内で
生じる発振回路から生成されたクロック信号との干渉を
することなしにマスタークロック信号をＤＡコンバータ
に供給できる。
【図１】本発明のデジタル記録再生機器の一実施例にお
ける構成図
ける構成図
【図２】本発明の各回路におけるクロックのスペクトラ
ム図
ム図
【図３】本発明のデジタル記録再生機器の従来例におけ
る構成図
る構成図
【図４】従来例の各回路におけるクロックのスペクトラ
ム図
ム図
１ 磁気テープ
２ 再生ヘッド
３ 再生アンプ
４ デジタル信号処理回路
５ ＤＡコンバータ
６ アナログ出力アンプ
７ アナログ出力端子
８ 第１の発振回路
９ 第２の発振回路
１０ 第３の発振回路
１１ セレクタ
１２ 第１の分周回路
１３ 第２の分周回路
１４ 同期回路
１５ デジタル入力端子
１６ デジタル信号同期回路
１７ デジタル信号処理用発振回路
Claims (1)
- 【請求項１】複数の水晶発振回路を有し、複数の発振回
路から生成されたクロック信号を選択するセレクタと発
振回路から生成されたクロック信号から１サンプリング
同期及びＬ／Ｒを区別するＬＲクロック信号を生成する
分周回路と、発振回路から生成されたクロック信号から
ディジタルオーディオデータ転送用のビットクロック信
号を生成する分周回路を備えたデジタル信号処理回路を
有し、各発振回路から生成されたクロック信号間の干渉
を受けにくい低周波のＬＲクロックを逓倍しマスターク
ロックを生成する同期回路を備え、前記同期回路によっ
て生成されたマスタークロック信号をＤＡコンバータに
供給できることを特微とするデジタル記録再生機器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03071533A JP3143944B2 (ja) | 1991-04-04 | 1991-04-04 | デジタル記録再生機器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03071533A JP3143944B2 (ja) | 1991-04-04 | 1991-04-04 | デジタル記録再生機器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04307470A true JPH04307470A (ja) | 1992-10-29 |
| JP3143944B2 JP3143944B2 (ja) | 2001-03-07 |
Family
ID=13463472
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03071533A Expired - Fee Related JP3143944B2 (ja) | 1991-04-04 | 1991-04-04 | デジタル記録再生機器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3143944B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7565214B2 (en) | 2004-12-09 | 2009-07-21 | Fujitsu Component Limited | Audio system for playing back recorded information by remote transmission |
-
1991
- 1991-04-04 JP JP03071533A patent/JP3143944B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7565214B2 (en) | 2004-12-09 | 2009-07-21 | Fujitsu Component Limited | Audio system for playing back recorded information by remote transmission |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3143944B2 (ja) | 2001-03-07 |
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