JPH07210949A - ディジタルｖｃｒの可変速度再生装置 - Google Patents
ディジタルｖｃｒの可変速度再生装置Info
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- JPH07210949A JPH07210949A JP6310977A JP31097794A JPH07210949A JP H07210949 A JPH07210949 A JP H07210949A JP 6310977 A JP6310977 A JP 6310977A JP 31097794 A JP31097794 A JP 31097794A JP H07210949 A JPH07210949 A JP H07210949A
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- Signal Processing For Digital Recording And Reproducing (AREA)
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Abstract
(57)【要約】
【目的】 ディジタルＶＣＲの可変速度再生装置を提供
する。 【構成】 速度デ−タを入力してゲ−ト信号とＰＬＬ制
御信号を発生する可変速度再生制御部と、再生信号を入
力してゲ−ト信号に応じて所定のレベル以下の信号を取
り除くゲ−ト部とゲ−ト部の出力を入力して位相および
振幅を補正する再生イクオ−ライザ部と再生イクオ−ラ
イザ部の出力を入力してデ−タを検出するデ−タ再生部
とデ−タ再生部の出力を入力してＰＬＬ制御信号に応じ
てクロックを発生する位相同期ル−プとデ−タを前記ク
ロックに同期させて出力する同期部を具備してビデオテ
−プに記録された信号をヘッドにより読み出して増幅し
た再生信号を可変速度に従ってデ−タとして再生する。 【効果】 可変速度の再生のためのハ−ドウェアを減ら
し、エラ−率を低減して同期能力を向上させて再生シス
テムを安定化させうる。
する。 【構成】 速度デ−タを入力してゲ−ト信号とＰＬＬ制
御信号を発生する可変速度再生制御部と、再生信号を入
力してゲ−ト信号に応じて所定のレベル以下の信号を取
り除くゲ−ト部とゲ−ト部の出力を入力して位相および
振幅を補正する再生イクオ−ライザ部と再生イクオ−ラ
イザ部の出力を入力してデ−タを検出するデ−タ再生部
とデ−タ再生部の出力を入力してＰＬＬ制御信号に応じ
てクロックを発生する位相同期ル−プとデ−タを前記ク
ロックに同期させて出力する同期部を具備してビデオテ
−プに記録された信号をヘッドにより読み出して増幅し
た再生信号を可変速度に従ってデ−タとして再生する。 【効果】 可変速度の再生のためのハ−ドウェアを減ら
し、エラ−率を低減して同期能力を向上させて再生シス
テムを安定化させうる。
Description
【０００１】
【産業上の利用分野】本発明のディジタルＶＣＲの可変
速度再生装置に係り、特に再生信号で所定の振幅以下の
出力を排除してデ−タ検出エラ−を抑制し、同期能力を
向上させた装置に関する。
速度再生装置に係り、特に再生信号で所定の振幅以下の
出力を排除してデ−タ検出エラ−を抑制し、同期能力を
向上させた装置に関する。
【０００２】
【従来の技術】ディジタルＶＣＲ（Ｄ- ＶＣＲ）におい
て、従来の可変速度再生時には簡単なＡＧＣ増幅器を利
用したり再生出力をそのまま利用したので、再生信号の
キャリア雑音比（Ｃ／Ｎ）が低い部分もデ−タ検出部に
送られるので、エラ−が発生されてＰＬＬ動作が不安に
なってビットエラ−レ−ト（ＢＥＲ）が増加された。ま
た、イクオ−ライザの出力もＣ／Ｎの低い部分が出力さ
れてエラ−を増加させるのでデ−タ検出時信頼できない
デ−タが出力されてＰＬＬ動作を不安定にする。その結
果、可変再生時ビットエラ−率（ＢＥＲ）が増加されて
全体的にシステムの性能を低下させる。
て、従来の可変速度再生時には簡単なＡＧＣ増幅器を利
用したり再生出力をそのまま利用したので、再生信号の
キャリア雑音比（Ｃ／Ｎ）が低い部分もデ−タ検出部に
送られるので、エラ−が発生されてＰＬＬ動作が不安に
なってビットエラ−レ−ト（ＢＥＲ）が増加された。ま
た、イクオ−ライザの出力もＣ／Ｎの低い部分が出力さ
れてエラ−を増加させるのでデ−タ検出時信頼できない
デ−タが出力されてＰＬＬ動作を不安定にする。その結
果、可変再生時ビットエラ−率（ＢＥＲ）が増加されて
全体的にシステムの性能を低下させる。
【０００３】増幅された再生信号は振幅が所定のレベル
以下で極めて低いのでＣ／Ｎ比の劣悪な部分が共に存す
る。このような振幅の低い部分はデ−タ検出時にエラ−
が発生する確率を高め、位相同期ル−プ（Phase Lock L
oop)の同期能力を低下させる問題点があった。従来の可
変速磁気記録再生装置はアメリカ特許第 4,930,024号に
開示されている。前記アメリカ特許第 4,930,024号は可
変速回転ヘッドおよび可変速ディスク駆動装置と前記可
変速ディスク駆動装置の速度変化によって前記回転ヘッ
ドの速度を制御する回路を含み、再生時に発生される雑
音を低減させうるが、再生出力の大きさによる選択的な
出力はできなかった。
以下で極めて低いのでＣ／Ｎ比の劣悪な部分が共に存す
る。このような振幅の低い部分はデ−タ検出時にエラ−
が発生する確率を高め、位相同期ル−プ（Phase Lock L
oop)の同期能力を低下させる問題点があった。従来の可
変速磁気記録再生装置はアメリカ特許第 4,930,024号に
開示されている。前記アメリカ特許第 4,930,024号は可
変速回転ヘッドおよび可変速ディスク駆動装置と前記可
変速ディスク駆動装置の速度変化によって前記回転ヘッ
ドの速度を制御する回路を含み、再生時に発生される雑
音を低減させうるが、再生出力の大きさによる選択的な
出力はできなかった。
【０００４】
【発明が解決しようとする課題】したがって、本発明の
目的は前記のような従来の問題点を解決するために可変
速度再生時に所定の振幅以下の可変再生信号は出力を遮
断し、所定の振幅以上の再生信号のみ出力してデ−タの
エラ−率と同期能力を改善したディジタルＶＣＲの可変
速度再生装置を提供することである。
目的は前記のような従来の問題点を解決するために可変
速度再生時に所定の振幅以下の可変再生信号は出力を遮
断し、所定の振幅以上の再生信号のみ出力してデ−タの
エラ−率と同期能力を改善したディジタルＶＣＲの可変
速度再生装置を提供することである。
【０００５】
【課題を解決するための手段】前記のような目的を達成
するために本発明の装置はテ−プに記録された信号をヘ
ッドで読み出して増幅した再生信号を可変速度に応じて
デ−タに再生するディジタルＶＣＲの可変速度再生装置
において、速度デ−タを入力してゲ−ト信号とＰＬＬ制
御信号を発生する可変速度再生制御部と、前記再生信号
を入力して前記ゲ−ト信号に応じて所定のレベル振幅以
下の信号を取り除くゲ−ト部と、前記ゲ−ト部の出力を
入力して位相及び振幅を補正する再生イクオ−ライザ部
と、前記再生イクオ−ライザ部の出力を入力してデ−タ
を検出するデ−タ再生部と、前記デ−タ再生部の出力を
入力して前記ＰＬＬ制御信号に応じてクロックを発生す
る位相同期ル−プと、前記デ−タを前記クロックに同期
させて出力する同期部を具備したことを特徴とする。
するために本発明の装置はテ−プに記録された信号をヘ
ッドで読み出して増幅した再生信号を可変速度に応じて
デ−タに再生するディジタルＶＣＲの可変速度再生装置
において、速度デ−タを入力してゲ−ト信号とＰＬＬ制
御信号を発生する可変速度再生制御部と、前記再生信号
を入力して前記ゲ−ト信号に応じて所定のレベル振幅以
下の信号を取り除くゲ−ト部と、前記ゲ−ト部の出力を
入力して位相及び振幅を補正する再生イクオ−ライザ部
と、前記再生イクオ−ライザ部の出力を入力してデ−タ
を検出するデ−タ再生部と、前記デ−タ再生部の出力を
入力して前記ＰＬＬ制御信号に応じてクロックを発生す
る位相同期ル−プと、前記デ−タを前記クロックに同期
させて出力する同期部を具備したことを特徴とする。
【０００６】
【作用】ビデオテ−プに記録された信号をヘッドにより
読み出して増幅した再生信号を可変速度に従ってデ−タ
に再生するので、可変速度の再生のためのハ−ドウェア
を減らし、エラ−率を低減して同期能力を向上させる。
読み出して増幅した再生信号を可変速度に従ってデ−タ
に再生するので、可変速度の再生のためのハ−ドウェア
を減らし、エラ−率を低減して同期能力を向上させる。
【０００７】
【実施例】以下、添付した図面に基づき本発明を詳細に
説明する。図１において、本発明の一実施例による可変
速度再生装置はヘッド１０、再生増幅器（ＰＢ- ＡＭ
Ｐ）１１、ゲ−トバッファ−１２、再生イクオ−ライザ
部１３、再生部１４、同期部１５、位相同期ル−プ（Ｐ
ＬＬ）１６、可変速度再生制御部２０を具備する。ヘッ
ド１０は記録媒体（磁気テ−プなど）に記録されたデ−
タを再生して再生増幅器１１に出力し、再生増幅器１１
は再生信号を増幅する。ゲ−トバッファ−１２は可変速
度再生制御部２０の出力に従って再生増幅器１１の出力
信号で所定レベル以上の信号のみ出力する。再生イクオ
−ライザ部１３はゲ−ト部１２の出力を入力してチャネ
ル特性に適するように補償して信号干渉などを抑制す
る。再生イクオ−ライザ部１３の出力は再生部１４から
デ−タとして検出されて同期部１５で再生クロックに同
期された後、デ−タとして出力される。再生部１４の出
力は位相同期ル−プ１６に入力されて再生クロックを発
生して同期部１５とシステムの他部分に出力する。ま
た、ＰＬＬ１６は可変速度再生制御部２０の出力に応じ
て再生クロックを発生する。可変速度再生制御部２０は
速度デ−タを入力し、制御信号をゲ−ト部１２とＰＬＬ
１６に出力する。
説明する。図１において、本発明の一実施例による可変
速度再生装置はヘッド１０、再生増幅器（ＰＢ- ＡＭ
Ｐ）１１、ゲ−トバッファ−１２、再生イクオ−ライザ
部１３、再生部１４、同期部１５、位相同期ル−プ（Ｐ
ＬＬ）１６、可変速度再生制御部２０を具備する。ヘッ
ド１０は記録媒体（磁気テ−プなど）に記録されたデ−
タを再生して再生増幅器１１に出力し、再生増幅器１１
は再生信号を増幅する。ゲ−トバッファ−１２は可変速
度再生制御部２０の出力に従って再生増幅器１１の出力
信号で所定レベル以上の信号のみ出力する。再生イクオ
−ライザ部１３はゲ−ト部１２の出力を入力してチャネ
ル特性に適するように補償して信号干渉などを抑制す
る。再生イクオ−ライザ部１３の出力は再生部１４から
デ−タとして検出されて同期部１５で再生クロックに同
期された後、デ−タとして出力される。再生部１４の出
力は位相同期ル−プ１６に入力されて再生クロックを発
生して同期部１５とシステムの他部分に出力する。ま
た、ＰＬＬ１６は可変速度再生制御部２０の出力に応じ
て再生クロックを発生する。可変速度再生制御部２０は
速度デ−タを入力し、制御信号をゲ−ト部１２とＰＬＬ
１６に出力する。
【０００８】図２は本発明の他の実施例による可変速度
再生装置を示したブロック図であって、ヘッド１０と再
生増幅器（ＰＢ- ＡＭＰ）１１とゲ−トバッファ−１２
と自動利得増幅部３０と再生イクオ−ライザ部１３と再
生部１４と同期部１５とＰＬＬ１６と可変速度再生制御
部２０を具備する。図２の可変速度再生装置は図１の可
変速度再生装置に自動利得増幅部３０をさらに具備した
ものであって、自動利得増幅部３０はゲ−トバッファ−
１２の出力を自動利得制御信号に応じて増幅する自動利
得増幅器（ＡＧＣ ＡＭＰ）３１と、自動利得増幅器３
１の出力を入力してゲ−ト信号に応じて自動利得制御信
号を発生する検波部３２を具備する。また、可変速度再
生制御部２０はデ−タ発生部２１、ゲ−ト信号発生部２
２及びＰＬＬエラ−電圧発生部２３を具備する。
再生装置を示したブロック図であって、ヘッド１０と再
生増幅器（ＰＢ- ＡＭＰ）１１とゲ−トバッファ−１２
と自動利得増幅部３０と再生イクオ−ライザ部１３と再
生部１４と同期部１５とＰＬＬ１６と可変速度再生制御
部２０を具備する。図２の可変速度再生装置は図１の可
変速度再生装置に自動利得増幅部３０をさらに具備した
ものであって、自動利得増幅部３０はゲ−トバッファ−
１２の出力を自動利得制御信号に応じて増幅する自動利
得増幅器（ＡＧＣ ＡＭＰ）３１と、自動利得増幅器３
１の出力を入力してゲ−ト信号に応じて自動利得制御信
号を発生する検波部３２を具備する。また、可変速度再
生制御部２０はデ−タ発生部２１、ゲ−ト信号発生部２
２及びＰＬＬエラ−電圧発生部２３を具備する。
【０００９】図２において、ヘッド１０は記録媒体に記
録されたデ−タを再生して再生増幅器１１に出力し、再
生増幅器１１はヘッド１０が読み出した再生信号
（ＳR ）を増幅する。ゲ−トバッファ−１２はゲ−ト信
号発生部２２の出力によって再生増幅器１１の出力で所
定レベル以上の振幅を有する再生信号（ＳR ´）はＡＧ
Ｃ増幅器３１に出力し、所定レベル未満の振幅を有する
再生信号（ＳR ）は取り除く。即ち、再生増幅器１１の
出力中には振幅がとても低くて、Ｃ／Ｎ比が劣悪な部分
が存する。このような振幅の低い部分はデ−タ検出時エ
ラ−が発生する確率が極めて高いので、本発明ではゲ−
ト信号に応じてこの部分を取り除く。ＡＧＣ増幅器３１
はＡＧＣ検波した一定な振幅に達しない図３（Ｄ）の信
号をデ−タ検出時有利な振幅で増幅させる。この際、Ａ
ＧＣ増幅器３１で増幅された信号（ＳR″）は検波部３
２でゲ−ト信号に応じて検波されて、ＡＧＣ増幅器３１
にフィ−ドバットされる。再生イクオ−ライザ部１３の
出力からデ−タを検出する。ＰＬＬ１６は再生デ−タ
（DATA) を受けてＰＬＬエラ−電圧発生部２３の出力
（ＰＬＬ制御信号）にクロック(CLOCK) を発生する。同
期部１５は再生部１４のデ−タを再生されたクロック(C
LOCK) に応じて同期させて出力する。可変速度再生制御
部２０はサ−ボ部（図示せず）から入力される速度デ−
タを全ての可変速度が表現できる‘４’ビットのデ−タ
に変換させてＰＬＬ制御信号とゲ−ト信号（GATE) を発
生する。即ち、デ−タ発生部２１は速度デ−タを入力し
て４ビットの可変速度識別デ−タを発生し、ＰＬＬエラ
−電圧発生部２３は該当可変速度に合うクロックを発生
させうるように、ＰＬＬ制御信号を可変速度識別デ−タ
によって固有の直流電圧に変換して変換された信号をＰ
ＬＬ１６に出力する。ゲ−ト信号発生部２２は４ビット
の識別デ−タを入力してヘッドスイッチング信号を適当
に分周して、それぞれの可変速度に合う固有のゲ−ト信
号（GATE）を発生させてゲ−ト部（即ち、ゲ−トバッフ
ァ−増幅器）１２と検波部３２とデ−タ再生部１４に出
力する。
録されたデ−タを再生して再生増幅器１１に出力し、再
生増幅器１１はヘッド１０が読み出した再生信号
（ＳR ）を増幅する。ゲ−トバッファ−１２はゲ−ト信
号発生部２２の出力によって再生増幅器１１の出力で所
定レベル以上の振幅を有する再生信号（ＳR ´）はＡＧ
Ｃ増幅器３１に出力し、所定レベル未満の振幅を有する
再生信号（ＳR ）は取り除く。即ち、再生増幅器１１の
出力中には振幅がとても低くて、Ｃ／Ｎ比が劣悪な部分
が存する。このような振幅の低い部分はデ−タ検出時エ
ラ−が発生する確率が極めて高いので、本発明ではゲ−
ト信号に応じてこの部分を取り除く。ＡＧＣ増幅器３１
はＡＧＣ検波した一定な振幅に達しない図３（Ｄ）の信
号をデ−タ検出時有利な振幅で増幅させる。この際、Ａ
ＧＣ増幅器３１で増幅された信号（ＳR″）は検波部３
２でゲ−ト信号に応じて検波されて、ＡＧＣ増幅器３１
にフィ−ドバットされる。再生イクオ−ライザ部１３の
出力からデ−タを検出する。ＰＬＬ１６は再生デ−タ
（DATA) を受けてＰＬＬエラ−電圧発生部２３の出力
（ＰＬＬ制御信号）にクロック(CLOCK) を発生する。同
期部１５は再生部１４のデ−タを再生されたクロック(C
LOCK) に応じて同期させて出力する。可変速度再生制御
部２０はサ−ボ部（図示せず）から入力される速度デ−
タを全ての可変速度が表現できる‘４’ビットのデ−タ
に変換させてＰＬＬ制御信号とゲ−ト信号（GATE) を発
生する。即ち、デ−タ発生部２１は速度デ−タを入力し
て４ビットの可変速度識別デ−タを発生し、ＰＬＬエラ
−電圧発生部２３は該当可変速度に合うクロックを発生
させうるように、ＰＬＬ制御信号を可変速度識別デ−タ
によって固有の直流電圧に変換して変換された信号をＰ
ＬＬ１６に出力する。ゲ−ト信号発生部２２は４ビット
の識別デ−タを入力してヘッドスイッチング信号を適当
に分周して、それぞれの可変速度に合う固有のゲ−ト信
号（GATE）を発生させてゲ−ト部（即ち、ゲ−トバッフ
ァ−増幅器）１２と検波部３２とデ−タ再生部１４に出
力する。
【００１０】図３（Ａ）〜図３（Ｇ）は本発明による図
２の可変再生装置の各部に表れた各種信号の動作波形図
である。図３（Ａ）はヘッドスイッチング信号（ H´DS
WP)を示した波形図である。図３（Ｂ）は図１の再生増
幅器の出力である再生信号（ＳR ）を示した波形図であ
って、点線は所定のレベル（Ｌ+ , Ｌ- ）を示す。図３
（Ｃ）は図１および図２のゲ−ト信号（GATE）を示した
波形図である。図３（Ｄ）は図１および図２のゲ−トバ
ッファ−１２の出力であるゲ−トされた再生信号
（ＳR ′）を示した波形図であって、ゲ−ト信号（GAT
E）が‘ハイ’の時には再生信号（ＳR ）を増幅して出
力し、ゲ−ト信号（GATE）が‘ロ−’の時には出力しな
いことが分る。図３（Ｅ）は図２のＡＧＣ増幅器３１の
出力であるＡＧＣ増幅された再生信号（ＳR ″）を示し
たものであって、ゲ−トされた再生信号（ＳR ′）をデ
−タ検出時有利な振幅で増幅したことが分る。図３
（Ｆ）は図１および図２のデ−タ再生部１４から検出さ
れたデ−タ信号（ＤＡＴＡ）を示す。図３（Ｇ）は図１
および図２のＰＬＬ１６の出力であるクロック信号（CL
OCK)を示す。
２の可変再生装置の各部に表れた各種信号の動作波形図
である。図３（Ａ）はヘッドスイッチング信号（ H´DS
WP)を示した波形図である。図３（Ｂ）は図１の再生増
幅器の出力である再生信号（ＳR ）を示した波形図であ
って、点線は所定のレベル（Ｌ+ , Ｌ- ）を示す。図３
（Ｃ）は図１および図２のゲ−ト信号（GATE）を示した
波形図である。図３（Ｄ）は図１および図２のゲ−トバ
ッファ−１２の出力であるゲ−トされた再生信号
（ＳR ′）を示した波形図であって、ゲ−ト信号（GAT
E）が‘ハイ’の時には再生信号（ＳR ）を増幅して出
力し、ゲ−ト信号（GATE）が‘ロ−’の時には出力しな
いことが分る。図３（Ｅ）は図２のＡＧＣ増幅器３１の
出力であるＡＧＣ増幅された再生信号（ＳR ″）を示し
たものであって、ゲ−トされた再生信号（ＳR ′）をデ
−タ検出時有利な振幅で増幅したことが分る。図３
（Ｆ）は図１および図２のデ−タ再生部１４から検出さ
れたデ−タ信号（ＤＡＴＡ）を示す。図３（Ｇ）は図１
および図２のＰＬＬ１６の出力であるクロック信号（CL
OCK)を示す。
【００１１】
【発明の効果】以上で調べたように本発明によると、可
変速度再生のためのハ−ドウェアを減らしてエラ−率を
低減し、同期能力を向上させて再生システムを安定化さ
せる。
変速度再生のためのハ−ドウェアを減らしてエラ−率を
低減し、同期能力を向上させて再生システムを安定化さ
せる。
【図１】本発明による可変速度再生装置の一実施例を示
したブロック図である。
したブロック図である。
【図２】本発明による他の実施例による可変再生装置を
示したブロック図である。
示したブロック図である。
【図３】（Ａ）〜（Ｇ）は図２上の可変再生装置の各部
に示した各種信号の動作波形図である。
に示した各種信号の動作波形図である。
１０ ヘッド １１ 再生増幅器 １２ ゲ−トバッファ− １３ 再生イクオ−ライザ １４ 再生部 １５ 同期部 １６ 位相同期ル−プ ２０ 可変速度再生制御部 ２１ デ−タ発生部 ２２ ゲ−ト信号発生部 ２３ ＰＬＬエラ−電圧発生部
Claims (4)
- 【請求項１】 テ−プに記録された信号をヘッドで読み
出して増幅した再生信号を可変速度に従ってデ−タに再
生するディジタルＶＣＲの可変速度再生装置において、 速度デ−タを入力してゲ−ト信号とＰＬＬ制御信号を発
生する可変速度再生制御部と、 前記再生信号を入力して前記ゲ−ト信号に応じて所定の
レベル以下の信号を取り除くゲ−ト部と、 前記ゲ−ト部の出力を入力して位相及び振幅を補正する
再生イクオ−ライザ部と、 前記再生イクオ−ライザ部の出力を入力してデ−タを検
出するデ−タ再生部と、 前記デ−タ再生部の出力を入力して前記ＰＬＬ制御信号
に応じてクロックを発生する位相同期ル−プと、 前記デ−タを前記クロックに同期させて出力する同期部
を具備したことを特徴とするディジタルＶＣＲの可変速
度再生装置。 - 【請求項２】 前記可変速度再生制御部は前記速度デ−
タを入力して可変速度識別デ−タを発生するデ−タ発生
部と、前記可変速度識別デ−タに応じてゲ−ト信号を発
生するゲ−ト信号発生部と、前記可変速度識別デ−タに
よってＰＬＬエラ−電圧を発生するＰＬＬエラ−電圧発
生部を具備したことを特徴とする請求項１記載のディジ
タルＶＣＲ可変速度再生装置。 - 【請求項３】 テ−プに記録された信号をヘッドで読み
出して増幅した再生信号を可変速度に従ってデ−タに再
生するディジタルＶＣＲの可変速度再生装置において、 速度デ−タを入力してゲ−ト信号とＰＬＬ制御信号を発
生する可変速度再生制御部と、 前記再生信号を入力して前記ゲ−ト信号に応じて所定の
レベル以下の信号を取り除くゲ−ト部と、 前記ゲ−ト部の出力を入力して前記ゲ−ト信号に応じて
増幅する自動利得増幅部と、 前記自動利得増幅部の出力を入力して位相および振幅を
補正する再生イクオ−ライザ部と、 前記再生イクオ−ライザ部の出力を入力してデ−タを検
出するデ−タ再生部と、 前記デ−タ再生部の出力を入力して前記ＰＬＬ制御信号
に応じてクロックを発生する位相同期ル−プと、 前記デ−タを前記クロックに同期させて出力する同期部
を具備したことを特徴とするディジタルＶＣＲの可変速
度再生装置。 - 【請求項４】 前記自動利得増幅部は前記ゲ−ト部の出
力を自動利得制御信号に応じて増幅する自動利得増幅器
と、前記自動利得増幅器の出力を入力して前記自動利得
制御信号を発生する検波部を具備したことを特徴とする
請求項３記載のディジタルＶＣＲの可変速度再生装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR31601/1993 | 1993-12-30 | ||
| KR1019930031601A KR0141213B1 (ko) | 1993-12-30 | 1993-12-30 | 디지탈 브이시알의 가변속도 재생장치 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07210949A true JPH07210949A (ja) | 1995-08-11 |
| JP2804900B2 JP2804900B2 (ja) | 1998-09-30 |
Family
ID=19374541
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6310977A Expired - Fee Related JP2804900B2 (ja) | 1993-12-30 | 1994-12-14 | ディジタルｖｃｒの可変速度再生装置 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US5523896A (ja) |
| JP (1) | JP2804900B2 (ja) |
| KR (1) | KR0141213B1 (ja) |
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|---|---|---|---|---|
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