JPH04249384A - 半導体発光素子の製造方法 - Google Patents
半導体発光素子の製造方法Info
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- JPH04249384A JPH04249384A JP3014126A JP1412691A JPH04249384A JP H04249384 A JPH04249384 A JP H04249384A JP 3014126 A JP3014126 A JP 3014126A JP 1412691 A JP1412691 A JP 1412691A JP H04249384 A JPH04249384 A JP H04249384A
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 8
- 239000000758 substrate Substances 0.000 claims abstract description 34
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- 238000005253 cladding Methods 0.000 claims description 11
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- 229910000530 Gallium indium arsenide Inorganic materials 0.000 claims description 6
- VEXZGXHMUGYJMC-UHFFFAOYSA-N Hydrochloric acid Chemical compound Cl VEXZGXHMUGYJMC-UHFFFAOYSA-N 0.000 abstract description 10
- 239000005416 organic matter Substances 0.000 abstract 1
- 238000005498 polishing Methods 0.000 description 6
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- 238000007517 polishing process Methods 0.000 description 4
- 238000005336 cracking Methods 0.000 description 2
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
- H01S5/00—Semiconductor lasers
- H01S5/02—Structural details or components not essential to laser action
- H01S5/0206—Substrates, e.g. growth, shape, material, removal or bonding
- H01S5/0217—Removal of the substrate
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】本発明は半導体発光素子の製造方
法に関し、特にInP基板を用いた素子の製造方法に関
する。
法に関し、特にInP基板を用いた素子の製造方法に関
する。
【0002】
【従来の技術】従来、InP基板を用いた半導体発光素
子のうちのInP/InGaAsP発光ダイオードの製
造方法は、図3に示すように、厚さ約400μmのN型
InP基板1上に厚さ3μmのN型InPクラッド層3
と、厚さ1μmで波長1.3μm組成のInGaAsP
活性層4、及び厚さ2μmのP型InPクラッド層5と
、厚さ1μm波長1.2μm組成のP型InGaAsP
キャップ層6の各エピタキシャル層を形成する工程(図
3(a))と、前記N型InP基板1を約100μm程
度に研磨して薄くする工程(図3(b))、及び半導体
層の表裏に電極7と電極9及び電流狭窄の為の絶縁膜8
を形成する工程(図3(c))を有していた。
子のうちのInP/InGaAsP発光ダイオードの製
造方法は、図3に示すように、厚さ約400μmのN型
InP基板1上に厚さ3μmのN型InPクラッド層3
と、厚さ1μmで波長1.3μm組成のInGaAsP
活性層4、及び厚さ2μmのP型InPクラッド層5と
、厚さ1μm波長1.2μm組成のP型InGaAsP
キャップ層6の各エピタキシャル層を形成する工程(図
3(a))と、前記N型InP基板1を約100μm程
度に研磨して薄くする工程(図3(b))、及び半導体
層の表裏に電極7と電極9及び電流狭窄の為の絶縁膜8
を形成する工程(図3(c))を有していた。
【0003】ここで、前記N型InP基板1の研磨工程
(図3(b))は上述した製造工程のあとに行うところ
のウェハ状態から各チップに分離する為の劈開分離工程
を可能にする為のものであって、ウェハを研磨治具には
りつけ、研磨剤を使用して、InP基板1側を研磨する
工程である。
(図3(b))は上述した製造工程のあとに行うところ
のウェハ状態から各チップに分離する為の劈開分離工程
を可能にする為のものであって、ウェハを研磨治具には
りつけ、研磨剤を使用して、InP基板1側を研磨する
工程である。
【0004】
【発明が解決しようとする課題】しかし、従来の製造方
法は、前述した研磨工程において、研磨中に機械的な振
動等によりウェハが割れる事故がしばしば起こり、製造
歩留りが悪いという欠点を有していた。
法は、前述した研磨工程において、研磨中に機械的な振
動等によりウェハが割れる事故がしばしば起こり、製造
歩留りが悪いという欠点を有していた。
【0005】
【課題を解決するための手段】本発明の製造方法は、I
nGaAsP活性層とInPクラッド層を含むヘテロ接
合体を形成するのに先だち、InP基板上にInGaA
sPもしくはInGaAsのエピタキシャル層を形成す
る工程と、ヘテロ接合体上に少なくとも厚さ50μm以
上のInP層を形成する工程と、InPのみをエッチン
グし、InGaAsPもしくはInGaAsをエッチン
グしないいわゆる選択エッチング液によってInP基板
を除去する工程とを有している。
nGaAsP活性層とInPクラッド層を含むヘテロ接
合体を形成するのに先だち、InP基板上にInGaA
sPもしくはInGaAsのエピタキシャル層を形成す
る工程と、ヘテロ接合体上に少なくとも厚さ50μm以
上のInP層を形成する工程と、InPのみをエッチン
グし、InGaAsPもしくはInGaAsをエッチン
グしないいわゆる選択エッチング液によってInP基板
を除去する工程とを有している。
【0006】
【実施例】次に本発明の第1の実施例の発光ダイオード
の製造方法を図面を参照して説明する。本実施例の製造
方法は、図1に示すように、厚さ約400μmのN型I
nP基板1上に厚さ1μm、波長が1.2μm組成のI
nGaAs層2aと厚さ3μmのN型InPクラッド層
3と、厚さ1μm、波長が1.3μm組成のInGaA
sP活性層4及び厚さが約100μmのP型InPクラ
ッド層5を形成する(図1(a))。次いで、上述した
エピタキシャルウェハのエピタキシャル成長層側を有機
物でおおい、N型InP基板1側より塩酸を用いて同N
型InP基板1のみを選択エッチングして除去する(図
1(b))。この後、電極7、電極9と絶縁膜8を形成
して発光素子とする(図1(c))。
の製造方法を図面を参照して説明する。本実施例の製造
方法は、図1に示すように、厚さ約400μmのN型I
nP基板1上に厚さ1μm、波長が1.2μm組成のI
nGaAs層2aと厚さ3μmのN型InPクラッド層
3と、厚さ1μm、波長が1.3μm組成のInGaA
sP活性層4及び厚さが約100μmのP型InPクラ
ッド層5を形成する(図1(a))。次いで、上述した
エピタキシャルウェハのエピタキシャル成長層側を有機
物でおおい、N型InP基板1側より塩酸を用いて同N
型InP基板1のみを選択エッチングして除去する(図
1(b))。この後、電極7、電極9と絶縁膜8を形成
して発光素子とする(図1(c))。
【0007】ここで、P型InPクラッド層5を約10
0μmと厚く形成している為、N型InP基板1を除去
しても素子の機械的強度は保たれている。また、N型I
nP基板1上にN型InGaAsP層2aを形成してい
る為、N型InP基板1を塩酸によってエッチングする
際、エッチングはN型InGaAsP層2aでストップ
する。これによって、発光に寄与するエピタキシャル層
を損傷することなくN型InP基板1をエッチングによ
って除去することが可能となった。
0μmと厚く形成している為、N型InP基板1を除去
しても素子の機械的強度は保たれている。また、N型I
nP基板1上にN型InGaAsP層2aを形成してい
る為、N型InP基板1を塩酸によってエッチングする
際、エッチングはN型InGaAsP層2aでストップ
する。これによって、発光に寄与するエピタキシャル層
を損傷することなくN型InP基板1をエッチングによ
って除去することが可能となった。
【0008】このように、本発明の製造方法は、InP
基板の研磨工程を除くことが可能となり、従来問題とな
っていた同工程でのおよそ1〜2割程度のウェハ割れ不
良が皆無となり、製造歩留りを改善することができた。
基板の研磨工程を除くことが可能となり、従来問題とな
っていた同工程でのおよそ1〜2割程度のウェハ割れ不
良が皆無となり、製造歩留りを改善することができた。
【0009】次に本発明の第2の実施例である半導体レ
ーザの製造方法について説明する。
ーザの製造方法について説明する。
【0010】図2に示すように本実施例の製造方法は厚
さ約400μmのN型InP基板1上に厚さ1μmのN
型InGaAs層2bと、厚さ3μmのN型InPクラ
ッド層3、及び厚さ0.1μm、波長が1.3μm組成
のInGaAsP活性層4と、厚さ1μmのP型InP
クラッド層5aを順次形成する(図2(a))。次いで
、同エピタキシャル層をメサ形にエッチングする(図2
(b))。この後、メサ部Mの上部のみを除いてP型I
nPブロック層10とN型InPブロック層11、さら
に全面に厚さ約100μmのP型InP層5bを形成す
る(図2(c))。最後に、第1の実施例同様、N型I
nP基板1を塩酸によって除去し、電極7と電極9を形
成する(図2(d))。
さ約400μmのN型InP基板1上に厚さ1μmのN
型InGaAs層2bと、厚さ3μmのN型InPクラ
ッド層3、及び厚さ0.1μm、波長が1.3μm組成
のInGaAsP活性層4と、厚さ1μmのP型InP
クラッド層5aを順次形成する(図2(a))。次いで
、同エピタキシャル層をメサ形にエッチングする(図2
(b))。この後、メサ部Mの上部のみを除いてP型I
nPブロック層10とN型InPブロック層11、さら
に全面に厚さ約100μmのP型InP層5bを形成す
る(図2(c))。最後に、第1の実施例同様、N型I
nP基板1を塩酸によって除去し、電極7と電極9を形
成する(図2(d))。
【0011】第1の実施例ではInP基板上にInGa
AsP層2aを形成したのに対し、第2の実施例ではI
nGaAs層2bを形成したという相違点を有するが、
InGaAsP層2a及びInGaAs層2bとも塩酸
によってエッチングされず、InP基板1をエッチング
によって除去しても発光に寄与するエピタキシャル層を
損傷しない点では同様の効果を有している。また、第2
の実施例では2回のエピタキシャル工程によって所望の
エピタキシャル層を形成しているが、ともに約100μ
mのInP層を有しており、InP基板を除去しても素
子の機械的強度が保たれる点でも同様の効果を有してい
る。したがって、本第2の実施例の方法においても第1
の実施例同様、InP基板の研磨工程がなく、ウェハの
割れがなく製造歩留りを向上できるという効果を有して
いる。
AsP層2aを形成したのに対し、第2の実施例ではI
nGaAs層2bを形成したという相違点を有するが、
InGaAsP層2a及びInGaAs層2bとも塩酸
によってエッチングされず、InP基板1をエッチング
によって除去しても発光に寄与するエピタキシャル層を
損傷しない点では同様の効果を有している。また、第2
の実施例では2回のエピタキシャル工程によって所望の
エピタキシャル層を形成しているが、ともに約100μ
mのInP層を有しており、InP基板を除去しても素
子の機械的強度が保たれる点でも同様の効果を有してい
る。したがって、本第2の実施例の方法においても第1
の実施例同様、InP基板の研磨工程がなく、ウェハの
割れがなく製造歩留りを向上できるという効果を有して
いる。
【0012】
【発明の効果】以上説明したように、本発明の製造方法
は、InP基板上にInGaAsP層もしくはInGa
As層と、少なくとも厚さ50μm以上のInP層とを
形成する工程を有しており、この為、InP基板を研磨
によらずエッチングによって除去することができる為、
従来のようにInP基板の研磨工程でウェハが割れるよ
うな事故もなくなり製造歩留りを向上できる効果を有す
る。
は、InP基板上にInGaAsP層もしくはInGa
As層と、少なくとも厚さ50μm以上のInP層とを
形成する工程を有しており、この為、InP基板を研磨
によらずエッチングによって除去することができる為、
従来のようにInP基板の研磨工程でウェハが割れるよ
うな事故もなくなり製造歩留りを向上できる効果を有す
る。
【図1】本発明の製造方法を示した素子断面の流れ図。
【図2】本発明の製造方法を示した素子断面の流れ図。
【図3】従来の製造方法の素子断面の流れ図。
1 N型InP基板
2a N型InGaAsP層
2b N型InGaAs層
3 N型InPクラッド層
4 InGaAsP活性層
5,5a,5b P型InPクラッド層6
P型InGaAsPキャップ層7,9 電極 8 絶縁膜 10 P型InPブロック層 11 N型InPブロック層
P型InGaAsPキャップ層7,9 電極 8 絶縁膜 10 P型InPブロック層 11 N型InPブロック層
Claims (1)
- 【請求項1】 InP基板上にInGaAsPもしく
はInGaAsのエピタキシャル成長膜を形成したのち
、InGaAsP活性層とInPクラッド層を含むヘテ
ロ接合体と少なくとも厚さが50μmあるInP層とを
含むエピタキシャル層を形成する工程と、前記InP基
板をエッチングによって除去する工程とを少くとも含ん
でなることを特徴とする半導体発光素子の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3014126A JPH04249384A (ja) | 1991-02-05 | 1991-02-05 | 半導体発光素子の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3014126A JPH04249384A (ja) | 1991-02-05 | 1991-02-05 | 半導体発光素子の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04249384A true JPH04249384A (ja) | 1992-09-04 |
Family
ID=11852434
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3014126A Pending JPH04249384A (ja) | 1991-02-05 | 1991-02-05 | 半導体発光素子の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04249384A (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007538408A (ja) * | 2004-05-18 | 2007-12-27 | クリー インコーポレイテッド | 第3族窒化物デバイスを製造する方法およびその方法を使用して製造されたデバイス |
WO2019124497A1 (ja) * | 2017-12-22 | 2019-06-27 | Dowaエレクトロニクス株式会社 | 半導体発光素子およびその製造方法 |
US20210020814A1 (en) * | 2018-03-30 | 2021-01-21 | Dowa Electronics Materials Co., Ltd. | Method of manufacturing semiconductor optical device and intermediate article of semiconductor optical device |
US20210234069A1 (en) * | 2020-01-25 | 2021-07-29 | Jade Bird Display (shanghai) Limited | Micro light emitting diode with high light extraction efficiency |
-
1991
- 1991-02-05 JP JP3014126A patent/JPH04249384A/ja active Pending
Cited By (14)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007538408A (ja) * | 2004-05-18 | 2007-12-27 | クリー インコーポレイテッド | 第3族窒化物デバイスを製造する方法およびその方法を使用して製造されたデバイス |
JP2023014201A (ja) * | 2017-12-22 | 2023-01-26 | Dowaエレクトロニクス株式会社 | 半導体発光素子およびその製造方法 |
JP2019114650A (ja) * | 2017-12-22 | 2019-07-11 | Dowaエレクトロニクス株式会社 | 半導体発光素子およびその製造方法 |
KR20200070381A (ko) * | 2017-12-22 | 2020-06-17 | 도와 일렉트로닉스 가부시키가이샤 | 반도체 발광소자 및 그 제조방법 |
CN111492494A (zh) * | 2017-12-22 | 2020-08-04 | 同和电子科技有限公司 | 半导体发光元件及其制造方法 |
TWI713235B (zh) * | 2017-12-22 | 2020-12-11 | 日商同和電子科技股份有限公司 | 半導體發光元件及其製造方法 |
US11508875B2 (en) | 2017-12-22 | 2022-11-22 | Dowa Electronics Materials Co., Ltd. | Semiconductor light-emitting device and method of manufacturing the same |
WO2019124497A1 (ja) * | 2017-12-22 | 2019-06-27 | Dowaエレクトロニクス株式会社 | 半導体発光素子およびその製造方法 |
CN111492494B (zh) * | 2017-12-22 | 2023-08-01 | 同和电子科技有限公司 | 半导体发光元件及其制造方法 |
US20210020814A1 (en) * | 2018-03-30 | 2021-01-21 | Dowa Electronics Materials Co., Ltd. | Method of manufacturing semiconductor optical device and intermediate article of semiconductor optical device |
US11894502B2 (en) * | 2018-03-30 | 2024-02-06 | Dowa Electronics Materials Co., Ltd. | Method of manufacturing semiconductor optical device and intermediate article of semiconductor optical device |
US20210234069A1 (en) * | 2020-01-25 | 2021-07-29 | Jade Bird Display (shanghai) Limited | Micro light emitting diode with high light extraction efficiency |
US11626550B2 (en) * | 2020-01-25 | 2023-04-11 | Jade Bird Display (shanghai) Limited | Micro light emitting diode with high light extraction efficiency |
US11908988B2 (en) | 2020-01-25 | 2024-02-20 | Jade Bird Display (shanghai) Limited | Micro light emitting diode with high light extraction efficiency |
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