JPH0423510A - 電源周波数検知回路 - Google Patents
電源周波数検知回路Info
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- JPH0423510A JPH0423510A JP12849790A JP12849790A JPH0423510A JP H0423510 A JPH0423510 A JP H0423510A JP 12849790 A JP12849790 A JP 12849790A JP 12849790 A JP12849790 A JP 12849790A JP H0423510 A JPH0423510 A JP H0423510A
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- 238000010586 diagram Methods 0.000 description 13
- 230000007257 malfunction Effects 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 230000008878 coupling Effects 0.000 description 1
- 238000010168 coupling process Methods 0.000 description 1
- 238000005859 coupling reaction Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
Landscapes
- Manipulation Of Pulses (AREA)
- Measuring Frequencies, Analyzing Spectra (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は電気時計等に用いられる電源周波数検知回路に
関するものである。
関するものである。
従来の技術
近年電子回路の普及にともない機器に高度な機能が付加
される様になってきている。例えばタイマー機能を持つ
時計を搭載し、それを利用して予め設定した時刻での自
動起動や自動動作もその一つである。
される様になってきている。例えばタイマー機能を持つ
時計を搭載し、それを利用して予め設定した時刻での自
動起動や自動動作もその一つである。
機器内にて時計機能を実現したものとしては、専用の時
計ＩＣと水晶振動子を組合わせたもの、また機器の制御
回路内のマイクロコンピュータ自らのザイクルを計数す
るものがある。また、機器に接続される交流電源の交流
周波数を検知して計数するものがある。例えば、フォト
カプラによって電源の一次側の交流成分の正または負の
いずれか一つの半波を検出し、二次側の計数回路に入力
する電源周波数検知回路が設けられていた。
計ＩＣと水晶振動子を組合わせたもの、また機器の制御
回路内のマイクロコンピュータ自らのザイクルを計数す
るものがある。また、機器に接続される交流電源の交流
周波数を検知して計数するものがある。例えば、フォト
カプラによって電源の一次側の交流成分の正または負の
いずれか一つの半波を検出し、二次側の計数回路に入力
する電源周波数検知回路が設けられていた。
以下に従来の電源周波数検知回路について説明する。第
５図は従来の電源周波数検知回路の構成図であり、Ｌｌ
、Ｌ２は交流電源線である。１４はフォトカプラー、１
５はフォトカプラー１４の発光側に流れる電流を決定す
るための抵抗器。１６はフォトカプラー１４の発光素子
である。１７はフォトカプラー１４の発光側素子に逆極
性に並列接続されたバイパスダイオードであり、フォト
カプラー１４の発光側素子に対する逆方向電流をバイパ
スし、同発光側素子を逆方向過電圧から保護をする。以
上が一次側回路である。
５図は従来の電源周波数検知回路の構成図であり、Ｌｌ
、Ｌ２は交流電源線である。１４はフォトカプラー、１
５はフォトカプラー１４の発光側に流れる電流を決定す
るための抵抗器。１６はフォトカプラー１４の発光素子
である。１７はフォトカプラー１４の発光側素子に逆極
性に並列接続されたバイパスダイオードであり、フォト
カプラー１４の発光側素子に対する逆方向電流をバイパ
スし、同発光側素子を逆方向過電圧から保護をする。以
上が一次側回路である。
１８はフォトカプラー１４の受光側素子すなわちフォト
トランジスタである。１９はフォトカプラー１４のコレ
クタ抵抗器であり、フォトトランジスタ１８のコレクタ
とこのコレクタ抵抗器１９の接続点から取り出されたパ
ルス信号が計数手段２０に入力し、計数手段２０がその
パルスをカウントする。以上が二次側回路である。
トランジスタである。１９はフォトカプラー１４のコレ
クタ抵抗器であり、フォトトランジスタ１８のコレクタ
とこのコレクタ抵抗器１９の接続点から取り出されたパ
ルス信号が計数手段２０に入力し、計数手段２０がその
パルスをカウントする。以上が二次側回路である。
このように、−次側回路のＬｌ、Ｌ２間の時間ｔととも
に変化する交流電源の交流電圧Ｖ １（ｔ）の周波数を
検知するため、Ｌｌ、Ｌ２間に抵抗器１５、バイパスダ
イオード１７、フォトカプラーの受光側素子１６で構成
された回路を挿入している。また受光側素子１６で交流
波形Ｖｉ（ｔ）の正または負のいずれかの半周期を検出
する事が出来ように、受光側素子１６が順電圧となる半
サイクルのみにフォトトランジスタ１８をオンさせる程
度の電流が一次側回路のＬＩＸＬ２間に流れるように構
成されている。
に変化する交流電源の交流電圧Ｖ １（ｔ）の周波数を
検知するため、Ｌｌ、Ｌ２間に抵抗器１５、バイパスダ
イオード１７、フォトカプラーの受光側素子１６で構成
された回路を挿入している。また受光側素子１６で交流
波形Ｖｉ（ｔ）の正または負のいずれかの半周期を検出
する事が出来ように、受光側素子１６が順電圧となる半
サイクルのみにフォトトランジスタ１８をオンさせる程
度の電流が一次側回路のＬＩＸＬ２間に流れるように構
成されている。
以上のように構成された電源周波数検知回路について、
以下にその動作を説明する。電源が投入されると、フォ
トカプラー１４の発光側素子に半サイクル期間のみ電流
が流れ、フォトカプラー１４は周期的にオンとなる。そ
して二次回路側のフォトトランジスタ１８も周期的にオ
ンとオフを繰返す。
以下にその動作を説明する。電源が投入されると、フォ
トカプラー１４の発光側素子に半サイクル期間のみ電流
が流れ、フォトカプラー１４は周期的にオンとなる。そ
して二次回路側のフォトトランジスタ１８も周期的にオ
ンとオフを繰返す。
第６図は電源周波数検知回路の出力を示したものである
。Ｖｉ（ｔ）は時間とともに電圧値が変化する一次側の
交流電源電圧、ｖｌはそのスレシホールド電圧でＶｉ（
ｔ）≧Ｖ１となった時、フォトカプラー１４をオンする
。この出力はすなわち周波数検出出力ＦＤＥＴである。
。Ｖｉ（ｔ）は時間とともに電圧値が変化する一次側の
交流電源電圧、ｖｌはそのスレシホールド電圧でＶｉ（
ｔ）≧Ｖ１となった時、フォトカプラー１４をオンする
。この出力はすなわち周波数検出出力ＦＤＥＴである。
発明が解決しようとする課題
しかしながら上記従来の構成では、−次側回路の交流電
圧Ｖｉ（ｔ）に何らかの原因でノイズが混入した場合に
、それがそのまま出力波形にＶｎに影響を与える事とな
り、誤動作が起こってしまう。
圧Ｖｉ（ｔ）に何らかの原因でノイズが混入した場合に
、それがそのまま出力波形にＶｎに影響を与える事とな
り、誤動作が起こってしまう。
つまり、第７図に示すように交流電圧Ｖｉ（ｔ）にノイ
ズ電圧Ｖｎが重畳されたとき、Ｖｉ（ｔ）がＶｉ（ｔ）
＜Ｖｌとなる区間にてこのノイズ電圧ＶｎがＶｎ≧Ｖｌ
−Ｖｉ（ｔ）となる大きさであると、出力波形にＶｎの
影響が出てしまう。
ズ電圧Ｖｎが重畳されたとき、Ｖｉ（ｔ）がＶｉ（ｔ）
＜Ｖｌとなる区間にてこのノイズ電圧ＶｎがＶｎ≧Ｖｌ
−Ｖｉ（ｔ）となる大きさであると、出力波形にＶｎの
影響が出てしまう。
課題を解決するための手段
本発明は以上の課題を解決するため、それぞれ入力交流
電圧の正の半サイクルと負の半サイクルで交互にオンす
る一対のフォトカプラーを設け、Ｒ−Ｓフリップフロッ
プ回路のセット端子を一方のフォトカプラーの出力端子
に接続し、同Ｒ−Ｓフリップフロップ回路のリセット端
子を他方のフォトカプラーの出力端子に接続し、このＲ
−Ｓフリップフロップ回路の出力信号を計数手段へ送る
ように構成した。
電圧の正の半サイクルと負の半サイクルで交互にオンす
る一対のフォトカプラーを設け、Ｒ−Ｓフリップフロッ
プ回路のセット端子を一方のフォトカプラーの出力端子
に接続し、同Ｒ−Ｓフリップフロップ回路のリセット端
子を他方のフォトカプラーの出力端子に接続し、このＲ
−Ｓフリップフロップ回路の出力信号を計数手段へ送る
ように構成した。
作用
以上のように、交流電圧の正の半サイクルと負の半サイ
クルを検出してＲ−Ｓフリップフロップに入力し、Ｒ−
Ｓフリップフロップのセットとリセットを交互に繰り返
す事により、入力交流電圧に従って交互に反転する信号
を得るように構成したので、出力を安定させる事が出来
る。つまり、−旦セット端子の入力がハイになった後は
、次はリセット端子の入力がハイにならないとＲ−Ｓフ
リップフロップの出力が反転する事は無く、たとえセッ
ト端子およびリセット端子の入力をハイにしたものがノ
イズであっても、Ｒ−Ｓフリップフロップの出力信号の
周期が乱れる司能性は小さい。
クルを検出してＲ−Ｓフリップフロップに入力し、Ｒ−
Ｓフリップフロップのセットとリセットを交互に繰り返
す事により、入力交流電圧に従って交互に反転する信号
を得るように構成したので、出力を安定させる事が出来
る。つまり、−旦セット端子の入力がハイになった後は
、次はリセット端子の入力がハイにならないとＲ−Ｓフ
リップフロップの出力が反転する事は無く、たとえセッ
ト端子およびリセット端子の入力をハイにしたものがノ
イズであっても、Ｒ−Ｓフリップフロップの出力信号の
周期が乱れる司能性は小さい。
実施例
以下本発明の一実施例について、図面を参照しながら説
明する。
明する。
第１図は本発明の一実施例に於ける電源周波数検知回路
の構成図である。
の構成図である。
第１図に於いて、ＬＬ、Ｌ２は交流電源線、２および３
はそれぞれ電流検知手段として設けられたフォトカプラ
ー、１はフォトカプラー２，３の発光側素子に流れる電
流を決定するための抵抗器である。１２および１３はそ
れぞれフォトカプラー２，３の発光側素子である。以上
が一次側回路である。
はそれぞれ電流検知手段として設けられたフォトカプラ
ー、１はフォトカプラー２，３の発光側素子に流れる電
流を決定するための抵抗器である。１２および１３はそ
れぞれフォトカプラー２，３の発光側素子である。以上
が一次側回路である。
５および６はそれぞれ前記フォトカプラー２゜３の受光
側素子すなわちフォトトランジスタである。７はフォト
トランジスタ５のコレクタ抵抗器、８はフォトトランジ
スタ６のコレクタ抵抗器である。９はＲ−Ｓフリップフ
ロップであり、各フォトカプラー２，３の出力は次段の
Ｒ−Ｓフリップフロップ９のセット端子およびリセット
端子に接続されている。１０は計数手段であり、Ｒ−Ｓ
フリップフロップ９の出力信号はこの計数手段へ送られ
る事となる。以上が二次側回路である。
側素子すなわちフォトトランジスタである。７はフォト
トランジスタ５のコレクタ抵抗器、８はフォトトランジ
スタ６のコレクタ抵抗器である。９はＲ−Ｓフリップフ
ロップであり、各フォトカプラー２，３の出力は次段の
Ｒ−Ｓフリップフロップ９のセット端子およびリセット
端子に接続されている。１０は計数手段であり、Ｒ−Ｓ
フリップフロップ９の出力信号はこの計数手段へ送られ
る事となる。以上が二次側回路である。
このように、−次側回路のＩ、■、５２間の時間ｔとと
もに変化する交流電源の交流電圧Ｖｉ（ｔ）の周波数を
検知するため、Ｌ １、Ｌ ２間に抵抗器１、発光素子
１２．１３で構成された回路が挿入されている。
もに変化する交流電源の交流電圧Ｖｉ（ｔ）の周波数を
検知するため、Ｌ １、Ｌ ２間に抵抗器１、発光素子
１２．１３で構成された回路が挿入されている。
一方のフォトカプラー２の発光素子１２にはＶｉ（１）
の正の半周期で電流が流れ、又、他方のフォトカプラー
３の発光素子１３には負の半周期で電流が流れるように
なっている。抵抗器１はこの２つのフォトカプラー２，
３の発光側素子の電流を決めるためのものである。
の正の半周期で電流が流れ、又、他方のフォトカプラー
３の発光素子１３には負の半周期で電流が流れるように
なっている。抵抗器１はこの２つのフォトカプラー２，
３の発光側素子の電流を決めるためのものである。
二次側回路においては、両フォトカプラー２゜３のフォ
トトランジスタ５，６のコレクタにはそれぞれコレクタ
抵抗器が接続され、これによってエミッタ接地のスイッ
チング回路が構成されている。発光素子１２はＶｉ（ｔ
）の正の半周期でオン、発光素子１３は負の半周期でオ
ンする事となる。
トトランジスタ５，６のコレクタにはそれぞれコレクタ
抵抗器が接続され、これによってエミッタ接地のスイッ
チング回路が構成されている。発光素子１２はＶｉ（ｔ
）の正の半周期でオン、発光素子１３は負の半周期でオ
ンする事となる。
Ｖｉ（ｔ）の正の半周期におけるスレシホールド電圧ｖ
１は、抵抗器１と発光素子１２とフォトトランジスタ５
の結合特性で決まり、同じ（Ｖｉ（ｔ）の負の半周期に
おけるスレシホールド電圧ｖ２は抵抗器１と発光素子１
３とフォトトランジスタ６の結合特性で決まり、そのパ
ラメータの選択により任意に決めることができる。
１は、抵抗器１と発光素子１２とフォトトランジスタ５
の結合特性で決まり、同じ（Ｖｉ（ｔ）の負の半周期に
おけるスレシホールド電圧ｖ２は抵抗器１と発光素子１
３とフォトトランジスタ６の結合特性で決まり、そのパ
ラメータの選択により任意に決めることができる。
第２図・第３図・第４図は本発明の電源周波数検知回路
の出力を示したものである。Ｖｉ（ｔ）は時間とともに
電圧値が変化する一次側の交流電源電圧である。ｖｌは
正の半周期におけるスレシホールド電圧であり、Ｖｉ（
ｔ）≧Ｖｌとなった時、一方のフォトカプラー２の受光
素子であるフォトトランジスタ５がオンとなる。■２は
負の半周期におけるスレシホールド電圧であり、Ｖｉ（
ｔ）≦ｖ２となった時に、他方のフォトカプラー３のフ
ォトトランジスタ６がオンとなる。
の出力を示したものである。Ｖｉ（ｔ）は時間とともに
電圧値が変化する一次側の交流電源電圧である。ｖｌは
正の半周期におけるスレシホールド電圧であり、Ｖｉ（
ｔ）≧Ｖｌとなった時、一方のフォトカプラー２の受光
素子であるフォトトランジスタ５がオンとなる。■２は
負の半周期におけるスレシホールド電圧であり、Ｖｉ（
ｔ）≦ｖ２となった時に、他方のフォトカプラー３のフ
ォトトランジスタ６がオンとなる。
各フォトカプラー２，３の出力は、Ｒ’−Ｓフリップフ
ロップ９のセット入力、リセット入力にそれぞれ入力さ
れる。ＦＤＥＴは周波数検出出力であり、Ｒ−Ｓフリッ
プフロップ９の出力がこの周波数検出出力ＦＤＥＴとな
る。
ロップ９のセット入力、リセット入力にそれぞれ入力さ
れる。ＦＤＥＴは周波数検出出力であり、Ｒ−Ｓフリッ
プフロップ９の出力がこの周波数検出出力ＦＤＥＴとな
る。
一次側回路の交流電圧Ｖｉ（ｔ）にノイズ電圧Ｖｎが重
畳された時、ＦＤＥＴの周波数に影響の出る時は以下の
場合のみである。すなわち、Ｖｉ（ｔ）≧ｖｌとなるｔ
の区間では Ｖｎ≦Ｖ２− Ｖｉ（ｔ） ＝・ＩＶｉ（ｔ）≦ｖ
２となるｔの区間では Ｖｎ≧Ｖｌ−Ｖｉ（ｔ） ・・・２Ｖｉ（ｔ）がＶ
２＜Ｖｉ（ｔ）＜Ｖｌとなるｔの区間でがっそのＶ １
（ｔ）の傾きが正の場合は Ｖｎｌ≧Ｖｌ −Ｖｉ（ｔ） となるＶｎｌにつづき Ｖｎ２≦Ｖ２−Ｖｉ（ｔ） となるＶｎ２が重畳されたとき ・・・３Ｖｉ（ｔ）
がＶ２＜Ｖｉ（ｔ）＜Ｖｌとなる区間でかつソノＶｉ（
ｔ）の傾きが負の場合は Ｖｎｌ≦Ｖ２−Ｖｉ（ｔ） となるＶｎｌにつづき Ｖｎ２≧Ｖｌ−Ｖｉ（ｔ） となるＶｎ２が重畳されたとき ・・・４となる。
畳された時、ＦＤＥＴの周波数に影響の出る時は以下の
場合のみである。すなわち、Ｖｉ（ｔ）≧ｖｌとなるｔ
の区間では Ｖｎ≦Ｖ２− Ｖｉ（ｔ） ＝・ＩＶｉ（ｔ）≦ｖ
２となるｔの区間では Ｖｎ≧Ｖｌ−Ｖｉ（ｔ） ・・・２Ｖｉ（ｔ）がＶ
２＜Ｖｉ（ｔ）＜Ｖｌとなるｔの区間でがっそのＶ １
（ｔ）の傾きが正の場合は Ｖｎｌ≧Ｖｌ −Ｖｉ（ｔ） となるＶｎｌにつづき Ｖｎ２≦Ｖ２−Ｖｉ（ｔ） となるＶｎ２が重畳されたとき ・・・３Ｖｉ（ｔ）
がＶ２＜Ｖｉ（ｔ）＜Ｖｌとなる区間でかつソノＶｉ（
ｔ）の傾きが負の場合は Ｖｎｌ≦Ｖ２−Ｖｉ（ｔ） となるＶｎｌにつづき Ｖｎ２≧Ｖｌ−Ｖｉ（ｔ） となるＶｎ２が重畳されたとき ・・・４となる。
第２図はノイズが重畳されない時の電源周波数検知回路
の出力を示している。
の出力を示している。
正負の各半サイクルのフォトカプラー２，３の出力によ
ってＲ−Ｓフリップフロップ９はセット、リセットの動
作を交互にくり返し、Ｒ−Ｓフリップフロップ９の特性
上、ＦＤＥＴの論理は次に入力されるセット、またはリ
セット入力までは安定している。
ってＲ−Ｓフリップフロップ９はセット、リセットの動
作を交互にくり返し、Ｒ−Ｓフリップフロップ９の特性
上、ＦＤＥＴの論理は次に入力されるセット、またはリ
セット入力までは安定している。
第３図はノイズが重畳されるがＦＤＥＴの周波数に影響
ない場合の動作を示している。
ない場合の動作を示している。
例えばａが示すようにノイズが重畳された場合、セット
入力が定常より先に入力される事となる。
入力が定常より先に入力される事となる。
従ってフリップフロップ９のセットのタイミングは早ま
るがＦＤＥＴの周波数に変化はない。またｂが示すよう
にノイズが重畳された場合、リセット入力が定常より先
に入力され、フリップフロップ９のリセットタイミング
は早まるが、この場合もＦＴＤＴの周波数に変化はない
。そしてＣが示すようにノイズが重畳された場合、瞬間
的にリセット入力が解除されるが、セット入力が印加さ
れないのでフリップフロップ９の出方は保持され、ＦＤ
ＥＴに影響ない。またｄが示すようにノイズが重畳され
た場合も、瞬間的にセット入力は解除されるが、リセッ
ト入力が印加されないのでフリップフロップ９の出力は
保持され、ＦＤＥＴに影響はない。またｅが示すように
ノイズが重畳された場合、セットの状態を保持している
時に再度セット入力が生じる事となるが、ＦＤＥＴに影
響はない。ｆが示すようにノイズが重畳された場合、リ
セットの状態を保持している時に再度リセット入力が生
じる事となるが、ＦＤＥＴに影響はない。
るがＦＤＥＴの周波数に変化はない。またｂが示すよう
にノイズが重畳された場合、リセット入力が定常より先
に入力され、フリップフロップ９のリセットタイミング
は早まるが、この場合もＦＴＤＴの周波数に変化はない
。そしてＣが示すようにノイズが重畳された場合、瞬間
的にリセット入力が解除されるが、セット入力が印加さ
れないのでフリップフロップ９の出方は保持され、ＦＤ
ＥＴに影響ない。またｄが示すようにノイズが重畳され
た場合も、瞬間的にセット入力は解除されるが、リセッ
ト入力が印加されないのでフリップフロップ９の出力は
保持され、ＦＤＥＴに影響はない。またｅが示すように
ノイズが重畳された場合、セットの状態を保持している
時に再度セット入力が生じる事となるが、ＦＤＥＴに影
響はない。ｆが示すようにノイズが重畳された場合、リ
セットの状態を保持している時に再度リセット入力が生
じる事となるが、ＦＤＥＴに影響はない。
第４図は、ノイズが重畳された場合でＦＤＥＴの周波数
に影響の出る場合の動作を示している。
に影響の出る場合の動作を示している。
ａが示すように非常に大きなノイズが重畳された場合に
は、入力されていたセット入力は解除され、更にリセッ
ト入力が生じる事となるので、ＦＤＥＴの周波数に影響
がでる。これは前述のＶｉ（ｔ）≧ｖ１となるｔの区間
でＶｎ≦Ｖ２−Ｖｉ（ｔ）となルノイズが重畳された場
合である。またｂが示すノイズの直後にｂ′が示すよう
にノイズが印加された場合、ノイズｂによってフリップ
フロップはリセットされ、ノイズｂ′によってセットさ
れるので、Ｆ Ｉ） Ｅ Ｔの周波数に影響がでる。こ
れは前述のＶｉ（ｔ）がＶ２＜Ｖｉ（ｔ）＜Ｖｌとなる
ｔの区間で傾きが負の場合で、Ｖｎｌ≦Ｖ２−Ｖｉ（ｔ
）となるＶｎｌにつづき、Ｖｎ２≧Ｖｌ−Ｖｉ（ｔ）と
なるＶｎ２が重畳された場合である。またＣが示すよう
に大きなノイズが重畳された場合、入力されていたリセ
ット入力は解除され、更にセット入力が行われＦＤＥＴ
の周波数に影響が出る。これは前述のＶｉ（ｔ）≦Ｖ２
となるｔの区間で、Ｖｎ≧Ｖｌ−Ｖｉ（ｔ）となるノイ
ズが重畳された場合である。またノイズｄの直後にノイ
ズｄ′が生じた場合、ノイズｄによってフリップフロッ
プ９はセットされ、すぐ後にノイズｄ′によってリセッ
トされる事となって、ＦＤＥＴの周波数に影響が出る。
は、入力されていたセット入力は解除され、更にリセッ
ト入力が生じる事となるので、ＦＤＥＴの周波数に影響
がでる。これは前述のＶｉ（ｔ）≧ｖ１となるｔの区間
でＶｎ≦Ｖ２−Ｖｉ（ｔ）となルノイズが重畳された場
合である。またｂが示すノイズの直後にｂ′が示すよう
にノイズが印加された場合、ノイズｂによってフリップ
フロップはリセットされ、ノイズｂ′によってセットさ
れるので、Ｆ Ｉ） Ｅ Ｔの周波数に影響がでる。こ
れは前述のＶｉ（ｔ）がＶ２＜Ｖｉ（ｔ）＜Ｖｌとなる
ｔの区間で傾きが負の場合で、Ｖｎｌ≦Ｖ２−Ｖｉ（ｔ
）となるＶｎｌにつづき、Ｖｎ２≧Ｖｌ−Ｖｉ（ｔ）と
なるＶｎ２が重畳された場合である。またＣが示すよう
に大きなノイズが重畳された場合、入力されていたリセ
ット入力は解除され、更にセット入力が行われＦＤＥＴ
の周波数に影響が出る。これは前述のＶｉ（ｔ）≦Ｖ２
となるｔの区間で、Ｖｎ≧Ｖｌ−Ｖｉ（ｔ）となるノイ
ズが重畳された場合である。またノイズｄの直後にノイ
ズｄ′が生じた場合、ノイズｄによってフリップフロッ
プ９はセットされ、すぐ後にノイズｄ′によってリセッ
トされる事となって、ＦＤＥＴの周波数に影響が出る。
これは前述のＶｉ（ｔ）がＶ２＜Ｖｉ（ｔ）＜Ｖｌとな
るｔの区間で、Ｖｉ（ｔ）の傾きが正の場合で、Ｖｎｌ
≧Ｖｌ−Ｖｉ（ｔ）となるＶｎｌにつづきＶｎ２≦Ｖ２
−Ｖｉ（ｔ）となル■ｎ２が重畳された峙である。
るｔの区間で、Ｖｉ（ｔ）の傾きが正の場合で、Ｖｎｌ
≧Ｖｌ−Ｖｉ（ｔ）となるＶｎｌにつづきＶｎ２≦Ｖ２
−Ｖｉ（ｔ）となル■ｎ２が重畳された峙である。
発明の効果
以上のように本発明は、それぞれ入力交流電圧の正の半
サイクルと負の半サイクルで交互にオンする一対のフォ
トカプラーを設け、Ｒ−Ｓフリップフロップ回路のセッ
ト端子を一方のフォトカプラーの出力端子に接続し、同
Ｒ−Ｓフリップフロップ回路のリセット端子を他方のフ
ォトカプラーの出力端子に接続し、このＲ−Ｓフリップ
フロップ回路の出力信号を計数手段へ送るように構成し
た事により、交流電圧の正の半サイクルと負の半サイク
ルを検出してＲ−Ｓフリップフロップに入力し、Ｒ−Ｓ
フリップフロップのセットとリセットを交互に繰り返す
事により、入力交流電圧に従って交互に反転する信号を
得る事となり、その信号が周波数検出出力となるので、
その周波数検出出力は非常に安定する事となる。つまり
、旦セット端子の入力がハイになった後は、リセット端
子の入力がハイにならないとＲ−Ｓフリップフロップの
出力が反転する事は無く、たとえセット端子およびリセ
ット端子の入力をハイにしたものがノイズであっても、
Ｒ−Ｓフリップフロップの出力信号の周期が乱れる可能
性は小さい。従って一次側回路に印加されたノイズ成分
に対して非常に強く、誤動作の少ない優れた電源周波数
検知回路を実現出来る。
サイクルと負の半サイクルで交互にオンする一対のフォ
トカプラーを設け、Ｒ−Ｓフリップフロップ回路のセッ
ト端子を一方のフォトカプラーの出力端子に接続し、同
Ｒ−Ｓフリップフロップ回路のリセット端子を他方のフ
ォトカプラーの出力端子に接続し、このＲ−Ｓフリップ
フロップ回路の出力信号を計数手段へ送るように構成し
た事により、交流電圧の正の半サイクルと負の半サイク
ルを検出してＲ−Ｓフリップフロップに入力し、Ｒ−Ｓ
フリップフロップのセットとリセットを交互に繰り返す
事により、入力交流電圧に従って交互に反転する信号を
得る事となり、その信号が周波数検出出力となるので、
その周波数検出出力は非常に安定する事となる。つまり
、旦セット端子の入力がハイになった後は、リセット端
子の入力がハイにならないとＲ−Ｓフリップフロップの
出力が反転する事は無く、たとえセット端子およびリセ
ット端子の入力をハイにしたものがノイズであっても、
Ｒ−Ｓフリップフロップの出力信号の周期が乱れる可能
性は小さい。従って一次側回路に印加されたノイズ成分
に対して非常に強く、誤動作の少ない優れた電源周波数
検知回路を実現出来る。
第１図は本発明の実施例に於ける電源周波数検知回路の
回路図、第２図、第３図、第４図は同電源周波数検知回
路の出力波形図であり、第２図はノイズが重畳されてい
ない時の波形図、第３図はノイズが重畳されているが誤
動作しない場合の波形図、第４図はノイズが重畳して誤
動作した場合の波形図、第５図は従来の電源周波数検知
回路の回路図、第６図、第７図は同従来の電源周波数検
知回路の出力波形図であり、第６図はノイズが重畳され
ていない時の波形図、第７図はノイズが重畳された時を
の波形図である。 １・抵抗器 ２，３ フォトカプラー１２．１
３：発光側素子 ５．６：フオトトランシスタ ７．８・コレクタ抵抗器 ９・Ｒ−Ｓフリップフロップ １０：計数手段代理人の
氏名 弁理士 粟野重孝 はか１名檜、 到ノ ■ 飼） 図
回路図、第２図、第３図、第４図は同電源周波数検知回
路の出力波形図であり、第２図はノイズが重畳されてい
ない時の波形図、第３図はノイズが重畳されているが誤
動作しない場合の波形図、第４図はノイズが重畳して誤
動作した場合の波形図、第５図は従来の電源周波数検知
回路の回路図、第６図、第７図は同従来の電源周波数検
知回路の出力波形図であり、第６図はノイズが重畳され
ていない時の波形図、第７図はノイズが重畳された時を
の波形図である。 １・抵抗器 ２，３ フォトカプラー１２．１
３：発光側素子 ５．６：フオトトランシスタ ７．８・コレクタ抵抗器 ９・Ｒ−Ｓフリップフロップ １０：計数手段代理人の
氏名 弁理士 粟野重孝 はか１名檜、 到ノ ■ 飼） 図
Claims (1)
- 【特許請求の範囲】 入力交流電圧の半サイクルでオンする第１の電流検知手
段と、同入力交流電圧の他の半サイクルでオンする第２
の電流検知手段と、 セット端子が上記第１の電流検知手段に接続され、リセ
ット端子が上記第２の電流検知手段に接続されたフリッ
プフロップ回路と、 上記フリップフロップ回路の出力パルスを計数する計数
手段を備えた事を特徴とする電源周波数検知回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12849790A JPH0423510A (ja) | 1990-05-17 | 1990-05-17 | 電源周波数検知回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12849790A JPH0423510A (ja) | 1990-05-17 | 1990-05-17 | 電源周波数検知回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0423510A true JPH0423510A (ja) | 1992-01-27 |
Family
ID=14986207
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12849790A Pending JPH0423510A (ja) | 1990-05-17 | 1990-05-17 | 電源周波数検知回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0423510A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6043749A (en) * | 1997-04-16 | 2000-03-28 | Nec Corporation | Frequency detection circuit |
| JP2017198467A (ja) * | 2016-04-25 | 2017-11-02 | キヤノン株式会社 | 検出回路、電源装置、及び画像形成装置 |
-
1990
- 1990-05-17 JP JP12849790A patent/JPH0423510A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6043749A (en) * | 1997-04-16 | 2000-03-28 | Nec Corporation | Frequency detection circuit |
| JP2017198467A (ja) * | 2016-04-25 | 2017-11-02 | キヤノン株式会社 | 検出回路、電源装置、及び画像形成装置 |
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