JPH0420066A - 光書込み装置 - Google Patents
光書込み装置Info
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- JPH0420066A JPH0420066A JP2123923A JP12392390A JPH0420066A JP H0420066 A JPH0420066 A JP H0420066A JP 2123923 A JP2123923 A JP 2123923A JP 12392390 A JP12392390 A JP 12392390A JP H0420066 A JPH0420066 A JP H0420066A
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- Japan
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- writing
- writting
- main scanning
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- beams
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- 230000003287 optical effect Effects 0.000 title claims abstract description 22
- 230000001360 synchronised effect Effects 0.000 claims description 15
- 239000004065 semiconductor Substances 0.000 abstract description 10
- 239000000872 buffer Substances 0.000 description 13
- 238000000034 method Methods 0.000 description 6
- 230000003111 delayed effect Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 230000010355 oscillation Effects 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、レーザプロッタ、高品質レーザプリンタ等に
用いられる多点同期方式の光書込み装置に関する。
用いられる多点同期方式の光書込み装置に関する。
従来の技術
般に、レーザプリンタ等の光書込み装置では、レーザ光
源を画像情報に応じて変調し、かつ、ポリゴンミラー等
の偏向器で走査させて感光体等に光書込みを行うように
している。この時、ポリゴンミラー等の駆動において一
定速度で回転させることは困難で、現実には速度ムラ等
が生じ、書込みドツト位置にずれを生ずる。そこで、書
込みドツト間隔が一定となる良好なる光書込みを行うた
め、多数のスリットを有するリニアエンコーダを用いた
多点同期方式の光書込み装置が、例えば米国特許２，３
８９，４０３号明細書等により知られている。
源を画像情報に応じて変調し、かつ、ポリゴンミラー等
の偏向器で走査させて感光体等に光書込みを行うように
している。この時、ポリゴンミラー等の駆動において一
定速度で回転させることは困難で、現実には速度ムラ等
が生じ、書込みドツト位置にずれを生ずる。そこで、書
込みドツト間隔が一定となる良好なる光書込みを行うた
め、多数のスリットを有するリニアエンコーダを用いた
多点同期方式の光書込み装置が、例えば米国特許２，３
８９，４０３号明細書等により知られている。
ユニに、リニアエンコーダの製造を容易にする等の改良
を施したものとして、特開昭５４−９７０５０号公報に
示されるものがある。これは、リニアエンコーダより得
られる光電パルスをｎ逓倍してビデオクロック（画素ク
ロック）とするようにしたものである。具体的には、リ
ニアエンコーダによって得られる光電パルスをＰＬＬ回
路の位相比較器で基準パルスと比較し、両者が一致する
ように電圧制御発振器をフィードバック制御し、ＰＬＬ
回路からは光電パルスに同期し、かつ、ｎ逓倍されたク
ロック信号を半導体レーザを変調させる変調信号なる画
素クロックとして出力させるものである。この他、特開
昭５６−１４６３５９号公報、特開昭５８−１８１３６
２号公報等にも多点同期方式が示されている。
を施したものとして、特開昭５４−９７０５０号公報に
示されるものがある。これは、リニアエンコーダより得
られる光電パルスをｎ逓倍してビデオクロック（画素ク
ロック）とするようにしたものである。具体的には、リ
ニアエンコーダによって得られる光電パルスをＰＬＬ回
路の位相比較器で基準パルスと比較し、両者が一致する
ように電圧制御発振器をフィードバック制御し、ＰＬＬ
回路からは光電パルスに同期し、かつ、ｎ逓倍されたク
ロック信号を半導体レーザを変調させる変調信号なる画
素クロックとして出力させるものである。この他、特開
昭５６−１４６３５９号公報、特開昭５８−１８１３６
２号公報等にも多点同期方式が示されている。
発明が解決しようとする課題
ところが、このようにドツト位置精度を高めるための多
点同期方式にあっては、ＰＬＬ基準入力の高速化、ｖＣ
Ｏ発振周波数の高域化が困難であり、書込み時間が長く
なってしまうものである。
点同期方式にあっては、ＰＬＬ基準入力の高速化、ｖＣ
Ｏ発振周波数の高域化が困難であり、書込み時間が長く
なってしまうものである。
課題を解決するための手段
書込みビームの他に同期ビームを用い、この同期ビーム
に基づき主走査方向全域に渡って生成される基準パルス
と位相同期した画素クロックをＰＬＬ回路により発生さ
せ、この画素クロックに同期した画像情報により書込み
ビームを変調させて光書込みを行わせるようにした多点
同期方式の光書込み装置において、前記書込みビームを
複数本設け、これらの書込みビームに各々異なる画像情
報を割当てて変調する駆動制御回路を設けた。
に基づき主走査方向全域に渡って生成される基準パルス
と位相同期した画素クロックをＰＬＬ回路により発生さ
せ、この画素クロックに同期した画像情報により書込み
ビームを変調させて光書込みを行わせるようにした多点
同期方式の光書込み装置において、前記書込みビームを
複数本設け、これらの書込みビームに各々異なる画像情
報を割当てて変調する駆動制御回路を設けた。
特に、請求項２記載の発明では、各書込みビームの発光
点を結ぶ直線を主走査方向に平行でない方向に設定し、
各々の書込みビームに各々異なる主走査線分の画像情報
を割当てた。
点を結ぶ直線を主走査方向に平行でない方向に設定し、
各々の書込みビームに各々異なる主走査線分の画像情報
を割当てた。
作用
書込みビームが複数本で、各々異なる画像情報が割当て
られて変調されるので、複数ドツト分が同時に書込まれ
ることになり、多点同期方式による高ドツト位置精度性
を確保しつつ光書込み時間を短縮できる。
られて変調されるので、複数ドツト分が同時に書込まれ
ることになり、多点同期方式による高ドツト位置精度性
を確保しつつ光書込み時間を短縮できる。
特に、各書込みビームの発光点を結ぶ直線を主走査方向
に平行でない方向に設定し、各々の書込みビームに各々
異なる主走査線分の画像情報を割当てると、−度に複数
の主走査線分の光書込みが可能となり、かつ、その駆動
制御回路も主走査線単位で制御するものでよく、容易に
構成し得るものとなる。
に平行でない方向に設定し、各々の書込みビームに各々
異なる主走査線分の画像情報を割当てると、−度に複数
の主走査線分の光書込みが可能となり、かつ、その駆動
制御回路も主走査線単位で制御するものでよく、容易に
構成し得るものとなる。
実施例
本発明の一実施例を図面に基づいて説明する。
まず、本実施例の基本となる多点同期方式を用いた光書
込み装置の概要を第３図により説明する。
込み装置の概要を第３図により説明する。
この方式は、例えば前述した米国特許２，３８９゜４０
３号明細書等により知られており、これをベースとして
、特開昭５４−９７０５０号公報、特開昭６０−１０６
６７号公報等においても示されている。第２図によれば
、画像情報（Ｖ １ｄｅｏ信号）により変調されて書込
みビームＰ１ を射出する書込み用の半導体レーザ１
が設けられている。この半導体レーザ１から射出された
書込みビームＰはポリゴンミラー２の１面により偏向さ
れ、ｆθレンズ３を通った後、ミラー４により反射され
て記録媒体５上に結像され、主走査される。一方、約記
半導体レーザ１とは別に同期用に画素クロック生成用）
の半導体レーザ６が設けられている。
３号明細書等により知られており、これをベースとして
、特開昭５４−９７０５０号公報、特開昭６０−１０６
６７号公報等においても示されている。第２図によれば
、画像情報（Ｖ １ｄｅｏ信号）により変調されて書込
みビームＰ１ を射出する書込み用の半導体レーザ１
が設けられている。この半導体レーザ１から射出された
書込みビームＰはポリゴンミラー２の１面により偏向さ
れ、ｆθレンズ３を通った後、ミラー４により反射され
て記録媒体５上に結像され、主走査される。一方、約記
半導体レーザ１とは別に同期用に画素クロック生成用）
の半導体レーザ６が設けられている。
この半導体レーザ６がら射出された同期ビームＰ、は前
記ポリゴンミラー２の同一反射面上において書込みビー
ムＰ、に対しある間隔離れた位置（主走査方向では同一
位置）に入射され、書込みビームＰ、と同様にｆθレン
ズ３に入射する。ｆθレンズ３透過後は上下位置が異な
ることにより、同期ビームＰ、はミラー４上を通過し、
前記記録媒体５と光学的に等価な位置に設けたグレーテ
ィング７を走査する。このグレーティング７の透過部分
を透過した同期ビームＰ、はレンズアレイ８により複数
、例えば５個の受光素子９ａ〜９ｅに順次集光結像され
、これらの受光素子９ａ〜９ｅからパルス列が発生する
。このパルス列がＰＬＬ回路（図示せず）に入力され、
所定の処理が行なわれ、画素クロックが生成される。書
込みビームＰ１ はこの画素クロックに同期して変調さ
れる。
記ポリゴンミラー２の同一反射面上において書込みビー
ムＰ、に対しある間隔離れた位置（主走査方向では同一
位置）に入射され、書込みビームＰ、と同様にｆθレン
ズ３に入射する。ｆθレンズ３透過後は上下位置が異な
ることにより、同期ビームＰ、はミラー４上を通過し、
前記記録媒体５と光学的に等価な位置に設けたグレーテ
ィング７を走査する。このグレーティング７の透過部分
を透過した同期ビームＰ、はレンズアレイ８により複数
、例えば５個の受光素子９ａ〜９ｅに順次集光結像され
、これらの受光素子９ａ〜９ｅからパルス列が発生する
。このパルス列がＰＬＬ回路（図示せず）に入力され、
所定の処理が行なわれ、画素クロックが生成される。書
込みビームＰ１ はこの画素クロックに同期して変調さ
れる。
しかして、本実施例では、書込み用の前記半導体レーザ
１を同一チップ上に複数個、ここでは２個の発光点Ｂ、
、 Ｂ、を有するものとし、これらの発光点Ｂ、、 Ｂ
、から発せられる２つの書込みビームＰ Ｉ ｌ ｔ
Ｐ ｌ ｆｉを用いて書込みを行わせるようにしたもの
である。ここに、これらの書込みビームを一般論として
Ｐ＋＋＊ Ｐｏ５ｅ 〜Ｐ＋ｎ（ただし、ｎ≧２）とす
ると、これらの書込みビームＰ１．。
１を同一チップ上に複数個、ここでは２個の発光点Ｂ、
、 Ｂ、を有するものとし、これらの発光点Ｂ、、 Ｂ
、から発せられる２つの書込みビームＰ Ｉ ｌ ｔ
Ｐ ｌ ｆｉを用いて書込みを行わせるようにしたもの
である。ここに、これらの書込みビームを一般論として
Ｐ＋＋＊ Ｐｏ５ｅ 〜Ｐ＋ｎ（ただし、ｎ≧２）とす
ると、これらの書込みビームＰ１．。
Ｐｏｓ、〜Ｐ、ｎの発光点Ｂ 、 〜Ｂ ｎを結ぶ直線
りは、第２図に示すように、主走査方向（偏向方向）Ｓ
に平行しない状態に、ビーム間ピッチしにて、配置設定
されている。即ち、各書込みビームＰ１．。
りは、第２図に示すように、主走査方向（偏向方向）Ｓ
に平行しない状態に、ビーム間ピッチしにて、配置設定
されている。即ち、各書込みビームＰ１．。
Ｐｌ、、〜 Ｐ、ｎは同一主走査線上に配置されること
なく、複数の主走査線分をカバーし得るように配置され
ている。ここに、主走査方向に直交する方向の配列が最
も簡単（駆動制御系を含めて）となるが、図示例のよう
に斜め配列とすれば、副走査方向にオーバラップさせる
のが容易で、副走査方向の高密度化には好都合である。
なく、複数の主走査線分をカバーし得るように配置され
ている。ここに、主走査方向に直交する方向の配列が最
も簡単（駆動制御系を含めて）となるが、図示例のよう
に斜め配列とすれば、副走査方向にオーバラップさせる
のが容易で、副走査方向の高密度化には好都合である。
いま、２つの書込みビームｐ、、、ｐ、、を用いるもの
とすれば、その駆動制御回路１０は例えば第１図に示す
ように構成される。まず、画像情報りが入力される入力
端子１１にはバッファスイッチ１２により選択切換えさ
れる２つのラインバッファ１３ａ、１３ｂが接続されて
いる。ラインバッファ１３ａは半導体レーザ１中の発光
点Ｂ１ に対する駆動制御系１０ａを形成するもので、
ＲＡＭ１４ａ、ドライバ１５ａが順に接続されている。
とすれば、その駆動制御回路１０は例えば第１図に示す
ように構成される。まず、画像情報りが入力される入力
端子１１にはバッファスイッチ１２により選択切換えさ
れる２つのラインバッファ１３ａ、１３ｂが接続されて
いる。ラインバッファ１３ａは半導体レーザ１中の発光
点Ｂ１ に対する駆動制御系１０ａを形成するもので、
ＲＡＭ１４ａ、ドライバ１５ａが順に接続されている。
一方、ラインバッファ１３ｂは半導体レーザｌ中の発光
点１ｂに対する駆動制御系１０ｂを形成するもので、Ｒ
ＡＭ ｌ ４ ｂ、 ドライバ１５ｂが順に接続され
、かつ、ＲＡＭ １４ ｂ・ドライバ１５ｂ間には遅延
回路１６が介在されている。これらのバッファスイッチ
１２、ラインバッファ１３ａ。
点１ｂに対する駆動制御系１０ｂを形成するもので、Ｒ
ＡＭ ｌ ４ ｂ、 ドライバ１５ｂが順に接続され
、かつ、ＲＡＭ １４ ｂ・ドライバ１５ｂ間には遅延
回路１６が介在されている。これらのバッファスイッチ
１２、ラインバッファ１３ａ。
１３ｂ％ＲＡＭ１４ａ、１４ｂは制御回路１７により切
換え制御、動作制御される。この制御回路１７は画像デ
ータ有効幅信号Ｆ、 Ｇａｔｅ 、同期信号り、５ｙｎ
ｃ、１走査書込み幅信号り、Ｇａｔｅ、ＰＬＬ回路から
の画素クロックＷ、Ｃ１ｋの各々に対する入力端子１８
ａ〜１８ｄを有する。
換え制御、動作制御される。この制御回路１７は画像デ
ータ有効幅信号Ｆ、 Ｇａｔｅ 、同期信号り、５ｙｎ
ｃ、１走査書込み幅信号り、Ｇａｔｅ、ＰＬＬ回路から
の画素クロックＷ、Ｃ１ｋの各々に対する入力端子１８
ａ〜１８ｄを有する。
このような構成において、第４図のタイミングチャート
を参照して書込み動作を説明する。まず、画像データ有
効幅信号Ｆ、Ｇａｔｅが立上って、同期信号り、５ｙｎ
ｃが発生すると、ホスト（図示せず）からは２主走査線
分の画像データＤＩ、Ｄ２が、画素クロックＷ、Ｃ１ｋ
の倍のクロックで、各々シフトレジスタ等によるライン
バッファ１３ａ。
を参照して書込み動作を説明する。まず、画像データ有
効幅信号Ｆ、Ｇａｔｅが立上って、同期信号り、５ｙｎ
ｃが発生すると、ホスト（図示せず）からは２主走査線
分の画像データＤＩ、Ｄ２が、画素クロックＷ、Ｃ１ｋ
の倍のクロックで、各々シフトレジスタ等によるライン
バッファ１３ａ。
１３ｂに取込まれる。より詳細には、取込むための１走
査書込み幅信号り、Ｇａｔｅの半分のゲート信号Ｇ、Ｇ
ａｔｅを制御回路１７が生成し、ゲート信号Ｇ、Ｇａｔ
ｅのＨレベル期間中は１主走査線分の画像データＤＩを
ラインバッファ１３ａ側に取込み、ゲート信号Ｇ、Ｇａ
ｔ６がＬレベルになるタイミングでバッファスイッチ１
２を切換えて、残りの１主走査線分の画像データＤ２を
ラインバッファ１３ｂ側に取込むように動作する。■走
査書込み幅信号り、 Ｇａｔｅ ７’ｌ＜Ｌレベルにな
ると、制御回路１７は、各々ラインバッファ１３ａ、１
３ｂに取込んだ画像データＤＩ、Ｄ２を、内蔵のライト
カウンタ、アドレスデコーダに従い、ｌ主走査線分のデ
ータ数に等しいビットを有するＲＡＭ １４ａ、１４ｂ
に蓄積する。データ蓄積後、次の同期信号り、、５ｙｎ
ｃが発生すると、ホストから転送される画像データは後
続する２主走査線分の画像データＤ３．Ｄ４となり、画
素クロックＶｔ１’、Ｃ１にの倍のクロックで、各々ラ
インバッファ１３ａ。
査書込み幅信号り、Ｇａｔｅの半分のゲート信号Ｇ、Ｇ
ａｔｅを制御回路１７が生成し、ゲート信号Ｇ、Ｇａｔ
ｅのＨレベル期間中は１主走査線分の画像データＤＩを
ラインバッファ１３ａ側に取込み、ゲート信号Ｇ、Ｇａ
ｔ６がＬレベルになるタイミングでバッファスイッチ１
２を切換えて、残りの１主走査線分の画像データＤ２を
ラインバッファ１３ｂ側に取込むように動作する。■走
査書込み幅信号り、 Ｇａｔｅ ７’ｌ＜Ｌレベルにな
ると、制御回路１７は、各々ラインバッファ１３ａ、１
３ｂに取込んだ画像データＤＩ、Ｄ２を、内蔵のライト
カウンタ、アドレスデコーダに従い、ｌ主走査線分のデ
ータ数に等しいビットを有するＲＡＭ １４ａ、１４ｂ
に蓄積する。データ蓄積後、次の同期信号り、、５ｙｎ
ｃが発生すると、ホストから転送される画像データは後
続する２主走査線分の画像データＤ３．Ｄ４となり、画
素クロックＶｔ１’、Ｃ１にの倍のクロックで、各々ラ
インバッファ１３ａ。
１３ｂへの取込みが開始される。先行するラインバッフ
ァ１３ａへのデータ取込みが開始されると、制御回路１
７に内蔵のリードカウンタ、アドレスデコーダの内容に
従い、画素クロックＷ、Ｃ１ｋに同期してＲＡＭＩ ４
ａ、１４ ｂから２主走査線分の画像データＤｉ、Ｄ
２が同時に読出される。読出された一方の画像データＤ
１は、そのまま信号ＳＤ＋とじてドライバ１５ａに出力
され発光点Ｂ。
ァ１３ａへのデータ取込みが開始されると、制御回路１
７に内蔵のリードカウンタ、アドレスデコーダの内容に
従い、画素クロックＷ、Ｃ１ｋに同期してＲＡＭＩ ４
ａ、１４ ｂから２主走査線分の画像データＤｉ、Ｄ
２が同時に読出される。読出された一方の画像データＤ
１は、そのまま信号ＳＤ＋とじてドライバ１５ａに出力
され発光点Ｂ。
の変調に供され変調された書込みビームＰ、、が出力さ
れる。他方の画像データＤ２は、両書込みビームｐ＋＋
Ｐ、１間のピッチ間しに相当する時間だけ遅延回路１６
により遅延されて信号ＳＤ、としてドライバ１５ｂに出
力され、発光点Ｂ、の変調に供され変調された書込みビ
ームＰ ｌ ｍが出力される。
れる。他方の画像データＤ２は、両書込みビームｐ＋＋
Ｐ、１間のピッチ間しに相当する時間だけ遅延回路１６
により遅延されて信号ＳＤ、としてドライバ１５ｂに出
力され、発光点Ｂ、の変調に供され変調された書込みビ
ームＰ ｌ ｍが出力される。
ＲＡＭ１４ａ、１４ｂからの画像データＤＩ、Ｄ２の読
出しが終了し、１走査書込み幅信号り、Ｇａｔｅが立下
ると（実際、信号り、Ｇａｔｅのゲート期間は画像デー
タ時間よりも長い）、制御回路１７は、各々ラインバッ
ファ１３ａ、１３ｂに取込んだ画像データＤ３．Ｄ４を
ＲＡＭ１４ａ、１４ｂに蓄積する。以下、同様に動作す
る。
出しが終了し、１走査書込み幅信号り、Ｇａｔｅが立下
ると（実際、信号り、Ｇａｔｅのゲート期間は画像デー
タ時間よりも長い）、制御回路１７は、各々ラインバッ
ファ１３ａ、１３ｂに取込んだ画像データＤ３．Ｄ４を
ＲＡＭ１４ａ、１４ｂに蓄積する。以下、同様に動作す
る。
このように、本実施例によれば、副走査方向にずれてい
る２つの書込みビームＰ Ｉｌｊ ｐ＋＊を用いるので
、画像データの入力に対して書込みが１周期遅れるもの
の、２主走査線単位で同時書込みが行われることになり
、高精度な書込みを維持しつつ、書込み時間を短縮でき
るものとなる。
る２つの書込みビームＰ Ｉｌｊ ｐ＋＊を用いるので
、画像データの入力に対して書込みが１周期遅れるもの
の、２主走査線単位で同時書込みが行われることになり
、高精度な書込みを維持しつつ、書込み時間を短縮でき
るものとなる。
発明の効果
本発明は、上述したように多点同期方式の光書込み装置
において、書込みビームを複数本とし、これらの書込み
ビームに駆動制御回路により各々異なる画像情報を割当
てて変調し、光書込みを行わせるようにしたので、複数
ドツト分を同時に書込み得ることになり、多点同期方式
による高ドツト位置精度性を確保しつつ光書込み時間を
短縮でき、特に、請求項２記載の発明のように、各書込
みビームの発光点を結ぶ直線を主走査方向に平行でない
方向に設定し、各々の書込みビームに各々興なる主走査
線分の画像情報を割当てれば、−度に複数の主走査線分
の光書込みが可能となり、かつ、その駆動制御回路も主
走査線単位で制御するものでよく、容易に構成できるも
のとなる。
において、書込みビームを複数本とし、これらの書込み
ビームに駆動制御回路により各々異なる画像情報を割当
てて変調し、光書込みを行わせるようにしたので、複数
ドツト分を同時に書込み得ることになり、多点同期方式
による高ドツト位置精度性を確保しつつ光書込み時間を
短縮でき、特に、請求項２記載の発明のように、各書込
みビームの発光点を結ぶ直線を主走査方向に平行でない
方向に設定し、各々の書込みビームに各々興なる主走査
線分の画像情報を割当てれば、−度に複数の主走査線分
の光書込みが可能となり、かつ、その駆動制御回路も主
走査線単位で制御するものでよく、容易に構成できるも
のとなる。
図面は本発明の一実施例を示すもので、第１図は駆動制
御系のブロック図、第２図は全体構成を示す概略斜視図
、第３図は複数本の書込みビームの位置関係を示す説明
図、第４図はその動作を示すタイミングチャートである
。 Ｏ・・・駆動制御回路、 Ｂ。 ・・・発光点、 Ｐｌｌ・・・書込みビーム、 Ｐ。 ・・・同期ビーム、 Ｗ、Ｃ１ｋ・・・画素クロック 出 願 人 株式会社 リ コ 」 図
御系のブロック図、第２図は全体構成を示す概略斜視図
、第３図は複数本の書込みビームの位置関係を示す説明
図、第４図はその動作を示すタイミングチャートである
。 Ｏ・・・駆動制御回路、 Ｂ。 ・・・発光点、 Ｐｌｌ・・・書込みビーム、 Ｐ。 ・・・同期ビーム、 Ｗ、Ｃ１ｋ・・・画素クロック 出 願 人 株式会社 リ コ 」 図
Claims (1)
- 【特許請求の範囲】 １、書込みビームの他に同期ビームを用い、この同期ビ
ームに基づき主走査方向全域に渡って生成される基準パ
ルスと位相同期した画素クロックをＰＬＬ回路により発
生させ、この画素クロックに同期した画像情報により書
込みビームを変調させて光書込みを行わせるようにした
多点同期方式の光書込み装置において、前記書込みビー
ムを複数本設け、これらの書込みビームに各々異なる画
像情報を割当てて変調する駆動制御回路を設けたことを
特徴とする光書込み装置。 ２、各書込みビームの発光点を結ぶ直線を主走査方向に
平行でない方向に設定し、各々の書込みビームに各々異
なる主走査線分の画像情報を割当てたことを特徴とする
請求項１記載の光書込み装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2123923A JP3029638B2 (ja) | 1990-05-14 | 1990-05-14 | 光書込み装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2123923A JP3029638B2 (ja) | 1990-05-14 | 1990-05-14 | 光書込み装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0420066A true JPH0420066A (ja) | 1992-01-23 |
| JP3029638B2 JP3029638B2 (ja) | 2000-04-04 |
Family
ID=14872689
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2123923A Expired - Fee Related JP3029638B2 (ja) | 1990-05-14 | 1990-05-14 | 光書込み装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3029638B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2011143591A (ja) * | 2010-01-13 | 2011-07-28 | Seiko Epson Corp | 画像形成装置 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2016088048A (ja) | 2014-11-11 | 2016-05-23 | コニカミノルタ株式会社 | 光書込み装置および画像形成装置 |
-
1990
- 1990-05-14 JP JP2123923A patent/JP3029638B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2011143591A (ja) * | 2010-01-13 | 2011-07-28 | Seiko Epson Corp | 画像形成装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3029638B2 (ja) | 2000-04-04 |
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