JPH04172534A - 情報処理装置 - Google Patents
情報処理装置Info
- Publication number
- JPH04172534A JPH04172534A JP30159490A JP30159490A JPH04172534A JP H04172534 A JPH04172534 A JP H04172534A JP 30159490 A JP30159490 A JP 30159490A JP 30159490 A JP30159490 A JP 30159490A JP H04172534 A JPH04172534 A JP H04172534A
- Authority
- JP
- Japan
- Prior art keywords
- software
- spare
- storage means
- section
- main cpu
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000010365 information processing Effects 0.000 claims description 11
- 230000004044 response Effects 0.000 claims description 4
- 238000000034 method Methods 0.000 description 7
- 238000010586 diagram Methods 0.000 description 2
- 230000006870 function Effects 0.000 description 1
Landscapes
- Stored Programmes (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は情報処理装置に関し、特に装置のソフトウェア
の更新に関する。
の更新に関する。
従来技術
従来、情報処理装置に対するアプリケーションソフトウ
ェアの更新方法としては、装置内に実装されているソフ
トウェアの書込まれたROMを他のROMと交換する方
法が主であった。また、装置を非運用状態としてソフト
ウェアの更新処理に専有させ、外部よりダウンロードを
行うという方式もあった。
ェアの更新方法としては、装置内に実装されているソフ
トウェアの書込まれたROMを他のROMと交換する方
法が主であった。また、装置を非運用状態としてソフト
ウェアの更新処理に専有させ、外部よりダウンロードを
行うという方式もあった。
しかし、上述した従来の情報処理装置におけるソフトウ
ェアの更新方法では、更新中は電源を断とするか又は非
運用状態とする必要があり、その装置が備えていた機能
の提供を一時的に停止しなければならなかった。このこ
とは、高信頼性及びリアルタイム処理を要求される装置
においては大きな欠点であった。
ェアの更新方法では、更新中は電源を断とするか又は非
運用状態とする必要があり、その装置が備えていた機能
の提供を一時的に停止しなければならなかった。このこ
とは、高信頼性及びリアルタイム処理を要求される装置
においては大きな欠点であった。
発明の目的
本発明は上述した従来の欠点を解決するためになされた
ものであり、その目的は電源を断とせず、かつ非運用状
態とすることなくソフトウェアの更新を可能とする情報
処理装置を提供することである。
ものであり、その目的は電源を断とせず、かつ非運用状
態とすることなくソフトウェアの更新を可能とする情報
処理装置を提供することである。
発明の構成
本発明による情報処理装置は、ソフトウェアのロードが
外部よりなされる情報処理装置であって、現用及び予備
の記憶手段と、前記予備の記憶手段内に前記ソフトウェ
アをロードする手段と、このロードの完了に応答して前
記現用の記憶手段と予備の記憶手段とを切替える手段と
を有することを特徴とする。
外部よりなされる情報処理装置であって、現用及び予備
の記憶手段と、前記予備の記憶手段内に前記ソフトウェ
アをロードする手段と、このロードの完了に応答して前
記現用の記憶手段と予備の記憶手段とを切替える手段と
を有することを特徴とする。
実施例
次に、本発明について図面を参照して説明する。
第1図は本発明による情報処理装置の一実施例の構成を
示すブロック図である。図において、本発明の一実施例
による情報処理装置100は、外部記憶200内のソフ
トウェアがダウンロードされるものであり、運用系20
及び予備系30を有する二重化構成となっている。なお
、外部記憶には、フロッピディスク装置(FDD)又は
ハードディスク装置(HDD)を用いれば良い。
示すブロック図である。図において、本発明の一実施例
による情報処理装置100は、外部記憶200内のソフ
トウェアがダウンロードされるものであり、運用系20
及び予備系30を有する二重化構成となっている。なお
、外部記憶には、フロッピディスク装置(FDD)又は
ハードディスク装置(HDD)を用いれば良い。
そして、本実施例においては、運用系20により運用状
態を確保するとともに、ソフトウェアのダウンロードの
際には予備系30にロードし、そのロード後に運用系と
予備系とを切替える構成となっている。
態を確保するとともに、ソフトウェアのダウンロードの
際には予備系30にロードし、そのロード後に運用系と
予備系とを切替える構成となっている。
まず、運用系20は、各部の制御を行う主CPU部21
と、各種データを記憶するグローバルメモリ25と、外
部記憶200に対してアクセスを行う外部記憶アクセス
部27と、外部インタフェース部26とを含んで構成さ
れている。さらに、主CPU部21内にはプロクラムが
書込まれたROM2Bと、プログラム保持用のRA M
24と、CPU22とが含まれている。
と、各種データを記憶するグローバルメモリ25と、外
部記憶200に対してアクセスを行う外部記憶アクセス
部27と、外部インタフェース部26とを含んで構成さ
れている。さらに、主CPU部21内にはプロクラムが
書込まれたROM2Bと、プログラム保持用のRA M
24と、CPU22とが含まれている。
一方、予備系30も運用系20と同様に、主CPU部3
1と、グローバルメモリ35と、外部記憶アクセス部3
7と、外部インタフェース部36とを含んで構成されて
いる。また、主CPU部31も主CPU部21と同様に
ROM33と、RAM34と、CPU’32とを含んで
いる。
1と、グローバルメモリ35と、外部記憶アクセス部3
7と、外部インタフェース部36とを含んで構成されて
いる。また、主CPU部31も主CPU部21と同様に
ROM33と、RAM34と、CPU’32とを含んで
いる。
なお、10はシステム管理部であり、バスの使用権の設
定、運用系と予備系との切替え処理等を行うものである
。
定、運用系と予備系との切替え処理等を行うものである
。
かかる構成において、通常状態においては、運用系20
のシステムにより、各種の動作が行われる。
のシステムにより、各種の動作が行われる。
ソフトウェアのダウンローFを実行する際は、まず運用
系20の主CPU部21からシステム管理部10へ要求
を行う。これに応答し、システム管理部10は予備系3
0の主CPU部31と外部記憶アクセス部37とに予備
系バスの使用権を設定し、ソフトウェアの外部記憶20
0からのダウンロートの指示を行う。
系20の主CPU部21からシステム管理部10へ要求
を行う。これに応答し、システム管理部10は予備系3
0の主CPU部31と外部記憶アクセス部37とに予備
系バスの使用権を設定し、ソフトウェアの外部記憶20
0からのダウンロートの指示を行う。
ダウンロード処理は、予備系の主CPU部31内にある
ROM33に書込まれたプログラムにより行われる。す
なわち、外、部記憶アクセス部37から主CPU部31
のプログラム保持用メモリのRAM34へ予備系バスを
使用して書込み処理が行われるのである。
ROM33に書込まれたプログラムにより行われる。す
なわち、外、部記憶アクセス部37から主CPU部31
のプログラム保持用メモリのRAM34へ予備系バスを
使用して書込み処理が行われるのである。
全てのダウンロード処理が終了したとき、予備系の主C
PU部3.1からシステム管理部10へ終了メツセージ
を通知する。このことに応答してシステム管理部10は
運用系20と予備系30との切替えを行い、新たにダウ
ンロードされたソフトウェアを有する予備系30を新た
な運用系として指定する。そして、予備系に切替えられ
た元の運用系20に対し、システム管理部10は先程と
同様にソフトウェアのダウンロード処理を実行させる。
PU部3.1からシステム管理部10へ終了メツセージ
を通知する。このことに応答してシステム管理部10は
運用系20と予備系30との切替えを行い、新たにダウ
ンロードされたソフトウェアを有する予備系30を新た
な運用系として指定する。そして、予備系に切替えられ
た元の運用系20に対し、システム管理部10は先程と
同様にソフトウェアのダウンロード処理を実行させる。
その後、さらにソフトウェアのダウンロード処理を行う
場合も同様の手順で処理される。
場合も同様の手順で処理される。
なお、本実施例では、外部記憶として装置の外にFDD
又はHDDの記憶媒体か設けられている場合を示したが
、外部記憶200が装置100内に存在しても同様の動
作となる。
又はHDDの記憶媒体か設けられている場合を示したが
、外部記憶200が装置100内に存在しても同様の動
作となる。
また、外部記憶の代りに通信回線により遠隔からのデー
タ転送でソフトウェアのダウンロートを行う場合も同様
の構成により実現し得ることは明らかである。
タ転送でソフトウェアのダウンロートを行う場合も同様
の構成により実現し得ることは明らかである。
さらにまた、本発明がソフトウェアを有する各種の装置
に広く適用できることは明らかである。
に広く適用できることは明らかである。
発明の詳細
な説明したように本発明は、二重化された構成を用いる
ことにより運用状態に影響を与えることなくア、ブリケ
ーションソフトウエアの更新ができるという効果がある
。
ことにより運用状態に影響を与えることなくア、ブリケ
ーションソフトウエアの更新ができるという効果がある
。
第1図は本発明の実施例による情報処理装置の構成を示
すブロック図である。 主要部分の符号の説明 10・・・・・システム管理部 20・・・・・運用系 30・・・・・予備系 200・・・・外部記憶
すブロック図である。 主要部分の符号の説明 10・・・・・システム管理部 20・・・・・運用系 30・・・・・予備系 200・・・・外部記憶
Claims (1)
- (1)ソフトウェアのロードが外部よりなされる情報処
理装置であって、現用及び予備の記憶手段と、前記予備
の記憶手段内に前記ソフトウェアをロードする手段と、
このロードの完了に応答して前記現用の記憶手段と予備
の記憶手段とを切替える手段とを有することを特徴とす
る情報処理装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30159490A JPH04172534A (ja) | 1990-11-07 | 1990-11-07 | 情報処理装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30159490A JPH04172534A (ja) | 1990-11-07 | 1990-11-07 | 情報処理装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04172534A true JPH04172534A (ja) | 1992-06-19 |
Family
ID=17898830
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP30159490A Pending JPH04172534A (ja) | 1990-11-07 | 1990-11-07 | 情報処理装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04172534A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010181922A (ja) * | 2009-02-03 | 2010-08-19 | Nec Corp | プロセッサ周辺回路 |
JP2016173636A (ja) * | 2015-03-16 | 2016-09-29 | 日本電気株式会社 | ファームウェア更新方法および二重化システム |
-
1990
- 1990-11-07 JP JP30159490A patent/JPH04172534A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010181922A (ja) * | 2009-02-03 | 2010-08-19 | Nec Corp | プロセッサ周辺回路 |
JP2016173636A (ja) * | 2015-03-16 | 2016-09-29 | 日本電気株式会社 | ファームウェア更新方法および二重化システム |
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