JPH04105774U - ピークacl回路 - Google Patents
ピークacl回路Info
- Publication number
- JPH04105774U JPH04105774U JP1476491U JP1476491U JPH04105774U JP H04105774 U JPH04105774 U JP H04105774U JP 1476491 U JP1476491 U JP 1476491U JP 1476491 U JP1476491 U JP 1476491U JP H04105774 U JPH04105774 U JP H04105774U
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- JP
- Japan
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- transistor
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims abstract description 12
- 230000006866 deterioration Effects 0.000 abstract description 4
- 230000007257 malfunction Effects 0.000 abstract description 4
- 238000010586 diagram Methods 0.000 description 6
- 239000003990 capacitor Substances 0.000 description 1
Landscapes
- Television Receiver Circuits (AREA)
Abstract
(57)【要約】
【目的】 カラーテレビ受信機におけるCRT(ブラウ
ン管)上の白ピーク信号飽和による画質劣化を防止する
ピークACL回路に関し、自動白バランス調整用として
の基準パルスの影響による誤動作を防止することを目的
とする。 【構成】 トランジスタのベースに自動白バランス調整
用の基準パルスと白ピーク検出電圧とが交互に繰り返さ
れてなる入力信号が供給されるエミッタ接地式ピークA
CL回路のベース回路において、一端に該入力信号が供
給された抵抗の他端を該ベースに接続し、該ベースにア
ノードが接続されたダイオードのカソードを第1のトラ
ンジスタのコレクタに接続し、該第1のトランジスタの
エミッタをアースしベースに制御信号を供給する。
ン管)上の白ピーク信号飽和による画質劣化を防止する
ピークACL回路に関し、自動白バランス調整用として
の基準パルスの影響による誤動作を防止することを目的
とする。 【構成】 トランジスタのベースに自動白バランス調整
用の基準パルスと白ピーク検出電圧とが交互に繰り返さ
れてなる入力信号が供給されるエミッタ接地式ピークA
CL回路のベース回路において、一端に該入力信号が供
給された抵抗の他端を該ベースに接続し、該ベースにア
ノードが接続されたダイオードのカソードを第1のトラ
ンジスタのコレクタに接続し、該第1のトランジスタの
エミッタをアースしベースに制御信号を供給する。
Description
【0001】
本考案は、カラーテレビ受信機におけるCRT(ブラウン管)上の白ピーク信
号飽和による画質劣化を防止するピークACL回路に関する。
【0002】
従来のピークACL(AUTOMATIC CONTRAST LIMITTER )回路を図2に基づき説
明する。図2(A)において、1は赤映像出力回路、2および3はそれぞれ緑映
像出力回路および青映像出力回路であるが回路構成は1と同一であるので省略し
てある。a乃至cは各映像出力回路の映像信号入力端子、d乃至fはCRT4の
カソード電流を検出抵抗(R1等)より電圧として赤青緑ごとに取り出す出力端子
、4はCRT(ブラウン管)、TR2は白ピーク検出用トランジスタ、R2は白ピー
ク検出用抵抗、TR3およびTR4はピークACL回路トランジスタ、5はピークA
CL回路出力端子である。図2(B)は図2(A)の主要ポイントの信号波形を
示したものである。
次に、当回路の動作を赤映像出力回路を例に説明する。入力端子aには図2(
B)に示すように基準パルスと映像信号からなる信号が入力される。基準パルス
は自動白バランス調整に供する信号であり低輝度の白バランス調整用として1個
または2個(本例はT1とT2の2個)および高輝度の白バランス調整用として1個
または2個(本例はT3とT4の2個)からなり垂直ブランキング信号の数H(H:
水平周期)後に付加される。aに示す信号は出力回路1で増幅後CRT4の赤カ
ソードへ加えられカソード電流が流れ検出抵抗R1に該カソード電流に比例した電
圧(d)が発生する。自動白バランス調整はd、e、fのT1乃至T4の各色ごとの
振幅偏差を検出信号として別途設けてなる自動白バランス調整回路によりCRT
4のカソード電圧を制御し低輝度および高輝度の白バランスを常に一定の色温度
に保つものである。一方入力a、b、cによる各出力回路のTR1等の各エミッタ
電圧は白ピーク検出用トランジスタTR2のエミッタへ供給される。TR2はベース
抵抗R3およびR4で固定バイアスがかけられエミッタ電圧が該固定バイアスより高
いときのみエミッタ電流が流れ白ピーク検出抵抗R2にgに示す電圧を発生する。
この電圧の尖頭値が白ピークを表しa、b、cにおける白ピーク信号に応じてそ
の尖頭値が変化する。但し、gに示す電圧には映像信号の他に上記基準パルスも
含まれている。該白ピーク電圧はピークACL回路のTR3で増幅後TR4で低イン
ピーダンス化するとともにコンデンサC1で平滑しR5を経てACL制御電圧として
出力し別途設けられてなるコントラスト調整回路を制御しCRTの白ピーク飽和
(俗に白つぶれ、またはブルーミングと称す)による画質劣化を防止する。
【0003】
前記説明のように白ピーク検出抵抗R2の電圧中には映像信号の他に前記基準パ
ルスが含まれているので該基準パルスの方が映像信号より大きい場合は該基準パ
ルスを白ピーク信号とみなしピークACL回路が誤動作を起こす。
本考案は、自動白バランス調整機能の維持を前提に上記誤動作を防止するピー
クACL回路を提供することを目的とする。
【0004】
本考案は、トランジスタのベースに自動白バランス調整用の基準パルスと白ピ
ーク検出電圧とが交互に繰り返されてなる入力信号が供給されるエミッタ接地式
ピークACL回路のベース回路において、一端に該入力信号が供給された抵抗の
他端を該ベースに接続し、該ベースにアノードが接続されたダイオードのカソー
ドを第1のトランジスタのコレクタに接続し、該第1のトランジスタのエミッタ
をアースしベースに制御信号を供給したピークACL回路を提供するものである
。
【0005】
ピークACL回路のベース側にダイオードおよびトランジスタ等からなるスイ
ッチ回路を追加し前記基準パルスと位相の一致した制御信号をもって該トランジ
スタを制御して前記基準パルスを除去する。
【0006】
以下、図面に基づいて本考案によるピークACL回路を説明する。
図1(A)は本考案によるピークACL回路の一実施例を示す要部回路図であ
る。図において、図2と同一符号は図2の説明と同様であり、TR5はスイッチン
グ用トランジスタ、D1はダイオード、R6およびR7は抵抗である。また、図2(B
)は主要ポイントの信号波形図である。
【0007】
次に、本考案の動作について説明する。TR5のベースにはR7を介してhに示す
制御信号が供給され該供給時TR5はオンする。該制御信号は垂直ブランキング信
号を遅延(約4H)させることにより得ている。gに示す信号中の基準パルスと
制御信号(h)との位相は一致させてあるのでTR5のオンによりD1を経て基準パ
ルスはアースされ殆ど除去される。制御信号がないときはTR5はオフであるので
映像信号は減衰することなくピークACL回路トランジスタTR3のベースへ供給
される。TR3のベースの信号波形をiに示す。尚、R6を設けた理由はTR5のスイ
ッチ作用によるTR2への影響を少なくするとともに該基準パルスの除去を十分に
行うためである。また、D1は制御信号(h)のTR2、TR3への逆流を防止するた
めである。その他の動作は図2における説明と同様である。
上記説明はTR5にNPNタイプのトランジスタを使用した場合であるがPNP
タイプのトランジスタでも同様の効果が得られる。但し、この場合エミッタをD1
のカソード側に接続しコレクタをアースする。さらに制御信号の極性はhを反転
したものが必要となる。
【0008】
以上説明したように本考案によれば、自動白バランス調整機能上欠かすことの
できない基準パルスの影響によるピークACL回路の誤動作を防止し動作を安定
化するので白ピーク飽和による画質劣化を改善する効果を奏し、大なる利点を有
する。
【図1】本考案によるピークACL回路の一実施例を示
す要部回路図(A)および信号波形図(B)である。
す要部回路図(A)および信号波形図(B)である。
【図2】従来のピークACL回路の一実施例を示す要部
回路図(A)および信号波形図(B)である。
回路図(A)および信号波形図(B)である。
1 赤映像出力回路
2 緑映像出力回路
3 青映像出力回路
4 CRT(ブラウン管)
5 ピークACL回路出力端子
Claims (2)
- 【請求項1】 トランジスタのベースに自動白バランス
調整用の基準パルスと白ピーク検出電圧とが交互に繰り
返されてなる入力信号が供給されるエミッタ接地式ピー
クACL回路のベース回路において、一端に該入力信号
が供給された抵抗の他端を該ベースに接続し、該ベース
にアノードが接続されたダイオードのカソードを第1の
トランジスタのコレクタに接続し、該第1のトランジス
タのエミッタをアースしベースに制御信号を供給したこ
とを特徴とするピークACL回路。 - 【請求項2】 前記第1のトランジスタにおいて、エミ
ッタが前記ダイオードのカソードに接続され、コレクタ
がアースされ、ベースに前記垂直ブランキング信号を反
転した信号を供給したことを特徴とする請求項1記載の
ピークACL回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1476491U JPH04105774U (ja) | 1991-02-21 | 1991-02-21 | ピークacl回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1476491U JPH04105774U (ja) | 1991-02-21 | 1991-02-21 | ピークacl回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04105774U true JPH04105774U (ja) | 1992-09-11 |
Family
ID=31902160
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1476491U Pending JPH04105774U (ja) | 1991-02-21 | 1991-02-21 | ピークacl回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04105774U (ja) |
-
1991
- 1991-02-21 JP JP1476491U patent/JPH04105774U/ja active Pending
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