JPH0342980A - 時間軸圧縮方式映像信号再生装置 - Google Patents

時間軸圧縮方式映像信号再生装置

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JPH0342980A
JPH0342980A JP1177586A JP17758689A JPH0342980A JP H0342980 A JPH0342980 A JP H0342980A JP 1177586 A JP1177586 A JP 1177586A JP 17758689 A JP17758689 A JP 17758689A JP H0342980 A JPH0342980 A JP H0342980A
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JP
Japan
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signal
time
circuit
memory
video signal
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JP1177586A
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English (en)
Inventor
Teruyoshi Komuro
輝芳 小室
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Sony Corp
Original Assignee
Sony Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 以下の順序で本発明を説明する。
A、産業上の利用分野 B1発明の概要 C1従来の技術 り1発明が解決しようとする課題 81課題を解決するための手段 19作用 G、実施例 G1実施例の構成(第1図、第2図) Gt、実施例の動作と作用(第3図) B1発明の効果 A、産業上の利用分野 本発明は、時間軸圧縮方式で記録した映像信号を再生す
る際に、垂直同期ジッターを吸収する時間軸圧縮方式映
像信号再生装置に関するものである。
B0発明の概要 本発明は、メモリに時間軸圧縮映像信号データを書き込
み、これを読み出す際にその時間軸を復元する時間軸圧
縮方式映像信号再生装置において、メモリへの書き込み
から時間軸圧縮映像信号の垂直同期信号までの水平走査
区間をカウントし、このカウント値を用いてメモリの読
み出しのタイミングを補正することで、復元した垂直同
期信号が正しく垂直走査区間に入るようにすることによ
り、 ドラムジッターによる垂直同期ジッターを吸収できるよ
うにしたものである。
C1従来の技術 従来より、VRT (ビデオテープレコーダ)などの分
野において、時間軸を圧縮して映像信号を記録・再生す
る方式が提案されている。このような時間軸圧縮方式で
記録された映像信号を再生する際に元の時間軸に復元す
る方法は、再生した時間軸圧縮映像信号を一旦ディジタ
ル化してメモリに書き込み、それを読み出す際の読み出
しの速度を遅くすることで行うことができる。
D9発明が解決しようとする課題 しかしながら、上記従来の技術における時間軸圧縮映像
信号の時間軸の復元方法では、ドラムジッターによるV
(垂直同期)ジッターが発生する問題が予想される。即
ち、再生された時間軸圧縮信号のメモリへの書き込みは
ヘッドの切り換信号であるスイッチングパルスに同期し
て開始されることになるが、このスイッチングパルスは
ドラムのPG(パルスジェネレータ)を遅延させて作成
するため、ドラムジッターがあると再生される時間軸圧
縮映像信号との関係において、H(水平走査)区間を越
えてしまう場合があり、その場合には少なくともIHず
れて時間軸圧縮映像信号がメモリへ書き込まれることに
なって、画面上では■ジッターとなってしまう。
本発明は、上記問題点を解決するために創案されたもの
で、ドラムジッターによるVジッターを吸収する時間軸
圧縮方式映像信号再生装置を提供することを目的とする
81課題を解決するための手段 上記の目的を達成するための本発明の時間軸圧縮方式映
像信号再生装置の構成は、 時間軸圧縮方式で記録した時間軸圧縮映像信号を再生し
てメモリへ順に書き込み、該メモリを順に読み出す際に
時間軸を復元する時間軸圧縮方式映像信号再生装置にお
いて、 上記メモリへの書き込みから時間軸圧縮映像信号の垂直
同期信号までの水平走査区間数をカウントするカウント
手段と、 このカウント手段のカウント値に基づいて上記メモリの
読み出しの終了時期を補正して上記メモリに書き込んだ
先頭のデータから読み出しを開始する手段とを有するこ
とを特徴とする。
19作用 本発明は、時間軸圧縮映像信号の垂直同期信号の前に時
間軸圧縮映像信号の重複部分を付加して、この部分のH
(水平走査)区間をメモリへの書き込みから時間軸圧縮
映像信号の垂直同期信号までカウントし、このカウント
値を用いてメモリの読み出しの終了時期を浦正し、上記
重複部分からの読み出しを連続させる。これによって復
元した垂直同期信号が正しくv区間に入るようにし、ド
ラムジッターによるVジッターを吸収する。
G、実施例 以下、本発明の実施例を図面に基づいて詳細に説明する
G1実施例の構成(第1図、第2図) 第1図は本発明の一実施例を示すブロック図である。本
実施例は、磁気テープ等に、時系列的に並んだ輝度信号
と色差線順次のクロマ信号とが時間軸圧縮方式で記録さ
れている映像信号を再生する場合を例とする。本実施例
の時間軸圧縮方式の映像信号再生装置は、図略の磁気テ
ープから記録信号を再生する磁気ヘッド1と、磁気ヘッ
ド1で再生した時間軸圧縮映像信号を復調し同期分離等
を行う第1のアナログ部2と、復調された時間軸圧縮映
像信号を後記のサンプリングクロック信号より作成した
サンプリングパルスで取り込みその時間軸を正規の時間
軸に伸張・復元するディジタルメモリ部3と、ディジタ
ルメモリ部3で必要とする時間軸圧縮信号のサンプリン
グクロック信号を再生された映像信号のパイロットバー
スト信号に同期して生成するインジェクション部4と、
時間軸が伸張・復元された映像信号を輝度信号Y。υ7
と色差信号R−Y、B−Yに分離して出力する第2のア
ナログ部5とを有する。
第1のアナログ部2において、21は磁気ヘッドlから
の再生信号を増幅するヘッドアンプ、22はヘッドアン
プ21の再生信号を復調する復調回路である。磁気テー
プの記録信号はFM復調の三角ノイズ低減のためにプリ
エンファシスされて記録されているので、復調後の再生
信号は、デイエンファシス回路23を通してデイエンフ
ァシスをかけ、高域信号成分のS/Nを改善する。デイ
エンファシス回路23から出力される再生された時間軸
圧縮映像信号の帯域が例えば7 M Hz前後である場
合、8MHzのローパスフィルタを通してクランプ回路
25に送出し、このクランプ回路25によりその信号レ
ベルをA/D (アナログ/ディジタル)変換の変換レ
ベル範囲に適合するようにクランプしてディジタルメモ
リ部3へ送出する。また、デイエンファシス回路23か
らの出力は、シンクセパレータ(同期分離回路)26と
インジェクション部4に送出し、シンクセパレータ26
で分離された水平同期信号Hと垂直同期信号Vはインジ
ェクション部4やディジタルメモリ部3へ送出する。
ディジタルメモリ部3において、31は前述のクランプ
回路25からの時間軸圧縮映像信号をインジェクション
部4からのサンプリングクロック信号より作成されるサ
ンプリングパルス(通常の再生では水平同期信号の基本
周波数(15,75KHz ) f Hの1536倍の
周波数を有する信号)によってディジタルに変換するA
/D変換回路、32はA/D変換回路3にでディジタル
化された時間軸圧縮映像信号のうち輝度信号を選択的に
上記サンプリングパルスに同期した信号で先き入れ先き
出しで記憶するファーストイン ファーストアウト メ
モリ(F I FO)であり、一方33はA/D変換回
路31でディジタル化された時間軸圧縮映像信号のうち
色差線順次のクロマ信号を同じく選択的にサンプリング
パルスに同期した信号により先き入れ先き出しで記憶す
るファーストインファーストアウト メモリ(F I 
FO)である。
このようにして、FIFO32,FIFO33に記憶さ
れたデータは、それぞれの時間軸圧縮率に対応する伸張
率を有するメモリ読み出しクロック信号で、それぞれ並
行に各時間軸を正規の時間軸に伸張・復元して読み出す
。上記において、F’IFO32,33の書き込みと読
み出しは独立して行なわれ、書き込みはスイッチングパ
ルスに同期したメモリ書き込み基準信号から0番地より
順次行われ、読み出しはリセットされることで0番地よ
り順次読み出される。
F I FO32から読み出した輝度信号データは、D
/A (ディジタル/アナログ)変換回路34で上記メ
モリ読み出しクロック信号に同期した信号(通常の再生
時は960f、)でアナログ信号に変換し、F I F
O33から読み出した線順次のクロマ信号はD/A変換
回路35で同じく上記メモリ読み出しクロック信号に同
期した信号(通常の再生時は192fH)でアナログ信
号に変換する。
これらのアナログ信号に変換された輝度信号とクロマ信
号は、第2のアナログ部5へ送出する。上記におけるA
/D変換、D/A変換およびFIF032.33の書き
込み、読み出しのタイミングの制御はデータ選択回路3
6等で行われ、その制御に必要なサンプリングクロック
信号はインジェクション部4から、FIFO32,33
のメモリ読み出しクロック信号は内部の発振回路37か
ら入力する。発振回路37の出力は、サーボ基準として
ドラムサーボ系にも送出され、上記FIFO32,33
からの読み出しによる正規の映像信号の復元と磁気テー
プからの時間軸圧縮映像信号の再生に相関を持たせる。
FIPO32,33へ書き込む輝度信号データとクロマ
信号データの分離は、シンクセパレータ26からの時間
軸圧縮映像信号の同期信号H,Vに基づいて、書き込み
を行う期間をサンプリングパルス敗に基づき時間的に切
り換えることにより行う。輝度信号とクロマ信号の読み
出し用のクロック信号およびD/A変換回路34.35
のクロック信号は、上記発振回路37のメモリ読み出し
クロック信号を分周して得る。復元時における正規の映
像信号の水平走査(H)区間の個数は、データ選択回路
36にカウンタ手段を設けて、メモリ読み出しクロック
信号を分周して作成した基準水平同期信号Hsをカウン
トして正規の個数(262または263)に揃える。
38は時間軸圧縮映像信号の垂直同期信号Vの前に重複
して付加された映像信号のH区間の個数をメモ′り書き
込み基準信号から上記の時間軸圧縮信号の垂直同期信号
Vまでカウントするカウンタ回路であり、39はそのカ
ウント値によりFII”032.33のリセットのタイ
ミングを補正して復元した垂直同期信号が正規のV区間
に入るようにするためのリセット回路である。
インジェクション部4において、41は再生された時間
軸圧縮映像信号に重畳されている再生用の基準信号であ
るパイロットバースト信号を抜き取るバースト抜取回路
、42はバースト抜取回路41で抜き出したパイロット
バースト信号を引き込んでそれに同期した周波数信号を
インジェクション方式で作り出すインジェクションロッ
ク回路、43はその周波数信号を8逓倍して上記再生さ
れた時間軸圧縮映像信号取り込み用のサンプリングパル
スの基準となるサンプリングクロック信号を得る8逓倍
回路、バースト抜取回路41は、シンクセパレータ26
からの水平同期信号Hに同期して時間的にゲート信号を
作成し、時間軸圧縮映像信号の所定部分に挿入されたパ
イロットバースト信号を抜き取る。インジェクションロ
ック回路42および8逓倍回路43は、ともに位相比較
器。
電圧制御発振回路(VCO)、分周回路等から戒るPL
L、(フェーズ ロックド ループ)回路などで構成す
ることもできる。
第2のアナログ部5において、D/A変換回路34から
入力される輝度信号は、4 M Hz前後となった輝度
信号Y。、JTのみを通す5 M Hzのローパスフィ
ルタ(LPF)51を通して出力する一方、D/A変換
回路35から入力されるクロマ信号は、IMHz内の帯
域となったクロマ信号のみを通す1MHzのローパスフ
ィルタ(LPF)52を通して、3つに分岐し、1つは
直接に、および他の1つはIH遅延回路53を通して、
さらに他の1つは2H遅延回路54を通してスイッチャ
−55に入力する。スイッチャ−55は、直接に入力さ
れた線順次の色差信号をR−YまたはB−Yに交互に振
り分けるとともに、そのとき送出されていない色差信号
をlH遅延回路53のIH前の色差信号と2H遅延回路
54の2H前の色差信号の和の1/2から作り出して補
間し、B−YまたはR−Yに交互に振り分ける。
第2図は本実施例の要部である第1図のカウンタ回路3
8とリセット回路39の構成例を示す回路図である。
カウンタ回路38は、4ビツトのバイナリカウンタ38
aと、そのカウント値をラッチするラッチ回路とで構成
する。カウンタ38aは、ヘッド切り換え用のスイッチ
ングパルスに同期するメモリ書き込み基準信号によりカ
ウント値Oをロードし、シンクセパレータ26で分離さ
れた時間軸圧縮信号の水平同期信号Hをカウントイネー
ブル端子EPに接続し、前述したサンプリングクロック
信号をクロック端子GKに接続してメモリ書き込み基準
信号から第1図のFIFO32,33に書き込まれるH
区間数をカウントする。ラッチ回路は、2つのアンド(
AND)回路38b、38cとノア(NOR)回路38
dの組から成る4組のセレクタ回路と4個のDフリップ
フロップ38eとで構成する。各セレクタ回路の組とD
フリップフロップ38eとの組はそれぞれカウンタの4
つのビットQ^、Qa、Qc、Qoに対応する。一方の
アンド回路38bの入力にはカウンタの対応するビット
QA−QDとシンクセパレータ26で分離した時間軸圧
縮信号の垂直同期信号Vとを接続し、他方のアンド回路
38cの入力には対応するDフリップフロップ38eの
反転出力を接続する。各アンド回路38b、38cの出
力はノア回路38dの入力に接続し、ノア回路38dの
出力は対応するDフリップフロップ38eのデータ入力
端子に接続する。各Dフリップフロップ38eのクロッ
ク端子にはサンプリングクロック信号を接続する。これ
によって各フリップフロップ38eは、メモリ書き込み
基準信号から再生された時間軸圧縮信号の垂直同期信号
までのH区間数を反転してラッチし、各反転出力端子か
ら正論理のH区間カウント値LA、Ls、Lc、Loを
出力する。
リセット回路39は、プログラマブルな4ビツトバイナ
リカウンタ39aと、Dフリップフロップ39bと、J
Kフリップフロップ39cと、ナンド(NAND)回路
39dと、ノア(NOR)回路39eで構成する。カウ
ンタ39aは、前述したカウンタ回路38でラッチされ
たカウント値L A= L oをメモリ読み出しの基準
垂直同期信号VSでロードする。Dフリップフロップ3
9bは、カウンタ392Lのロード信号Vs(上記Vs
の反転信号)をメモリ読み出し用のクロック信号に同期
させるためのものである。JKフリップフロップ39c
は、カウンタ39aのカウント期間を定めるものあり、
そのJ入力端子にはDフリップフロップ39bの反転出
力を接続し、そのに入力端子にはナンド回路39dの出
力であるリセットパルスを接続し、そのクロック端子に
はメモリ読み出しクロック信号を接続する。カウンタ3
9aのカウントイネーブル端子EPには、メモリ読み出
しの基準水平同期信号HsとJKフリップフロップ39
cの反転出力を人力に接続したノア回路39eの出力を
接続する。これによって、JKフリップフロップ39c
は基準垂直同期信号Vsからリセットパルス発生までの
間、ノア回路39eにローレベルを入力し、その間カウ
ンタ回路39aは基準水平同期信号Hsをカウント可能
にする。
リセットパルスはナンド回路39dによりカウンタ39
aのキャリーアウト信号とノア回路39eの出力のナン
ド(NAND)論理で作成される。
従って、リセット回路39は、基準垂直同期信号Vsか
らカウント回路38のカウント値L^〜L。
のフルカウント値までの残数をカウントした時点でリセ
ットパルスを発生することになる。このリセットパルス
はPIFO32,33に与えられ、その時点からFIF
O32,33読み出しはO番地より始まる。この0番地
から垂直同期信号の書き込み位置までは、前記したカウ
ンタ回路38のカウンタ値に等しいH区間が書き込まれ
ているので、常に基準垂直同期信号Hsから実際にFI
F032より復元される垂直同期信号までのH区間数が
一定値(カウンタ39aのフルカウント値16)になる
ようにFIFO32,33の読み出しのタイミングが制
御される。
Gt、実施例の動作と作用(第3図) 以上のように構成した実施例の動作および作用を第1図
、第2図を参照して述べる。第3図は本実施例の動作を
説明するためのタイミング図である。(a)は、本実施
例における時間軸圧縮方式の映像信号(TCI信号)の
I H(1水平走査区間)の波形図である。本TCI信
号は、水平同期信号Hに続いて、パイロットバースト信
号Bとクロマ信号Cと輝度信号Yがその順Jこ時間軸が
圧縮されて形成されている。(b)は磁気テープから再
生されたTCI信号を示し、垂直同期信号Vの前に数H
区間分の重複信号が付加され、2つのフィールドA、H
の順に磁気ヘッドlおよび第1のアナログ部2で再生さ
れる。再生されたTCI信号は、(c)に示すヘッド切
り換え用のスイッチングパルスに同期するメモリ書き込
み基準信号からディジタルメモリ部3のFIFO32,
33に書き込まれ、このときからTCI信号より分離さ
れた(d)に示す垂直同期信号VまでのH区間数nをカ
ウンタ回路38でカウントしてラッチする。(e)はF
IFO32,33の読み出し系の基準垂直同期信号Vs
である。この基準垂直同期信号Vsは、FIFO32,
33の書き込み系の信号や復元される映像信号とは無関
係に作成されるものである。
リセット回路39は、この基準垂直同期信号Vsにより
、FIFO読み出しの基準水平同期信号H5を前記のカ
ウンタ回路38のカウント値nからフルカウント値16
までカウントし、その時点で(f)のリセットパルスを
発生し、FIFO32゜33へ送出する。これにより、
F’IFO32,33から読み出しは一旦終了しFIF
O32,33のO番地へ連続する。従って、(g)に示
すようにFIFO32,33から復元される映像信号に
おいて、基準垂直同期信号VsからF I FO32の
輝度信号より復元される垂直同期信号V′までのH区間
数は、常にm+n=16と一定になる。
ここで、基準垂直同期信号Vsは、メモリ読み出しクロ
ック信号を分周して正確にV区間が管理された信号であ
るから、復元される垂直同期信号V′は正しくV区間に
入ることになる。即ち、ドラムジッターによってnが不
安定に変化しても、そのnの値に従ってリセットパルス
のタイミングが補正され、復元された映像信号における
垂直同期信号V′の出現タイミングが常に一定になるよ
うにFIFO32,33の読み出しが制御され、ジッタ
ーフリーとなる。
なお、本発明は色差線順次の時間軸圧縮信号に限らず、
種々の時間軸圧縮信号に適用可能であることはもちろん
である。また、アドレス操作が必要となるが、実施例の
FIFOに代えてメモリを使用することもできる。この
ように、本発明はその主旨に沿って種々に応用され、種
々の実施態様を取り得るものである。
[発明の効果] 以上の説明で明らかなように、本発明の時間軸圧縮方式
映像信号再生装置によれば、ドラムジッターが大きくな
り、スイッチングパルスが再生された時間軸圧縮信号の
H区間を乗り越えるような場合でも、■ジッターが発生
しないようにすることができる。
【図面の簡単な説明】
第1図は本発明の一実施例を示すブロック図、第2図は
本発明の要部のカウンタ回路とリセット回路の一構成例
を示す回路図、第3図は動作説明用のタイミング図であ
る。 l・・・磁気ヘッド、2・・・第1のアナログ部、3・
・・ディジタルメモリ部、4・・・インジェクション部
、5・・・第2のアナログ部、32.33・・・FIF
O。 36・・・データ選択回路、37・・・発振回路、38
・・・ カウンタ回路、39・・・リセット回路。

Claims (1)

    【特許請求の範囲】
  1. (1)時間軸圧縮方式で記録した時間軸圧縮映像信号を
    再生してメモリへ順に書き込み、該メモリを順に読み出
    す際に時間軸を復元する時間軸圧縮方式映像信号再生装
    置において、 上記メモリへの書き込みから時間軸圧縮映像信号の垂直
    同期信号までの水平走査区間数をカウントするカウント
    手段と、 このカウント手段のカウント値に基づいて上記メモリの
    読み出しの終了時期を補正して上記メモリに書き込んだ
    先頭のデータから読み出しを開始する手段とを有するこ
    とを特徴とする時間軸圧縮方式映像信号再生装置。
JP1177586A 1989-07-10 1989-07-10 時間軸圧縮方式映像信号再生装置 Pending JPH0342980A (ja)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5459525A (en) * 1992-08-06 1995-10-17 Matsushita Electric Industrial Co., Ltd. Video signal converting device and noise eliminator used therein
US5500682A (en) * 1992-09-04 1996-03-19 Matsushita Electric Industrial Co., Ltd. Memory equipment for writing/reading a defective video signal in a FIFO memory device consectively

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* Cited by examiner, † Cited by third party
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US5459525A (en) * 1992-08-06 1995-10-17 Matsushita Electric Industrial Co., Ltd. Video signal converting device and noise eliminator used therein
US5500682A (en) * 1992-09-04 1996-03-19 Matsushita Electric Industrial Co., Ltd. Memory equipment for writing/reading a defective video signal in a FIFO memory device consectively

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