JPH03255720A - 電流駆動回路 - Google Patents

電流駆動回路

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Publication number
JPH03255720A
JPH03255720A JP2055413A JP5541390A JPH03255720A JP H03255720 A JPH03255720 A JP H03255720A JP 2055413 A JP2055413 A JP 2055413A JP 5541390 A JP5541390 A JP 5541390A JP H03255720 A JPH03255720 A JP H03255720A
Authority
JP
Japan
Prior art keywords
current
channel
resistor
output
channel width
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Pending
Application number
JP2055413A
Other languages
English (en)
Inventor
Takeyuki Okada
岡田　健行
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Publication of JPH03255720A publication Critical patent/JPH03255720A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、電流駆動回路、特に、ＬＥＤアレイの光出力
を光源とする電子写真方式のプリンタに使用しＬＥＤア
レイに電流を供給するための電流駆動回路に関する。
〔従来の技術〕
従来の電流駆動回路は駆動信号として必要な複数信号の
均一な出力電流を得るためのカレントミラー回路におい
て、ミラー効果を構成するため各々の素子は同一性能（
同一駆動能力）であった。
〔発明が解決しようとする課題〕
しかしながら、このような上述した従来の電流駆動回路
はカレントミラー回路による定電流機能を持たせるバイ
アス条件に制約があり、出力バラ大きくなり、チップサ
イズが大きくなるという欠点がある。
〔課題を解決するための手段〕
本発明の電流駆動回路は差動増幅器と、抵抗器と、カレ
ントミラー回路と、基準電圧源とを有して構成される。
〔実施例〕
次に、本発明の実施例について、図面を参照して説明す
る。
第１図は本発明の一実施例を示す回路図である。
第１図に示す電流駆動回路は基準電圧源１１と、抵抗器
９と、差動増幅器１０と、ＮチャネルＭＯ８ＦＥＴ８と
、ＰチャネルＭＯ８ＦＥＴ２〜６と、負荷７とを含んで
構成される。
この電流駆動回路は、電子写真方式のプリンタでは、感
光ドラムに対向して、ＬＥＤアレイ７の発光素子列を設
け、これらに２値信号を送り、点灯させることにより印
字情報Ｐ１〜Ｐｎをプリントさせるものである。
ここで、ＬＥＤアレイ７は駆動時間、駆動電流によって
決まる発光エネルギーが制御されている。
Ｐチャネル間Ｏ８ＦＥＴ５．ａ−は印字情報Ｐ１〜Ｐｎ
によってＰチャネルＭＯ８ＦＥＴ３．４を各々ＯＮ、Ｏ
ＦＦに制御するためのスイッチ機能を有している。
Ｐチャネル間Ｏ８ＦＥＴ５がＯＮのとき、ＰチャネルＭ
Ｏ３ＦＥＴ２．３のゲート部は等電位となる。Ｐチャネ
ルＭＯ８ＦＥＴ６がＯＮのとき、Ｐチャネル間Ｏ８ＦＥ
Ｔ２．４のゲート部は等電位となる。各々、電流値１．
．１．が負荷であるＬＥＤアレイ７に供給される。
マタ、Ｐチャ＊ルＭＯＳＦＥＴ５．６がＯＦＦではＰチ
ャネルＭＯ８ＦＥＴ３．４はＯＦＦとなり、１．＝Ｉ、
＝ＯてＬＥＤアレイ７に電流は供給されない。
ＮチャネルＭＯ８ＦＥＴ８は差動増幅器１０により制御
され、Ｐチャネル間Ｏ８ＦＥＴ２のゲート電位を制御す
る。差動増幅器１０は抵抗器９の両端の電位を通して基
準電流である電流工。は工。＝Ｖ／ＲとなるようにＰチ
ャネル間Ｏ８ＦＥＴ２のゲート電位を制御する機能を有
する。
印加電圧源１が供給されるＰチャネルＭＯ３ＦＥＴ２は
ＰチャネルＭＯ８ＦＥＴ３および４とともにカレントミ
ラー回路を構成している。
ただし、ＰチャネルＭＯ３ＦＥＴ２のチャネル長＝Ｌ、
チャネル幅＝Ｗに対し、Ｐチャネル間Ｏ３ＦＥＴ３．４
のチャネル長＝Ｌ、チャネル幅＝Ｗ／ｍであり、Ｖ　／
　Ｒ＝　Ｉ　ｏ　＝　Ｉ　＋　／　ｍ　＝　Ｉ　ｎ　／
　ｍとなる。
従って、負荷であるＬＥＤアレイ７に要求される圧力電
流が電流値１．、Ｉ、の場合、Ｌ＝Ｉ、＝ｍＩ。となる
ように基準電圧源１１の電圧値Ｖ、又は抵抗器９の抵抗
値Ｒを決定すればＰチャネルＭＯ８ＦＥＴ３．４の＋＋
＊ル幅がＰチャネル間Ｏ８ＦＥＴ２のチャネル幅に対し
１／ｍに縮少できる。
このため、これに対応してチップサイズを縮少できるこ
ととなる。
〔発明の効果〕
本発明の電流駆動回路は、ＰチャネルＭＯＳ　ＦＥＴの
サイズを小さくすることにより、チップサイズを縮少で
きるという効果がある。
【図面の簡単な説明】
第１図は本発明の一実施例を示す回路図である。 １・・・・・・印加電圧源、２〜６・・・・・・Ｐチャ
ネルＭＯ８ＦＥＴ、７・・・・・・ＬＥＤアレイ、８・
・・・・・ＮチャネルＭＯ８ＦＥＴ、９・・・・・・抵
抗器、１０・・・・・・差動増幅器、１１・・・・・・
基準電圧源、 Ｐ１〜Ｐｎ・・・・・・印字情報、工。ｒ　　ＩＩ〜工
、・・・・・・電流値、■・・・・・・電圧値、Ｒ・・
・・・・抵抗値。

Claims (1)

    【特許請求の範囲】
  1. 基準電圧源と、基準電流に応じた電圧を発生する抵抗器
    と、前記各電圧の差分信号に応じた電圧を出力する差動
    増幅器と、ミラー効果を利用して出力電流を得るカレン
    トミラー回路とを含むことを特徴とする電流駆動回路。
JP2055413A 1990-03-06 1990-03-06 電流駆動回路 Pending JPH03255720A (ja)

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JP2055413A JPH03255720A (ja) 1990-03-06 1990-03-06 電流駆動回路

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JPH03255720A true JPH03255720A (ja) 1991-11-14

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JP (1) JPH03255720A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013247622A (ja) * 2012-05-29 2013-12-09 Lapis Semiconductor Co Ltd 定電流出力ドライバ及びこれを含む半導体装置

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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