JPH01156083A - 電流駆動回路 - Google Patents

電流駆動回路

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JPH01156083A
JPH01156083A JP62316769A JP31676987A JPH01156083A JP H01156083 A JPH01156083 A JP H01156083A JP 62316769 A JP62316769 A JP 62316769A JP 31676987 A JP31676987 A JP 31676987A JP H01156083 A JPH01156083 A JP H01156083A
Authority
JP
Japan
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current
load
fet
voltage
integrator
Prior art date
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Pending
Application number
JP62316769A
Other languages
English (en)
Inventor
Takeyuki Okada
岡田 健行
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、電流駆動回路、特に、LEDアレイの光出力
を光源とする電子写真方式のプリンタに使用しLEDア
レイに電流を供給するための電流駆動回路に関する。
〔従来の技術〕
従来の電流駆動回路は駆動信号として必要な一定の出力
電流工。を得るための一定の電圧Vを印加し負荷の駆動
は印字情報AI、印字情報AnによりON、OFFは決
定されていた。
〔発明が解決しようとする問題点〕
しかしながら、このような上述した従来の電流駆動回路
は大電流出力が要求されるため、ノイズ発生等による誤
動作が発生したり、大容量コンデンサが必要となるとい
う欠点がある。
〔問題点を解決するための手段〕
本発明の電流駆動回路は、積分器と、抵抗器と、差動増
幅器と、カレントミラー回路とを有して構成される。
〔実施例〕
次に、本発明の実施例について、図面を参照して説明す
る。
第1図は本発明の一実施例を示す回路図、第2図は第1
図に示す実施例の各部の波形を示すタイミングチャート
である。
第1図に示す電流駆動回路は、積分回路部11と、差動
増幅器10と、抵抗器9と、NチャネルMO8FET8
と、PチャネルMO8FET2〜6と、負荷7とを含ん
で構成される。
この電流駆動回路は、電子写真方式のプリンタでは、感
光ドラムに対向して、LEDアレイ等の発光素子列を設
け、これらに二値信号を送り点灯させることにより印字
情報をプリントさせるものである。ここで、LEDアレ
イなどの発光素子列は駆動時間、駆動電流によって決ま
る発光エネルギーが制御されている。
第1図に示す実施例では、発光素子列である負荷7を三
角波信号により駆動しようとするものである。
印加電圧源1が供給されるPチャネルMO8FET2は
、P + +ネルMO8FET4および6と共にカレン
トミラー回路CMを構成している。
従って、PチャネルMO8F’ET2を流れる出力電流
IOと等しい出力電流工1もしくは出力電流InがPチ
ャネルMO8FET4.6により負荷7に一俳給できる
PチャネルMO8FET3がおよび5は、印字情報A1
およびAnによってPチャネルMO3FET4および6
を各々ON、OFFに制御するkめのスイッチ機能を有
している。PチャネルMO8FET3が0N(7)時工
1=工0であり、PチャネルMO8FET5がONの時
はIn=工0となる。
また、各々OFF時では11=O,ln=0であり負荷
7に電流は供給されない。
NチャネルMO8FET8は、差動増幅器10により制
御され、PチャネルMO3FET2のゲート電位を制御
する。差動増幅器10は抵抗器9の両端の電位を通して
PチャネルMO3FET2に流れる出力電流工0を制御
する機能を有する。
今、積分器11の積分出力電圧VIがVとすると、l0
=V/RとなるようにNチャネルMO8FET8を通じ
てPチャネルMO3FET2のゲート電位を制御する。
      ′ディジタル信に駆動信号Bを入力とする
積分器11は、三角波または台形状の波形を出力するも
ので、dv/dtを小さくするためのものである。
積分器11に入力される駆動信号Bは負荷7に対する駆
動時間を制御し、駆動スタート、ストップを意味する。
第2図において、印字情報A1が“Inの時、駆動信号
Bが積分器11に入力されると、積分器11の出力電圧
VIと同等の波形が出力電流工1として得られ、また印
字情報Anが“1”の時、出力電流Inとして得られる
ことを示す。
負荷に対してn bit全て駆動する場合においてもd
i/dtは小さくなり最も有効となる。
〔発明の効果〕
本発明の電流駆動回路は、駆動電流としてdi/dtを
小さくすることにより、ノイズ発生防止等が可能となる
という効果がある。
【図面の簡単な説明】
第1図は本発明の一実施例を示す回路図、第2図は第1
図に示す実施例の各部の波形を示すタイミングチャート
である。 CM・・・・・・カレントミラー回路、1・・・・・・
印加電圧源、2〜6・・・・・・PチャネルMO8FE
T、7・・・・・・負荷、8・・・・・・NチャネルM
O8FET、9・・・・・・抵抗器、10・・・・・・
差動増幅器、11・・・・・・積分器、 Al、An・・・・・・印字情報、B・・・・・・駆動
信号、VI・・・・・・積分出力電圧、IO,I’l、
In・・・・・・出力電流。 代理人 弁理士  内 原   音 上 d〕 ↓Φ 14111書に1

Claims (1)

    【特許請求の範囲】
  1. 供給された駆動信号に応じた積分出力電圧を発生する積
    分器と、前記積分出力電圧と基準電圧との差分信号に応
    じた出力電流を出力する差動増幅器と、前記出力信号に
    応じて制御され基準電流のスイッチング制御がなされる
    カレントミラー回路とを含むことを特徴とする電流駆動
    回路。
JP62316769A 1987-12-14 1987-12-14 電流駆動回路 Pending JPH01156083A (ja)

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JPH01156083A true JPH01156083A (ja) 1989-06-19

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