JPH03185994A - Vtrの色信号処理回路 - Google Patents
Vtrの色信号処理回路Info
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- JPH03185994A JPH03185994A JP1324405A JP32440589A JPH03185994A JP H03185994 A JPH03185994 A JP H03185994A JP 1324405 A JP1324405 A JP 1324405A JP 32440589 A JP32440589 A JP 32440589A JP H03185994 A JPH03185994 A JP H03185994A
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- 238000006243 chemical reaction Methods 0.000 claims description 17
- 230000010355 oscillation Effects 0.000 claims description 10
- 238000001514 detection method Methods 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 2
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 2
- 230000003111 delayed effect Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、VTR(ビデオテープレコーダ)の色信号処
理回路に関し、特に記録時に色信号を周波数変換すると
きに必要とする基準信号の発生回路に関する。
理回路に関し、特に記録時に色信号を周波数変換すると
きに必要とする基準信号の発生回路に関する。
本発明は、VTRでの記録時に色信号を周波数変換する
ときに必要とする基準信号の発生回路であって、この基
準信号を生成させるための分周器の分周比を所定周期毎
に切換えるようにして、複数の映像信号方式に対応した
信号処理が同一の回路で行えるようにしたものである。
ときに必要とする基準信号の発生回路であって、この基
準信号を生成させるための分周器の分周比を所定周期毎
に切換えるようにして、複数の映像信号方式に対応した
信号処理が同一の回路で行えるようにしたものである。
一般に、VTRで映像信号を記録する際には、色信号(
クロマ信号)を低域変換した後、この低域変換された色
信号を輝度信号と周波数多重で記録するようにしている
。この低域変換を行う従来の回路構成の一例を第4図に
示すと、この第4図において、(1)はクロマ信号入力
端子を示し、このクロマ信号入力端子(1)には記録す
る映像信号から分離したクロマ信号が供給され、このク
ロマ信号入力端子(1)に供給されるクロマ信号を混合
器(2)に供給する。そして、この混合器(2)で後述
する変換制御回路(11)から供給される周波数信号と
クロマ信号とを混合し、混合処理により低域の周波数に
変換する。そして、この低域変換されたクロマ信号を、
クロマ信号出力端子(3)から後段の記録系回路に供給
し、輝度信号と共にビデオテープに記録させる。
クロマ信号)を低域変換した後、この低域変換された色
信号を輝度信号と周波数多重で記録するようにしている
。この低域変換を行う従来の回路構成の一例を第4図に
示すと、この第4図において、(1)はクロマ信号入力
端子を示し、このクロマ信号入力端子(1)には記録す
る映像信号から分離したクロマ信号が供給され、このク
ロマ信号入力端子(1)に供給されるクロマ信号を混合
器(2)に供給する。そして、この混合器(2)で後述
する変換制御回路(11)から供給される周波数信号と
クロマ信号とを混合し、混合処理により低域の周波数に
変換する。そして、この低域変換されたクロマ信号を、
クロマ信号出力端子(3)から後段の記録系回路に供給
し、輝度信号と共にビデオテープに記録させる。
また、(4)は水平同期信号入力端子を示し、この水平
同期信号入力端子(4)に供給される水平同期信号を、
自動周波数制御回路(5)に供給する。この自動周波数
制御回路(5)は、後述する分周信号が供給され、水平
同期信号と分周信号とに基づいて制御信号を出力する。
同期信号入力端子(4)に供給される水平同期信号を、
自動周波数制御回路(5)に供給する。この自動周波数
制御回路(5)は、後述する分周信号が供給され、水平
同期信号と分周信号とに基づいて制御信号を出力する。
そして、この制御信号をローパスフィルタ(6)を介し
て直流化した後、電圧制御発振器(7)に供給する。
て直流化した後、電圧制御発振器(7)に供給する。
そして、電圧制御発振器(7)の発振信号を1 / n
分周器(8)及び1/m分周器(9)に供給する。この
1/n分周器(8)の分周信号と1/m分周器(9)の
分周信号とを、切換スイッチ(10)の第1及び第2の
固定接点(10a)及び(10b)に供給し、切換スイ
ッチ(10)の可動接点(10m)の切換わりにより、
1 / n分周器(8)の分周信号と1/m分周器(9
)の分周信号とが選択され、この可動接点(Lom)に
得られる分周信号を自動周波数制御回路(5)及び変換
制御回路(11)に供給する。
分周器(8)及び1/m分周器(9)に供給する。この
1/n分周器(8)の分周信号と1/m分周器(9)の
分周信号とを、切換スイッチ(10)の第1及び第2の
固定接点(10a)及び(10b)に供給し、切換スイ
ッチ(10)の可動接点(10m)の切換わりにより、
1 / n分周器(8)の分周信号と1/m分周器(9
)の分周信号とが選択され、この可動接点(Lom)に
得られる分周信号を自動周波数制御回路(5)及び変換
制御回路(11)に供給する。
そして、所定の周波数信号を出力する発振器(12)の
出力信号を変換制御回路(11)に供給し、切換スイッ
チ(10)から供給される分周信号とこの発振器(12
)の出力信号とを変換制御回路(11〉で混合し、混合
された周波数信号を混合器(2)に供給し、この混合器
(2)でクロマ信号に周波数信号を混合し、クロマ信号
の低域変換を行う。
出力信号を変換制御回路(11)に供給し、切換スイッ
チ(10)から供給される分周信号とこの発振器(12
)の出力信号とを変換制御回路(11〉で混合し、混合
された周波数信号を混合器(2)に供給し、この混合器
(2)でクロマ信号に周波数信号を混合し、クロマ信号
の低域変換を行う。
このような構成により安定して低域変換が行われる。こ
こで、切換スイッチ(10)により1 / n分周器(
8)と1/m分周器(9)とを切換えるようにしたのは
、複数の放送方式に対応させるためである。
こで、切換スイッチ(10)により1 / n分周器(
8)と1/m分周器(9)とを切換えるようにしたのは
、複数の放送方式に対応させるためである。
即ち、特開昭58−77390号公報に記載されるよう
に、発振信号の分周比を切換えることで、低域変換され
る周波数が変化し、例えばNTSC方式のクロマ信号処
理とPAL方式のクロマ信号処理との双方に対処し、異
なる放送方式で回路の共用化を行うことができる。
に、発振信号の分周比を切換えることで、低域変換され
る周波数が変化し、例えばNTSC方式のクロマ信号処
理とPAL方式のクロマ信号処理との双方に対処し、異
なる放送方式で回路の共用化を行うことができる。
ところが、このように2個の分周器を単に切換えさせる
構成とすると、それだけ分周器が多く必要で回路規模が
大きくなってしまう。特に、上述した回路が必要とする
1 / n分周器(8)と1/m分周器(9)とは分周
比が大きく、例えばnやmを320程度に設定する必要
があり、このように分周比の大きい分周器は構成が複雑
で、回路構成が複雑化してしまう。
構成とすると、それだけ分周器が多く必要で回路規模が
大きくなってしまう。特に、上述した回路が必要とする
1 / n分周器(8)と1/m分周器(9)とは分周
比が大きく、例えばnやmを320程度に設定する必要
があり、このように分周比の大きい分周器は構成が複雑
で、回路構成が複雑化してしまう。
本発明の目的は、複数の放送方式に対応したVTRの色
信号処理回路の構成を簡単にすることにある。
信号処理回路の構成を簡単にすることにある。
本発明のVTRの色信号処理回路は、例えば第1図に示
す如く、電圧制御発振器(7)の発振信号を第1の分周
比又は第2の分周比に選択的に分周する分周比切換回路
(20)と、この分周比切換回路(20)の出力を1/
Nに分周する1/N分周器(31)と、分周比切換回路
(31)の出力をN周期検出する毎に第1の分周比を第
2の分周比に一時的に切換えさせる制御パルスを分周比
切換回路(20)に供給する検出回路(31)とを設け
、1/N分周器(31)の出力に基づいて色信号の周波
数変換を行うようにしたものである。
す如く、電圧制御発振器(7)の発振信号を第1の分周
比又は第2の分周比に選択的に分周する分周比切換回路
(20)と、この分周比切換回路(20)の出力を1/
Nに分周する1/N分周器(31)と、分周比切換回路
(31)の出力をN周期検出する毎に第1の分周比を第
2の分周比に一時的に切換えさせる制御パルスを分周比
切換回路(20)に供給する検出回路(31)とを設け
、1/N分周器(31)の出力に基づいて色信号の周波
数変換を行うようにしたものである。
このようにしたことで、分周比切換回路での分周比の切
換えだけで、1/N分周器から異なる周波数の信号が出
力されるようになり、複数の放送方式に対応した色信号
の周波数変換が行われる。
換えだけで、1/N分周器から異なる周波数の信号が出
力されるようになり、複数の放送方式に対応した色信号
の周波数変換が行われる。
以下、本発明のVTRの色信号処理回路の一実施例を、
第1図〜第3図を参照して説明する。この第1図〜第3
図において、第4図に対応する部分には同一符号を付し
、その詳細説明は省略する。
第1図〜第3図を参照して説明する。この第1図〜第3
図において、第4図に対応する部分には同一符号を付し
、その詳細説明は省略する。
本例においては、従来例と同様に複数の放送方式に対応
した色信号の周波数変換が行えるようにしたもので、第
1図に示す如く構成する。即ち本例においては、電圧制
御発振器(7)の発振出力を分周比切換回路(20)に
供給する。この分周比切換回路(20)は、分周比が1
15と1/6とに切換えられる分周器で、この分周比切
換回路(20)の後段に接続された1/64分周器(3
1)から供給される制御信号に基づいて、115と1/
6の分周比の選択が行われる。そして、分周比切換回路
(20)の出力を1/64分周器(31)に供給し、こ
の1/64分周器(31)で分周信号をさらにl/64
分周する。この場合、1/64分周器(31)で供給さ
れる信号の周期をカウントし、64周期カウントする毎
に分周比切換制御信号を出力し、接続スイッチ(32)
を介して分周比切換回路(20)に供給する。この場合
、接続スイッチ(32)はPAL方式の映像信号処理を
行うとき接続状態にし、NTSC方式の映像信号処理を
行うとき非接続状態にする。そして、1/64分周器(
31)で分周した信号を自動周波数制御回路(5)及び
変換制御回路(11)に供給する。
した色信号の周波数変換が行えるようにしたもので、第
1図に示す如く構成する。即ち本例においては、電圧制
御発振器(7)の発振出力を分周比切換回路(20)に
供給する。この分周比切換回路(20)は、分周比が1
15と1/6とに切換えられる分周器で、この分周比切
換回路(20)の後段に接続された1/64分周器(3
1)から供給される制御信号に基づいて、115と1/
6の分周比の選択が行われる。そして、分周比切換回路
(20)の出力を1/64分周器(31)に供給し、こ
の1/64分周器(31)で分周信号をさらにl/64
分周する。この場合、1/64分周器(31)で供給さ
れる信号の周期をカウントし、64周期カウントする毎
に分周比切換制御信号を出力し、接続スイッチ(32)
を介して分周比切換回路(20)に供給する。この場合
、接続スイッチ(32)はPAL方式の映像信号処理を
行うとき接続状態にし、NTSC方式の映像信号処理を
行うとき非接続状態にする。そして、1/64分周器(
31)で分周した信号を自動周波数制御回路(5)及び
変換制御回路(11)に供給する。
ここで、分周比切換回路(20)の構成を第2図に示す
と、図中(21)は電圧制御発振器(7)の発振信号が
供給される入力端子を示し、この入力端子(21)に供
給される発振信号をDフリップフロップ(22) 。
と、図中(21)は電圧制御発振器(7)の発振信号が
供給される入力端子を示し、この入力端子(21)に供
給される発振信号をDフリップフロップ(22) 。
(23)及び(24)のクロック信号入力端子CKに供
給する。そして、(25)は1/64分周器(31)か
ら供給される分周比切換制御信号の入力端子を示し、こ
の入力端子(25)に得られる分周比切換制御信号をO
Rゲート(26)の一方の入力側に供給する。そして、
Dフリップフロップ(23)のQ2出力をORゲ−I−
(26)の他方の入力側に供給する。そして、このOR
ゲート(26)の論理和出力をNANDゲート(27)
の一方の入力側に供給し、Dフリップフロップ(24)
のQ3出力をNANDゲート(27)の他方の入力側に
供給する。そして、このNANDゲート(27)の排他
的論理和出力をDフリップフロップ(22)のD入力に
供給し、Dフリップフロップ(22)のQ、出力をDフ
リップフロップ(23)のD入力に供給し、Dフリップ
フロップ(23)のQ2出力をDフリップフロップ(2
4)のD入力に供給し、Dフリップフロップ(24)の
Q3出力を分周信号出力端子(28)に供給する。そし
て、この分周信号出力端子(28)から1/64分周器
(31)に分周信号を供給する。
給する。そして、(25)は1/64分周器(31)か
ら供給される分周比切換制御信号の入力端子を示し、こ
の入力端子(25)に得られる分周比切換制御信号をO
Rゲート(26)の一方の入力側に供給する。そして、
Dフリップフロップ(23)のQ2出力をORゲ−I−
(26)の他方の入力側に供給する。そして、このOR
ゲート(26)の論理和出力をNANDゲート(27)
の一方の入力側に供給し、Dフリップフロップ(24)
のQ3出力をNANDゲート(27)の他方の入力側に
供給する。そして、このNANDゲート(27)の排他
的論理和出力をDフリップフロップ(22)のD入力に
供給し、Dフリップフロップ(22)のQ、出力をDフ
リップフロップ(23)のD入力に供給し、Dフリップ
フロップ(23)のQ2出力をDフリップフロップ(2
4)のD入力に供給し、Dフリップフロップ(24)の
Q3出力を分周信号出力端子(28)に供給する。そし
て、この分周信号出力端子(28)から1/64分周器
(31)に分周信号を供給する。
その他の部分は第4図例の回路と同様に構成する。
次に本例の色信号処理回路の動作を、第3図のタイミン
グ図を参照して説明する。この第3図は分周比切換回路
(20)の信号状態を中心に示した図で、PAL方式の
映像信号処理を行うものとし、接続スイッチ(32)を
接続状態にする。まず、電圧制御発振器(7)の発振信
号が第3図Aに示す周期で分周比切換回路(20)に供
給されているとする。このとき、1/64分周器(31
)から端子(25)に供給される分周比切換制御信号は
、第3図Fに示す如く、分周比切換回路(20)の出力
の64周期目をカウントしたとき以外はローレベル信号
II OI+になり、64周期目をカウントしたときは
所定期間ハイレベル信号II I I+になる。
グ図を参照して説明する。この第3図は分周比切換回路
(20)の信号状態を中心に示した図で、PAL方式の
映像信号処理を行うものとし、接続スイッチ(32)を
接続状態にする。まず、電圧制御発振器(7)の発振信
号が第3図Aに示す周期で分周比切換回路(20)に供
給されているとする。このとき、1/64分周器(31
)から端子(25)に供給される分周比切換制御信号は
、第3図Fに示す如く、分周比切換回路(20)の出力
の64周期目をカウントしたとき以外はローレベル信号
II OI+になり、64周期目をカウントしたときは
所定期間ハイレベル信号II I I+になる。
まず、この分周比切換制御信号がローレベル信号“′0
′”であるときについて考えると、分周比切換回路(2
0)のDフリップフロップ(22)のD入力には、第3
図Bに示す如く、上述した分周比切換回路(20)の構
成により電圧制御発振器(7)の発振出力の3周期ハイ
レベルになり2周期ローレベルになる175分周された
状態が繰り返される信号が供給される。即ち、Q2出力
とQ、l出力の双方がハイレベル信号“1゛であるとき
、Dフリップフロップ(22〉のD入力に供給される信
号がローレベル信号゛0パになり、上述した周期の信号
になる。
′”であるときについて考えると、分周比切換回路(2
0)のDフリップフロップ(22)のD入力には、第3
図Bに示す如く、上述した分周比切換回路(20)の構
成により電圧制御発振器(7)の発振出力の3周期ハイ
レベルになり2周期ローレベルになる175分周された
状態が繰り返される信号が供給される。即ち、Q2出力
とQ、l出力の双方がハイレベル信号“1゛であるとき
、Dフリップフロップ(22〉のD入力に供給される信
号がローレベル信号゛0パになり、上述した周期の信号
になる。
そして、このDフリップフロップ(22)のQ、出力か
らは、第3図Cに示す如く、このD入力に供給される信
号が1クロック分遅れて出力される。同様にして、Dフ
リップフロップ(23)及び(24)のQ2出力及びQ
3出力からは、第3図り及び已に示す如く、さらに1ク
ロック分ずつ遅れて出力される。
らは、第3図Cに示す如く、このD入力に供給される信
号が1クロック分遅れて出力される。同様にして、Dフ
リップフロップ(23)及び(24)のQ2出力及びQ
3出力からは、第3図り及び已に示す如く、さらに1ク
ロック分ずつ遅れて出力される。
従って、第3図計に示すDフリップフロップ(24)の
Q3出力が、分周比切換回路(20)により分周された
出力信号として1/64分周器(31)に供給され、分
周比切換制御信号がローレベル信号“0”である限り1
15分周された信号がl/64分周器(31)に供給さ
れる。
Q3出力が、分周比切換回路(20)により分周された
出力信号として1/64分周器(31)に供給され、分
周比切換制御信号がローレベル信号“0”である限り1
15分周された信号がl/64分周器(31)に供給さ
れる。
そして、1/64分周器(31)で分周比切換回路(2
0)の出力の64周期目をカウントしたときには、分周
比切換制御信号が第3図Fに示すようにハイレベル信号
“1”°に一時的に変化する。このとぎには、○Rアゲ
−−(26)の出力は、分周比切換制御信号がハイレベ
ル信号″1“である限りハイレベル信号“1゛に固定さ
れ、Dフリップフロップ(24)のQ3出力が反転した
信号がDフリップフロップ(22)の0人力に供給され
るようになる。従って、Dフリップフロップ(22)の
D入力には、−時的に電圧制御発振器(7)の発振出力
の3周期ローレベルになる信号が供給され、この信号が
Dフリップフロップ(22)、 (23)及び(24)
により順次遅らされて、Dフリップフロップ(24)の
Q、出力として電圧制御発振器(7)の発振出力の3周
期ローレベルが続くことになる。このため、このときに
は−時的に1/6分周されたことになり、1/6分周さ
れた信号が1/64分周器(31)に供給される。
0)の出力の64周期目をカウントしたときには、分周
比切換制御信号が第3図Fに示すようにハイレベル信号
“1”°に一時的に変化する。このとぎには、○Rアゲ
−−(26)の出力は、分周比切換制御信号がハイレベ
ル信号″1“である限りハイレベル信号“1゛に固定さ
れ、Dフリップフロップ(24)のQ3出力が反転した
信号がDフリップフロップ(22)の0人力に供給され
るようになる。従って、Dフリップフロップ(22)の
D入力には、−時的に電圧制御発振器(7)の発振出力
の3周期ローレベルになる信号が供給され、この信号が
Dフリップフロップ(22)、 (23)及び(24)
により順次遅らされて、Dフリップフロップ(24)の
Q、出力として電圧制御発振器(7)の発振出力の3周
期ローレベルが続くことになる。このため、このときに
は−時的に1/6分周されたことになり、1/6分周さ
れた信号が1/64分周器(31)に供給される。
このようにして、分周比切換回路(20)の出力の64
周期に一回だけ115分周が1/6分周に切換わること
で、1/64分周器(31)の出力としては、電圧制御
発振器(7)の出力が1 /321分周された信号にな
る。即ち、175分周された信号が63回と1/6分周
された信号が1回で1周期が構成されるので、1/ (
5X63+6) −1/321分周となる。
周期に一回だけ115分周が1/6分周に切換わること
で、1/64分周器(31)の出力としては、電圧制御
発振器(7)の出力が1 /321分周された信号にな
る。即ち、175分周された信号が63回と1/6分周
された信号が1回で1周期が構成されるので、1/ (
5X63+6) −1/321分周となる。
このように1 /321分周が行われることで、水平同
期信号をf、とすると、電圧制御発振器(7)は321
f、の周波数信号を出力するようになり、1/64分
周器(31)の出力が記録映像信号の水平同期信号f、
に同期した信号になり、PAL方式の記録用のクロマ信
号の周波数変換が良好に行われる。
期信号をf、とすると、電圧制御発振器(7)は321
f、の周波数信号を出力するようになり、1/64分
周器(31)の出力が記録映像信号の水平同期信号f、
に同期した信号になり、PAL方式の記録用のクロマ信
号の周波数変換が良好に行われる。
次に、NTSC方式の映像信号処理を行う場合について
説明すると、このときには接続スイッチ(32)を非接
続状態にする。このようにすることで、分周比切換制御
信号はローレベル信号“′O゛のまま変化せず、上述し
たPAL方式の信号処理時の1/64分周器(31)で
分周比切換回路(20)の出力の64周期目をカランl
−したとき以外の状態と同様の処理が行われる。即ち、
分周比切換回路(20)は1 115分周に固定され、1/ (5X64) =1/3
201/32われる。この1/320分周が行われるこ
とで、水平同期信号をf、とすると、電圧制御発振器(
7)は320flIの周波数信号を出力するようになり
、1/64分周器(31)の出力が記録映像信号の水平
同期信号f、に同期した信号になり、NTSC方式の記
録用のクロマ信号の周波数変換が良好に行われる。
説明すると、このときには接続スイッチ(32)を非接
続状態にする。このようにすることで、分周比切換制御
信号はローレベル信号“′O゛のまま変化せず、上述し
たPAL方式の信号処理時の1/64分周器(31)で
分周比切換回路(20)の出力の64周期目をカランl
−したとき以外の状態と同様の処理が行われる。即ち、
分周比切換回路(20)は1 115分周に固定され、1/ (5X64) =1/3
201/32われる。この1/320分周が行われるこ
とで、水平同期信号をf、とすると、電圧制御発振器(
7)は320flIの周波数信号を出力するようになり
、1/64分周器(31)の出力が記録映像信号の水平
同期信号f、に同期した信号になり、NTSC方式の記
録用のクロマ信号の周波数変換が良好に行われる。
このように本例の色信号処理回路によると、分周比が簡
単に切換わり、NTSC方式とPAL方式の両方式の色
信号処理が良好に行える。この場合、分周比は、分周比
切換回路(20)で175分周と1/6分周とを切換え
るだけで、1/64分周器(31)は共通に使用される
ので、回路構成が簡単である。
単に切換わり、NTSC方式とPAL方式の両方式の色
信号処理が良好に行える。この場合、分周比は、分周比
切換回路(20)で175分周と1/6分周とを切換え
るだけで、1/64分周器(31)は共通に使用される
ので、回路構成が簡単である。
なお、上述実施例においてはNTSC方式とPAL方式
とで兼用するようにしたが、他の方式にも適用できるこ
とは勿論である。また、NTSC方式とPAL方式とで
兼用させる場合にも、VTRのフォーマットによっては
別の分周比を選ぶ場2 合もある。さらにまた、本発明は上述実施例に限らず、
その他種々の構成が取り得ることは勿論である。
とで兼用するようにしたが、他の方式にも適用できるこ
とは勿論である。また、NTSC方式とPAL方式とで
兼用させる場合にも、VTRのフォーマットによっては
別の分周比を選ぶ場2 合もある。さらにまた、本発明は上述実施例に限らず、
その他種々の構成が取り得ることは勿論である。
本発明によると、簡単な回路構成で複数の放送方式に対
応した色信号の周波数変換が良好に行える。
応した色信号の周波数変換が良好に行える。
第1図は本発明のVTRの色信号処理回路の一実施例を
示す構成図、第2図は一実施例の要部を示す構成図、第
3図は一実施例の説明に供するタイくング図、第4図は
従来のVTRの色信号処理回路の一例を示す構成図であ
る。 (4)は水平同期信号入力端子、(5)は自動周波数制
御回路、(7)は電圧制御発振器、(20)は分周比切
換回路、(31)は1/64分周器である。
示す構成図、第2図は一実施例の要部を示す構成図、第
3図は一実施例の説明に供するタイくング図、第4図は
従来のVTRの色信号処理回路の一例を示す構成図であ
る。 (4)は水平同期信号入力端子、(5)は自動周波数制
御回路、(7)は電圧制御発振器、(20)は分周比切
換回路、(31)は1/64分周器である。
Claims (1)
- 【特許請求の範囲】 所定の発振信号を第1の分周比又は第2の分周比に選択
的に分周する分周比切換回路と、該分周比切換回路の出
力を1/Nに分周する1/N分周器と、上記分周比切換
回路の出力をN周期検出する毎に上記第1の分周比を第
2の分周比に一時的に切換えさせる制御パルスを上記分
周比切換回路に供給する検出回路とを設け、 上記1/N分周器の出力に基づいて色信号の周波数変換
を行うようにしたことを特徴とするVTRの色信号処理
回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1324405A JPH03185994A (ja) | 1989-12-14 | 1989-12-14 | Vtrの色信号処理回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1324405A JPH03185994A (ja) | 1989-12-14 | 1989-12-14 | Vtrの色信号処理回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH03185994A true JPH03185994A (ja) | 1991-08-13 |
Family
ID=18165433
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1324405A Pending JPH03185994A (ja) | 1989-12-14 | 1989-12-14 | Vtrの色信号処理回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH03185994A (ja) |
-
1989
- 1989-12-14 JP JP1324405A patent/JPH03185994A/ja active Pending
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