JPH03124048A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPH03124048A
JPH03124048A JP26246789A JP26246789A JPH03124048A JP H03124048 A JPH03124048 A JP H03124048A JP 26246789 A JP26246789 A JP 26246789A JP 26246789 A JP26246789 A JP 26246789A JP H03124048 A JPH03124048 A JP H03124048A
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electrode
sog
hole
spin
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JP26246789A
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Hideki Harada
秀樹 原田
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Kyushu Fujitsu Electronics Ltd
Fujitsu Ltd
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Kyushu Fujitsu Electronics Ltd
Fujitsu Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、SOGによる層間平坦化技術に関する。
近年の多層配線技術には層間絶縁膜の平坦性。
またそれに伴い、上下層の配線が貫通するスルーホール
の微細化が要求されている。
そのため・、スルーホールコンタクト部分の接続性の信
頼度を向上させる必要がある。
3、発明の詳細な説明 [(既要] 本発明は、スピンオングラス(SOG)による層間平坦
化技術に関し、SOGからの脱ガスを減少させることを
目的とし 平坦化に利用するSOG膜をSiw板上に被覆し。
39 S OG膜にスルーホールを形成した後、該スル
〔従来の技術〕 第3図は従来例の説明図である。
図において、 12はSi基板、 13はへ!電極、1
4はSOG膜、15はpsc膜、16はAP配線である
従来は、スルーホールのコンタクト部の安定化のために
、アルミニウム(Affi)lliを形成する前に、 
Si基板を加熱するか、若しくは Aeの蒸着を低温で
行なって、Al電極表面或いはスルーホールからの脱ガ
スを防いでいた。
ところが、SOG膜による層間平坦化技術を用いると、
スルーホールの側壁にSOG膜の端面が露出してしまい
、その部分からの水分等の脱ガスの為に2 へ!電極表
面と上層のA!配線との接続が不安定となっていた。
そのため、第3図(a)に示すように、Si基板12上
のAff電極13にSOG膜14をスピンコードしたあ
と、第3図(b)に示すようにRIHによる異方性エン
チングによりSOG膜14をエツチングして、 へr電
極13の表面を露出し、その上に、燐珪酸ガラス(ps
c)膜15を被覆してスルーホールを形成していた。
即ら、スルーホール部分にSOG膜がなく、従って脱ガ
スも起こりにくいが、実際には、SOG膜14をエツチ
ングして、  /H2電極13の表面を露出する工程に
おいて1 アンダーエツチングではSOG膜が表面に残
って2 コンタクト不良となり、オーバーエツチングで
は微細なへ2電極13の形状不良となり、エツチングの
コントロールが困難であった。更に、Si基板12上の
Affi電極13の幅が種々異なる場合に、 八!の幅
が小さい場合はSOGが薄く付着し、またAI!の幅が
大きい場合にはSOG膜が厚く付着する傾向があるので
、SOG膜を均一に除去することもまた困難であった。
(発明が解決しようとする課題〕 従って2従来のプロセスにおいては、  AI電極配線
の相互のコンタクトの安定性に欠け、スルーホールの微
細化ができないといった問題を生していた。
本発明は1以上の点を鑑み、SOG膜からの脱ガスを減
少させることを目的として提供されるものである。
(課題を解決するための手段] 第1図は本発明の原理説明図、第2図は本発明の工程順
模式断面図である。
図において、lはSOG、2は水酸基、3はシリル基、
4は4はSi基板、5はへβ電極、6はSOG膜、7は
PSG膜、8はスルーホール、9は水酸基、10はシリ
ル基111はA1配線である。
上記の問題点は2本発明の平坦化に利用するSOG膜を
Si基板上4に被覆し、該SOG膜6にスルーホール8
を形成した後、該スルーホール8内のS OG +19
6の露出面をカップリング処理して該S OG IIW
 6の露出面を撥水性にすることにより解決される。
即ち、第1図(a)に示すように1層間絶縁膜の平坦化
に使用した5OG1の膜のスルーホール形成後の側壁の
露出した表面には水酸基2があるため、親水性を示して
、水分を吸着しやすい。
従って、  Aj2i着等で加熱されると、水分が蒸発
して、 AP主電極表面に酸化物等を形成して、上層の
へ!配線とのコンタクトを不安定にする。
そのため、カップリング剤として、トリメチルシリルを
使用し、5OGIの表面を処理して、第1図(b)に示
すように5OGIの表面の水酸基2をシリル基3に置換
する。するとSOG 1の表面は撥水性tなって、水分
を吸着せず、 Δp蒸着時の水分等の脱ガスが避けられ
ることになる。
〔作用〕
本発明では、第1図のように、SOG表面をシリル基等
の有機基でキャップするようになるため。
表面が出水性となり、水が吸着しにく(なる。
従って、スルーホール側壁のSOGは水分の吸着が減少
して、脱ガスが抑えられ5 A!電極のコンタクト特性
も安定する。
〔実施例] 第2図は1本発明の一実施例の工程順模式断面図である
以下1本発明を工程順に説明する。
第2図(a)に示すように、Si基板4にスパッタによ
りA!を1μmの厚さに被覆しパタニングしてAI電極
5を形成する。
第2図(b)に示すように、SOG膜6をSi基板4の
上にs、ooo人の厚さにスピンコードし、窒素(N2
)中450°Cで30分間焼成してガラス膜とする。
続イテPSGII!7を CVC1法により、  40
0’Cで5.000人の厚さに積層する。
第2図(c)に示すように、  AI2電極5上にスル
ーホール8をRIIEにより開口したあと+ NZ中で
350°Cで30分間の加熱処理を行なう。
この時、スルーホール側壁に露出したSOG膜6の表面
のAの部分は、第2図(d)に拡大して示すように、水
酸基9があり、水分を吸着し易い状態となっている。
このため、カップリング剤として、シリル化剤。
例えばトリメチルシリル(Si (C1l:l) 30
11)をスピンコードで塗布するか2或いは、シリル他
剤雰囲気中に曝気して被覆した後3ホツトプレート上で
150’C2分間のヘーキングを行なう。
すると、第2図(e)で示すBの部分を1第2図(f)
に拡大して示すように、SOG膜6の表面の水酸基9が
シリル化剤と架橋して、シリル基lOに置換する。
そのため、SOG膜6の表面は撥水性となり。
水分を吸着しににくなる。
第2図(g)に示すように、  AAをスパッタにより
1μmの厚さに被覆して、スルーホール8を埋めるとと
もに、パタニングして上層のAI配線11を形成する。
〔発明の効果〕
以上説明した様に1本発明によれば、SOG自身が水を
吸着しにくくなるという効果を奏し、SOGからの水分
等の脱ガスが抑えられ、  AP、電極のコンタクトの
安定化に寄与するところが大きい。
【図面の簡単な説明】
第1回は本発明の原理説明図。 第2図は本発明の一実施例の工程順模式断面図第3図は
従来例の説明図 である。 図において lはSOG、      2は水酸基。 3はシリル基 5はへβ電極 7はPSG膜。 9は水酸基。 IIはAf配線 4はSi基板。 6はSOG膜。 8はスルーホール 10はシリル基 (α) (b) 本−一口月の万巨王里=是θ月Ea 第1図 本光口月の一大書行イ列の工程ノφノ莫へ14面図る駐
米イ列の該1月図 第 図

Claims (1)

    【特許請求の範囲】
  1. 平坦化に利用するスピンオングラス(SOG)(1)か
    らなるSOG膜(6)をSi基板(4)上に被覆し、該
    SOG膜(6)にスルーホール(8)を形成した後、該
    スルーホール(8)内のSOG膜(6)の露出面をカッ
    プリング処理して、該SOG膜(6)の露出面を撥水性
    にすることを特徴とする半導体装置の製造方法。
JP26246789A 1989-10-06 1989-10-06 半導体装置の製造方法 Expired - Lifetime JP2868243B2 (ja)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1064676A1 (en) * 1999-01-20 2001-01-03 Koninklijke Philips Electronics N.V. Reliable via structures having hydrophobic inner wall surfaces and methods for making the same
WO2005034194A2 (en) * 2003-10-08 2005-04-14 Honeywell International Inc. Repairing damage to low-k dielectric materials using silylating agents
US7709371B2 (en) 2003-01-25 2010-05-04 Honeywell International Inc. Repairing damage to low-k dielectric materials using silylating agents
JP2012015379A (ja) * 2010-07-01 2012-01-19 Univ Of Miyazaki シリコン酸化膜からのoh基除去法

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CA2413592A1 (en) 2000-06-23 2002-01-03 Nigel P. Hacker Method to restore hydrophobicity in dielectric films and materials
US8475666B2 (en) 2004-09-15 2013-07-02 Honeywell International Inc. Method for making toughening agent materials

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1064676A1 (en) * 1999-01-20 2001-01-03 Koninklijke Philips Electronics N.V. Reliable via structures having hydrophobic inner wall surfaces and methods for making the same
EP1064676A4 (en) * 1999-01-20 2007-10-17 Nxp Bv RELIABLE VIA STRUCTURES WITH HYDROPHOBIC INTERIOR WALL SURFACES AND MANUFACTURING METHOD
US7709371B2 (en) 2003-01-25 2010-05-04 Honeywell International Inc. Repairing damage to low-k dielectric materials using silylating agents
WO2005034194A2 (en) * 2003-10-08 2005-04-14 Honeywell International Inc. Repairing damage to low-k dielectric materials using silylating agents
WO2005034194A3 (en) * 2003-10-08 2005-09-15 Honeywell Int Inc Repairing damage to low-k dielectric materials using silylating agents
JP2012015379A (ja) * 2010-07-01 2012-01-19 Univ Of Miyazaki シリコン酸化膜からのoh基除去法

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