JPH03105957A - 半導体集積回路装置 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims description 34
- 239000008188 pellet Substances 0.000 claims abstract description 59
- 239000000463 material Substances 0.000 claims description 18
- 239000011347 resin Substances 0.000 claims description 13
- 229920005989 resin Polymers 0.000 claims description 13
- 239000000853 adhesive Substances 0.000 claims description 4
- 230000001070 adhesive effect Effects 0.000 claims description 4
- 230000015572 biosynthetic process Effects 0.000 claims description 3
- 229910000679 solder Inorganic materials 0.000 abstract description 29
- 238000000034 method Methods 0.000 abstract description 3
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 10
- 229910052710 silicon Inorganic materials 0.000 description 10
- 239000010703 silicon Substances 0.000 description 10
- 238000004519 manufacturing process Methods 0.000 description 3
- 238000004382 potting Methods 0.000 description 3
- 239000004593 Epoxy Substances 0.000 description 2
- 230000007547 defect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000017525 heat dissipation Effects 0.000 description 2
- 229920001296 polysiloxane Polymers 0.000 description 2
- GNLJOAHHAPACCT-UHFFFAOYSA-N 4-diethoxyphosphorylmorpholine Chemical compound CCOP(=O)(OCC)N1CCOCC1 GNLJOAHHAPACCT-UHFFFAOYSA-N 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- 229910052782 aluminium Inorganic materials 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- 238000003892 spreading Methods 0.000 description 1
- 238000009736 wetting Methods 0.000 description 1
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- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は、半導体集積回Fl@装置に関し、特にP2
2
N接合構造・レジンモールド形の半導体集積回路装置に
おいて、ペレット付けの際の接着材による短絡発生の抑
制が可能とされる半導体集積回路装置に適用して有効な
技術に関する。
おいて、ペレット付けの際の接着材による短絡発生の抑
制が可能とされる半導体集積回路装置に適用して有効な
技術に関する。
〔従来の技術]
たとえば、PN接合構造・レジンモールド形の半導体集
積回路装置としては、電波新聞社、昭和59年5月20
B発行、「総合電子部品ハンドブックJ P174〜P
211などの文章に記載されるように、PN接合構造の
半導体材料を挟んで突起電極および平面電極が形成され
たペレットと、内部接点および外部電極が形戊された一
対のIJ一ドフレームと、これらのペレットおよびリー
ドフレームが接続される接続アームとで構或されている
。
積回路装置としては、電波新聞社、昭和59年5月20
B発行、「総合電子部品ハンドブックJ P174〜P
211などの文章に記載されるように、PN接合構造の
半導体材料を挟んで突起電極および平面電極が形成され
たペレットと、内部接点および外部電極が形戊された一
対のIJ一ドフレームと、これらのペレットおよびリー
ドフレームが接続される接続アームとで構或されている
。
そして、たとえば一方のリードフレームの内部接点に半
田がポッティングされ、その」二にペレットが平面電極
側を下にして搭載され、リフロー炉を通されることによ
ってリードフレームの内部接点とペレットの平面電極と
が接続される。また、他方のリードフレームについても
同様に、内部接点に接続アームの一端側が半田を介して
接続され、他端側かペレットの突起電極に半田を介して
接続されている。
田がポッティングされ、その」二にペレットが平面電極
側を下にして搭載され、リフロー炉を通されることによ
ってリードフレームの内部接点とペレットの平面電極と
が接続される。また、他方のリードフレームについても
同様に、内部接点に接続アームの一端側が半田を介して
接続され、他端側かペレットの突起電極に半田を介して
接続されている。
さらに、エポキシまたはンリコーンなどのレジン材料に
よってモールドされ、レジンモールド構造とされている
。
よってモールドされ、レジンモールド構造とされている
。
ところが、PN接合構造・レジンモールド形の半導体集
積回路装置においては、主に放熱部分であるPN接合部
が、モールド構造の中心部に位置されるために放熱性の
面において問題が生じている。
積回路装置においては、主に放熱部分であるPN接合部
が、モールド構造の中心部に位置されるために放熱性の
面において問題が生じている。
そこで、たとえばペレットの上下方向が逆にされ、リー
ドフレームの内部接点にペレットの突起電極側が接続さ
れ、半導体集積回路装置の外端面に近い部分にPN接合
部の放熱部分が位置されてモールドされる方法が提案さ
れている。
ドフレームの内部接点にペレットの突起電極側が接続さ
れ、半導体集積回路装置の外端面に近い部分にPN接合
部の放熱部分が位置されてモールドされる方法が提案さ
れている。
[発明が解決しようとする課題]
ところが、前記のような提案された従来技術においては
、半導体集積回路装置の放熱性は向上されるものの、半
田のポッティング量によるペレットの半導体材料が露出
される側面と、リードフレームとの短絡発生について配
慮がされておらず、たとえば半田量が多過ぎたり、また
は突起電極が充分な高さに形威されていない場合には、
ペレットの突起電極形成側が半田中に埋もれてしまうと
いう欠点がある。
、半導体集積回路装置の放熱性は向上されるものの、半
田のポッティング量によるペレットの半導体材料が露出
される側面と、リードフレームとの短絡発生について配
慮がされておらず、たとえば半田量が多過ぎたり、また
は突起電極が充分な高さに形威されていない場合には、
ペレットの突起電極形成側が半田中に埋もれてしまうと
いう欠点がある。
従って、リードフレームにベレノトを接続する場合に、
半田によってペレットの側面とリードフレームとの間が
短絡して製造不良が発生してしまうという問題がある。
半田によってペレットの側面とリードフレームとの間が
短絡して製造不良が発生してしまうという問題がある。
そこで、本発明の目的は、半田のポッテイング量による
ペレットの側面とリードフレームとの短絡許容範囲が拡
大され、半田量および突起電極高さの許容範囲を大きく
とることができると同時に、製造工程における組立歩留
りの向上が可能とされる半導体集積回路装置を提供する
ことにある。
ペレットの側面とリードフレームとの短絡許容範囲が拡
大され、半田量および突起電極高さの許容範囲を大きく
とることができると同時に、製造工程における組立歩留
りの向上が可能とされる半導体集積回路装置を提供する
ことにある。
本発明の前記ならびにその他の目的と新規な特徴は、本
明細書の記述および添付図面から明らかになるであろう
。
明細書の記述および添付図面から明らかになるであろう
。
[課題を解決するための手段]
本願において開示される発明のうち、代表的なものの概
要を簡単に説明すれば、下記のとおりである。
要を簡単に説明すれば、下記のとおりである。
すなわち、本発明の半導体集積回路装置は、突起電場が
形戊されたペレットと、該ペレットに接着材を介して接
続されるリードフレームとを備えたベレソト付け構造の
半導体集積回路装置であって、前記リードフレームの接
続側に突起部が形戊され、該リードフレームの突起部に
前記ペレットの突起電極が位置合わせされて接続される
ものである。
形戊されたペレットと、該ペレットに接着材を介して接
続されるリードフレームとを備えたベレソト付け構造の
半導体集積回路装置であって、前記リードフレームの接
続側に突起部が形戊され、該リードフレームの突起部に
前記ペレットの突起電極が位置合わせされて接続される
ものである。
また、前記ペレットが、側面に半導体材料が露出されて
PN接合構造に形成され、かつPN接合形成側が前記リ
ードフレームに接続され、レジン材料によってモールド
されるものである。
PN接合構造に形成され、かつPN接合形成側が前記リ
ードフレームに接続され、レジン材料によってモールド
されるものである。
[作用]
前記した半導体集積回路装置によれば、リードフレーム
の接続側に突起部が形成されることによ起電極を位置合
わせして接続することができる。
の接続側に突起部が形成されることによ起電極を位置合
わせして接続することができる。
また、このペレットが、側面に半導体材料が露出されて
PN接合構造に形成され、かつPN接合形成側が前記リ
ードフレームに接続され、レジン材料によってモールド
される場合においては、半田のボッティング量によるペ
レットの側面とリードフレームとの短絡許容範囲が拡大
され、半田量および突起電極高さの許容範囲を大きくと
ることができる。
PN接合構造に形成され、かつPN接合形成側が前記リ
ードフレームに接続され、レジン材料によってモールド
される場合においては、半田のボッティング量によるペ
レットの側面とリードフレームとの短絡許容範囲が拡大
され、半田量および突起電極高さの許容範囲を大きくと
ることができる。
これにより、半田量が多過ぎた場合においても、ペレッ
トの突起電極がリードフレームの突起部に当接され、ま
た半田がリードフレーム上に濡れ広がり易くなるために
、リードフレームの側面が半田中に埋もれることが低減
される。
トの突起電極がリードフレームの突起部に当接され、ま
た半田がリードフレーム上に濡れ広がり易くなるために
、リードフレームの側面が半田中に埋もれることが低減
される。
[実施例]
第1図は本発明の一実施例である半導体集積回路装置の
レジンモールド型シリコンダイオードを示す断面図、第
2図は本実施例におけるシリコンダイオードのペレット
とリードフレームとの接続レフトをリードフレームに接
続する場合を示す断面図である。
レジンモールド型シリコンダイオードを示す断面図、第
2図は本実施例におけるシリコンダイオードのペレット
とリードフレームとの接続レフトをリードフレームに接
続する場合を示す断面図である。
まず、第1図により本実施例のレジンモールド型シリコ
ンダイオードの構或を説明する。
ンダイオードの構或を説明する。
本実施例のシリコンダイオードは、たとえば両端面に電
極を備えたべレット1と、外部に接続される電極を備え
た一対のリードフレーム2.3と、ペレット1およびリ
ードフレーム2,3を接続する接続アーム4とで構或さ
れ、エボキシまたはシリコーンなどのレジン材料5によ
ってモールドされている。そして、一方のリードフレー
ム2にペレノト1の一端面が接続され、他方のリードフ
レーム3に接続アーム4を介してペレット1の他端面が
接続されている。
極を備えたべレット1と、外部に接続される電極を備え
た一対のリードフレーム2.3と、ペレット1およびリ
ードフレーム2,3を接続する接続アーム4とで構或さ
れ、エボキシまたはシリコーンなどのレジン材料5によ
ってモールドされている。そして、一方のリードフレー
ム2にペレノト1の一端面が接続され、他方のリードフ
レーム3に接続アーム4を介してペレット1の他端面が
接続されている。
ペレット1は、PN接合構造に形成された半導体材料6
、たとえばシリコン単結晶を挟んで上端面、PN接合構
造形成側に突起電極7が接続され、下端面に平面電極8
が接続されている。
、たとえばシリコン単結晶を挟んで上端面、PN接合構
造形成側に突起電極7が接続され、下端面に平面電極8
が接続されている。
に外部に接続される外部電極10が形威されている。そ
して、左側のリードフレーム2の接続接点9の接続側に
は、たとえば第2図に示すようにペレット1の突起電極
7の大きさとほぼ同じ大きさの突起部9aが形成されて
いる。
して、左側のリードフレーム2の接続接点9の接続側に
は、たとえば第2図に示すようにペレット1の突起電極
7の大きさとほぼ同じ大きさの突起部9aが形成されて
いる。
接続アーム4は、両端側に接続接点11.12が形成さ
れている。
れている。
このように構或される本実施例のシリコンダイオードは
、たとえばペレット1の突起電極7が、半田13を介し
て左側リードフレーム2の接続接点9に接続されている
。一方、ペレット1の平面電極8は、半田13を介して
接続アーム4の一方の接続接点1lに接続され、他方の
接続接点12から半田13を介して右側リードフレーム
3の接続接点9に接続されている。
、たとえばペレット1の突起電極7が、半田13を介し
て左側リードフレーム2の接続接点9に接続されている
。一方、ペレット1の平面電極8は、半田13を介して
接続アーム4の一方の接続接点1lに接続され、他方の
接続接点12から半田13を介して右側リードフレーム
3の接続接点9に接続されている。
次に、本実施例の作用について説明する。
本実施例のシリコンダイオードにおいては、リードフレ
ーム2の接続接点9の接続側に突起部9aが形戊される
ことによって、ペレット1のリードフレーム2へのグイ
ボンディングの際に、たとえば第3図に示すようにリー
ドフレーム2の突起部9aに半田13がボッテイングさ
れ、その上方から突起電極7を下側にしてペレット1が
装着される。
ーム2の接続接点9の接続側に突起部9aが形戊される
ことによって、ペレット1のリードフレーム2へのグイ
ボンディングの際に、たとえば第3図に示すようにリー
ドフレーム2の突起部9aに半田13がボッテイングさ
れ、その上方から突起電極7を下側にしてペレット1が
装着される。
そして、リードフレーム2にペレット1が装着された状
態において、リフロー炉内を通過されることによってグ
イボンディングが完了する。
態において、リフロー炉内を通過されることによってグ
イボンディングが完了する。
この場合に、たとえばペレット1の突起電極7の高さが
充分でなくても、リードフレーム2に突起部9aが形成
されることによって、ペレット1の側面とリードフレー
ム2との間に所定の距離を形成することができる。
充分でなくても、リードフレーム2に突起部9aが形成
されることによって、ペレット1の側面とリードフレー
ム2との間に所定の距離を形成することができる。
また、ボッティングされた半田l3の量が多かった場合
においても、半田13の濡れ広がり性によって第2図の
ような形状となり、従って過剰な半田量によって発生す
るペレット1の側面とIJ 一ドフレーム2とのショー
トの可能性を低減することができる。
においても、半田13の濡れ広がり性によって第2図の
ような形状となり、従って過剰な半田量によって発生す
るペレット1の側面とIJ 一ドフレーム2とのショー
トの可能性を低減することができる。
以上、本発明者によってなされた発明を実施例に基づき
具体的に説明したが、本発明は前記実施例に限定される
ものではなく、その要旨を逸脱しない範囲で種々変更可
能であることはいうまでもない。
具体的に説明したが、本発明は前記実施例に限定される
ものではなく、その要旨を逸脱しない範囲で種々変更可
能であることはいうまでもない。
たとえば、本実施例の半導体集積回路装置については、
レジンモールド型シリコンダイオードである場合につい
て説明したが、本発明は前記実施例に限定されるもので
はなく、突起電極7が形成されたべレット1をリードフ
レーム2に接続する構造のペレット付け半導体集積回路
装置について広く適用可能である。
レジンモールド型シリコンダイオードである場合につい
て説明したが、本発明は前記実施例に限定されるもので
はなく、突起電極7が形成されたべレット1をリードフ
レーム2に接続する構造のペレット付け半導体集積回路
装置について広く適用可能である。
また、本実施例においては、ベレッ}1とリードフレー
ム2とが接続アーム4によって接続される場合について
説明したが、たとえばアルミニウムなどの配線材勢によ
って接続される場合についても適用可能である。
ム2とが接続アーム4によって接続される場合について
説明したが、たとえばアルミニウムなどの配線材勢によ
って接続される場合についても適用可能である。
以上の説明では、主として本発明者によってなされた発
明をその利用分野であるPN接合構造・レジンモールド
形の半導体集積回路装置に適用した場合について説明し
たが、これに限定されるものではなく、他のペレット付
け構造の半導体集積回路装置についても広く適用可能で
ある。
明をその利用分野であるPN接合構造・レジンモールド
形の半導体集積回路装置に適用した場合について説明し
たが、これに限定されるものではなく、他のペレット付
け構造の半導体集積回路装置についても広く適用可能で
ある。
[発明の効果]
本願において開示される発明のうち、代表的なものによ
って得られる効果を簡単に説明すれば、下記のとおりで
ある。
って得られる効果を簡単に説明すれば、下記のとおりで
ある。
すなわち、突起電極が形成されたペレットと、このペレ
ットに接着材を介して接続されるリードフレームとを備
えたペレット付け構造の半導体集積回路装置において、
リードフレームの接続側に突起部が形戒されることによ
り、このリードフレームの突起部にペレットの突起電極
を位置合わせして接続することができるので、ペレット
とリードフレームとの短絡許容範囲を拡大することがで
きる。
ットに接着材を介して接続されるリードフレームとを備
えたペレット付け構造の半導体集積回路装置において、
リードフレームの接続側に突起部が形戒されることによ
り、このリードフレームの突起部にペレットの突起電極
を位置合わせして接続することができるので、ペレット
とリードフレームとの短絡許容範囲を拡大することがで
きる。
また、このペレットが、側面に半導体材料が露出されて
PN接合構造に形戊され、かつPN接合形成側がリード
フレームに接続され、レジン材料によってモールドされ
る場合においては、半田のポッティング量によるペレッ
トの側面とリードフレームとの短絡許容範囲が拡大され
、半田量および突起電極高さの許容範囲を大きくとるこ
とができる。
PN接合構造に形戊され、かつPN接合形成側がリード
フレームに接続され、レジン材料によってモールドされ
る場合においては、半田のポッティング量によるペレッ
トの側面とリードフレームとの短絡許容範囲が拡大され
、半田量および突起電極高さの許容範囲を大きくとるこ
とができる。
これにより、半田量が多過ぎた場合においても、ペレッ
トの突起電極がリードフレームの突起部に当接され、ま
た半田がリードフレーム上に濡れ広がり易くなるために
、リードフレームの側面が半田中に埋もれることなく、
過剰な半田量によるペレットの半導体材料が露出された
側面とリードフレームとの間の短絡が低減され、製造不
良の発生を抑制することができる。
トの突起電極がリードフレームの突起部に当接され、ま
た半田がリードフレーム上に濡れ広がり易くなるために
、リードフレームの側面が半田中に埋もれることなく、
過剰な半田量によるペレットの半導体材料が露出された
側面とリードフレームとの間の短絡が低減され、製造不
良の発生を抑制することができる。
この結果、リードフレームの突起部の高さおよび大きさ
が、ペレットの大きさなどの組立条件に応じて制御され
ることによって、半導体集積回路装置の製造工程におけ
る組立歩留りの向上が可能である。
が、ペレットの大きさなどの組立条件に応じて制御され
ることによって、半導体集積回路装置の製造工程におけ
る組立歩留りの向上が可能である。
第1図は本発明の一実施例である半導体集積回路装置の
レジンモールド型シリコンダイオードを示す断面図、 第2図は本実施例におけるシリコンダイオードのベレフ
トとリードフレームとの接続を示す拡大断面図、 第3図は本実施例におけるペレットをリードフレームに
接続する場合を示す断面図である。 1・・・ペレット、2・・・リードフレーム、3・・・
リードフレーム、4・・・接続アーム、5・・・レジン
材料、6・・・半導体材料、7・・・突起電極、8・・
・平面電極、9・・・接続接点、9a・・・突起部、l
O・・・外部電極、1l・・・接続接点、12・・・接
続接点、13・・・半田(接着材)。 第1図 6,手導本萩料
レジンモールド型シリコンダイオードを示す断面図、 第2図は本実施例におけるシリコンダイオードのベレフ
トとリードフレームとの接続を示す拡大断面図、 第3図は本実施例におけるペレットをリードフレームに
接続する場合を示す断面図である。 1・・・ペレット、2・・・リードフレーム、3・・・
リードフレーム、4・・・接続アーム、5・・・レジン
材料、6・・・半導体材料、7・・・突起電極、8・・
・平面電極、9・・・接続接点、9a・・・突起部、l
O・・・外部電極、1l・・・接続接点、12・・・接
続接点、13・・・半田(接着材)。 第1図 6,手導本萩料
Claims (1)
- 【特許請求の範囲】 1、突起電極が形成されたペレットと、該ペレットに接
着材を介して接続されるリードフレームとを備えたペレ
ット付け構造の半導体集積回路装置であって、前記リー
ドフレームの接続側に突起部が形成され、該リードフレ
ームの突起部に前記ペレットの突起電極が位置合わせさ
れて接続されることを特徴とする半導体集積回路装置。 2、前記ペレットが、側面に半導体材料が露出されてP
N接合構造に形成され、かつPN接合形成側が前記リー
ドフレームに接続され、レジン材料によってモールドさ
れることを特徴とする請求項1記載の半導体集積回路装
置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1241968A JPH03105957A (ja) | 1989-09-20 | 1989-09-20 | 半導体集積回路装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1241968A JPH03105957A (ja) | 1989-09-20 | 1989-09-20 | 半導体集積回路装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH03105957A true JPH03105957A (ja) | 1991-05-02 |
Family
ID=17082261
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1241968A Pending JPH03105957A (ja) | 1989-09-20 | 1989-09-20 | 半導体集積回路装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH03105957A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100258050B1 (ko) * | 1995-11-24 | 2000-06-01 | 가네꼬 히사시 | 반도체 장치와 그 제조 방법 및 그에 사용되는 리드 프레임 |
JP2001203312A (ja) * | 2000-01-18 | 2001-07-27 | Sanken Electric Co Ltd | リード端子及び半導体装置 |
JP2014116511A (ja) * | 2012-12-11 | 2014-06-26 | Hitachi Power Semiconductor Device Ltd | パワー半導体装置、整流装置および電源装置 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS417878Y1 (ja) * | 1964-12-28 | 1966-04-20 | ||
JPS63281451A (ja) * | 1987-05-13 | 1988-11-17 | Hitachi Ltd | 半導体装置 |
-
1989
- 1989-09-20 JP JP1241968A patent/JPH03105957A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS417878Y1 (ja) * | 1964-12-28 | 1966-04-20 | ||
JPS63281451A (ja) * | 1987-05-13 | 1988-11-17 | Hitachi Ltd | 半導体装置 |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100258050B1 (ko) * | 1995-11-24 | 2000-06-01 | 가네꼬 히사시 | 반도체 장치와 그 제조 방법 및 그에 사용되는 리드 프레임 |
JP2001203312A (ja) * | 2000-01-18 | 2001-07-27 | Sanken Electric Co Ltd | リード端子及び半導体装置 |
JP2014116511A (ja) * | 2012-12-11 | 2014-06-26 | Hitachi Power Semiconductor Device Ltd | パワー半導体装置、整流装置および電源装置 |
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