JPH02893A - 表示装置およびその作動方法 - Google Patents
表示装置およびその作動方法Info
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は表示装置に関し、特に液晶表示装置に関する。
ヨーロッパ特許出願第０２６１９０１Ａ号に記載されて
いるようなピクセルの行を有する表示のための既存のグ
ループ時間多重アドレス指定技術（ｇｒｏｕｐ ｔｉ＋
＊ｅ−ａ＋ｕｌＬｉｐｌｅｘ ａｄｄｒｅｓｓｉｎｇｔ
ｅｃｈｎｉｑｕｅ）では、アドレス指定が行のグループ
を同時にセットすることを含み、各グループは、１つの
グループ内の行が２進累進を呈示するアドレス指定シー
ケンスにおける時間的間隔を有する隣接行と系列を形成
するようにアドレス指定シーケンスにおいて離間された
複数の行よりなる。２ビット多重化に対しては、この技
術は４つのグレーレベルを有する表示を与える。これが
２つの独立して付勢可能な領域（空間的デイザ−（ｓｐ
ａｔｉａｌ−ｄｉｔｈｅｒ）として知られている）でも
って１つのピクセルをアドレスする計画と組合せられた
場合には、１６のレベルを有する表示が実現されうる。
いるようなピクセルの行を有する表示のための既存のグ
ループ時間多重アドレス指定技術（ｇｒｏｕｐ ｔｉ＋
＊ｅ−ａ＋ｕｌＬｉｐｌｅｘ ａｄｄｒｅｓｓｉｎｇｔ
ｅｃｈｎｉｑｕｅ）では、アドレス指定が行のグループ
を同時にセットすることを含み、各グループは、１つの
グループ内の行が２進累進を呈示するアドレス指定シー
ケンスにおける時間的間隔を有する隣接行と系列を形成
するようにアドレス指定シーケンスにおいて離間された
複数の行よりなる。２ビット多重化に対しては、この技
術は４つのグレーレベルを有する表示を与える。これが
２つの独立して付勢可能な領域（空間的デイザ−（ｓｐ
ａｔｉａｌ−ｄｉｔｈｅｒ）として知られている）でも
って１つのピクセルをアドレスする計画と組合せられた
場合には、１６のレベルを有する表示が実現されうる。
本発明の１つの目的は１つの表示内のグレーレベルの数
を多くなしうるグループ時間多重化技術を提供すること
である。
を多くなしうるグループ時間多重化技術を提供すること
である。
本発明は、それぞれ選択的にセットしうるピクセル要素
の格子を有する表示装置の動作方法であって、 表示のための画像を表わす信号を受信し、各画像に対し
複数のアドレス回数だけピクセル要素の集団を時間多重
アドレス指定することよりなり、 前記アドレス指定工程が１つのグループの集団をセット
することを含み、そのグループは、３またはそれ以上に
対応する整数である共通の比Ｎを有する等比数列を呈示
するアドレス指定シーケンスにおいて時間的間隔を有す
る隣接集団とともに前記グループにおける集団が系列を
形成するようにアドレス指定シーケンスにおける離間し
た複数の集団よりなる表示装置の動作方法を提供する。
の格子を有する表示装置の動作方法であって、 表示のための画像を表わす信号を受信し、各画像に対し
複数のアドレス回数だけピクセル要素の集団を時間多重
アドレス指定することよりなり、 前記アドレス指定工程が１つのグループの集団をセット
することを含み、そのグループは、３またはそれ以上に
対応する整数である共通の比Ｎを有する等比数列を呈示
するアドレス指定シーケンスにおいて時間的間隔を有す
る隣接集団とともに前記グループにおける集団が系列を
形成するようにアドレス指定シーケンスにおける離間し
た複数の集団よりなる表示装置の動作方法を提供する。
アドレスされた後には、ピクセル要素は、次のアドレス
指定が生ずるまでセットされた状態にとどまるかあるい
はその状態に維持される。従って、セットされているピ
クセルの持続期間はそのピクセルの集団とそのグループ
における次の集団との間のアドレス指定シーケンスにお
ける時間的間隔に依存し、この間隔は前述のように１つ
のグループにおいて等比数列関係を有する。このように
して、アドレス指定手段は所定の画像に対する１つのア
ドレスにおける第１の予め定められた期間のあいだ１つ
の集団（ｃｏｌｌｅｃｔｉｏｎ）をセットし、次にその
画像に対する他のアドレスにおける第２の予め定められ
た期間のあいだその集団をセットし、それによって所定
の画像に対する１つの集団の異なるアドレスに対して異
なるセット時間を与えるように作用する。
指定が生ずるまでセットされた状態にとどまるかあるい
はその状態に維持される。従って、セットされているピ
クセルの持続期間はそのピクセルの集団とそのグループ
における次の集団との間のアドレス指定シーケンスにお
ける時間的間隔に依存し、この間隔は前述のように１つ
のグループにおいて等比数列関係を有する。このように
して、アドレス指定手段は所定の画像に対する１つのア
ドレスにおける第１の予め定められた期間のあいだ１つ
の集団（ｃｏｌｌｅｃｔｉｏｎ）をセットし、次にその
画像に対する他のアドレスにおける第２の予め定められ
た期間のあいだその集団をセットし、それによって所定
の画像に対する１つの集団の異なるアドレスに対して異
なるセット時間を与えるように作用する。
各ピクセル要素は多数の選択的にセットしうる状態を有
することが好ましく、Ｎはその状態の数に等しい、従っ
て、グループ時間多重化と空間的デイザ−の順序を等し
くするこたによって、必要とされる所定の数のグレーレ
ベルに対して両方の技術の最高の能率的かつ効率的動作
が実現されうる。
することが好ましく、Ｎはその状態の数に等しい、従っ
て、グループ時間多重化と空間的デイザ−の順序を等し
くするこたによって、必要とされる所定の数のグレーレ
ベルに対して両方の技術の最高の能率的かつ効率的動作
が実現されうる。
本発明の他のＢ様によれば、表示のための１つの画像を
表わす信号の各部分に依存してそれぞれ選択的にセット
可能なピクセル要素の格子と、予め定められたシーケン
スに従ってピクセル要素の集団についての時間多重アド
レス指定を行う手段を具備し、 前記アドレス指定を行う手段が１つのグループの集団を
セットするための手段を含み、前記グループは、３また
はそれ以上に対応する整数である共通の比Ｎを有する等
比数列を呈示するアドレス指定シーケンスにおいて時間
的間隔を有する隣接集団とともに前記グループにおける
集団が系列を形成するようにアドレス指定シーケンスに
おける離間した複数の集団よりなる表示装置が提供され
る。
表わす信号の各部分に依存してそれぞれ選択的にセット
可能なピクセル要素の格子と、予め定められたシーケン
スに従ってピクセル要素の集団についての時間多重アド
レス指定を行う手段を具備し、 前記アドレス指定を行う手段が１つのグループの集団を
セットするための手段を含み、前記グループは、３また
はそれ以上に対応する整数である共通の比Ｎを有する等
比数列を呈示するアドレス指定シーケンスにおいて時間
的間隔を有する隣接集団とともに前記グループにおける
集団が系列を形成するようにアドレス指定シーケンスに
おける離間した複数の集団よりなる表示装置が提供され
る。
本発明は、付加的なラインおよびドライバ、または高解
度の空間的デイザ−あるいは非常に高速のスイッチング
時間を必要とすることなしに双安定のセット可能なピク
セル要素の効果的なアドレス指定を可能にする。
度の空間的デイザ−あるいは非常に高速のスイッチング
時間を必要とすることなしに双安定のセット可能なピク
セル要素の効果的なアドレス指定を可能にする。
１つのピクセルは１またはそれ以上の液晶セルよりなる
ことが好ましい。
ことが好ましい。
本発明はカラー表示とモノクロム表示に適用しうる。
本発明の他の態様は、本発明による表示装置のためのフ
ォーマット、例えば本明細書に記載されているフォーマ
ントの信号の発生に適したおよび／またはそのために設
計された装置を提供する。
ォーマット、例えば本明細書に記載されているフォーマ
ントの信号の発生に適したおよび／またはそのために設
計された装置を提供する。
本発明のさらに他のこのような信号の発生のために適し
たおよび／またはそのために設計された装置、およびそ
のような信号を処理するための装置を提供する。従って
、例えば、本発明は本明細書に記述されている態様で表
示装置をアドレスするために適したおよび／またはその
ために設計されたドライバ集積回路を具現する。
たおよび／またはそのために設計された装置、およびそ
のような信号を処理するための装置を提供する。従って
、例えば、本発明は本明細書に記述されている態様で表
示装置をアドレスするために適したおよび／またはその
ために設計されたドライバ集積回路を具現する。
本明細書の他の個所に示されているように、Ｎは３を含
む上述した任意の整数値を有しうる。特に有益な蓼は４
．８および！６であり、これらの値は空間的デイザ−に
ついて特に効果的かつ能率的な動作を与え、それぞれ２
．３および４のオーダ（すなわち各ピクセルにつき独立
にセットしうる領域の数）をそれぞれ有する。
む上述した任意の整数値を有しうる。特に有益な蓼は４
．８および！６であり、これらの値は空間的デイザ−に
ついて特に効果的かつ能率的な動作を与え、それぞれ２
．３および４のオーダ（すなわち各ピクセルにつき独立
にセットしうる領域の数）をそれぞれ有する。
以下図面を参照して本発明の実施例につき説明しよう。
この実施例は、空間的デイザ−を用いた強誘電体液晶表
示のように１つの組の個別的輝度状態を有する表示上に
グレースケールを与えるための技術に関する。
示のように１つの組の個別的輝度状態を有する表示上に
グレースケールを与えるための技術に関する。
それぞれＮの輝度または選択的にセットしうる状態を有
するピクセルによる表示の場合には、感知される輝度状
態またはグレーレベルの数が時間デイザ−（ｔｉｍｅ
ｄｉｔｈｅｒ）を用いることによって増加される。すな
わち、中間の輝度レベルが感知されるようなパターンで
ピクセルが１つの状態から他の状態に移動されうる。こ
れを行う都合の良い方法は長さがＮ倍だけ異なるＭ個の
時間周期を１組として用いることによる方法である。ピ
クセルは、ＮＨ個の利用しうる輝度またはグレーレベル
を与える各時間周期のあいだ異なる輝度レベルにセット
されうる。かくして、この技法は、表示上の所定のピク
セルがとりうる状態の数によってセットされる数底で作
用する。マトリクス・アドレスされる表示はライン毎に
（ｌｉｎｅ ｂｙ １ｉｎｅ）書き込まれ、これはウェ
イトづけされた時間周期を割当てる場合に考慮されなけ
ればならない。
するピクセルによる表示の場合には、感知される輝度状
態またはグレーレベルの数が時間デイザ−（ｔｉｍｅ
ｄｉｔｈｅｒ）を用いることによって増加される。すな
わち、中間の輝度レベルが感知されるようなパターンで
ピクセルが１つの状態から他の状態に移動されうる。こ
れを行う都合の良い方法は長さがＮ倍だけ異なるＭ個の
時間周期を１組として用いることによる方法である。ピ
クセルは、ＮＨ個の利用しうる輝度またはグレーレベル
を与える各時間周期のあいだ異なる輝度レベルにセット
されうる。かくして、この技法は、表示上の所定のピク
セルがとりうる状態の数によってセットされる数底で作
用する。マトリクス・アドレスされる表示はライン毎に
（ｌｉｎｅ ｂｙ １ｉｎｅ）書き込まれ、これはウェ
イトづけされた時間周期を割当てる場合に考慮されなけ
ればならない。
第１図は、Ｎ＝４およびＭ＝３の計画で得られるグレー
レベルの数の示している。３つの時間周期はり、、ＤＩ
およびＤｌであり、この場合、Ｄｘ／Ｄ、＝Ｄ、／Ｄｅ
＝４である。各時間周期において、各ピクセルは４つの
光出力状態０，１．２．３のうちの１つをとりうる。１
つの光出力に対するグレーレベルは、その光出力がゼロ
である場合にはそれに「１」を加えることによって与え
られ、ピクセルのグレーレベルは１である。
レベルの数の示している。３つの時間周期はり、、ＤＩ
およびＤｌであり、この場合、Ｄｘ／Ｄ、＝Ｄ、／Ｄｅ
＝４である。各時間周期において、各ピクセルは４つの
光出力状態０，１．２．３のうちの１つをとりうる。１
つの光出力に対するグレーレベルは、その光出力がゼロ
である場合にはそれに「１」を加えることによって与え
られ、ピクセルのグレーレベルは１である。
本発明によるマトリクス・アドレス指定計画（ｍａｔｒ
ｉｘ ａｄｄｒｅｓｓｉｎｇ ｓｃｈｅｍｅ）では、ウ
ェイトづけされた時間周期りいＤｌおよびＤオは、行が
第２図に示されているようにスキャンされる順序の論理
的結果である。これを実現するためには、表示のための
画像を表わす信号は、それぞれ格子内のピクセル要素を
セットする１３１数の部分よりなる。
ｉｘ ａｄｄｒｅｓｓｉｎｇ ｓｃｈｅｍｅ）では、ウ
ェイトづけされた時間周期りいＤｌおよびＤオは、行が
第２図に示されているようにスキャンされる順序の論理
的結果である。これを実現するためには、表示のための
画像を表わす信号は、それぞれ格子内のピクセル要素を
セットする１３１数の部分よりなる。
これらの各部分は複数のセクションまたはビットによっ
て構成され、１つのセクションはその画像における１つ
のアドレスについてピクセル要素に対するアドレス・デ
ータを表わす、従って、１つの部分におけるセクション
の数は、任意のピクセル要素が１つの画像に対してアド
レスされるアドレス時間の数に等しい０例えば、第２図
の計画では、各部分は３つのセクションＤ２、ＤＩ、Ｄ
ｏよりなり、各ピクセル要素は１つの画像に対して３回
アドレスされる。長さがＮ倍だけ異なるＭ個の時間周期
を有する計画の場合には、表示装置における行の最少数
は （ＮＭ−１）／（Ｎ −１”） である。
て構成され、１つのセクションはその画像における１つ
のアドレスについてピクセル要素に対するアドレス・デ
ータを表わす、従って、１つの部分におけるセクション
の数は、任意のピクセル要素が１つの画像に対してアド
レスされるアドレス時間の数に等しい０例えば、第２図
の計画では、各部分は３つのセクションＤ２、ＤＩ、Ｄ
ｏよりなり、各ピクセル要素は１つの画像に対して３回
アドレスされる。長さがＮ倍だけ異なるＭ個の時間周期
を有する計画の場合には、表示装置における行の最少数
は （ＮＭ−１）／（Ｎ −１”） である。
従って、この計画によって作動される表示装置は、（Ｎ
′″−１）／（Ｎ −１）のＸ倍に等しい行数を有する
。Ｘが１より大きい場合には、ピクセルの格子は行のミ
ニフィールドまたは集団に分割することができ、１つの
集団における行の数はＸに等しいことが好ましい、（ｘ
−１の場合には、集団は１つの行よりなる。） 第２図を参照すると、この図は底４グループ時間多重化
（ｂａｓｅ−ｆｏｕｒ ｇｒｏｕｐ ｔｉｍｅ ｍｕｌ
ｔｉｐｌｅｘｉｎｇ）を含む計画（ｓｃｈｅｍｅ）のマ
トリクス・アドレス指定を概略的に示しており、ピクセ
ル輝度はビットＤｔ−Ｄ１、Ｄ、で表わされ（底・フォ
アにおける３ビット時間デイザー）、各ピクセルは４つ
の状態を与える２つの選択的にセットしうる領域を有す
る（２ビット空間的デイザー）、大文字りはそのビット
を書き込まれる１つの集団を表わし、小文字ｄはピクセ
ル要素（例えば液晶セル）の双安定性のためにまだ表示
されているデータを表わす０表示は示されているように
２１個の行集団に分割される。
′″−１）／（Ｎ −１）のＸ倍に等しい行数を有する
。Ｘが１より大きい場合には、ピクセルの格子は行のミ
ニフィールドまたは集団に分割することができ、１つの
集団における行の数はＸに等しいことが好ましい、（ｘ
−１の場合には、集団は１つの行よりなる。） 第２図を参照すると、この図は底４グループ時間多重化
（ｂａｓｅ−ｆｏｕｒ ｇｒｏｕｐ ｔｉｍｅ ｍｕｌ
ｔｉｐｌｅｘｉｎｇ）を含む計画（ｓｃｈｅｍｅ）のマ
トリクス・アドレス指定を概略的に示しており、ピクセ
ル輝度はビットＤｔ−Ｄ１、Ｄ、で表わされ（底・フォ
アにおける３ビット時間デイザー）、各ピクセルは４つ
の状態を与える２つの選択的にセットしうる領域を有す
る（２ビット空間的デイザー）、大文字りはそのビット
を書き込まれる１つの集団を表わし、小文字ｄはピクセ
ル要素（例えば液晶セル）の双安定性のためにまだ表示
されているデータを表わす０表示は示されているように
２１個の行集団に分割される。
最初のグループ・アドレス周期では、最初の行集団が最
下位桁のビットＤ、を書き込まれる（これは空間的デイ
ザ−の２つのビットを書き込むことを含み、これらのビ
ットが４つのレベルを表わす）。同様に、集団５はそれ
の二番目の桁のビットＤ、を書き込まれ、そして集団２
１はそれの最上位桁のビットＤｔを書き込まれる。
下位桁のビットＤ、を書き込まれる（これは空間的デイ
ザ−の２つのビットを書き込むことを含み、これらのビ
ットが４つのレベルを表わす）。同様に、集団５はそれ
の二番目の桁のビットＤ、を書き込まれ、そして集団２
１はそれの最上位桁のビットＤｔを書き込まれる。
次に二番目のグループ・アドレス周期では、アドレスさ
れた集団は表示上を下方に１つの行集団だけ移動してい
る。従って、例えば、集団２はそれの最下位桁のピッ）
Ｄｏを書き込まれ、集団６はそれの二番目の行のビット
Ｄ、を書き込まれ、そして集団ｌ （これは集団２１の
後の集団である）はそれの最上位桁のビットをアドレス
される。
れた集団は表示上を下方に１つの行集団だけ移動してい
る。従って、例えば、集団２はそれの最下位桁のピッ）
Ｄｏを書き込まれ、集団６はそれの二番目の行のビット
Ｄ、を書き込まれ、そして集団ｌ （これは集団２１の
後の集団である）はそれの最上位桁のビットをアドレス
される。
集団１はそれの最下位桁ビットをオーバーライドされて
、最下位桁ビットは１つのグループ・アドレス周期のあ
いだだけ表示上にあったことに注意すべきである。同様
に、行５はそれの二番目の桁のビットを４つのグループ
・アドレス周期のあいだ表示上に有し、集団２１はそれ
の最上位桁ビットを１６の集団グループ・アドレス周期
のあいだ表示上に有する。このことは、行の集団に書き
込まれたデータは表示されるビットの桁に対応した時間
のあいだ表示されることを意味する。
、最下位桁ビットは１つのグループ・アドレス周期のあ
いだだけ表示上にあったことに注意すべきである。同様
に、行５はそれの二番目の桁のビットを４つのグループ
・アドレス周期のあいだ表示上に有し、集団２１はそれ
の最上位桁ビットを１６の集団グループ・アドレス周期
のあいだ表示上に有する。このことは、行の集団に書き
込まれたデータは表示されるビットの桁に対応した時間
のあいだ表示されることを意味する。
１つの行集団がアドレスされる場合には、４つのレベル
が底４計画（ｂａｓｅ ４ ｓｃｈｅｍｅ）に対してセ
ットされなければならない、これは２つの右頁域を２：
１の比でスケールされた空間的デイザ−の２ビツトを用
いて行われ、この場合、それら２つの領域は並列にアド
レスされなければならない。
が底４計画（ｂａｓｅ ４ ｓｃｈｅｍｅ）に対してセ
ットされなければならない、これは２つの右頁域を２：
１の比でスケールされた空間的デイザ−の２ビツトを用
いて行われ、この場合、それら２つの領域は並列にアド
レスされなければならない。
完全な６４レベル・グレースケール画像が２１のグルー
プ・アドレス周期で組立てられうろことがこの図かられ
かる。
プ・アドレス周期で組立てられうろことがこの図かられ
かる。
このようにして、計画は、アドレス指定シーケンスが底
４周期、すなわち既存の技術におけるｌ：２：４ではな
くて１：４１６等に従う点で既存のグループ時間多重技
術とは異なる。これにより、特定の行集団の再アドレス
指定間に異なる時間間隔を生ずる０時間デイザ−の３ビ
ツトを有する既存グループ時間多重計画は８つのグレー
レベルを表示されることができるが、空間的デイザ−の
２ビツトと時間デイザ−の３ビツトを有する本発明によ
る計画は６４のグレーレベルを表示することができるよ
うにする。
４周期、すなわち既存の技術におけるｌ：２：４ではな
くて１：４１６等に従う点で既存のグループ時間多重技
術とは異なる。これにより、特定の行集団の再アドレス
指定間に異なる時間間隔を生ずる０時間デイザ−の３ビ
ツトを有する既存グループ時間多重計画は８つのグレー
レベルを表示されることができるが、空間的デイザ−の
２ビツトと時間デイザ−の３ビツトを有する本発明によ
る計画は６４のグレーレベルを表示することができるよ
うにする。
一般的なＮ、Ｍ非順次グループ・アドレス指定計画では
、表示上の各色に対する各ピクセルにおける所要の輝度
はまず底（ｂａｓｅ） Ｎに変換される。
、表示上の各色に対する各ピクセルにおける所要の輝度
はまず底（ｂａｓｅ） Ｎに変換される。
最初のグループ・アドレス期間のあいだに、第１のグル
ープのラインのブロックが書き込まれる。
ープのラインのブロックが書き込まれる。
行集団数（Ｎｋ−１）／（Ｎ −１）はｋ （１−−−
−−Ｍ）に対するこのグループのメンバーである。
−−Ｍ）に対するこのグループのメンバーである。
これらの行集団のそれぞれにおける各ピクセルはそれの
輝度の底Ｎ表示の第に番目のデイジットを書き込まれて
いる。従って、この第１の行集団におけるピクセルはそ
れらに最低桁のデイジットを書き込まれており、行集団
Ｎ＋１におけるピクセルは次の最も高い桁のデイジット
を書き込まれており、以下同様である０次のグループ・
アドレス期間では、一連のグループが同様にして書き込
まれる。一連のグループは前のグループの各メンバーの
集団番号（ｃｏｌｌｅｃｔｉｏｎ ｎｕｍｂｅｒ）に１
モジユールｊ＋ｌを加えることによって得られる。ただ
し、ｊは行集団の合計数である。
輝度の底Ｎ表示の第に番目のデイジットを書き込まれて
いる。従って、この第１の行集団におけるピクセルはそ
れらに最低桁のデイジットを書き込まれており、行集団
Ｎ＋１におけるピクセルは次の最も高い桁のデイジット
を書き込まれており、以下同様である０次のグループ・
アドレス期間では、一連のグループが同様にして書き込
まれる。一連のグループは前のグループの各メンバーの
集団番号（ｃｏｌｌｅｃｔｉｏｎ ｎｕｍｂｅｒ）に１
モジユールｊ＋ｌを加えることによって得られる。ただ
し、ｊは行集団の合計数である。
１つのグループ内の行集団が書き込まれる順序はビクセ
ル要素の有限の切換速度によって導入される誤差を最小
限におさえるように選択される。
ル要素の有限の切換速度によって導入される誤差を最小
限におさえるように選択される。
各行集団内の行は、それらが書き込まれる毎にそのシー
ケンスが維持されるかぎり任意のシーケンスで書き込ま
れう石。
ケンスが維持されるかぎり任意のシーケンスで書き込ま
れう石。
好ましい配列では、特定の集団の行は互いに隣接してい
る。従って画像記憶器は単一の行ではなくて集団でアド
レスされることができるので、アドレス動作の数を減少
させることができる。第３図は行がＸの行を含む集団と
してアドレスされる表示装置のブロック回路図である。
る。従って画像記憶器は単一の行ではなくて集団でアド
レスされることができるので、アドレス動作の数を減少
させることができる。第３図は行がＸの行を含む集団と
してアドレスされる表示装置のブロック回路図である。
信号がビデオ信号源２から受信されそして完全な映像の
表示すなわちビデオ信号の１つの画像を表わすのに十分
な量のビデオ信号を保持する容量を有する画像記憶器４
に記憶される。この実施例の計画では、画像記憶器はピ
クセル当り８ビツトを保持する。最下位桁ビットおよび
ビット２は、４つの選択的にセット可能な状態を有する
１つのピクセルを形成する２つのサブビクセルの空間的
デイザ−を制御する。他の６つの２進ビツトは底４にお
けるビットＤいＤｌ、Ｄ、に対応する。このようにして
、各ピクセルにおける所要の輝度の底Ｎへの変換が２つ
の２進ビツトを用いて簡単に行われる。従って、Ｎ＝２
’であることが好ましい、ただし、ｙは情報記憶および
操作を容易にするための整数である。
表示すなわちビデオ信号の１つの画像を表わすのに十分
な量のビデオ信号を保持する容量を有する画像記憶器４
に記憶される。この実施例の計画では、画像記憶器はピ
クセル当り８ビツトを保持する。最下位桁ビットおよび
ビット２は、４つの選択的にセット可能な状態を有する
１つのピクセルを形成する２つのサブビクセルの空間的
デイザ−を制御する。他の６つの２進ビツトは底４にお
けるビットＤいＤｌ、Ｄ、に対応する。このようにして
、各ピクセルにおける所要の輝度の底Ｎへの変換が２つ
の２進ビツトを用いて簡単に行われる。従って、Ｎ＝２
’であることが好ましい、ただし、ｙは情報記憶および
操作を容易にするための整数である。
データが画像記憶器４からアクセスされ、この場合、各
ビットはそれの桁に応じて８つのＲＡＭ６のうちの１つ
に記憶される。１つの動作において表示の行集団に特定
の桁のビットを書き込むのに適した態様でＲＡＭ６から
データが検索される。
ビットはそれの桁に応じて８つのＲＡＭ６のうちの１つ
に記憶される。１つの動作において表示の行集団に特定
の桁のビットを書き込むのに適した態様でＲＡＭ６から
データが検索される。
その結果得られた信号は制御回路およびピクセルの格子
に作用するピクセル・ドライバに送られる。
に作用するピクセル・ドライバに送られる。
第４図はピクセル要素の格子（全体として２０で示され
ている）と、複数のドライバ２３とＸＯＲゲートを介し
て行のアドレス指定を選択するための第１のパーサタイ
ル・シフト機構２２と、複数のドライバ２５とＸＯＲゲ
ートを介して列のアドレス指定を選択するためのパーサ
タイル・シフト機構２４を具備した表示装置を示してい
る。各パーサタイル・シフト機構２２．２４は第１のレ
ジスタ手段２６．２８と第２のレジスタ手段３０．３２
を具備している０行をアドレスするための第２のレジス
タ手段３０に対する制御人力３４はハイに保持されてい
るので、このレジスタ手段３０はバイパス・モードにあ
る０列をアドレスするための第２のレジスタ手段３２に
対する制御入力３６はローに保持されているので、この
レジスタ手段３２は１つの組の透明ラッチとして作用す
る。
ている）と、複数のドライバ２３とＸＯＲゲートを介し
て行のアドレス指定を選択するための第１のパーサタイ
ル・シフト機構２２と、複数のドライバ２５とＸＯＲゲ
ートを介して列のアドレス指定を選択するためのパーサ
タイル・シフト機構２４を具備した表示装置を示してい
る。各パーサタイル・シフト機構２２．２４は第１のレ
ジスタ手段２６．２８と第２のレジスタ手段３０．３２
を具備している０行をアドレスするための第２のレジス
タ手段３０に対する制御人力３４はハイに保持されてい
るので、このレジスタ手段３０はバイパス・モードにあ
る０列をアドレスするための第２のレジスタ手段３２に
対する制御入力３６はローに保持されているので、この
レジスタ手段３２は１つの組の透明ラッチとして作用す
る。
第２のレジスタ手段３０がバイパス・モードにある場合
には、第１のレジスタ手段２６の１つにステージに存在
する情報が、第２のレジスタ手段３０における対応する
ステージがバイパスされるかあるいはエネイブルされう
るかを決定する。
には、第１のレジスタ手段２６の１つにステージに存在
する情報が、第２のレジスタ手段３０における対応する
ステージがバイパスされるかあるいはエネイブルされう
るかを決定する。
長さの点で１つの画像に対応した信号がビデオ信号源３
８から受信され、そしてこの信号が列データＲＡＭ （
第２図にさらに詳細に示されている）に記憶される。ピ
クセルが各色特性に対して書き込まれる順序はアドレス
ＲＯＭ４１によって決定される。マスク・データＲＯＭ
４２は、用いられている非順次グループ・アドレス指定
計画でアドレスされるべき１つのグループのメンバーの
位置を決定する。この悄幸旧よ行パーサタイル・シフト
機構２２の第１のシフトレジスタ手段２６に直列にロー
ドされる。スキャン・データＲＯＭ４４からのストロー
ブ・ビットは第２のシフトレジスタ手段にロードされ、
その位置が、どの行または行集団が第６図に関して後述
するようにしてストローブされるべきかを決定する。
８から受信され、そしてこの信号が列データＲＡＭ （
第２図にさらに詳細に示されている）に記憶される。ピ
クセルが各色特性に対して書き込まれる順序はアドレス
ＲＯＭ４１によって決定される。マスク・データＲＯＭ
４２は、用いられている非順次グループ・アドレス指定
計画でアドレスされるべき１つのグループのメンバーの
位置を決定する。この悄幸旧よ行パーサタイル・シフト
機構２２の第１のシフトレジスタ手段２６に直列にロー
ドされる。スキャン・データＲＯＭ４４からのストロー
ブ・ビットは第２のシフトレジスタ手段にロードされ、
その位置が、どの行または行集団が第６図に関して後述
するようにしてストローブされるべきかを決定する。
第６図は第５図のパーサタイル・シフト機構２２を用い
て行集団がどのようにしてストローブされるべきかを示
している。ｉ初の列はピクセル要素のブロツクの位置と
、第１のレジスタ手段２６および第２のレジスタ手段３
０の関連したレジスタ・ステージを示している。第２の
組の列は時間ｔいｔ４および【、において第１のレジス
タ手段２６のレジスタ・ステージに存在する情報を示し
ている。第３の組の列は時間１．−１．において第２の
レジスタ手段の対応するステージの出力を示している。
て行集団がどのようにしてストローブされるべきかを示
している。ｉ初の列はピクセル要素のブロツクの位置と
、第１のレジスタ手段２６および第２のレジスタ手段３
０の関連したレジスタ・ステージを示している。第２の
組の列は時間ｔいｔ４および【、において第１のレジス
タ手段２６のレジスタ・ステージに存在する情報を示し
ている。第３の組の列は時間１．−１．において第２の
レジスタ手段の対応するステージの出力を示している。
Ｍ＝３であるので、任意のステップでアドレスされるべ
き集団のグループは３つのメンバーよりなる０時間ｔ１
に対するグループの各メンバーの位置はピッ） ｒｌＪ
のような第１のレジスタ手段の適当なステージにロード
され、第１のレジスタ手段における他のステージにはビ
ット「０」がロードされる。ストローブ選択ビットは第
２のレジスタ手段に沿ってクロックされる。第１のレジ
スタ手段の各ステージから第２のレジスタ手段の１つの
ステージへの入力がローである場合、すなわちビット「
Ｏ」を含む場合には、そのステージはバイパスされる。
き集団のグループは３つのメンバーよりなる０時間ｔ１
に対するグループの各メンバーの位置はピッ） ｒｌＪ
のような第１のレジスタ手段の適当なステージにロード
され、第１のレジスタ手段における他のステージにはビ
ット「０」がロードされる。ストローブ選択ビットは第
２のレジスタ手段に沿ってクロックされる。第１のレジ
スタ手段の各ステージから第２のレジスタ手段の１つの
ステージへの入力がローである場合、すなわちビット「
Ｏ」を含む場合には、そのステージはバイパスされる。
第１のレジスタ手段の各ステージから第２のレジスタ手
段の１つのステージへの入力がハイである場合、すなわ
ちビットｒｌＪを含む場合には、そのステージはエネイ
ブルされ（ｅｎａｔ＋Ｉｅｄ）そしてピクセル要素の対
応した集団がストローブされる。このようにして、時間
ｔ、においで、集団ｌがストローブされる０時間ｔ２に
おいて、ストローブ・ビットが集団２をストローブする
ようにクロックされるであろうが、第１のレジスタ手段
における各ステージが「０」を含んでいるから、第２の
レジスタ手段におけるステージはバイパスされている。
段の１つのステージへの入力がハイである場合、すなわ
ちビットｒｌＪを含む場合には、そのステージはエネイ
ブルされ（ｅｎａｔ＋Ｉｅｄ）そしてピクセル要素の対
応した集団がストローブされる。このようにして、時間
ｔ、においで、集団ｌがストローブされる０時間ｔ２に
おいて、ストローブ・ビットが集団２をストローブする
ようにクロックされるであろうが、第１のレジスタ手段
における各ステージが「０」を含んでいるから、第２の
レジスタ手段におけるステージはバイパスされている。
従って、ストローブ・ビットは、バイパスされていない
第２のレジスタ手段における次のステージに送られる。
第２のレジスタ手段における次のステージに送られる。
このステージは５であり、従って時間ｔ、において集団
５がストローブされる。同様に時間ｔ、において、集団
２１がストローブされる０時間【、の後では、グループ
のすべてのメンバーがストローブされており、従って第
１のレジスタ手段に対する単一のクロックパルスがグル
ープ全体の位置を一緒に１つの位置だけ移動させ、そし
てアドレス指定が継続する。このようにして、集団がア
ドレスされる順序は１．５．２１，２．６．１３．７．
２等である。第１のレジスタ手段は第２のレジスタ手段
のどのステージがバイパスされるべきかを特定するため
のマスクとして作用する。
５がストローブされる。同様に時間ｔ、において、集団
２１がストローブされる０時間【、の後では、グループ
のすべてのメンバーがストローブされており、従って第
１のレジスタ手段に対する単一のクロックパルスがグル
ープ全体の位置を一緒に１つの位置だけ移動させ、そし
てアドレス指定が継続する。このようにして、集団がア
ドレスされる順序は１．５．２１，２．６．１３．７．
２等である。第１のレジスタ手段は第２のレジスタ手段
のどのステージがバイパスされるべきかを特定するため
のマスクとして作用する。
クロックパルス発生源４６からの周波数ｆのクロックパ
ルスがアドレスＲＯＭ４１を介して列デ−タＲＡＭ４０
に与えられると、ストローブされるべき次の集団のピク
セルに対するデータが列パーサタイル・シフト機構２４
の第１のシフトレジスタ手段２８に直列にロードされ、
従って第２のシフトレジスタ手段３２のレジスタ・ステ
ージの出力に存在する。従って、１つの行におけるピク
セルの数がｎであれば、周波数ｆ／ｎのクロックパルス
が行パーサタイル・シフト機構２２の第２のパーサタイ
ル・シフト機構２２の第２のシフトレジスタ手段３０に
与えられ、ストローブ・ビットをクロックし、かつ周波
数ｆ ／ ｎ ｍのクロックパルスが第１のシフトレジ
スタ手段２６に与えられて、そのグループのメンバーの
位置を一緒に１つだけ移動させる。（ｍの値は用いられ
ている特定の非順次グループ・アドレス指定計画によっ
て決定される。）マルチプレクス・コントローラ４８は
パーサタイル・シフト機構２２．２４にロードされるデ
ータに応答して列ドライバおよびＸＯＲゲート２３によ
って発生されるべき波形を制御する。
ルスがアドレスＲＯＭ４１を介して列デ−タＲＡＭ４０
に与えられると、ストローブされるべき次の集団のピク
セルに対するデータが列パーサタイル・シフト機構２４
の第１のシフトレジスタ手段２８に直列にロードされ、
従って第２のシフトレジスタ手段３２のレジスタ・ステ
ージの出力に存在する。従って、１つの行におけるピク
セルの数がｎであれば、周波数ｆ／ｎのクロックパルス
が行パーサタイル・シフト機構２２の第２のパーサタイ
ル・シフト機構２２の第２のシフトレジスタ手段３０に
与えられ、ストローブ・ビットをクロックし、かつ周波
数ｆ ／ ｎ ｍのクロックパルスが第１のシフトレジ
スタ手段２６に与えられて、そのグループのメンバーの
位置を一緒に１つだけ移動させる。（ｍの値は用いられ
ている特定の非順次グループ・アドレス指定計画によっ
て決定される。）マルチプレクス・コントローラ４８は
パーサタイル・シフト機構２２．２４にロードされるデ
ータに応答して列ドライバおよびＸＯＲゲート２３によ
って発生されるべき波形を制御する。
第２のレジスタ手段のステージの出力は排他的ＯＲ（Ｘ
ＯＲ）ゲートの入力に接続されており、これは列をアド
レスするために用いられる機構２４に対して特にを益で
ある。ＸＯＲゲートに対する真理値表が下記に示されて
いる。
ＯＲ）ゲートの入力に接続されており、これは列をアド
レスするために用いられる機構２４に対して特にを益で
ある。ＸＯＲゲートに対する真理値表が下記に示されて
いる。
ピクセル要素の集団または行がストローブされるマトリ
クス・アレイ型アドレス指定方法では、１つの列に与え
られる波形が、ストローブされた集団とその列との交差
点におけるピクセルがｒオン」であるか「オフ」である
かを決定する。第７図は列「オン」および対応する列「
オフ」波形の一例を示している。各波形５０．５２は、
形状は同じで極性が異なるサブ波形５０ａ、５０ｂおよ
び５２ａ１５２ｂに分割されうろことがわかる。
クス・アレイ型アドレス指定方法では、１つの列に与え
られる波形が、ストローブされた集団とその列との交差
点におけるピクセルがｒオン」であるか「オフ」である
かを決定する。第７図は列「オン」および対応する列「
オフ」波形の一例を示している。各波形５０．５２は、
形状は同じで極性が異なるサブ波形５０ａ、５０ｂおよ
び５２ａ１５２ｂに分割されうろことがわかる。
従って、「０」出力を有するステージによって負掘性す
、プ波形５０ａ、５２ｂが発生され、そしてｒｌＪ出力
を有するステージによって正極性サブ波形５０ｂ、５２
ａが発生されるとすると、正しい極性のサブ波形を発生
するために適当なレジスタ・ステージにおいて「０」ま
たはｒｌＪをロード・インすることによって列ドライバ
において所要の波形を発生することが可能である。その
レジスタ・ステージの出力はＸＯＲゲートの入力に接続
され、その入力に従う、ＸＯＲゲートの他の入力を「１
」に変更することによって他のサブ波形が簡単に発生さ
れうる。
、プ波形５０ａ、５２ｂが発生され、そしてｒｌＪ出力
を有するステージによって正極性サブ波形５０ｂ、５２
ａが発生されるとすると、正しい極性のサブ波形を発生
するために適当なレジスタ・ステージにおいて「０」ま
たはｒｌＪをロード・インすることによって列ドライバ
において所要の波形を発生することが可能である。その
レジスタ・ステージの出力はＸＯＲゲートの入力に接続
され、その入力に従う、ＸＯＲゲートの他の入力を「１
」に変更することによって他のサブ波形が簡単に発生さ
れうる。
任意の１つの画像において、Ｎ′４個のグレーレベルを
区別することが可能であるが、非常に明るいまたは非常
に暗い画像はコントラストを失うかあるいはフェードア
ウトするので、一連の画像におけるＮおよびＭの特定の
（りをもって輝度レベルの全ダイナミックレンジを表示
するのにはこれでは十分でないことがありうる。Ｎまた
はＭの値を増大させることの代替的手段として、先行フ
ィールドの平均輝度レベルが４ビツトＡ／Ｄコンバータ
の基準電圧をセットする適応グレースケール計画が用い
られうる。アナログ信号がＡ／Ｄコンバータによって変
換され、４ビツトが先行画像の輝度の範囲をスケールし
、各画像においてＮＮ個のグレーレベルが常に解像され
うるようにする。これは先行フレームのある画定された
平均輝度レベルを検知することによって実現されるが、
そのレベルはステップ比較器で１００％輝度レベルと比
較され、その比較器が輝度レベルをスケールするための
可変基準電圧を与える。
区別することが可能であるが、非常に明るいまたは非常
に暗い画像はコントラストを失うかあるいはフェードア
ウトするので、一連の画像におけるＮおよびＭの特定の
（りをもって輝度レベルの全ダイナミックレンジを表示
するのにはこれでは十分でないことがありうる。Ｎまた
はＭの値を増大させることの代替的手段として、先行フ
ィールドの平均輝度レベルが４ビツトＡ／Ｄコンバータ
の基準電圧をセットする適応グレースケール計画が用い
られうる。アナログ信号がＡ／Ｄコンバータによって変
換され、４ビツトが先行画像の輝度の範囲をスケールし
、各画像においてＮＮ個のグレーレベルが常に解像され
うるようにする。これは先行フレームのある画定された
平均輝度レベルを検知することによって実現されるが、
そのレベルはステップ比較器で１００％輝度レベルと比
較され、その比較器が輝度レベルをスケールするための
可変基準電圧を与える。
適応スケーリングに従って表示上の輝度レベルを変化さ
せるために、１つのグループにおける集団がアドレス・
ラインの一部にわたってスケールされる。そのグループ
の外のアドレス・ラインは、最上位桁ビットを表示する
周期の終りにおいて付加的なビットの情報の形で与えら
れるブランキングパルスによってブランキングされる。
せるために、１つのグループにおける集団がアドレス・
ラインの一部にわたってスケールされる。そのグループ
の外のアドレス・ラインは、最上位桁ビットを表示する
周期の終りにおいて付加的なビットの情報の形で与えら
れるブランキングパルスによってブランキングされる。
これが利用しうるグループ書き込み時間を少なくする。
この適応特徴が本質的に自動コントローラおよび譚皮調
節を与え、輝度に関係なく少なくともＮ８個のグレーレ
ベルが任意のシーンに常に含まれうるようになされる。
節を与え、輝度に関係なく少なくともＮ８個のグレーレ
ベルが任意のシーンに常に含まれうるようになされる。
上述した実施例については種々の変更が特許請求の範囲
内で可能であることが当業者には明らかであろう。
内で可能であることが当業者には明らかであろう。
第１図は本発明に従って提供される計画の一例で得られ
るグレーレベルの数を示す図、第２図は本発明に従って
提供されるアドレス指定計画を概略的に示す図、第３図
は本発明を実施するための回路のブロック図、第４図は
本発明に従って提供される表示装置のブロック回路図、
第５図は第４図の装置における行の集団についてのアド
レス指定を示す図、第６図はマトリクス・アレイ型アド
レス指定方法に対する典型的な列波形を示す図である。 図面において、２はビデオ信号源、４は画像記憶器、６
はＲＡＭ、２０はビクセル要素の格子、２２．２４はパ
ーサタイル・シフト機構、２６．２８．３０．３２はレ
ジスタ手段、３８はビデオ信号源、４０は列データＲＡ
Ｍ、４１はアドレスＲＯＭ、４２はマスク・データＲＯ
Ｍ、４４はスキャン・データＲＯＭをそれぞれ示す。
るグレーレベルの数を示す図、第２図は本発明に従って
提供されるアドレス指定計画を概略的に示す図、第３図
は本発明を実施するための回路のブロック図、第４図は
本発明に従って提供される表示装置のブロック回路図、
第５図は第４図の装置における行の集団についてのアド
レス指定を示す図、第６図はマトリクス・アレイ型アド
レス指定方法に対する典型的な列波形を示す図である。 図面において、２はビデオ信号源、４は画像記憶器、６
はＲＡＭ、２０はビクセル要素の格子、２２．２４はパ
ーサタイル・シフト機構、２６．２８．３０．３２はレ
ジスタ手段、３８はビデオ信号源、４０は列データＲＡ
Ｍ、４１はアドレスＲＯＭ、４２はマスク・データＲＯ
Ｍ、４４はスキャン・データＲＯＭをそれぞれ示す。
Claims (1)
- 【特許請求の範囲】 １、それぞれ選択的にセットしうるピクセル要素の格子
を有する表示装置の動作方法であって、表示のための画
像を表わす信号を受信し、 各画像に対し複数のアドレス回数だけピクセル要素の集
団を時間多重アドレス指定することよりなり、 前記アドレス指定工程が１つのグループの集団をセット
することを含み、そのグループは、３またはそれ以上に
対応する整数である共通の比Ｎを有する等比数列を呈示
するアドレス指定シーケンスにおいて時間的間隔を有す
る隣接集団とともに前記グループにおける集団が系列を
形成するようにアドレス指定シーケンスにおける離間し
た複数の集団よりなる表示装置の動作方法。 ２、各ピクセル要素が多数の選択的にセット可能な状態
を有し、かつＮが前記状態の数に等しい請求項１の方法
。 ３、前記画像を表わす信号がそれぞれ前記格子における
各ピクセル要素をセットするためのデータを表わす複数
の部分を含み、それらの各部分はそれぞれ前記画像に対
する１つのアドレス時間に関して前記各ピクセル要素に
対するアドレス指定データを表わす複数のセクションよ
りなり、前記アドレス回数がセクションの数に等しい請
求項１または２の方法。 ４、前記アドレス指定工程が、ピクセル・データの各最
初のセクションに従ってかつ画定されたアドレス周期内
で順次的に前記グループの第１の集団のすべてのピクセ
ルをセットする工程と、ピクセル・データの各第２セク
ションに従って前記グループの第２の集団のすべてのピ
クセルをセットする工程を含む請求項３の方法。 ５、前記格子がピクセル要素の多数の行よりなり、かつ
この行の数が（Ｎ＾Ｍ−１）／（Ｎ−１）の倍数に等し
く、Ｍが前記アドレス回数に等しい請求項１〜４のうち
の１つによる方法。 ６、各集団が複数の隣接行よりなる請求項５の方法。 ７、各集団が複数の行よりなり、各集団における行の数
は格子内の行の数を（Ｎ＾Ｍ−１）／（Ｎ−１）で割っ
たものである請求項５または６の方法。 ８、各集団がピクセル要素の単一の行よりなる請求項１
〜５のうちの１つによる方法。 ９、第１の画像に対する平均輝度レベルの値を発生しか
つ前記第１の画像に対する前記値に従って次の画像にお
ける各グループに対するピクセル・データのセクション
のスケーリングを行う工程をさらに含む請求項１〜８の
うちの１つによる方法。 １０、表示のための１つの画像を表わす信号の各部分に
依存してそれぞれ選択的にセット可能なピクセル要素の
格子と、 予め定められたシーケンスに従ってピクセル要素の集団
についての時間多重アドレス指定を行う手段を具備し、 前記アドレス指定を行う手段が１つのグループの集団を
セットするための手段を含み、前記グループは、３また
はそれ以上に対応する整数である共通の比Ｎを有する等
比数列を呈示するアドレス指定シーケンスにおいて時間
的間隔を有する隣接集団とともに前記グループにおける
集団が系列を形成するようにアドレス指定シーケンスに
おける離間した複数の集団よりなる表示装置。 １１、各ピクセル要素が多数の選択的にセット可能な状
態を有し、かつＮが前記状態の数に等しい請求項１０の
表示装置。 １２、前記格子がピクセル要素の多数の行よりなり、そ
の行の数が（Ｎ＾Ｍ−１）／（Ｎ−１）であり、ただし
Ｍは前記アドレス回数に等しい請求項１０または１１の
表示装置。１３、各集団が複数の隣接行よりなる請求項
１２の表示装置。 １４、各集団が複数の行よりなり、各集団における行の
数は格子内の行の数を（Ｎ＾Ｍ−１）／（Ｎ−１）で割
ったものである請求項１２または１３の表示装置。 １５、各集団がピクセル要素の単一の列よりなる請求項
１０〜１２のうちの１つによる表示装置。
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|---|---|---|---|
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