JPH0243431B2 - - Google Patents
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- Publication number
- JPH0243431B2 JPH0243431B2 JP22823284A JP22823284A JPH0243431B2 JP H0243431 B2 JPH0243431 B2 JP H0243431B2 JP 22823284 A JP22823284 A JP 22823284A JP 22823284 A JP22823284 A JP 22823284A JP H0243431 B2 JPH0243431 B2 JP H0243431B2
- Authority
- JP
- Japan
- Prior art keywords
- resistor
- zener diode
- capacitor
- transistor
- pulse width
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000003990 capacitor Substances 0.000 claims description 20
- 238000004804 winding Methods 0.000 description 11
- 238000010586 diagram Methods 0.000 description 7
- 230000000694 effects Effects 0.000 description 2
- 230000017525 heat dissipation Effects 0.000 description 2
- 230000010355 oscillation Effects 0.000 description 2
- 230000002159 abnormal effect Effects 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 238000009499 grossing Methods 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 238000003079 width control Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of dc power input into dc power output
- H02M3/22—Conversion of dc power input into dc power output with intermediate conversion into ac
- H02M3/24—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters
- H02M3/28—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
Description
【発明の詳細な説明】
〔産業上の技術分野〕
本発明は、入力電圧が所定値に達した時にパル
ス幅変調制御回路に対して一定時間だけ電源供給
を行うと共に、再起動を確実に行い得るようにし
たスイツチング・レギユレータ起動回路に関する
ものである。
ス幅変調制御回路に対して一定時間だけ電源供給
を行うと共に、再起動を確実に行い得るようにし
たスイツチング・レギユレータ起動回路に関する
ものである。
第３図は従来のスイツチング・レギユレータ起
動回路の１例のブロツク図である。第３図におい
て、１と２は抵抗、３と４はトランジスタ、５な
いし７はダイオード、８と９はコンデンサ、１０
はツエナ・ダイオード、１１は変圧器の１次捲
線、１２は変圧器の２次捲線、１３は変圧器の３
次捲線、１４はパルス幅変調制御回路をそれぞれ
示している。入力端子Ti間に直流電圧が印加さ
れ、その値が所定値を越えると、ツエナ・ダイオ
ード１０が電流を流し、電流が抵抗１、トランジ
スタ３、ダイオード３を経由してパルス幅変調制
御回路１４に流れる。パルス幅変調制御回路１４
は、起動されると、トランジスタ４をオン／オフ
する。トランジスタ４がオン／オフすると、１次
捲線１１に電流が断続的に流れ、これにより２次
捲線１２及び３次捲線１３に電圧が誘起され、負
荷に電流が流れる。３次捲線１３に電圧が誘起さ
れると、パルス幅制御回路１４には３次捲線１３
から電力が供給され、トランジスタ３及びダイオ
ード５はオフする。第３図において、負荷側が短
絡したり、あるいはパルス幅変調制御回路１４が
故障して発振を停止したりすると、電力は抵抗
１、トランジスタ３及びダイオード５を介してパ
ルス幅変調制御回路１４に供給され、このとき抵
抗１及びトランジスタ３の発熱は最大となり、そ
の放熱も充分考慮して設計しなければならず、形
状が大きくなり、コスト・アツプを招く。
動回路の１例のブロツク図である。第３図におい
て、１と２は抵抗、３と４はトランジスタ、５な
いし７はダイオード、８と９はコンデンサ、１０
はツエナ・ダイオード、１１は変圧器の１次捲
線、１２は変圧器の２次捲線、１３は変圧器の３
次捲線、１４はパルス幅変調制御回路をそれぞれ
示している。入力端子Ti間に直流電圧が印加さ
れ、その値が所定値を越えると、ツエナ・ダイオ
ード１０が電流を流し、電流が抵抗１、トランジ
スタ３、ダイオード３を経由してパルス幅変調制
御回路１４に流れる。パルス幅変調制御回路１４
は、起動されると、トランジスタ４をオン／オフ
する。トランジスタ４がオン／オフすると、１次
捲線１１に電流が断続的に流れ、これにより２次
捲線１２及び３次捲線１３に電圧が誘起され、負
荷に電流が流れる。３次捲線１３に電圧が誘起さ
れると、パルス幅制御回路１４には３次捲線１３
から電力が供給され、トランジスタ３及びダイオ
ード５はオフする。第３図において、負荷側が短
絡したり、あるいはパルス幅変調制御回路１４が
故障して発振を停止したりすると、電力は抵抗
１、トランジスタ３及びダイオード５を介してパ
ルス幅変調制御回路１４に供給され、このとき抵
抗１及びトランジスタ３の発熱は最大となり、そ
の放熱も充分考慮して設計しなければならず、形
状が大きくなり、コスト・アツプを招く。
第４図は従来のスイツチング・レギユレータ起
動回路の他例のブロツク図である。第４図におい
て、１５は抵抗、１６はコンデンサをそれぞれ示
している。なお、第３図と同一符号は同一物を示
している。第４図において、入力端子Ti間に印
加される電圧が所定値を越えると、コンデンサ１
６、抵抗２及びダイオードを経由してパルス幅変
調制御回路１４に電力が供給されてパルス幅変調
制御回路１４が起動され、コンデンサ１６の電圧
が所定値に達すると、上記のパスによるパルス幅
変調制御回路１４への電力供給は停止される。パ
ルス幅変調制御回路１４が起動された後の動作は
第３図のものと略ぼ同じである。
動回路の他例のブロツク図である。第４図におい
て、１５は抵抗、１６はコンデンサをそれぞれ示
している。なお、第３図と同一符号は同一物を示
している。第４図において、入力端子Ti間に印
加される電圧が所定値を越えると、コンデンサ１
６、抵抗２及びダイオードを経由してパルス幅変
調制御回路１４に電力が供給されてパルス幅変調
制御回路１４が起動され、コンデンサ１６の電圧
が所定値に達すると、上記のパスによるパルス幅
変調制御回路１４への電力供給は停止される。パ
ルス幅変調制御回路１４が起動された後の動作は
第３図のものと略ぼ同じである。
第４図の従来例においては、電源投入時に抵抗
２及びツエナ・ダイオード１０を流れる電流を充
分大きくしなければ、スムーズに起動がかから
ず、また、一旦電源を切つた場合、コンデンサ１
６と抵抗１５で構成されデイスチヤージ回路で再
起動に充分な位にコンデンサ１６に蓄えられた電
荷を放電する迄にかなりの時間を必要とする。
２及びツエナ・ダイオード１０を流れる電流を充
分大きくしなければ、スムーズに起動がかから
ず、また、一旦電源を切つた場合、コンデンサ１
６と抵抗１５で構成されデイスチヤージ回路で再
起動に充分な位にコンデンサ１６に蓄えられた電
荷を放電する迄にかなりの時間を必要とする。
本発明は、上記の考察に基づくものであつて、
部品の小型化が可能なこと、再起動を確実に行い
得ること及び製造コストが廉価なこと等の特徴を
持つスイツチング・レギユレータ起動回路を提供
することを目的としている。
部品の小型化が可能なこと、再起動を確実に行い
得ること及び製造コストが廉価なこと等の特徴を
持つスイツチング・レギユレータ起動回路を提供
することを目的としている。
そしてそのため、本発明のスイツチング・レギ
ユレータ起動回路は、１対の入力端子と、抵抗、
第１のツエナ・ダイオード、第２のツエナ・ダイ
オード及び第３のツエナ・ダイオードより成り且
つ上記１対の入力端子間に接続された第１の直列
回路と、パルス幅変調制御回路と、コレクタが上
記一方の入力端子に直接又は抵抗を介して接続さ
れ、エミツタが上記パルス幅変調制御回路に接続
され、ベースが上記第２のツエナ・ダイオードと
第３のツエナ・ダイオードの接合点Ａに接続され
た第１のトランジスタと、上記接合点Ａと他方の
入力端子間に接続された抵抗と、上記第１のツエ
ナ・ダイオードと第２のツエナ・ダイオードの接
合点Ｂと他方の入力端子間に接続された抵抗とコ
ンデンサより成る第２の直列回路と、エミツタが
上記接合点Ｂに接続され、コレクタが上記他方の
入力端子に接続され、ベースが抵抗を介して上記
コンデンサと抵抗の接合点に接続された第２のト
ランジスタと、上記コンデンサと並列接続された
抵抗とを具備することを特徴としている。
ユレータ起動回路は、１対の入力端子と、抵抗、
第１のツエナ・ダイオード、第２のツエナ・ダイ
オード及び第３のツエナ・ダイオードより成り且
つ上記１対の入力端子間に接続された第１の直列
回路と、パルス幅変調制御回路と、コレクタが上
記一方の入力端子に直接又は抵抗を介して接続さ
れ、エミツタが上記パルス幅変調制御回路に接続
され、ベースが上記第２のツエナ・ダイオードと
第３のツエナ・ダイオードの接合点Ａに接続され
た第１のトランジスタと、上記接合点Ａと他方の
入力端子間に接続された抵抗と、上記第１のツエ
ナ・ダイオードと第２のツエナ・ダイオードの接
合点Ｂと他方の入力端子間に接続された抵抗とコ
ンデンサより成る第２の直列回路と、エミツタが
上記接合点Ｂに接続され、コレクタが上記他方の
入力端子に接続され、ベースが抵抗を介して上記
コンデンサと抵抗の接合点に接続された第２のト
ランジスタと、上記コンデンサと並列接続された
抵抗とを具備することを特徴としている。
以下、本発明を図面を参照しつつ説明する。第
１図は本発明の１実施例のブロツク図である。第
１図において、１７ないし２１は抵抗、２２はト
ランジスタ、２３はコンデンサ、２４ないし２６
はツエナ・ダイオードをそれぞれ示している。な
お、第３図と同一符号は同一物をそれぞれ示して
いる。
１図は本発明の１実施例のブロツク図である。第
１図において、１７ないし２１は抵抗、２２はト
ランジスタ、２３はコンデンサ、２４ないし２６
はツエナ・ダイオードをそれぞれ示している。な
お、第３図と同一符号は同一物をそれぞれ示して
いる。
入力端子Ti間に印加される直流電圧は130V±
20％である。例えば、抵抗１７は20Kで1/2Ｗ、
抵抗１８は27K、抵抗１９は47K、抵抗２０は
27K、抵抗２１は100K、コンデンサ２３は100μ、
ツエナ・ダイオード２４はRD82F（日本電気）、
ツエナ・ダイオード２５はRP4.7EB（日本電気）、
ツエナ・ダイオード２６はRD8.2EB（日本電気）
である。
20％である。例えば、抵抗１７は20Kで1/2Ｗ、
抵抗１８は27K、抵抗１９は47K、抵抗２０は
27K、抵抗２１は100K、コンデンサ２３は100μ、
ツエナ・ダイオード２４はRD82F（日本電気）、
ツエナ・ダイオード２５はRP4.7EB（日本電気）、
ツエナ・ダイオード２６はRD8.2EB（日本電気）
である。
電源投入後、入力端子に印加される電圧がツエ
ナ・ダイオード２４，２５及び２６が決定される
電圧以上になると、トランジスタ３及びダイオー
ド５を介してパルス幅変調制御回路１４に電力を
供給される。これと同時にコンデンサ２３の充電
が開始され、所定時間後にトランジスタ２２がオ
ンし、ツエナ・ダイオード２５と２６よりなる直
列回路の両端をシヤントする。この時のトランジ
スタ２２のエミツタ―コレクタ間の電圧は2V程
度である。上記の直列回路がトランジスタ２２の
オンによりシヤントされると、トランジスタ３の
ベースに印可される電圧は0Vになり、トランジ
スタ３の出力電圧は0V付近まで降下する。この
ため、出力短絡、或いは発振停止等の異常事態が
連続することによるトランジスタ３等の放熱の問
題が無くなり、また、このときパルス幅変調制御
回路１４に電力が供給されないので、メイン・ト
ランジスタ及び二次側整流ダイオードの保護回路
としても動作する。電源がオフされると、コンデ
ンサ２３の電荷は、トランジスタ２２のベース・
エミツタ間ダイオードと抵抗１９よりなる回路及
びこれに並列な抵抗１８を通つて急速に放電され
る。このため、再起動は、第４図の従来方式に比
べ確実に行うことが出来る。なお、第３図に示す
ように、トランジスタ３のコレクタを抵抗を介し
て一方の入力端子に接続しても良い。
ナ・ダイオード２４，２５及び２６が決定される
電圧以上になると、トランジスタ３及びダイオー
ド５を介してパルス幅変調制御回路１４に電力を
供給される。これと同時にコンデンサ２３の充電
が開始され、所定時間後にトランジスタ２２がオ
ンし、ツエナ・ダイオード２５と２６よりなる直
列回路の両端をシヤントする。この時のトランジ
スタ２２のエミツタ―コレクタ間の電圧は2V程
度である。上記の直列回路がトランジスタ２２の
オンによりシヤントされると、トランジスタ３の
ベースに印可される電圧は0Vになり、トランジ
スタ３の出力電圧は0V付近まで降下する。この
ため、出力短絡、或いは発振停止等の異常事態が
連続することによるトランジスタ３等の放熱の問
題が無くなり、また、このときパルス幅変調制御
回路１４に電力が供給されないので、メイン・ト
ランジスタ及び二次側整流ダイオードの保護回路
としても動作する。電源がオフされると、コンデ
ンサ２３の電荷は、トランジスタ２２のベース・
エミツタ間ダイオードと抵抗１９よりなる回路及
びこれに並列な抵抗１８を通つて急速に放電され
る。このため、再起動は、第４図の従来方式に比
べ確実に行うことが出来る。なお、第３図に示す
ように、トランジスタ３のコレクタを抵抗を介し
て一方の入力端子に接続しても良い。
第２図は第１図の実施例の動作を説明する図で
ある。交流電圧の全波整流器出力が抵抗とコンデ
ンサとより成る平滑回路で平滑化され、これが入
力端子Tiに印加される。電源スイツチが閉じら
れると、入力端子Tiに印加される電圧が約94Vに
なると、トランジスタ３の出力電圧は急激に上昇
する。この出力電圧は、高さが約7.5Vで幅が約
240msのパルス波形を持つ。
ある。交流電圧の全波整流器出力が抵抗とコンデ
ンサとより成る平滑回路で平滑化され、これが入
力端子Tiに印加される。電源スイツチが閉じら
れると、入力端子Tiに印加される電圧が約94Vに
なると、トランジスタ３の出力電圧は急激に上昇
する。この出力電圧は、高さが約7.5Vで幅が約
240msのパルス波形を持つ。
以上の説明から明らかなように、本発明によれ
ば、部品が小型化できること、再起動を確実に行
い得ること及び廉価で有ること等の顕著な効果を
奏することが出来る。
ば、部品が小型化できること、再起動を確実に行
い得ること及び廉価で有ること等の顕著な効果を
奏することが出来る。
第１図は本発明の１実施例のブロツク図、第２
図はその動作を説明するための図、第３図及び第
４図は従来のスイツチング・レギユレータ起動回
路のブロツク図である。 １と２……抵抗、３と４……トランジスタ、５
ないし７……ダイオード、８と９……コンデン
サ、１０……ツエナ・ダイオード、１１……変圧
器の１次捲線、１２……変圧器の２次捲線、１３
……変圧器の３次捲線、１４……パルス幅変調制
御回路、１５……抵抗、１６……コンデンサ、１
７ないし２１……抵抗、２２……トランジスタ、
２３……コンデンサ、２４ないし２６……ツエ
ナ・ダイオード。
図はその動作を説明するための図、第３図及び第
４図は従来のスイツチング・レギユレータ起動回
路のブロツク図である。 １と２……抵抗、３と４……トランジスタ、５
ないし７……ダイオード、８と９……コンデン
サ、１０……ツエナ・ダイオード、１１……変圧
器の１次捲線、１２……変圧器の２次捲線、１３
……変圧器の３次捲線、１４……パルス幅変調制
御回路、１５……抵抗、１６……コンデンサ、１
７ないし２１……抵抗、２２……トランジスタ、
２３……コンデンサ、２４ないし２６……ツエ
ナ・ダイオード。
Claims (1)
- １ １対の入力端子と、抵抗、第１のツエナ・ダ
イオード、第２のツエナ・ダイオード及び第３の
ツエナ・ダイオードより成り且つ上記１対の入力
端子間に接続された第１の直列回路と、パルス幅
変調制御回路と、コレクタが上記一方の入力端子
に直接又は抵抗を介して接続され、エミツタが上
記パルス幅変調制御回路に接続され、ベースが上
記第２のツエナ・ダイオードと第３のツエナ・ダ
イオードの接合点Ａに接続された第１のトランジ
スタと、上記接合点Ａと他方の入力端子間に接続
された抵抗と、上記第１のツエナ・ダイオードと
第２のツエナ・ダイオードの接合点Ｂと他方の入
力端子間に接続された抵抗とコンデンサより成る
第２の直列回路と、エミツタが上記接合点Ｂに接
続され、コレクタが上記他方の入力端子に接続さ
れ、ベースが抵抗を介して上記コンデンサと抵抗
の接合点に接続された第２のトランジスタと、上
記コンデンサと並列接続された抵抗とを具備する
ことを特徴とするスイツチング・レギユレータ起
動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22823284A JPS61106066A (ja) | 1984-10-30 | 1984-10-30 | スイツチング・レギユレ−タ起動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22823284A JPS61106066A (ja) | 1984-10-30 | 1984-10-30 | スイツチング・レギユレ−タ起動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61106066A JPS61106066A (ja) | 1986-05-24 |
| JPH0243431B2 true JPH0243431B2 (ja) | 1990-09-28 |
Family
ID=16873234
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22823284A Granted JPS61106066A (ja) | 1984-10-30 | 1984-10-30 | スイツチング・レギユレ−タ起動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61106066A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0732600B2 (ja) * | 1988-06-17 | 1995-04-10 | 株式会社村田製作所 | スイッチング電源回路 |
| JPH0640473Y2 (ja) * | 1989-08-31 | 1994-10-19 | 富士通電装株式会社 | スイッチングレギュレータ |
-
1984
- 1984-10-30 JP JP22823284A patent/JPS61106066A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61106066A (ja) | 1986-05-24 |
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