JPH02290393A - 色信号同期回路 - Google Patents
色信号同期回路Info
- Publication number
- JPH02290393A JPH02290393A JP9802789A JP9802789A JPH02290393A JP H02290393 A JPH02290393 A JP H02290393A JP 9802789 A JP9802789 A JP 9802789A JP 9802789 A JP9802789 A JP 9802789A JP H02290393 A JPH02290393 A JP H02290393A
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- signal
- circuit
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- Pending
Links
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- 238000000034 method Methods 0.000 claims description 5
- 239000000284 extract Substances 0.000 claims description 2
- 230000010355 oscillation Effects 0.000 abstract description 7
- 238000000605 extraction Methods 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 8
- 239000003990 capacitor Substances 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 2
- 239000013078 crystal Substances 0.000 description 1
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- 230000001360 synchronised effect Effects 0.000 description 1
Landscapes
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は色信号同期回路に閏し、特に、A/D変換器を
備えて構成され、所定の基準バースト信号に位相同期し
た色信号を含むビデオ信号を生成する色信号同期回路に
閏する. 〔従来の技術〕 一般に、色信号同期回路は、外部のビデオ信号のバース
トに内部の色信号の位相を同期させるための回路であり
、従来より、主に自動位相制御方式、バースト注入ロッ
ク方式および水晶リンギング方式などが用いられている
。
備えて構成され、所定の基準バースト信号に位相同期し
た色信号を含むビデオ信号を生成する色信号同期回路に
閏する. 〔従来の技術〕 一般に、色信号同期回路は、外部のビデオ信号のバース
トに内部の色信号の位相を同期させるための回路であり
、従来より、主に自動位相制御方式、バースト注入ロッ
ク方式および水晶リンギング方式などが用いられている
。
第3図に示されるのは、現在、一般的に用いられている
自動位相制御方式による、A/D変換器を用いた色信号
同期回路の一例を示すブロック図であり、第4図は、前
記従来例におけるA/D変換器のクロツクの位相補正の
一例を示す回路図である。
自動位相制御方式による、A/D変換器を用いた色信号
同期回路の一例を示すブロック図であり、第4図は、前
記従来例におけるA/D変換器のクロツクの位相補正の
一例を示す回路図である。
第3図において、それぞれ、端子53および54から入
力されるバースト抜取り信号106および色信号107
と、タイミング発生回路l1において発生される内部バ
ースト信号109は、位相比較回路8に入力され、色信
号107と内部バースト信号109との位相比較が行わ
れて、色信号107の内部バースト信号109に対する
位相の進み、または遅れが、バースト抜取り信号106
のタイミングにおいて検出される。
力されるバースト抜取り信号106および色信号107
と、タイミング発生回路l1において発生される内部バ
ースト信号109は、位相比較回路8に入力され、色信
号107と内部バースト信号109との位相比較が行わ
れて、色信号107の内部バースト信号109に対する
位相の進み、または遅れが、バースト抜取り信号106
のタイミングにおいて検出される。
位相比較回路8から出力される位相比較出力信号は、低
域フィルタ9に入力されて直流電圧レベルに変換され、
電圧制御発振器10に入力される。
域フィルタ9に入力されて直流電圧レベルに変換され、
電圧制御発振器10に入力される。
電圧制御発振器10においては、前記直流電圧レベルに
対応する周波数の発振出力が原発振信号として出力され
、タイミング発生回路11に入力される。
対応する周波数の発振出力が原発振信号として出力され
、タイミング発生回路11に入力される。
一方、端子55からは、ビデオ信号108がA/D変換
器12に入力され、デジタル・ビデオ信号に変換されて
デコード回路l4に入力される。デコード回路14にお
いては、前記デジタル・ビデオ信号は、R−Y,B−Y
およびYの色差信号に変換されて内部回路13に出力さ
れる。
器12に入力され、デジタル・ビデオ信号に変換されて
デコード回路l4に入力される。デコード回路14にお
いては、前記デジタル・ビデオ信号は、R−Y,B−Y
およびYの色差信号に変換されて内部回路13に出力さ
れる。
上述した従来の色信号同期回路においては、タイミング
発生回路から出力される内部バースト信号と、色信号中
のバースト信号とを比較して位相差を補正しているが、
ビデオ信号がA/D変換器においてA/D変換される段
階において生じる入力遅延時間により、再度位相差が生
じることになる。
発生回路から出力される内部バースト信号と、色信号中
のバースト信号とを比較して位相差を補正しているが、
ビデオ信号がA/D変換器においてA/D変換される段
階において生じる入力遅延時間により、再度位相差が生
じることになる。
このA/D変換器における位相差を無くするなめに、第
4図に示されるように、端子56から入力されるビデオ
信号を、A/D変換して端子57より出力するA/D変
換器l5においては、端子58から入力されるA/D変
換用クロックを、インバータ16および19、抵抗17
およびコンデンサ18により構成される遅延回路を経由
してA/D変換器15のクロック端子に人力させ、前記
遅延回路により、A/D変換用クロックの遅延時間を調
整する必要がある、という欠点がある。
4図に示されるように、端子56から入力されるビデオ
信号を、A/D変換して端子57より出力するA/D変
換器l5においては、端子58から入力されるA/D変
換用クロックを、インバータ16および19、抵抗17
およびコンデンサ18により構成される遅延回路を経由
してA/D変換器15のクロック端子に人力させ、前記
遅延回路により、A/D変換用クロックの遅延時間を調
整する必要がある、という欠点がある。
本発明の色信号同期回路は、外部から入力されるビデオ
信号をデジタル・ビデオ信号に変換するA ,/ D変
換器を含み、自動位相制御方式により構成される色信号
同期回路において、前記デジタル・ビデオ信号を入力し
て、所定の色差信号を所定の内部回路に出力するデコー
ド回路と、前記色差信号に含まれるB−YのMSBを分
離して入力し、所定のバースト抜取り信号のタイミング
を介して前記B−YのMSBを抜取り、位相差出力信号
として出力する位相比較回路と、前記位相差出力信号を
入力し、前記自動位相制御方式による位相制御機能に対
応して、タイミング位相を制御されたサンプリング・ク
ロックを生成し、前記A/D変換器、デコード回路およ
び前記内部回路に対して出力する手段と、を備えて構成
される。
信号をデジタル・ビデオ信号に変換するA ,/ D変
換器を含み、自動位相制御方式により構成される色信号
同期回路において、前記デジタル・ビデオ信号を入力し
て、所定の色差信号を所定の内部回路に出力するデコー
ド回路と、前記色差信号に含まれるB−YのMSBを分
離して入力し、所定のバースト抜取り信号のタイミング
を介して前記B−YのMSBを抜取り、位相差出力信号
として出力する位相比較回路と、前記位相差出力信号を
入力し、前記自動位相制御方式による位相制御機能に対
応して、タイミング位相を制御されたサンプリング・ク
ロックを生成し、前記A/D変換器、デコード回路およ
び前記内部回路に対して出力する手段と、を備えて構成
される。
次に、本発明について図面を参照して説明する。第1図
は、本発明の一実施例を示すブロック図である。第1図
に示されるように、本実施例は、所定の内部回路6に対
応して、位相比較回路1と、低域フィルタ2と、電圧制
御発振器3と,タイミング発生回路4と,A,/D変換
器5と、デコード回路7と、を備えて構成される.第1
図において、位相比較回路1から出力される位相比較出
力信号105は、低域フィルタ2に入力され、直流電圧
レベルに変換されて電圧制御発振器3に入力される。電
圧制御発振器3においては、前記直流電圧レベルに対応
する周波数の発振出力が原発振信号として出力され、タ
イミング発生回路4に入力される. タイミング発生回路4においては、前記原発振信号の入
力に対応して、ビデオ信号102を取込むための制御信
号103が生成され、A/D変換器5、デコード回路7
および内部回路6に送られる。A/D変換器5において
は、端子52から入力されるアナログのビデオ信号10
2がデジタルービデオ信号に変換され、デコード回路7
に入力される。デコード回路7においては、萌記デジタ
ル・ビデオ信号を入力してR−Yおよび[3−Yを含む
色差信号が出力され、内部回路6に送出されるとともに
、前記色差信号の内、B−YのM S B 104は位
相比較回路1に入力される。
は、本発明の一実施例を示すブロック図である。第1図
に示されるように、本実施例は、所定の内部回路6に対
応して、位相比較回路1と、低域フィルタ2と、電圧制
御発振器3と,タイミング発生回路4と,A,/D変換
器5と、デコード回路7と、を備えて構成される.第1
図において、位相比較回路1から出力される位相比較出
力信号105は、低域フィルタ2に入力され、直流電圧
レベルに変換されて電圧制御発振器3に入力される。電
圧制御発振器3においては、前記直流電圧レベルに対応
する周波数の発振出力が原発振信号として出力され、タ
イミング発生回路4に入力される. タイミング発生回路4においては、前記原発振信号の入
力に対応して、ビデオ信号102を取込むための制御信
号103が生成され、A/D変換器5、デコード回路7
および内部回路6に送られる。A/D変換器5において
は、端子52から入力されるアナログのビデオ信号10
2がデジタルービデオ信号に変換され、デコード回路7
に入力される。デコード回路7においては、萌記デジタ
ル・ビデオ信号を入力してR−Yおよび[3−Yを含む
色差信号が出力され、内部回路6に送出されるとともに
、前記色差信号の内、B−YのM S B 104は位
相比較回路1に入力される。
位相比較回路lにおいては、デコード回路7から入力さ
れるB−YのM S B 104を、端子51から入力
されるバースト抜取り信号101のタイミングで抜取る
ことにより、位相比較出力信号105が得られる。
れるB−YのM S B 104を、端子51から入力
されるバースト抜取り信号101のタイミングで抜取る
ことにより、位相比較出力信号105が得られる。
第2図(a), (b), (c)および(d)は、こ
の位相比較回路1における動作を説明するためのタイミ
ング図で、第2図(a)に示されるビデオ信号102の
バースト信号部分が、A/D変換器5およびデコード回
路7を介して、第2図(b)に示される色差信号B−Y
のM S B 104として出力され、位相比較回路1
において、第2図(C)に示されるバースト抜取り信号
1.01のタイミングを介して、前記色差信号B−Yの
M S B 104を抜取ることにより,第2図(d)
に示される位相比較出力信号105が得\ られる。
の位相比較回路1における動作を説明するためのタイミ
ング図で、第2図(a)に示されるビデオ信号102の
バースト信号部分が、A/D変換器5およびデコード回
路7を介して、第2図(b)に示される色差信号B−Y
のM S B 104として出力され、位相比較回路1
において、第2図(C)に示されるバースト抜取り信号
1.01のタイミングを介して、前記色差信号B−Yの
M S B 104を抜取ることにより,第2図(d)
に示される位相比較出力信号105が得\ られる。
以上の説明より明らかなように、本発明は、A/D変換
器の後段より得られる外部バースト信号の位相と、A/
D変換器のサンプリング・クロックとの位相比較を介し
て、色信号の同期を取る構成としているところに特徴が
ある。
器の後段より得られる外部バースト信号の位相と、A/
D変換器のサンプリング・クロックとの位相比較を介し
て、色信号の同期を取る構成としているところに特徴が
ある。
以上、詳細に説明したように、本発明は、所定のA ,
/ D変換器を含んで構成される色信号同期回路に適用
されて、前記A/D変換器のサンプリング・クロックを
、前記A/D変換器を介して取込まれる外部バースト信
号の位相に同期させることにより、前記A/D変換器に
対するサンプリング・クロックの位相補正用回路が不要
となるとともに、位相補正に要する調整時間を排除する
ことができるという効果がある.
/ D変換器を含んで構成される色信号同期回路に適用
されて、前記A/D変換器のサンプリング・クロックを
、前記A/D変換器を介して取込まれる外部バースト信
号の位相に同期させることにより、前記A/D変換器に
対するサンプリング・クロックの位相補正用回路が不要
となるとともに、位相補正に要する調整時間を排除する
ことができるという効果がある.
第1図は、本発明の一実施例を示すブロヅク図、第2図
は、前記一実施例における主要信号のタイミング図、第
3図は、従来例の色信号同期回路を示すブロック図、第
4図は、前記従来例におけるA/D変換器のクロックの
位相補正の一例を示す回路図である。 図において、1.8・−・・・・位相比較回路、2.9
・・・−・・・・・低域フィルタ、3.10・・・・・
・電圧制御発振器、4,1l・一・・・・タイミング発
生回路、5,12.15・・・・−・A/D変換器、6
,I3・・・・・・内部回路、7,l4・・・・・・デ
コード回路、16.19−・・・・インバータ、17・
・・・・・抵抗、18・・・・・・・・・コンデンサ。 声 1 図 代理人 弁理士 内 原 晋 M Z 図
は、前記一実施例における主要信号のタイミング図、第
3図は、従来例の色信号同期回路を示すブロック図、第
4図は、前記従来例におけるA/D変換器のクロックの
位相補正の一例を示す回路図である。 図において、1.8・−・・・・位相比較回路、2.9
・・・−・・・・・低域フィルタ、3.10・・・・・
・電圧制御発振器、4,1l・一・・・・タイミング発
生回路、5,12.15・・・・−・A/D変換器、6
,I3・・・・・・内部回路、7,l4・・・・・・デ
コード回路、16.19−・・・・インバータ、17・
・・・・・抵抗、18・・・・・・・・・コンデンサ。 声 1 図 代理人 弁理士 内 原 晋 M Z 図
Claims (1)
- 【特許請求の範囲】 外部から入力されるビデオ信号をデジタル・ビデオ信号
に変換するA/D変換器を含み、自動位相制御方式によ
り構成される色信号同期回路において、 前記デジタル・ビデオ信号を入力して、所定の色差信号
を所定の内部回路に出力するデコード回路と、 前記色差信号に含まれるB−YのMSBを分離して入力
し、所定のバースト抜取り信号のタイミングを介して前
記B−YのMSBを抜取り、位相差出力信号として出力
する位相比較回路と、前記位相差出力信号を入力し、前
記自動位相制御方式による位相制御機能に対応して、タ
イミング位相を制御されたサンプリング・クロックを生
成し、前記A/D変換器、デコード回路および前記内部
回路に対して出力する手段と、を備えることを特徴とす
る色信号同期回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9802789A JPH02290393A (ja) | 1989-04-17 | 1989-04-17 | 色信号同期回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9802789A JPH02290393A (ja) | 1989-04-17 | 1989-04-17 | 色信号同期回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02290393A true JPH02290393A (ja) | 1990-11-30 |
Family
ID=14208464
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP9802789A Pending JPH02290393A (ja) | 1989-04-17 | 1989-04-17 | 色信号同期回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02290393A (ja) |
-
1989
- 1989-04-17 JP JP9802789A patent/JPH02290393A/ja active Pending
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