JPH02278850A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH02278850A JPH02278850A JP10056489A JP10056489A JPH02278850A JP H02278850 A JPH02278850 A JP H02278850A JP 10056489 A JP10056489 A JP 10056489A JP 10056489 A JP10056489 A JP 10056489A JP H02278850 A JPH02278850 A JP H02278850A
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- 238000004519 manufacturing process Methods 0.000 title claims description 8
- 239000004065 semiconductor Substances 0.000 title claims description 8
- 238000000576 coating method Methods 0.000 claims abstract description 32
- SCPYDCQAZCOKTP-UHFFFAOYSA-N silanol Chemical compound [SiH3]O SCPYDCQAZCOKTP-UHFFFAOYSA-N 0.000 claims abstract description 30
- 239000011248 coating agent Substances 0.000 claims abstract description 29
- 238000000034 method Methods 0.000 claims abstract description 21
- 239000000126 substance Substances 0.000 claims abstract description 9
- 239000011229 interlayer Substances 0.000 claims abstract description 6
- 238000010304 firing Methods 0.000 claims description 3
- 239000010410 layer Substances 0.000 abstract description 20
- 239000000758 substrate Substances 0.000 abstract description 4
- 238000000137 annealing Methods 0.000 abstract description 3
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 abstract 4
- 229910052681 coesite Inorganic materials 0.000 abstract 2
- 229910052906 cristobalite Inorganic materials 0.000 abstract 2
- 239000000377 silicon dioxide Substances 0.000 abstract 2
- 235000012239 silicon dioxide Nutrition 0.000 abstract 2
- 229910052682 stishovite Inorganic materials 0.000 abstract 2
- 229910052905 tridymite Inorganic materials 0.000 abstract 2
- 238000005530 etching Methods 0.000 description 11
- 238000009413 insulation Methods 0.000 description 7
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 3
- 229910052782 aluminium Inorganic materials 0.000 description 3
- 238000007796 conventional method Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 238000009826 distribution Methods 0.000 description 3
- 210000004709 eyebrow Anatomy 0.000 description 3
- 238000000151 deposition Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 2
- IRPGOXJVTQTAAN-UHFFFAOYSA-N 2,2,3,3,3-pentafluoropropanal Chemical compound FC(F)(F)C(F)(F)C=O IRPGOXJVTQTAAN-UHFFFAOYSA-N 0.000 description 1
- KLZUFWVZNOTSEM-UHFFFAOYSA-K Aluminum fluoride Inorganic materials F[Al](F)F KLZUFWVZNOTSEM-UHFFFAOYSA-K 0.000 description 1
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 239000004744 fabric Substances 0.000 description 1
- 239000007888 film coating Substances 0.000 description 1
- 238000009501 film coating Methods 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 239000007788 liquid Substances 0.000 description 1
- 239000011368 organic material Substances 0.000 description 1
- 239000005416 organic matter Substances 0.000 description 1
- 239000003960 organic solvent Substances 0.000 description 1
- 229920002120 photoresistant polymer Polymers 0.000 description 1
- 238000005268 plasma chemical vapour deposition Methods 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
Landscapes
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Formation Of Insulating Films (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、多層配線構造の半導体装置の製造方法に関す
る。
る。
多層配線プロセスは、デバイスの微細化、高速化やレイ
アウトの自由度の増加による設計のしやすさおよび自動
化の可能なことなど、そのメリットは太き(半導体装置
製造において重要なプロセスになっている。
アウトの自由度の増加による設計のしやすさおよび自動
化の可能なことなど、そのメリットは太き(半導体装置
製造において重要なプロセスになっている。
多層配線のプロセスで最も重要な点は、層間絶縁膜の平
坦化である。!J在用いられる各種平坦化法としては、
大きく分けて次の3種類がある。
坦化である。!J在用いられる各種平坦化法としては、
大きく分けて次の3種類がある。
11+フオトレジストによゐエッチバンク法(ツバイア
ススバッタ。バイアスECRCVD、バイアスプラズマ
CVD等による眉間絶縁膜自身の平坦化堆積法 Cm S OG (Spin−On−Glass)膜の
塗布による方法これらの平坦化法を比較検討した場合、
(11のエッチバンク法は、スループットが遅い、再現
性が雇い、エッチバンクによるプラズマダメージが大き
い等の欠点がある。(欝の眉間#11m膜自身の平坦化
堆積法は、やはりスループットが遅い、ウェハへのバイ
アス印加によるダメージが残る等の問題がある。それに
対して(3)のSOG膜の塗布法は、プロセスが安価で
筒便、ダメージの影響が少ない等の利点があり、量産向
けの技術として世の中で広く使用されるようになってき
ている。
ススバッタ。バイアスECRCVD、バイアスプラズマ
CVD等による眉間絶縁膜自身の平坦化堆積法 Cm S OG (Spin−On−Glass)膜の
塗布による方法これらの平坦化法を比較検討した場合、
(11のエッチバンク法は、スループットが遅い、再現
性が雇い、エッチバンクによるプラズマダメージが大き
い等の欠点がある。(欝の眉間#11m膜自身の平坦化
堆積法は、やはりスループットが遅い、ウェハへのバイ
アス印加によるダメージが残る等の問題がある。それに
対して(3)のSOG膜の塗布法は、プロセスが安価で
筒便、ダメージの影響が少ない等の利点があり、量産向
けの技術として世の中で広く使用されるようになってき
ている。
(発明が解決しようとする課題〕
5OGWAの塗布による平坦化法を行った多層配線を第
2図に示す0図においてシリコン基板lの上にPSG膜
2を介して一層目のアルミニウム配線3が設けられる。
2図に示す0図においてシリコン基板lの上にPSG膜
2を介して一層目のアルミニウム配線3が設けられる。
SOC膜がMとの密着性が悪いことおよび眉間絶縁膜の
絶縁性を高めること等の理由から、SOG膜としてのシ
ラノール膜5を一層目のCV D 310m膜4と二層
目CV D 5ins膜6との間にはさみこむ中塗り法
が用いられている。
絶縁性を高めること等の理由から、SOG膜としてのシ
ラノール膜5を一層目のCV D 310m膜4と二層
目CV D 5ins膜6との間にはさみこむ中塗り法
が用いられている。
そして二層目M配線7がSOG膜5によって表面が平坦
化された二層目CV D Stow膜6の上に設けられ
ている。
化された二層目CV D Stow膜6の上に設けられ
ている。
SOG膜としては、有機物を含まない無機シラノール系
の塗布膜と有機物を含んだシラノール系の塗布膜の2種
類がある。無機シラノール系は、厚膜化すると熱処理に
よりクラックが発生しやすく、−度の塗布では100G
−1500人程度0膜形成が限界となるため、平坦性を
上げるには多数回の塗布、焼成が必要となり、プロセス
が複雑となる。
の塗布膜と有機物を含んだシラノール系の塗布膜の2種
類がある。無機シラノール系は、厚膜化すると熱処理に
よりクラックが発生しやすく、−度の塗布では100G
−1500人程度0膜形成が限界となるため、平坦性を
上げるには多数回の塗布、焼成が必要となり、プロセス
が複雑となる。
有機物を含んだシラノール系の塗布膜は、耐熱性が高い
ため一度の塗布で厚膜形成が可能となり、厚膜化が簡単
にはできない無機シラノール系塗布膜に比べより平坦性
が増すのでより微細化された多層配線プロセスにおいて
も充分使用できる。
ため一度の塗布で厚膜形成が可能となり、厚膜化が簡単
にはできない無機シラノール系塗布膜に比べより平坦性
が増すのでより微細化された多層配線プロセスにおいて
も充分使用できる。
しかしながら、無機シラノール系の約900人の厚さの
塗布膜および有機シラノール系の厚さ約4000人の塗
布膜を、300℃、30分とそれに次ぐ420℃、 3
0分のステップアニールにて焼成し、液温20℃のふう
化アルミニウムNHオFのエツチング液にてエツチング
を行い、その深さ方向に対するエツチング速度を調査し
たところ、無機シラノール系の塗布膜については第3図
、有機シラノール系の塗布膜については第4図に示す結
果を得た。第3図に示す無機シラノール系の塗布膜では
、深さ方向でのエツチング速度は約4000人分と均一
である。有機シラノール系の塗布膜では、表面から約4
000人程度の深さでエツチング速度は約200人/■
111と均一となっているがそれ以降の深さでは約80
0人/−1fiと極端にエツチング速度が大きくなる。
塗布膜および有機シラノール系の厚さ約4000人の塗
布膜を、300℃、30分とそれに次ぐ420℃、 3
0分のステップアニールにて焼成し、液温20℃のふう
化アルミニウムNHオFのエツチング液にてエツチング
を行い、その深さ方向に対するエツチング速度を調査し
たところ、無機シラノール系の塗布膜については第3図
、有機シラノール系の塗布膜については第4図に示す結
果を得た。第3図に示す無機シラノール系の塗布膜では
、深さ方向でのエツチング速度は約4000人分と均一
である。有機シラノール系の塗布膜では、表面から約4
000人程度の深さでエツチング速度は約200人/■
111と均一となっているがそれ以降の深さでは約80
0人/−1fiと極端にエツチング速度が大きくなる。
これは塗布膜が屡くなると深部が十分焼成されていない
ことを示す、このため、眉間絶縁膜として考えた場合に
、絶縁特性の偉績性上の問題が生じていた。
ことを示す、このため、眉間絶縁膜として考えた場合に
、絶縁特性の偉績性上の問題が生じていた。
本発明の目的は、厚膜形成の可能な有機物を含んだシラ
ノール系塗布膜を多層配線の眉間絶縁膜に用いる場合絶
縁特性の信頼性低下の問題を解決した半導体装置の製造
方法を提供することにある。
ノール系塗布膜を多層配線の眉間絶縁膜に用いる場合絶
縁特性の信頼性低下の問題を解決した半導体装置の製造
方法を提供することにある。
上記の目的の達成のために、本発明は、有機物を含むシ
ラノール系塗布膜が多層配線の層間絶縁膜の厚さ方向の
少なくとも一部を占める半導体装置の製造方法において
、有機物を含むシラノール系塗布膜を0.3−以下の厚
さの塗布、焼成を複数回盪返すことにより形成するもの
とする。
ラノール系塗布膜が多層配線の層間絶縁膜の厚さ方向の
少なくとも一部を占める半導体装置の製造方法において
、有機物を含むシラノール系塗布膜を0.3−以下の厚
さの塗布、焼成を複数回盪返すことにより形成するもの
とする。
厚さ0.3 n以下のIr1l物を含むシラノール系塗
布膜を盪返し形成して重ねれば、その都度の焼成の際に
膜中から有機溶剤等が十分に除去されるので、絶縁特性
が良好となり、所望の厚さの眉間絶縁膜の少なくとも一
部を形成することができる。
布膜を盪返し形成して重ねれば、その都度の焼成の際に
膜中から有機溶剤等が十分に除去されるので、絶縁特性
が良好となり、所望の厚さの眉間絶縁膜の少なくとも一
部を形成することができる。
第1図[al〜(e)は本発明の一実施例の多層配線形
成工程を示し、第2r!!Jと共通の部分には同一の符
号が付されている。
成工程を示し、第2r!!Jと共通の部分には同一の符
号が付されている。
第1図(alにおいては、51基板l上にPSG膜2を
1−の厚さに堆積し、さらにその上に線幅21m。
1−の厚さに堆積し、さらにその上に線幅21m。
犀さ0.8 #11の一層目M配線3のパターンを形成
した。第1図(b)においては、−層目Ajik!1%
I3上に一層目CV DSiO,膜4を0.3−の厚さ
に堆積した。
した。第1図(b)においては、−層目Ajik!1%
I3上に一層目CV DSiO,膜4を0.3−の厚さ
に堆積した。
第1図(clにおいては、有機物を含むシラノール系塗
布膜を厚さ0.25pまず塗布した後、300℃、30
分とそれに次ぐ420℃、30分のアニールにより焼成
し、さらに厚さ0.25m1!布し、同様の条件でアニ
ール、焼成し、合計厚さ0.5 nの有機シラノール系
塗布ll18を形成した。第1V!J+d)においては
、ソノ上ヨリ二層目CV D 5IOtll 6を0.
5111の厚さに堆積し、眉間絶amとして充分な厚さ
絶縁性を有する膜とした。第1図(alにおいては、そ
の上より二層目M配Ml17を1jrmの厚さに形成し
た。f1!布II!I8を十分な厚さにすることにより
、第1図(e)における−層目M配線3間の1.5趨の
間隔上での二層目MfSi!vA7の段差は0.2〜0
.3 pm程度であり、第2図に示した無機シラノール
系塗布H5を用いた従来技術の場合の二層目M配線7の
段差約0.7−よりはるかに小さくなっている。このこ
とより、平坦性も向上したことがわかった。
布膜を厚さ0.25pまず塗布した後、300℃、30
分とそれに次ぐ420℃、30分のアニールにより焼成
し、さらに厚さ0.25m1!布し、同様の条件でアニ
ール、焼成し、合計厚さ0.5 nの有機シラノール系
塗布ll18を形成した。第1V!J+d)においては
、ソノ上ヨリ二層目CV D 5IOtll 6を0.
5111の厚さに堆積し、眉間絶amとして充分な厚さ
絶縁性を有する膜とした。第1図(alにおいては、そ
の上より二層目M配Ml17を1jrmの厚さに形成し
た。f1!布II!I8を十分な厚さにすることにより
、第1図(e)における−層目M配線3間の1.5趨の
間隔上での二層目MfSi!vA7の段差は0.2〜0
.3 pm程度であり、第2図に示した無機シラノール
系塗布H5を用いた従来技術の場合の二層目M配線7の
段差約0.7−よりはるかに小さくなっている。このこ
とより、平坦性も向上したことがわかった。
第5図は、第1図に関して述べた実施例におけるのと同
様に形成した有機シラノール系塗布膜のぶつ化アンモニ
ウム液によるエツチング速度を示し、焼成時の膜厚が薄
いため膜中からを機溶剤等を十分に除去することができ
、エツチング速度が深さ方向に対して約200人/分と
均一になった。
様に形成した有機シラノール系塗布膜のぶつ化アンモニ
ウム液によるエツチング速度を示し、焼成時の膜厚が薄
いため膜中からを機溶剤等を十分に除去することができ
、エツチング速度が深さ方向に対して約200人/分と
均一になった。
本発明によれば、有機物を含むシラノール系塗布膜を0
゜3μ以下の厚さで焼成して複数重ねることにより、無
機シラノール系塗布膜に比して少ない回数で厚く、十分
焼成された有機シラノール系塗布膜を形成することが可
能となった。この有機シラノール系塗布膜を少なくとも
層間I!l&l膜の厚さ方向の一部として用いることに
より、所望の厚さで表面の平坦性の良好な眉間絶縁膜の
絶縁特性の信頼性を向上させることができた。
゜3μ以下の厚さで焼成して複数重ねることにより、無
機シラノール系塗布膜に比して少ない回数で厚く、十分
焼成された有機シラノール系塗布膜を形成することが可
能となった。この有機シラノール系塗布膜を少なくとも
層間I!l&l膜の厚さ方向の一部として用いることに
より、所望の厚さで表面の平坦性の良好な眉間絶縁膜の
絶縁特性の信頼性を向上させることができた。
第1図(al〜+61は本発明の一実施例における多層
配線形成工程を順次示す断面図、第2図は従来技術によ
って形成された多層配線の断面図、第3図は無機シラノ
ール系塗布膜のエツチング速度深さ方向分布線図、第4
図は従来技術によって形成された有機シラノール系塗布
膜のエツチング速度深さ方向分布線図、第5図は本発明
に基づいて形成された有機シラノール系塗布膜のエツチ
ング速度深さ方向分布線図である。 1:SI基板、2 : PSG膜、3ニ一層目アルミニ
ウム配線、4ニ一層目CV D Sl0g1ll、6:
二層目CV D Stow膜、7:二層目アルミニウム
配線、第2図 第1図
配線形成工程を順次示す断面図、第2図は従来技術によ
って形成された多層配線の断面図、第3図は無機シラノ
ール系塗布膜のエツチング速度深さ方向分布線図、第4
図は従来技術によって形成された有機シラノール系塗布
膜のエツチング速度深さ方向分布線図、第5図は本発明
に基づいて形成された有機シラノール系塗布膜のエツチ
ング速度深さ方向分布線図である。 1:SI基板、2 : PSG膜、3ニ一層目アルミニ
ウム配線、4ニ一層目CV D Sl0g1ll、6:
二層目CV D Stow膜、7:二層目アルミニウム
配線、第2図 第1図
Claims (1)
- 1)有機物を含むシラノール系塗布膜が多層配線の層間
絶縁膜の厚さ方向の少なくとも一部を占める半導体装置
の製造方法において、有機物を含むシラノール系塗布膜
を0.3μm以下の厚さの塗布、焼成を複数回繰返すこ
とにより形成することを特徴とする半導体装置の製造方
法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10056489A JPH02278850A (ja) | 1989-04-20 | 1989-04-20 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10056489A JPH02278850A (ja) | 1989-04-20 | 1989-04-20 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02278850A true JPH02278850A (ja) | 1990-11-15 |
Family
ID=14277416
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10056489A Pending JPH02278850A (ja) | 1989-04-20 | 1989-04-20 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02278850A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5874367A (en) * | 1992-07-04 | 1999-02-23 | Trikon Technologies Limited | Method of treating a semi-conductor wafer |
-
1989
- 1989-04-20 JP JP10056489A patent/JPH02278850A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5874367A (en) * | 1992-07-04 | 1999-02-23 | Trikon Technologies Limited | Method of treating a semi-conductor wafer |
US6287989B1 (en) | 1992-07-04 | 2001-09-11 | Trikon Technologies Limited | Method of treating a semiconductor wafer in a chamber using hydrogen peroxide and silicon containing gas or vapor |
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