JPH02229436A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
- Publication number
- JPH02229436A JPH02229436A JP5065589A JP5065589A JPH02229436A JP H02229436 A JPH02229436 A JP H02229436A JP 5065589 A JP5065589 A JP 5065589A JP 5065589 A JP5065589 A JP 5065589A JP H02229436 A JPH02229436 A JP H02229436A
- Authority
- JP
- Japan
- Prior art keywords
- collector
- layer
- electrode
- resist
- wiring metal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000004519 manufacturing process Methods 0.000 title claims description 9
- 239000004065 semiconductor Substances 0.000 title claims description 8
- 229910052751 metal Inorganic materials 0.000 claims abstract description 27
- 239000002184 metal Substances 0.000 claims abstract description 27
- 238000005530 etching Methods 0.000 claims abstract description 16
- 239000000758 substrate Substances 0.000 claims abstract description 7
- 239000011810 insulating material Substances 0.000 claims description 8
- 238000010884 ion-beam technique Methods 0.000 claims description 6
- 238000003801 milling Methods 0.000 claims description 6
- 150000001875 compounds Chemical class 0.000 claims description 4
- 238000000059 patterning Methods 0.000 claims description 4
- 238000000034 method Methods 0.000 abstract description 26
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 abstract description 10
- 229910052814 silicon oxide Inorganic materials 0.000 abstract description 10
- 229910001218 Gallium arsenide Inorganic materials 0.000 abstract description 9
- 230000015556 catabolic process Effects 0.000 abstract description 7
- 230000015572 biosynthetic process Effects 0.000 abstract description 4
- 229920002120 photoresistant polymer Polymers 0.000 abstract description 3
- 238000001020 plasma etching Methods 0.000 abstract description 3
- 239000010931 gold Substances 0.000 description 10
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 9
- 229910052737 gold Inorganic materials 0.000 description 8
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 5
- 238000010586 diagram Methods 0.000 description 5
- 238000001039 wet etching Methods 0.000 description 3
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 2
- BYDQGSVXQDOSJJ-UHFFFAOYSA-N [Ge].[Au] Chemical compound [Ge].[Au] BYDQGSVXQDOSJJ-UHFFFAOYSA-N 0.000 description 2
- 238000000137 annealing Methods 0.000 description 2
- SAOPTAQUONRHEV-UHFFFAOYSA-N gold zinc Chemical compound [Zn].[Au] SAOPTAQUONRHEV-UHFFFAOYSA-N 0.000 description 2
- 238000002513 implantation Methods 0.000 description 2
- 239000000463 material Substances 0.000 description 2
- 229910052759 nickel Inorganic materials 0.000 description 2
- 230000007261 regionalization Effects 0.000 description 2
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 1
- KZBUYRJDOAKODT-UHFFFAOYSA-N Chlorine Chemical compound ClCl KZBUYRJDOAKODT-UHFFFAOYSA-N 0.000 description 1
- 241000218202 Coptis Species 0.000 description 1
- 235000002991 Coptis groenlandica Nutrition 0.000 description 1
- 235000019687 Lamb Nutrition 0.000 description 1
- FYYHWMGAXLPEAU-UHFFFAOYSA-N Magnesium Chemical compound [Mg] FYYHWMGAXLPEAU-UHFFFAOYSA-N 0.000 description 1
- JLVVSXFLKOJNIY-UHFFFAOYSA-N Magnesium ion Chemical compound [Mg+2] JLVVSXFLKOJNIY-UHFFFAOYSA-N 0.000 description 1
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 1
- 229910052786 argon Inorganic materials 0.000 description 1
- 239000010953 base metal Substances 0.000 description 1
- 238000005452 bending Methods 0.000 description 1
- 229910052796 boron Inorganic materials 0.000 description 1
- 238000005229 chemical vapour deposition Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 238000007688 edging Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 239000007789 gas Substances 0.000 description 1
- 238000002955 isolation Methods 0.000 description 1
- 238000005304 joining Methods 0.000 description 1
- 229910052749 magnesium Inorganic materials 0.000 description 1
- 239000011777 magnesium Substances 0.000 description 1
- 229910001425 magnesium ion Inorganic materials 0.000 description 1
- 150000002815 nickel Chemical class 0.000 description 1
- 238000000992 sputter etching Methods 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 239000010936 titanium Substances 0.000 description 1
- 229910052719 titanium Inorganic materials 0.000 description 1
- 239000002023 wood Substances 0.000 description 1
Landscapes
- Electrodes Of Semiconductors (AREA)
- Bipolar Transistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の目的〕
(産業上の利用分野)
本発明は、半導体装置の製造方法に係り、特に反転型へ
テロ接合バイボーラトランジスタの形成に関する。
テロ接合バイボーラトランジスタの形成に関する。
異種の半導体材料を接合させ、ヘテロ接合を形成してな
るペテロ接合バイボーラトランジスタは、単一材料を用
いて作られるホモ接合バイボーラトランジスタと比べて
、高周波特性、スイッチング特性に優れ、マイクロ波用
トランジスタ、高速論理回路用トランジスタ、高速アナ
ログ回路用トランジスタとして極めて有望である。
るペテロ接合バイボーラトランジスタは、単一材料を用
いて作られるホモ接合バイボーラトランジスタと比べて
、高周波特性、スイッチング特性に優れ、マイクロ波用
トランジスタ、高速論理回路用トランジスタ、高速アナ
ログ回路用トランジスタとして極めて有望である。
ペテロ接合バイボーラトランジスタの内でも殊に、エミ
ッタを裏面側に配置した反転型へテロ接合バイボーラト
ランジスタは、通常のへテロ接合バイボーラトランジス
タに比べ、コレクタ容量が小さいため、より高速動作が
得られることから、近年この反転型へテロ接合バイボー
ラトランジスタを用いた高出力素子への需要が高まって
いる。
ッタを裏面側に配置した反転型へテロ接合バイボーラト
ランジスタは、通常のへテロ接合バイボーラトランジス
タに比べ、コレクタ容量が小さいため、より高速動作が
得られることから、近年この反転型へテロ接合バイボー
ラトランジスタを用いた高出力素子への需要が高まって
いる。
ところで、一般に高出力木子を得るためにはコレクタ耐
圧を高める必要があり、コレクタ層を厚くする必ばかあ
る。従って、反転型へテロ接合バイボーラトランジスタ
では、コレクタ段差を大きくする必要がある。
圧を高める必要があり、コレクタ層を厚くする必ばかあ
る。従って、反転型へテロ接合バイボーラトランジスタ
では、コレクタ段差を大きくする必要がある。
このような反転型へテロ接合バイボーラトランジスタは
、その一例として第2図に構造断面図を示すように、シ
リコンドーブのn士型GaAs基板1の表面にMBE法
により、エミッタ層を構成するシリコンドーブのn A
IGaAs層2、ベース層を構成するベリリウムドーブ
のp+GaAs層3、コレクタ層を構成するシリコンド
ーブのn GaAS層4を順次堆積してなるもので、各
領域の表面には夫々、コレクタ電極6、ベース電極7、
エミッタ電極8が形成されている。ここで5は、外部ベ
ース領域、4aは、高a度のシリコンドーブのn+Ga
As層からなるコレクタコンタクト層である。
、その一例として第2図に構造断面図を示すように、シ
リコンドーブのn士型GaAs基板1の表面にMBE法
により、エミッタ層を構成するシリコンドーブのn A
IGaAs層2、ベース層を構成するベリリウムドーブ
のp+GaAs層3、コレクタ層を構成するシリコンド
ーブのn GaAS層4を順次堆積してなるもので、各
領域の表面には夫々、コレクタ電極6、ベース電極7、
エミッタ電極8が形成されている。ここで5は、外部ベ
ース領域、4aは、高a度のシリコンドーブのn+Ga
As層からなるコレクタコンタクト層である。
このような反転型へテロ接合バイボーラトランジスタに
おいて、外部ベース領域5の形成は、npnM4造の化
合物半導体基板のn層(コレクタ層4およびコレクタコ
ンタクトJiW4a)をエッヂングしてコレクタメサ部
を形成し、コレクタメサ部上の酸化シリコン膜をマスク
としてマグネシウム(t4a)をイオン注入し、赤外線
ランプアニール処理をし、活性化をはかり、表面よりエ
ミッタ層であるnAIGaAs層2に達する深さにまで
ρ型領域を形成することにより得られる。そして外部ベ
ース領域5への電極の形成は、金一亜鉛(ALIZn)
層等の金B層を蒸着させることにより行われている。
おいて、外部ベース領域5の形成は、npnM4造の化
合物半導体基板のn層(コレクタ層4およびコレクタコ
ンタクトJiW4a)をエッヂングしてコレクタメサ部
を形成し、コレクタメサ部上の酸化シリコン膜をマスク
としてマグネシウム(t4a)をイオン注入し、赤外線
ランプアニール処理をし、活性化をはかり、表面よりエ
ミッタ層であるnAIGaAs層2に達する深さにまで
ρ型領域を形成することにより得られる。そして外部ベ
ース領域5への電極の形成は、金一亜鉛(ALIZn)
層等の金B層を蒸着させることにより行われている。
ところで、このコレクタ層4およびコレクタコンタクト
層4aをエッヂングしてコレクタメサ部を形成する工程
は、従来ウエットエッチング法により行われている。等
方性エッチングであるウエットエッチング法によれば、
パターンエッジがなだらかになるため上層に形成される
配線の段切れを防止できるという利点がある。
層4aをエッヂングしてコレクタメサ部を形成する工程
は、従来ウエットエッチング法により行われている。等
方性エッチングであるウエットエッチング法によれば、
パターンエッジがなだらかになるため上層に形成される
配線の段切れを防止できるという利点がある。
しかしながら、コレクタ層を厚く形成し、高耐圧化をは
かろうとすると、従来のいわゆるウエットエッチング法
によりレジストパターンRあるいは酸化シリコン膜をマ
スクとしてエッチングし、コレクタ段差を大きくしなけ
ればならない。この方法では、大きなコレクタ段差を青
ようとすると、第3図(a)および第3図(b)に示す
ように、サイドエッチングによりコレクタ上部と下部と
で面積に大きな差が生じるため、微細加工には限界があ
った。
かろうとすると、従来のいわゆるウエットエッチング法
によりレジストパターンRあるいは酸化シリコン膜をマ
スクとしてエッチングし、コレクタ段差を大きくしなけ
ればならない。この方法では、大きなコレクタ段差を青
ようとすると、第3図(a)および第3図(b)に示す
ように、サイドエッチングによりコレクタ上部と下部と
で面積に大きな差が生じるため、微細加工には限界があ
った。
また、反応性イオンエッチング法などの異方性エッチン
グを用いてエッジが垂直となるようにすることも可能で
ある。
グを用いてエッジが垂直となるようにすることも可能で
ある。
しかしながら、エッジが垂直でかつ大きい段差を有する
トランジスタを製造するに際し、コレクタ電極から配線
を引き出す工程で従来広く用いられているリフトオフ法
を用い配線パターンを形成しようとすると、アスペクト
比の大きな溝中に配線金属を形成しなければならないた
め、コレクタ段差の部分で配線金属が薄くなり、いわゆ
る段切れを生じ易いという問題があった。
トランジスタを製造するに際し、コレクタ電極から配線
を引き出す工程で従来広く用いられているリフトオフ法
を用い配線パターンを形成しようとすると、アスペクト
比の大きな溝中に配線金属を形成しなければならないた
め、コレクタ段差の部分で配線金属が薄くなり、いわゆ
る段切れを生じ易いという問題があった。
そこで、まず全面に配線金属を形成しPEP法により選
択的にエッヂング除去する方法も考えられるが、このコ
レクタ電極から配線を引き出す工程では、ペース電極上
の配線金属は除人するため、通常、金糸の電極金属で構
成されているベース電極表面が露呈すると、このベース
電極表面はダメージを受け易く、信頼性低下の原因とな
っていた。
択的にエッヂング除去する方法も考えられるが、このコ
レクタ電極から配線を引き出す工程では、ペース電極上
の配線金属は除人するため、通常、金糸の電極金属で構
成されているベース電極表面が露呈すると、このベース
電極表面はダメージを受け易く、信頼性低下の原因とな
っていた。
(発明が解決しようとする課題)
このように従来の反転型のへテロ接合バイボーラトラン
ジスタでは、高耐圧化に際してはパターン形成上、上述
したようないろいろな困難が伴い、微細で信頼性の高い
ものを得るのは困難であるという問題があった。
ジスタでは、高耐圧化に際してはパターン形成上、上述
したようないろいろな困難が伴い、微細で信頼性の高い
ものを得るのは困難であるという問題があった。
本発明は、前記実情に鑑みてなされたもので、高耐圧か
つ微細で歩留まりの高い反転型のへテロ接合バイボーラ
トランジスタを提供することを目的とする。
つ微細で歩留まりの高い反転型のへテロ接合バイボーラ
トランジスタを提供することを目的とする。
(課題を解決するための手段)
そこで本発明では、反転型のへテロ接合バイボーラトラ
ンジスタの製造に際し、ベース電極形成のためのコレク
タ層のエッチングを、異方性エッヂングによって行い、
エミッタ電極,ベース電極およびコレクタ電極を形成し
た後、基板表面にレジストまたは絶縁性材料を塗布し、
コレクタ電極表面のレジストまたは絶縁性材料を選択的
に除去し、さらに全面に配線金属を形成し、通常のPE
P法により配線金属をパターニングするようにしている
。
ンジスタの製造に際し、ベース電極形成のためのコレク
タ層のエッチングを、異方性エッヂングによって行い、
エミッタ電極,ベース電極およびコレクタ電極を形成し
た後、基板表面にレジストまたは絶縁性材料を塗布し、
コレクタ電極表面のレジストまたは絶縁性材料を選択的
に除去し、さらに全面に配線金属を形成し、通常のPE
P法により配線金属をパターニングするようにしている
。
望ましくは、配線金属のパターニングはイオンごームミ
リング法を用いるようにしている。
リング法を用いるようにしている。
(作用)
上記方法によれば、コレクタ層のエッチングに、異方性
エッチングを用いているため、コレクタ段差が大きい場
合にも、微細な領域に十分なコレクタ幅をとることがで
きる。
エッチングを用いているため、コレクタ段差が大きい場
合にも、微細な領域に十分なコレクタ幅をとることがで
きる。
そして配線金属の形成に際し、リフトオフ法を用いるこ
となく、コレクタ電極表面を除く領域にレジストまたは
絶縁性材料を形成しておき、この上層に全面に配線金属
を形成するようにしているため、リフトオフ法を用い凹
部内に形成する場合に比べ、段差部での膜厚は、薄くな
るのを防止することかでぎ、エッジをシャープに形成し
ながらも段切れのない配線を得ることができる。また、
このレジストまたは絶縁性材料は、コレクタ配線とベー
ス電極との間の導通を防止する。
となく、コレクタ電極表面を除く領域にレジストまたは
絶縁性材料を形成しておき、この上層に全面に配線金属
を形成するようにしているため、リフトオフ法を用い凹
部内に形成する場合に比べ、段差部での膜厚は、薄くな
るのを防止することかでぎ、エッジをシャープに形成し
ながらも段切れのない配線を得ることができる。また、
このレジストまたは絶縁性材料は、コレクタ配線とベー
ス電極との間の導通を防止する。
さらに、PEP法により配線金属をパターニングするに
際し、下地のベース電極はレジストまたは絶縁性材料で
覆われているため、エッチングによるダメージを防止す
ることができる。
際し、下地のベース電極はレジストまたは絶縁性材料で
覆われているため、エッチングによるダメージを防止す
ることができる。
また、配線金属のパターニングにイオンごームミリング
法を用いるようにすれば、高精度のパターン形成を行う
ことができる。このとき、下地はダメージを受けやすい
が、ベース電極はレジストまたは絶縁性材料で被覆され
ているため、良好に維持することができる。
法を用いるようにすれば、高精度のパターン形成を行う
ことができる。このとき、下地はダメージを受けやすい
が、ベース電極はレジストまたは絶縁性材料で被覆され
ているため、良好に維持することができる。
(実施例》
以下、本発明の実施例について、図面を参照しつつ詳細
に説明する。
に説明する。
第1図(a)乃至第1図(9)は、本発明実施例の反転
型へテロ接合バイボーラトランジスタ( H B T
)の製造工程を示す図である。
型へテロ接合バイボーラトランジスタ( H B T
)の製造工程を示す図である。
まず、第1図(a)に示すように、シリコンドープのn
+型GaAs基板1の表面にMBE法により、エミッタ
層を構成するシリコンドープのn AIGaAs層2、
ベース層を構成するベリリウムドーブのp+^lGaA
s層3、コレクタ層を構成するシリコンドーブのn G
aAs層/I tjよびコレクタコンタクト層を構成す
るシリコンドープのn+GaAs層4aを順次堆積する
。
+型GaAs基板1の表面にMBE法により、エミッタ
層を構成するシリコンドープのn AIGaAs層2、
ベース層を構成するベリリウムドーブのp+^lGaA
s層3、コレクタ層を構成するシリコンドーブのn G
aAs層/I tjよびコレクタコンタクト層を構成す
るシリコンドープのn+GaAs層4aを順次堆積する
。
この後、第1図(b)に示すように、CVD法により酸
化シリコン膜15を堆積し、PEP法を用いてコレクタ
形成領域を決定し、この酸化シリコン膜をマスクとして
塩素ガスを用いた反応性イオンエッチングによりコレク
タ形成領域以外のnGaAs層4およびn+GaAs層
4aをエッチング除去する。
化シリコン膜15を堆積し、PEP法を用いてコレクタ
形成領域を決定し、この酸化シリコン膜をマスクとして
塩素ガスを用いた反応性イオンエッチングによりコレク
タ形成領域以外のnGaAs層4およびn+GaAs層
4aをエッチング除去する。
さらに、第1図[C)に示すように、この酸化シリコン
!I15のパターンをマスクとしてマグネシウム向イオ
ンをイオン注入し、ランブアニール法を用いて高′a度
にドープされたρ子外部ベース領域5を形成する。
!I15のパターンをマスクとしてマグネシウム向イオ
ンをイオン注入し、ランブアニール法を用いて高′a度
にドープされたρ子外部ベース領域5を形成する。
そしてさらに、素子分離のためのボロン注入層およびプ
ロトン注入層(図示せず)を形成し高抵抗化を行った後
、CVD法により酸化シリコン膜10を堆梢しコレクタ
段差部分を覆うようにバタニングする。
ロトン注入層(図示せず)を形成し高抵抗化を行った後
、CVD法により酸化シリコン膜10を堆梢しコレクタ
段差部分を覆うようにバタニングする。
続いて、第1図(d)に示すように、金ゲル7二ウム(
^uGe )層,ニッケル(N1)層,金(八Ll)I
Iの3層構造のコレクタ電極6、金(AU)I&,金亜
鉛(Au’n)層の2層構造のベース電極7を順次形成
すると共に、裏面側にも金ゲルマニウム(^uGe)層
,ニッケル(N1)層,金(Au)層の3層構造のエミ
ッタ電極8を形成し、シンターを行う。
^uGe )層,ニッケル(N1)層,金(八Ll)I
Iの3層構造のコレクタ電極6、金(AU)I&,金亜
鉛(Au’n)層の2層構造のベース電極7を順次形成
すると共に、裏面側にも金ゲルマニウム(^uGe)層
,ニッケル(N1)層,金(Au)層の3層構造のエミ
ッタ電極8を形成し、シンターを行う。
この後、第1図(+3)に示すように、レジスト膜塗布
後このレジスト膜をPEP法によりパターニングし、コ
レクタ電極上のみに開口したパターン形状を有するレジ
ストパターンRを形成する。
後このレジスト膜をPEP法によりパターニングし、コ
レクタ電極上のみに開口したパターン形状を有するレジ
ストパターンRを形成する。
そして、第1図(r)に示すように、基板表面全体にチ
タンおよび金を蒸肴し、この2層構造の配線金fi12
を形成する。
タンおよび金を蒸肴し、この2層構造の配線金fi12
を形成する。
最後に、第1図(9)に示すように、フォトレジスト1
1を塗布し、PEP法を用いてコレクタ上の配線金属を
保護し、アルゴンガスを用いたイオンビームミリング法
を用いて不要な配線金屈を除去する。この際ベース金属
はレジストパターンRにより確実に保護される。
1を塗布し、PEP法を用いてコレクタ上の配線金属を
保護し、アルゴンガスを用いたイオンビームミリング法
を用いて不要な配線金屈を除去する。この際ベース金属
はレジストパターンRにより確実に保護される。
このようにして形成された反転型へテロ接合バイボーラ
トランジスタは、コレクタ幅4μm、コレクタ段差1μ
mであるとき、コレクタ耐圧は25Vであり、段切れは
ウエハ内の全素子のうち5%以下であった。
トランジスタは、コレクタ幅4μm、コレクタ段差1μ
mであるとき、コレクタ耐圧は25Vであり、段切れは
ウエハ内の全素子のうち5%以下であった。
これに対し従来の方法では、コレクタ幅4μmでコレク
タ段差5000八が微細加工の加工限界であり、コレク
タ耐圧はせいピい12Vであった。
タ段差5000八が微細加工の加工限界であり、コレク
タ耐圧はせいピい12Vであった。
これらの比較からも、本発明の方法によれば、コレクタ
耐圧が高く信頼性の高い反転型へテロ接合バイボーラト
ランジスタを得ることが可能となる。
耐圧が高く信頼性の高い反転型へテロ接合バイボーラト
ランジスタを得ることが可能となる。
なおこの方法では、コレクタ層のエッチングに、異方性
エッチングを用いているため、コレクタ段差が大きい場
合にも、十分なコレクタ幅をとることができるため微細
化をはかることができ、また、配線金属の形成に先立ち
、下地を被覆保護した状態でPEP工程で配線パターン
を形成することにより,異方性エッチングによる垂直な
エッジ上での段切れを防止しているため、垂直なコレク
タエッジを形成しているにもかかわらず、歩留まりが向
上しているものと思われる。
エッチングを用いているため、コレクタ段差が大きい場
合にも、十分なコレクタ幅をとることができるため微細
化をはかることができ、また、配線金属の形成に先立ち
、下地を被覆保護した状態でPEP工程で配線パターン
を形成することにより,異方性エッチングによる垂直な
エッジ上での段切れを防止しているため、垂直なコレク
タエッジを形成しているにもかかわらず、歩留まりが向
上しているものと思われる。
すなわち、配線金属の形成に際し、リフトオフ法を用い
ることなく、コレクタ電極表面を除く領域にレジストパ
ターンを形成しておき、この上層に全面に配線金属を形
成するようにしているため、リフトオフ法を用い凹部内
に形成する場合に比べ、段差部での+gI厚は、薄くな
るのを防止することができ、エッジをシャープに形成し
ながらも段切れのない配線を得ることができる。また、
このレジストパターンは、コレクタ配線とベース電極と
の間の導通を防止すると共に、配線金属のイオンビーム
ミリング工程における、下地のベース電極7のエッチン
グによるダメージを防止することができる。
ることなく、コレクタ電極表面を除く領域にレジストパ
ターンを形成しておき、この上層に全面に配線金属を形
成するようにしているため、リフトオフ法を用い凹部内
に形成する場合に比べ、段差部での+gI厚は、薄くな
るのを防止することができ、エッジをシャープに形成し
ながらも段切れのない配線を得ることができる。また、
このレジストパターンは、コレクタ配線とベース電極と
の間の導通を防止すると共に、配線金属のイオンビーム
ミリング工程における、下地のベース電極7のエッチン
グによるダメージを防止することができる。
なお、前記実施例では、配線金属のパターン形成にイオ
ンビームミリング法を用いるようにしたが、反応性イオ
ンエッチング法など他の方法でもよいことはいうまでも
ない。
ンビームミリング法を用いるようにしたが、反応性イオ
ンエッチング法など他の方法でもよいことはいうまでも
ない。
〔発明の効果)
以上説明してきたように、本発明によれば、反転型のへ
テロ接合バイボーラトランジスタの製造に際し、ベース
電極形成のためのコレクタ層のエッチングを、異方性エ
ッチングによって行い、エミッタ電極,ベース電極およ
びコレクタ電極を形成した後、コレクタ電極表面を除く
領域をレジストまたは絶縁性材料で被覆し、さらに全面
に配線金属を形成し、通常のPEP法により配線金屑を
パターニングするようにしているため、高耐圧かつ小形
で信頼性の高い、反転型のへテロ接合バイボーラトラン
ジスタを得ることが可能となる。
テロ接合バイボーラトランジスタの製造に際し、ベース
電極形成のためのコレクタ層のエッチングを、異方性エ
ッチングによって行い、エミッタ電極,ベース電極およ
びコレクタ電極を形成した後、コレクタ電極表面を除く
領域をレジストまたは絶縁性材料で被覆し、さらに全面
に配線金属を形成し、通常のPEP法により配線金屑を
パターニングするようにしているため、高耐圧かつ小形
で信頼性の高い、反転型のへテロ接合バイボーラトラン
ジスタを得ることが可能となる。
転型のへテロ接合バイボーラトランジスタの製造工程図
、第2図は従来例の反転型のへテロ接合バイボーラトラ
ンジスタを示す図、第3図(a)および第3図(b)は
、従来例の反転型のへテロ接合バイボーラトランジスタ
の製造工程の一部を示す図である。
、第2図は従来例の反転型のへテロ接合バイボーラトラ
ンジスタを示す図、第3図(a)および第3図(b)は
、従来例の反転型のへテロ接合バイボーラトランジスタ
の製造工程の一部を示す図である。
1 ・n十型GaAs基板、2−n AIGaAs層(
エミッタ層) 、3・p+ GaAs層(ベースM)、
4・ nGaAS層《コレクタ層》、5・・・外部ベー
ス領域、6・・・コレクタ電極、7・・・ベース電極、
8・・・エミッタ電極、R・・・レジストパターン、1
0・・・酸化シリコン膜、11・・・フォトレジスト、
12・・・配線金属。
エミッタ層) 、3・p+ GaAs層(ベースM)、
4・ nGaAS層《コレクタ層》、5・・・外部ベー
ス領域、6・・・コレクタ電極、7・・・ベース電極、
8・・・エミッタ電極、R・・・レジストパターン、1
0・・・酸化シリコン膜、11・・・フォトレジスト、
12・・・配線金属。
≧j’Er(所の2)
第2図
(b)
第3図
Claims (2)
- (1)エミッタ層、ベース層およびコレクタ層となるn
pn構造の化合物半導体領域を形成する化合物半導体領
域形成工程と、 異方性エッチングにより、ベース電極形成 のためにコレクタ層を選択的に除去するエッチング工程
と、 各化合物半導体領域に対しエミッタ電極、 ベース電極およびコレクタ電極を形成する電極形成工程
と、 コレクタ電極表面を除く基板表面にレジス トまたは絶縁性材料を塗布する絶縁膜形成工程と、前記
コレクタ電極に接続するように、全面 に配線金属を形成し、これらを選択的に除去しパターニ
ングする配線パターン形成工程とを含むようにしたこと
を特徴とする半導体装置の製造方法。 - (2)前記配線パターン形成工程における配線金属を選
択的に除去する工程は、イオンビームミリング法である
ことを特徴とする請求項(1)に記載の半導体装置の製
造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5065589A JPH02229436A (ja) | 1989-03-02 | 1989-03-02 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5065589A JPH02229436A (ja) | 1989-03-02 | 1989-03-02 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02229436A true JPH02229436A (ja) | 1990-09-12 |
Family
ID=12864965
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5065589A Pending JPH02229436A (ja) | 1989-03-02 | 1989-03-02 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02229436A (ja) |
-
1989
- 1989-03-02 JP JP5065589A patent/JPH02229436A/ja active Pending
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JPH03166734A (ja) | ヘテロ接合バイポーラトランジスタ | |
US5362658A (en) | Method for producing semiconductor device | |
KR0174538B1 (ko) | 헤테로 접합 바이폴라 트랜지스터 제조 방법 | |
JPH10233515A (ja) | ショットキーバリア半導体装置とその製造方法 | |
JPH07111966B2 (ja) | 半導体装置の製造方法 | |
EP0892441A2 (en) | Field effect transistor with recessed gate and a method for manufacturing the same | |
JP3799714B2 (ja) | 半導体装置 | |
JPH02229436A (ja) | 半導体装置の製造方法 | |
US6448162B1 (en) | Method for producing schottky diodes | |
JP3362650B2 (ja) | 窒化物半導体素子の製造方法 | |
JP2002124520A (ja) | エッチング可能なヘテロ接合界面 | |
JPH06310523A (ja) | ヘテロ接合バイポーラトランジスタ,及びその製造方法 | |
JPH0797634B2 (ja) | 電界効果トランジスタとその製造方法 | |
JP2862705B2 (ja) | ヘテロ接合半導体装置及びその製造方法 | |
JPS5986268A (ja) | 変調ド−ピング層を動作層とするシヨツトキ−ゲ−ト型電界効果トランジスタ− | |
JPS60244075A (ja) | E/d構成集積回路の製造方法 | |
JPS631066A (ja) | 半導体装置の製造方法 | |
JPH05267336A (ja) | 位置合わせマークを用いた配線層の形成方法 | |
JP2000353789A (ja) | 化合物半導体装置およびその製造方法 | |
JPH02257641A (ja) | 反転型ヘテロ接合バイポーラトランジスタの製造方法 | |
JPS63107066A (ja) | ヘテロ接合型バイポ−ラトランジスタ | |
JPS6084878A (ja) | 負性抵抗特性をもつ半導体装置およびその製造方法 | |
EP0146212A1 (en) | Schottky barrier diode and method of manufacturing it | |
JPH02113539A (ja) | 半導体装置の製造方法 | |
JPH0212838A (ja) | 半導体装置の製造方法 |