JPH02216475A - 半導体装置の検査方法 - Google Patents

半導体装置の検査方法

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JPH02216475A
JPH02216475A JP1037503A JP3750389A JPH02216475A JP H02216475 A JPH02216475 A JP H02216475A JP 1037503 A JP1037503 A JP 1037503A JP 3750389 A JP3750389 A JP 3750389A JP H02216475 A JPH02216475 A JP H02216475A
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wires
bonding
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Junichi Yokoyama
淳一 横山
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はペレットとリードとを複数本のボンディングワ
イヤで並列接続した半導体装置に関し、特にこれらワイ
ヤのうちの1本がオープン状態になっていることを電気
的に検査する方法に関する。
〔従来の技術〕
従来、半導体装置において、ベレット上の1つのポンデ
ィングパッドとパッケージの1つのリードとを2本のボ
ンディングワイヤで接続する場合がある。即ち、ポンデ
ィングパッドの寸法、形状に制限があって太いワイヤを
ボンディングできないため、比較的細いワイヤ2本で電
流容量に対処する場合、或いは、組立工程が比較的細い
ボンディングワイヤで標準化されていて、特定の品種の
み太いワイヤをボンディングすることができない場合に
、細いワイヤ2本で電流容量に対処する場合である。
〔発明が解決しようとする課題〕
ところで、この種の半導体装置において、ワイヤはボン
ディング直後には正常な状態にあっても、その後の工程
を通る間に切断されたリボンディング界面が剥がれる等
してオープン状態になることがある。特に、樹脂モール
ド型半導体素子では、モールド成形時に溶融樹脂が高圧
で射出されるため、ボンディングワイヤがオープン状態
になることが比較的起こりやすい。
このため、従来ではボンディングワイヤの接続不良を検
査してこれを除去することが要求されているが、従来で
は2本のボンディングワイヤのうちの1本がオープン状
態になっている半導体装置を電気的に検査することがで
きず、不良半導体装置を除去することができないという
問題がある。
即ち、2本のボンディングワイヤが共にオープンになっ
ている場合には、ベレットとリードとが電気的にもオー
プン状態になっているため、特性選別においてこの不良
装置を容易に選別、排除できる。ところが、2本のワイ
ヤのうちの1本のみがオーブン状態になっている場合に
は、ペレットとリードとが他方のワイヤで接続されてい
るため、従来の特性選別方法ではこの不良素子を電気的
に検知して選別、排除することができない。
このように1本のワイヤのみがオープンになっている半
導体装置はワイヤの電流容量が良品の半分になっている
ため明らかに不良半導体装置であり、これが排除されず
に最終工程まで流れ、出荷されてしまうという問題が生
している。
本発明は1本のワイヤのみがオープンになっている半導
体装置を検査して、これを選別除去することを可能にし
た半導体装置の検査方法を提供することを目的とする。
〔課題を解決するための手段〕
本発明の半導体装置の検査方法は、半導体ペレットの1
つのパッドとパッケージの1つのリードとを複数本のボ
ンディングワイヤで並列接続している半導体装置の検査
に際し、1本のボンディングワイヤの溶断電流値をボン
ディングワイヤの本数倍し、これよりも小さい電流をパ
ッドとリード間に印加してボンディングワイヤの接続状
態を検査している。
〔作用] 上述した方法では、少なくとも一本のワイヤがオープン
状態にあるときには、接続されている他のワイヤに溶断
電流値以上の過電流が流れることになり、他のワイヤが
溶断され、パッドとリードとの間が完全にオープンとな
り、半導体装置の不良を電気的に検査することが可能と
なる。
〔実施例〕
次に、本発明を図面を参照して説明する。
第1図乃至第3図は本発明の一実施例を説明するための
図である。
先ず、−船釣な半導体装置についてみると、ある与えら
れたパッケージ内に配線されたボンディングワイヤでは
、第1図に示すように、種々の電流パルス幅に対して溶
断電流とボンディングワイヤ径の相関がある。したがっ
て、製造する半導体装置におけるボンディングワイヤ径
と電流パルス幅に基づいてこの相関を予め実験的に求め
ておけば、その半導体装置における溶断電流値を求める
ことができる。
そこで、ここでは第2図(a)に示すように、コレクタ
リード2と一体のリードフレーム1上に搭載したトラン
ジスタ素子ICのエミッタパッドEとエミッタリード3
を2本のワイヤWl、W2で並列に接続し、ペースパッ
ドBとベースリード4を1本のワイヤW3で接続した半
導体装置を選別する例を示す。
先ず、ワイヤWl、W2の径寸法と、これに通電しよう
とする電流パルスに基づいて、第1図から1本のワイヤ
に対する溶断電流値を求める。
次いで、このトランジスタのベースリード4に適宜の電
流を印加してトランジスタをオンさせた状態とした上で
1.コレクタリード2とエミッタリード3との間に溶断
電流値の1.5倍の電流パルスを通流する。このとき、
エミッタパッド巳とエミッタリード3は2本のワイヤW
l、W2で並列接続されているため、溶断電流は2本の
ワイヤW1゜W2に夫々分流して溶断電流値の0.75
倍の電流しか流れず、したがって第2図(b、 )のよ
うに、ワイヤWl、W2が切断されることはない。これ
により、良品としての半導体装置として検査が終了され
る。
一方、第3図(a)に示すように、2本のワイヤWl、
W2の一方、ここではワイヤW1がオープンになってい
る場合には、上述と同様にトランジスタをオンして、コ
レクタリード2とエミッタリード3間に溶断電流値の1
.5倍の電流パルスを通流すると、接続されているワイ
ヤW2に全ての電流が印加されるため、第3図(b)の
ように過電流状態となってワイヤW2が溶断される。こ
の結果、エミッタリードが電気的にオーブンになり、後
工程の電気特性選別で特性測定が不可能となり、不良半
導体装置として選別され、除去される。
なお、このワイヤ選別と電気特性選別は、通常同一の試
験機で実施できる。
ここで、本発明は、ベレット上の1つのポンディングパ
ッドとパッケージの1つのリードとを3本以上のワイヤ
で接続する半導体装置においても同様に通用できる。
例えば、3本のワイヤの場合には、ワイヤ1本の溶断電
流の2倍以上で3倍未満の電流を流せばよい。これによ
り、3本のワイヤのうち1本または2本がオーブンの場
合には、残りのワイヤが溶断され、そのリードとポンデ
ィングパッド間は電気的にオーブン状態となり、次の電
気特性選別において不良として選別されることになる。
〔発明の効果〕
以上説明した様に本発明は、1本のボンディングワイヤ
の溶断電流値をボンディングワイヤの本数倍したよりも
小さい電流をパッドとリード間に印加しているので、少
なくとも一本のワイヤがオープン状態にあるときには、
接続されている他のワイヤが溶断されてパッドとリード
との間が完全にオーブンとなり、半導体装置の不良を電
気的に検査することが可能となる。
【図面の簡単な説明】
第1図は本発明におけるワイヤ径と溶断電流の相関を示
す図、第2図(a)及び第2図(b)は半導体装置が良
品の場合の選別方法を示す半導体装置の内部平面図、第
3図(a)及び第3図(b)は半導体装置が不良品の場
合の選別方法を示す半導体装置の内部平面図である。 1・・・リードフレーム、2・・・コレクタリード、3
・・・エミッタリード、4・・・ベースリード、IC・
・・トランジスタペレット、E・・・エミッタパッド、
B・・・ペースパッド、Wl、W2.W3・・・ボンデ
ィングワイヤ図 第3図 (a) 第2図 (a) (b) 3ユミ1..2ノーF

Claims (1)

    【特許請求の範囲】
  1. 1、半導体ペレットの1つのパッドとパッケージの1つ
    のリードとを複数本のボンディングワイヤで並列接続し
    ている半導体装置の検査に際し、1本のボンディングワ
    イヤの溶断電流値をボンディングワイヤの本数倍し、こ
    れよりも小さい電流を前記パッドとリード間に印加して
    ボンディングワイヤの接続状態を検査することを特徴と
    する半導体装置の検査方法。
JP1037503A 1989-02-17 1989-02-17 半導体装置の検査方法 Pending JPH02216475A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04326073A (ja) * 1991-04-26 1992-11-16 Nec Yamagata Ltd 半導体装置の測定装置
IT201700000460A1 (it) * 2017-01-03 2018-07-03 St Microelectronics Srl Procedimento per realizzare prodotti a semiconduttore, prodotto e dispositivo a semiconduttore corrispondenti
JP2020155690A (ja) * 2019-03-22 2020-09-24 三菱電機株式会社 半導体装置

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04326073A (ja) * 1991-04-26 1992-11-16 Nec Yamagata Ltd 半導体装置の測定装置
IT201700000460A1 (it) * 2017-01-03 2018-07-03 St Microelectronics Srl Procedimento per realizzare prodotti a semiconduttore, prodotto e dispositivo a semiconduttore corrispondenti
US10153229B2 (en) 2017-01-03 2018-12-11 Stmicroelectronics S.R.L. Method of manufacturing semiconductor products, corresponding semiconductor product and device
JP2020155690A (ja) * 2019-03-22 2020-09-24 三菱電機株式会社 半導体装置

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