JPH0213393B2 - - Google Patents
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- JPH0213393B2 JPH0213393B2 JP60037981A JP3798185A JPH0213393B2 JP H0213393 B2 JPH0213393 B2 JP H0213393B2 JP 60037981 A JP60037981 A JP 60037981A JP 3798185 A JP3798185 A JP 3798185A JP H0213393 B2 JPH0213393 B2 JP H0213393B2
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- connector
- pin
- pin lead
- circuit
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Description
【発明の詳細な説明】
〔産業上の利用分野〕
一軸異方性の稀土類鉄ガーネツト単結晶膜中に
生ずる磁気バブルを記憶媒体として利用するメモ
リデバイスの、特に可搬型構成メモリカセツト体
の帯電によるメモリ破壊保護対策に係る磁気バブ
ルメモリカセツトに関する。
生ずる磁気バブルを記憶媒体として利用するメモ
リデバイスの、特に可搬型構成メモリカセツト体
の帯電によるメモリ破壊保護対策に係る磁気バブ
ルメモリカセツトに関する。
本発明は、樹脂成形カセツト筐体の静電気帯電
にともなう例えばメモリ媒体駆動のロジツク回路
及びバブルメモリデバイス内の制御電極（ジエネ
レータ、リプリケータ、スワツプゲート）などの
破壊を皆無とする信頼性の高いメモリデバイスの
要請によりなされたものである。
にともなう例えばメモリ媒体駆動のロジツク回路
及びバブルメモリデバイス内の制御電極（ジエネ
レータ、リプリケータ、スワツプゲート）などの
破壊を皆無とする信頼性の高いメモリデバイスの
要請によりなされたものである。
かかるメモリデバイスは記憶媒体のバブルメモ
リチツプ、チツプ駆動の周辺回路等が樹脂成形に
なるカセツト筐体内部に収納される。該デバイス
収納のカセツト体は筐体の一側面に多数のコネク
タピンリード（端子）が導出され、ホスト装置側
カセツトホールダ部に設けるコネクタを介して、
チツプ駆動用電源とか記憶データ情報の読出しあ
るいは書込みの回路と接続して動作する。
リチツプ、チツプ駆動の周辺回路等が樹脂成形に
なるカセツト筐体内部に収納される。該デバイス
収納のカセツト体は筐体の一側面に多数のコネク
タピンリード（端子）が導出され、ホスト装置側
カセツトホールダ部に設けるコネクタを介して、
チツプ駆動用電源とか記憶データ情報の読出しあ
るいは書込みの回路と接続して動作する。
第３図は、従来におけるカセツト体の静電気保
護対策例を説明する等価回路図である。
護対策例を説明する等価回路図である。
図において、１はカセツト筐体、２は筐体１の
一端に装着された多数のピンリード３を有するコ
ネクタ、及び５は筐体内部に収納されたメモリデ
バイスである。又、６はコイル７と多数の接点８
を備える継電器であり、接点８はデバイス５の入
力回路４とコネクタのピンリード３間に挿入され
る常時開放接点である。
一端に装着された多数のピンリード３を有するコ
ネクタ、及び５は筐体内部に収納されたメモリデ
バイスである。又、６はコイル７と多数の接点８
を備える継電器であり、接点８はデバイス５の入
力回路４とコネクタのピンリード３間に挿入され
る常時開放接点である。
第３図回路図から明らかなように、筐体１内収
納のメモリデバイス５の回路は開放接点８で遮断
となることから、筐体帯電に伴う高圧の静電気が
たとえ側面に露出するピンリード３に印加される
事が生じても、デバイス駆動のゲート回路を充電
することが防止され、デバイス並びに記憶データ
を保護することが出来る。
納のメモリデバイス５の回路は開放接点８で遮断
となることから、筐体帯電に伴う高圧の静電気が
たとえ側面に露出するピンリード３に印加される
事が生じても、デバイス駆動のゲート回路を充電
することが防止され、デバイス並びに記憶データ
を保護することが出来る。
前記例示回路はメモリカセツト内に継電器を装
着したメモリデバイスの静電気保護対策を例示す
るが、本発明は更に簡易な構成になる静電気保護
手段を提示することである。
着したメモリデバイスの静電気保護対策を例示す
るが、本発明は更に簡易な構成になる静電気保護
手段を提示することである。
本発明によれば、ホスト装置側と接続する複数
のコネクタピンリードが設けられたバブルメモリ
デバイス収納のカセツト体において、前記コネク
タピンリードの複数個を同電位とするアース電極
を備えたコネクタ構成にしてホスト装置と接続す
るものである。
のコネクタピンリードが設けられたバブルメモリ
デバイス収納のカセツト体において、前記コネク
タピンリードの複数個を同電位とするアース電極
を備えたコネクタ構成にしてホスト装置と接続す
るものである。
常時、カセツト体のコネクタピンリードはアー
ス電極によつて、例えばデバイス入力の総ての回
路がアース電位になることからデバイス制御の薄
膜ロジツク回路の例えばゲート回路を静電気破壊
から保護することが出来る。
ス電極によつて、例えばデバイス入力の総ての回
路がアース電位になることからデバイス制御の薄
膜ロジツク回路の例えばゲート回路を静電気破壊
から保護することが出来る。
前記アース電極は、ホスト装置へ接続される
時、コネクタピンリードから開放されるので問題
はない。
時、コネクタピンリードから開放されるので問題
はない。
以下、本発明の一実施例を第１図と第２図に示
すカセツト接続構成側断面図を参照して詳細に説
明する。
すカセツト接続構成側断面図を参照して詳細に説
明する。
第１図側断面図は、コネクタを介して相互に接
続されるカセツト体ａとホスト装置側カセツトホ
ルダ部ｂのそれぞれの構成を示し、また第２図
は、第１図カセツト体の矢印方向に挿入されたコ
ネクタ接続完了時の側断面図である。
続されるカセツト体ａとホスト装置側カセツトホ
ルダ部ｂのそれぞれの構成を示し、また第２図
は、第１図カセツト体の矢印方向に挿入されたコ
ネクタ接続完了時の側断面図である。
樹脂モールド成形になるカセツト筐体１は、一
側面（図左方）は多数のコネクタピンリード３に
よる内部デバイス回路を導出する端子部が形成さ
れる。
側面（図左方）は多数のコネクタピンリード３に
よる内部デバイス回路を導出する端子部が形成さ
れる。
筐体内部はプリント基板９が装着され、該基板
９には、バブルメモリチツプと該チツプ駆動用フ
アンクシヨン回路などが納められたメモリデバイ
ス５、装置データバスと接続に必要となるインタ
フエース回路等が実装される。
９には、バブルメモリチツプと該チツプ駆動用フ
アンクシヨン回路などが納められたメモリデバイ
ス５、装置データバスと接続に必要となるインタ
フエース回路等が実装される。
ａ図中、１０はコネクタピンリード３に併記さ
せて形成するばね導体よりなるアース電極であ
る。
せて形成するばね導体よりなるアース電極であ
る。
電極１０は、筐体内部で接地導体回路１１へ接
続される。常時、カセツト体がカセツトホルダか
ら抜き取られている状態では、アース電極１０は
コネクタのピンリード（端子）３と導通させてな
り接地短絡状態となされる。
続される。常時、カセツト体がカセツトホルダか
ら抜き取られている状態では、アース電極１０は
コネクタのピンリード（端子）３と導通させてな
り接地短絡状態となされる。
かくして、カセツトのコネクタの総ての端子部
は、常にアース電位となるため、メモリデバイス
駆動のロジツク回路が静帯電で破壊することが防
がれる。
は、常にアース電位となるため、メモリデバイス
駆動のロジツク回路が静帯電で破壊することが防
がれる。
然し、アース電極１０は、同図ｂに示すホスト
装置側カセツトホルダ部１２のコネクタ１３に接
続されると、ピンリード３との導通が強制的に解
離させられる。即ち、ホルダ側コネクタ１３のピ
ンリード１４上面に形成する絶縁被覆１５により
接地短絡状態が解かれることになる。
装置側カセツトホルダ部１２のコネクタ１３に接
続されると、ピンリード３との導通が強制的に解
離させられる。即ち、ホルダ側コネクタ１３のピ
ンリード１４上面に形成する絶縁被覆１５により
接地短絡状態が解かれることになる。
第２図は、前記せるアース電極１０の接地短絡
状態が解かれたコネクタ接続完了後の側断面図で
ある。
状態が解かれたコネクタ接続完了後の側断面図で
ある。
前記のごとく、本発明のバブルメモリカセツト
体は、装置側カセツトホルダ１２に挿着したと
き、接地短絡用のばね導体からなるアース電極１
０が開放されるのでカセツト記憶データ情報の読
出しまたは書込み動作が従来同様におこなわれ
る。
体は、装置側カセツトホルダ１２に挿着したと
き、接地短絡用のばね導体からなるアース電極１
０が開放されるのでカセツト記憶データ情報の読
出しまたは書込み動作が従来同様におこなわれ
る。
以上説明したように本発明のメモリカセツト体
の静電気保護方法によれば、従来より更に簡易な
手段で該デバイス内記憶データの保護がされるこ
とになるので安価なカセツト体が提供される。
の静電気保護方法によれば、従来より更に簡易な
手段で該デバイス内記憶データの保護がされるこ
とになるので安価なカセツト体が提供される。
第１図ａ図とｂ図は、それぞれ本発明のカセツ
ト体とホスト装置側カセツトホルダ部の接続構成
側断面図、第２図はカセツト体のコネクタ接続完
了時の側断面図である。第３図は従来のカセツト
体の静電気保護をなす等価回路図である。 図中、１はカセツト筐体、２はコネクタ、３は
ピンリード、５はメモリデバイス、１０はアース
電極、１１は接地部、及び１３はピンリード３に
接続のピンリードである。
ト体とホスト装置側カセツトホルダ部の接続構成
側断面図、第２図はカセツト体のコネクタ接続完
了時の側断面図である。第３図は従来のカセツト
体の静電気保護をなす等価回路図である。 図中、１はカセツト筐体、２はコネクタ、３は
ピンリード、５はメモリデバイス、１０はアース
電極、１１は接地部、及び１３はピンリード３に
接続のピンリードである。
Claims (1)
- 【特許請求の範囲】 １ メモリデバイス５が収納され、かつ複数個の
ピンリード３と、該ピンリード３の夫々に常に電
気的に弾接するアース電極１０とを有するカセツ
ト筐体１と、 前記カセツト１が着脱され、かつ前記ピンリー
ド３が嵌脱されるピンリード１４とを有するカセ
ツトホルダ１２とからなり、 前記カセツト１が前記ホルダ１２に装着された
際に、 前記ピンリード３に弾接している前記アース電
極１０が、前記ピンリード１４に設けられた絶縁
被ふく１５によつて押し上げられて弾接状態が解
かれ、かつ該ピンリード３とピンリード１４とが
電気的に接続されることを特徴とする磁気バブル
メモリカセツト。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60037981A JPS61198488A (ja) | 1985-02-27 | 1985-02-27 | 磁気バブルメモリカセツト |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60037981A JPS61198488A (ja) | 1985-02-27 | 1985-02-27 | 磁気バブルメモリカセツト |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61198488A JPS61198488A (ja) | 1986-09-02 |
| JPH0213393B2 true JPH0213393B2 (ja) | 1990-04-04 |
Family
ID=12512741
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60037981A Granted JPS61198488A (ja) | 1985-02-27 | 1985-02-27 | 磁気バブルメモリカセツト |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61198488A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002008342A (ja) | 2000-06-26 | 2002-01-11 | Fuji Photo Film Co Ltd | 磁気テープカートリッジ |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57152581A (en) * | 1981-03-16 | 1982-09-20 | Hitachi Ltd | Magnetic bubble memory device |
| JPS58208983A (ja) * | 1982-04-26 | 1983-12-05 | Fujitsu Ltd | カセツト状磁気バブルメモリ装置 |
| JPS58211390A (ja) * | 1982-06-01 | 1983-12-08 | Fujitsu Ltd | バブルメモリカセットとホルダユニットとの接続構造 |
| JPS60211681A (ja) * | 1984-04-06 | 1985-10-24 | Hitachi Ltd | カセツト形磁気バブルメモリ装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58193398U (ja) * | 1982-06-16 | 1983-12-22 | 富士通株式会社 | 磁気バブルメモリカセツト |
-
1985
- 1985-02-27 JP JP60037981A patent/JPS61198488A/ja active Granted
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57152581A (en) * | 1981-03-16 | 1982-09-20 | Hitachi Ltd | Magnetic bubble memory device |
| JPS58208983A (ja) * | 1982-04-26 | 1983-12-05 | Fujitsu Ltd | カセツト状磁気バブルメモリ装置 |
| JPS58211390A (ja) * | 1982-06-01 | 1983-12-08 | Fujitsu Ltd | バブルメモリカセットとホルダユニットとの接続構造 |
| JPS60211681A (ja) * | 1984-04-06 | 1985-10-24 | Hitachi Ltd | カセツト形磁気バブルメモリ装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61198488A (ja) | 1986-09-02 |
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