JPH01309516A - 周波数シンセサイザ - Google Patents

周波数シンセサイザ

Info

Publication number
JPH01309516A
JPH01309516A JP63140777A JP14077788A JPH01309516A JP H01309516 A JPH01309516 A JP H01309516A JP 63140777 A JP63140777 A JP 63140777A JP 14077788 A JP14077788 A JP 14077788A JP H01309516 A JPH01309516 A JP H01309516A
Authority
JP
Japan
Prior art keywords
frequency
output signal
phase
voltage controlled
controlled oscillator
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP63140777A
Other languages
English (en)
Other versions
JP2834740B2 (ja
Inventor
Takenori Kurihara
栗原 武則
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Advantest Corp
Original Assignee
Advantest Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Advantest Corp filed Critical Advantest Corp
Priority to JP63140777A priority Critical patent/JP2834740B2/ja
Publication of JPH01309516A publication Critical patent/JPH01309516A/ja
Application granted granted Critical
Publication of JP2834740B2 publication Critical patent/JP2834740B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Landscapes

  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 「産業上の利用分野」 この発明は、少ない可変周波数発振器と位相同期ループ
で、高分解能で低雑音の周波数シンセサイザを実現しよ
うとするものである。
「従来技術の説明」 第2図に従来の周波数シンセサイザの回路図を示す。
入力端子11.12からそれぞれ周波数frl、fr2
の信号が入力される。位相/周波数比較器15の一方の
入力側には、入力端子11を通じて入力した周波数f 
rlの信号が供給される。位相/周波数比較器15の他
方の入力側には、電圧制御発振器14の出力信号が可変
分周器16を通して供給される。位相/周波数比較器1
5は2つの入力信号を比較し、その比較結果に対応した
電圧を電圧側?In発振器14に供給する。電圧制御発
振器14、可変分周器16、位相/周波数比較器15に
より位相同期ループ17が構成されている。可変分周器
16の分周率をN、とおくと、電圧制御発振器14から
周波数N1 ・f rlの信号が出力される。
この信号がミキサ19の一方の入力側に供給される。ミ
キサ19の他方の入力側には、別の電圧制御発振器18
の出力信号が供給され、ミキサ19から2つの入力信号
の差の周波数を有する信号が出力される。位相/周波数
比較器21の一方の入力端には入力端子12を通じて入
力した周波数f、□の信号が供給され、他方の入力側に
はミキサ19の出力信号が可変分周器20を通じて供給
される。
位相/周波数比較器21は2つの入力信号を比較し、そ
の比較結果に対応した電圧を低域通過ろ波器22を通じ
て電圧制御発振器18に供給する。
電圧制御発振器18、ミキサ19、可変分周器20、位
相/周波数比較器21、低域通過ろ波器22により位相
同期ループ23が構成されている。可変分周器20の分
周率をN2とおくと、電圧制御発振器18から周波数N
l  −f、++Nz  ・fr2の信号が出力される
。この信号が出力端子13から出力される。
出力端子13から出力される信号の周波数N1” rl
 +N2  ’ f r2は、可変分周器16及び20
の分周率を変化させることにより調整している。
ところが現在市販されている狭帯域の低域通過ろ波器を
用いても、2つの位相同期ループ17.23のめで多桁
の分解能で高速、高純度に発振周波数を調整することは
できない。このことを実現しようとすると、更に電圧制
御発振器と可変分周器と位相/周波数比較器とから成る
位相同期ループを付は加えなければならず、高価になる
という問題がある。
「問題点を解決するための手段」 この発明による周波数シンセサイザは、A、第1電圧制
御発振器と、 B、可変周波数発振器と、 C1該可変周波数発振器の出力信号が供給され、位相が
互いに90度ずれた信号を出力する90度シフタと、 D、上記第1電圧制御発振器の出力信号と上記90度シ
フタの一方の出力信号とを周波数合成する第1ミキサと
、 E、上記第1電圧制御発振器の出力信号と上記90度シ
フタの他方の出力信号とを周波数合成する第2ミキサと
、 F、上記第1ミキサ及び第2ミキサの出力信号が供給さ
れて、上記第1電圧制御発振器の発振周波数と上記90
度シフタの発振周波数の差の周波数の信号及び和の周波
数の信号を合成する90度ハイブリッドと、 G、該90度ハイブリッドの1つの出力信号を分周する
第1可変分周器と、 H,該第1可変分周器の出力信号と基準信号とを比較す
る第1位相/周波数比較器と、 I、上記90度ハイブリッドの一方の出力側に接続され
た遅延回路と、 J、該遅延回路を通過した90度ハイブリッドの一方の
出力信号と、他方の出力信号とを周波数合成する第3ミ
キサと、 K、上記周波数発振器の出力信号又は上記第3ミキサの
出力信号を逓倍又は分周することにより他方の出力信号
と同一の周波数に変換する第1周波数変換器と、 L、該第1周波数変換器で周波数変換された上記周波数
発振器の出力信号又は上記第3ミキサの出力信号と、他
方の出力信号とを比較する第2位相/周波数比較器と、 M、上記第1位相/周波数比較器の出力電圧と上記第2
位相/周波数比較器の出力電圧とを加算して、上記第1
電圧制御発振器に供給する加算器と、 により構成される。
第1電圧制御発振器の発振周波数をf。、90度シフタ
の発振周波数をf、とおく。周波数f。
は周波数f。と比較して小さい。この時、90度ハイブ
リッドの2つの出力端子からそれぞれ差の周波数f。−
f、の信号と、和の周波数f。1−flの信号が出力さ
れる。
そして例えば差の周波数f。−flの出力信号は第1可
変分周器を通じて第1位相/周波数比較器の一方の入力
側に供給される。この第1位相/周波数比較器の他方の
入力側には、例えば信号源から一定の周波数frの基準
信号が供給される。
第1位相/周波数比較器はこれらの2つの入力信号を比
較し、比較結果に対応した電圧を加算器の一方の入力側
を通じて第1電圧制御発振器に供給する。第1電圧制御
発振器、第1ミキサ、90度ハイブリッド、第1可変分
周器、第1位相/周波数比較器により第1位相同期ルー
プが構成される。
ここで、第1可変分周器の分周率をNIとおくと、第1
電圧制御発振器から周波数f。−f、 十N。
・f、の信号が出力される。
第3ミキサには90度ハイブリッドの2つの出力信号が
供給され、差の周波数2f、の信号が合成される。この
信号は第1周波数変換器を通じて、又は直接第2位相/
周波数比較器の一方の入力端に供給される。第2位相/
周波数比較器の他方の入力側には可変周波数発振器の出
力信号が直接、又は第1周波数変換器を通じて供給され
る。この第2位相/周波数比較器からの比較結果を示す
電圧は、加算器の他方の入力側を通じて第1電圧制御発
振器に供給される。第1電圧制御発振器、第1ミキサ及
び第2ミキサ、90度ハイブリッド、第3ミキサ、第2
位相/周波数比較器により第2位相同期ループが構成さ
れる。
このように第1電圧制御発振器の出力信号を2つの位相
同期ループで制御しているので、この第1電圧制御発振
器から低雑音の信号が出力される。
また可変周波数発振器を、例えば第2電圧制御発振器と
第2可変分周器と第3位相/周波数比較器とから成る第
3位相同期ループと、この第3位相同期ループの出力信
号を分周して上記90度シフタに供給する分周器とによ
り構成する。このようにすると第3位相同期ループから
出力される信号に含まれる雑音成分は、分周器で低減さ
れる。
そして第1電圧制御発振器から出力される信号の周波数
は第1可変分周器と第2可変分周器で調整できるので、
従来と比較して安価で高分解能の周波数シンセサイザが
得られる。
また第3位相同期ループの出力信号を分周する分周器の
代わりにミキサを用いてもよい。そしてこのミキサで第
3位相同期ループの出力信号を、上記可変周波数発振器
の出力側に接続された回路が動作可能な周波数帯域に周
波数変換する。このように構成しても高分解能の周波数
シンセサイザが得られる。
「実施例」 第1図にこの発明の一実施例である周波数シンセサイザ
の回路図を示す。
SSBミキサ28は90度シフタ27、第1ミキサ29
、第2ミキサ30.90度ハイブリッド47により構成
されている。第1電圧制御発振器24の出力信号は第1
ミキサ29及び第2ミキサ30の一方の入力側に供給さ
れる。また可変周波数発振器26の出力信号は、90度
シフタ27に供給される。90度シフタ27は例えばデ
ジタル型のフリップフロップ回路により構成されており
、可変周波数発振器26の出力信号を1/4の周波数の
信号に変換する。そしてこの90度シフタ27から第1
ミキサ29及び第2ミキサ30の他方の入力側に、互い
に位相が90度ずれた信号が供給される。第1ミキサ2
9及び第2ミキサ30の出力信号は90度ハイブリッド
47に供給される。
今、第1電圧制御発振器24、可変周波数発振器26か
ら出力される信号の周波数をそれぞれf。、4f、とお
く。ここでflはf。より小さい。この時90度シフタ
27から出力される信号の周波数はfl となる。90
度ハイブリット47の一方の出力側から差の周波数f。
−f、の信号が出力された場合、他方の出力側から和の
周波数f。+f1の信号が出力される。
例えば差の周波数f。−flの出力信号は、第1可変分
周器31で分周されて第1位相/周波数比較器33の一
方の入力側に供給される。第1位相/周波数比較器33
の他方の入力側には、入力端子32から周波数frの基
準信号が供給されている。この第1位相/周波数比較器
33からの比較結果を示す電圧は、加算器34の一方の
入力側を通じて第1電圧制御発振器24に供給される。
第1電圧制御発振器24、第1ミキサ29.90度ハイ
ブリッド47、第1可変分周器31、第1位相/周波数
比較器33により第1位相同期ループ35が構成される
。そして第1可変分周器31の分周率をN1とおくと、
第1電圧制御発振器24から周波数f。−f、+N、 
 ・f、の信号が出力される。この信号が出力端子25
から出力される。
90度ハイブリッド47の一方の出力側から出力される
周波数f。−flの信号は、第3ミキサ37の一方の入
力側に供給される。また90度ハイブリッド47の他方
の出力側から出力される周波数f。+f、の信号は、遅
延回路36を通じて第3ミキサ37の他方の入力側に供
給される。第3ミキサ37は2つの入力信号の差の周波
数2f。
の信号を合成し、これを第2位相/周波数比較器39の
一方の入力側に供給する。第2位相/周波数比較器39
の他方の入力側には、可変周波数発振器26の出力信号
が分周率1/2の第1分周器38を通じて供給される。
この第2位相/周波数比較器39からの比較結果を示す
電圧は、加算器34の他方の入力側を通じて第1電圧制
御発振器24に供給される。ここで90度ハイブリット
47の他方の出力側に遅延回路36を接続したのは、第
1電圧制御発振器24の出力信号に雑音が生じた時、そ
の雑音成分が第3ミキサ37で打ち消されないで、第1
電圧制御発振器24に帰還できるようにするためである
。第1電圧制御発振器24、SSBミキサ28、第3ミ
キサ37、第2位相/周波数比較器39、加算器34に
より第2位相同期ループ40が構成される。
以上のように第1電圧制御発振器24の出力信号を、第
1位相同期ループ35及び第2位相同期ループ40で2
重に同期をとっているので、出力端子25から低雑音の
信号が出力される。
第1分周器38の変わりに第3ミキサ37の出力側に逓
倍率が2倍の逓倍器を設け、この逓倍器で逓倍された信
号と可変周波数発振器26の出力信号とを第2位相周波
数比較器39で比較するようにしてもよい。
また可変周波数発振器26を第1図に示すように構成す
ることにより、分解能を向上させることができる。可変
周波数発振器26において、第2電圧制御発振器41の
出力信号は第2可変分周器42で分周されて第3位相/
周波数比較器43の一方の入力側に供給される。第3位
相/周波数比較器43の他方の入力側には、入力端子4
4から周波数fsの基準信号が供給されている。第3位
相/周波数比較器43からの比較結果を示す電圧は、第
2電圧制御発振器41に帰還される。第2電圧制御発振
器41、第2可変分周器42、第3位相/周波数比較器
41により第3位相同期ループ45が構成される。この
第3位相同期ループ45で周波数合成された信号は、第
2分周器46で分周されて90度シフタ27及び第1分
周器38に供給される。このように第3位相同期ループ
45で周波数合成された信号を第2分周器46で分周し
て出力しているので、第3位相同期ループ45の可変範
囲を比較的広くしても、可変周波数発振器26から雑音
の少ない信号が出力される。
今、入力端子32.33から供給される基準信号の周波
数fr、fsをそれぞれ100KHz、10KHz、第
1可変分周器31の分周率の可変範囲をN、=398〜
797、第2可変分周器42の分周率の可変範囲をN2
=20,000〜30.000、第2分周器46の分周
率を250とおく。この時、可変周波数発振器26の発
振周波数4f+ は0.8〜1.2Ml1zの間を40
11z間隔で変化する。従って90度シフタ27で1重
4分周された周波数f、は、0.2〜0.3MHzの間
を10Hz間隔で変化する。また90度ハイブリッド4
7の一方の出力側から第1可変分周器31に供給される
信号の周波数N、−f、は、39.8〜79.7Mtl
zの間を100 KHz間隔で変化する。従って出力端
子25から出力される信号の周波数f。=f、−トN、
  ・f、は、40〜80MH2の間を10Hz間隔で
変化させることができ、6桁の分解能が得られる。
また可変周波数発振器26において、第2分周器46の
代わりにミキサを用いてもよい。そして第3位相同期ル
ープ45の出力信号と所定の基準信号とを周波数合成し
て、例えばSSBミキサ28が動作可能な帯域に周波数
変換する。このように構成することにより、上記と同様
に発振周波数の分解能を向上させることができる。
「発明の効果」 以上説明したようにこの発明による周波数シンセサイザ
では、第1位相同期ループと第2位相同期ループの2重
のループで第1電圧制御発振器の発振周波数を制御して
いるので、この第1電圧制御発振器から低雑音の信号が
出力される。また可変周波数発振器として第3位相同期
ループとこの第3位相同期ループの出力信号を周波数変
換する第2周波数変換器で構成することにより、この可
変周波数発振器の発振周波数を比較的細かく設定するこ
とができる。従って安価な構成で高分解能の周波数シン
セサイザを実現することができる。
【図面の簡単な説明】
第1図はこの発明の一実施例である周波数シンセサイザ
の回路図、第2図は従来の周波数シンセサイザの回路図
である。 特許出願人 株式会社アトパンテスト 代理人  弁理士    打検 保男

Claims (2)

    【特許請求の範囲】
  1. (1)A、第1電圧制御発振器と、 B、可変周波数発振器と、 C、該可変周波数発振器の出力信号が供給され、位相が
    互いに90度ずれた信号を出力する90度シフタと、 D、上記第1電圧制御発振器の出力信号と上記90度シ
    フタの一方の出力信号とを周波数合成する第1ミキサと
    、 E、上記第1電圧制御発振器の出力信号と上記90度シ
    フタの他方の出力信号とを周波数合成する第2ミキサと
    、 F、上記第1ミキサ及び第2ミキサの出力信号が供給さ
    れて、上記第1電圧制御発振器の発振周波数と上記90
    度シフタの発振周波数の差の周波数の信号及び和の周波
    数の信号を合成する90度ハイブリッドと、 G、該90度ハイブリッドの1つの出力信号を分周する
    第1可変分周器と、 H、該第1可変分周器の出力信号と基準信号とを比較す
    る第1位相/周波数比較器と、 I、上記90度ハイブリッドの一方の出力側に接続され
    た遅延回路と、 J、該遅延回路を通過した90度ハイブリッドの一方の
    出力信号と、他方の出力信号とを周波数合成する第3ミ
    キサと、 K、上記周波数発振器の出力信号又は上記第3ミキサの
    出力信号を逓倍又は分周することにより他方の出力信号
    と同一の周波数に変換する第1周波数変換器と、 L、該第1周波数変換器で周波数変換された上記周波数
    発振器の出力信号又は上記第3ミキサの出力信号と、他
    方の出力信号とを比較する第2位相/周波数比較器と、 M、上記第1位相/周波数比較器の出力電圧と上記第2
    位相/周波数比較器の出力電圧とを加算して、上記第1
    電圧制御発振器に供給する加算器と、 を具備して成ることを特徴とする周波数シンセサイザ。
  2. (2)上記可変周波数発振器は、 A、第2電圧制御発振器と、 B、該第2電圧制御発振器の出力信号を分周する第2可
    変分周器と、 C、該第2可変分周器の出力信号と基準信号とを比較し
    、その比較結果に対応する電圧を上記第2電圧制御発振
    器に帰還する第3位相/周波数比較器と、 D、上記第2電圧制御発振器の出力信号を周波数変換し
    て上記90度シフタ及び第2位相/周波数比較器に供給
    する第2周波数変換器と、により構成されて成ることを
    特徴とする特許請求の範囲第1項記載の周波数シンセサ
    イザ。
JP63140777A 1988-06-08 1988-06-08 周波数シンセサイザ Expired - Fee Related JP2834740B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP63140777A JP2834740B2 (ja) 1988-06-08 1988-06-08 周波数シンセサイザ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP63140777A JP2834740B2 (ja) 1988-06-08 1988-06-08 周波数シンセサイザ

Publications (2)

Publication Number Publication Date
JPH01309516A true JPH01309516A (ja) 1989-12-13
JP2834740B2 JP2834740B2 (ja) 1998-12-14

Family

ID=15276507

Family Applications (1)

Application Number Title Priority Date Filing Date
JP63140777A Expired - Fee Related JP2834740B2 (ja) 1988-06-08 1988-06-08 周波数シンセサイザ

Country Status (1)

Country Link
JP (1) JP2834740B2 (ja)

Also Published As

Publication number Publication date
JP2834740B2 (ja) 1998-12-14

Similar Documents

Publication Publication Date Title
JP2526847B2 (ja) ディジタル方式無線電話機
US5831481A (en) Phase lock loop circuit having a broad loop band and small step frequency
JPH0946225A (ja) マイクロ波・ミリ波帯位相同期発振回路
JP2001144545A (ja) 周波数合成装置
JPS62260429A (ja) 高周波数シンセサイザ−
US7023948B2 (en) Frequency converter arrangement
JPS6359116A (ja) Pll周波数シンセサイザ
US6493410B1 (en) Wide band high resolution synthesizer
JPH01309516A (ja) 周波数シンセサイザ
JP2947203B2 (ja) 周波数シンセサイザ
JPS6238352Y2 (ja)
Rohde et al. Digital PLL Synthesizers
JP3248453B2 (ja) 発振装置
JPS61135227A (ja) フエイズロツクドル−プ発振器
JPS63308413A (ja) 位相同期ル−プ回路
JPH08204554A (ja) ダイレクト・デジタル・シンセサイザ位相同期発振回路
JP5133893B2 (ja) 共有発振器を有する信号調整回路
JPS6165609A (ja) 周波数変換装置
JPS6338329A (ja) マイクロ波シンセサイザ
JPH05284023A (ja) 周波数シンセサイザ
JPS6384320A (ja) マイクロ波帯周波数シンセサイザ
JPH09214336A (ja) 二重比較形シンセサイザ発振器
JPH0449292B2 (ja)
JP2006129330A (ja) 周波数シンセサイザ
JPH0998084A (ja) 位相同期発振回路

Legal Events

Date Code Title Description
LAPS Cancellation because of no payment of annual fees