JPH01218167A - クロツク信号発生装置 - Google Patents
クロツク信号発生装置Info
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- JPH01218167A JPH01218167A JP63042044A JP4204488A JPH01218167A JP H01218167 A JPH01218167 A JP H01218167A JP 63042044 A JP63042044 A JP 63042044A JP 4204488 A JP4204488 A JP 4204488A JP H01218167 A JPH01218167 A JP H01218167A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、クロック信号発生装置に係り、特にレーザー
ビームプリンタにおいて走査ビームの走査開始位置に精
度よく対応したビデオ信号を発生するのに好都合なりロ
ック信号発生装置に関する。
ビームプリンタにおいて走査ビームの走査開始位置に精
度よく対応したビデオ信号を発生するのに好都合なりロ
ック信号発生装置に関する。
レーザビームプリンタは、第２図に示すように、ビデオ
アンプ１はビデオ信号発生回路１１がら出力されるビデ
オ信号を増幅してレーザーダイオード２を駆動する。レ
ーザーダイオード２がら出方されたレーザー光は結合レ
ンズ３で整形されてレーザービームとなり、スキャナモ
ータ４によって高速回転されるポリゴンミラー５で偏向
され、Ｆ−θレンズ６を介して感光ドラム７の表面を走
査露光する。感光ドラム７は定速回転しており、帯電、
前記走査露光、現像、転写のゼログラフィープロセスに
よって記録紙にトナー像を形成する。
アンプ１はビデオ信号発生回路１１がら出力されるビデ
オ信号を増幅してレーザーダイオード２を駆動する。レ
ーザーダイオード２がら出方されたレーザー光は結合レ
ンズ３で整形されてレーザービームとなり、スキャナモ
ータ４によって高速回転されるポリゴンミラー５で偏向
され、Ｆ−θレンズ６を介して感光ドラム７の表面を走
査露光する。感光ドラム７は定速回転しており、帯電、
前記走査露光、現像、転写のゼログラフィープロセスに
よって記録紙にトナー像を形成する。
そして、記録紙上のトナー像は定着して利用される。
このようなレーザービームプリンタは、走査露光の開始
タイミングと前記ビデオ信号の発生タイミングを同期さ
せるために、レーザービームが走査開始基準位置を通過
するタイミングをフォトセンサ８で検出し、フォトセン
サ８の出力信号をセンサアンプ９で増幅して同期タイミ
ング信号とし、走査位相同期回路１０においてこの同期
タイミング信号に同期したビデオクロック信号を発生し
、第３図および第４図（ａ）のような画像を記録するよ
うにしている。しかし、このビデオクロック信号は、定
周波発振回路から出力されるクロック信号を利用するも
のであるので、各走査毎に前記同期タイミング信号と前
記クロック信号の位相を一致させることは困難であり、
両者間には１サイクルの範囲内での位相のずれ（位相差
）が発生する。この位相差は、第４図（ｂ）のように記
録画素の位置ずれとなることから、高精細画像を記録し
ようとする場合には、この位相差を減少させなければな
らない。
タイミングと前記ビデオ信号の発生タイミングを同期さ
せるために、レーザービームが走査開始基準位置を通過
するタイミングをフォトセンサ８で検出し、フォトセン
サ８の出力信号をセンサアンプ９で増幅して同期タイミ
ング信号とし、走査位相同期回路１０においてこの同期
タイミング信号に同期したビデオクロック信号を発生し
、第３図および第４図（ａ）のような画像を記録するよ
うにしている。しかし、このビデオクロック信号は、定
周波発振回路から出力されるクロック信号を利用するも
のであるので、各走査毎に前記同期タイミング信号と前
記クロック信号の位相を一致させることは困難であり、
両者間には１サイクルの範囲内での位相のずれ（位相差
）が発生する。この位相差は、第４図（ｂ）のように記
録画素の位置ずれとなることから、高精細画像を記録し
ようとする場合には、この位相差を減少させなければな
らない。
このために従来は、特開昭５８−１０４５６５号公報に
記載されたように、クロック信号を遅延回路で遅延して
位相差の異る複数個のクロック信号を作り、そのうちの
最適位相のものを選択的に使用するようにしていた。し
かしこの回路は、遅延回路がアナログ信号処理回路とな
るので安定性に欠ける問題がある。
記載されたように、クロック信号を遅延回路で遅延して
位相差の異る複数個のクロック信号を作り、そのうちの
最適位相のものを選択的に使用するようにしていた。し
かしこの回路は、遅延回路がアナログ信号処理回路とな
るので安定性に欠ける問題がある。
また、特開昭５６−１２６３７８号公報には、高周波ク
ロック信号を分周する分周開始タイミングを同期タイミ
ング信号で制御することによって、安定したビデオクロ
ック信号を得る回路が提案されている。しかし、この回
路は、位相差を減少しようとすると高周波クロック信号
の周波数を相応して高くしなければならず、高速信号処
理回路を必要とする。例えば、位相差をビデオクロック
信号の１サイクルの８分の１にするためには、高周波ク
ロック信号発振回路はビデオクロック信号の８倍の周波
数のクロック信号を発生しなければならない。
ロック信号を分周する分周開始タイミングを同期タイミ
ング信号で制御することによって、安定したビデオクロ
ック信号を得る回路が提案されている。しかし、この回
路は、位相差を減少しようとすると高周波クロック信号
の周波数を相応して高くしなければならず、高速信号処
理回路を必要とする。例えば、位相差をビデオクロック
信号の１サイクルの８分の１にするためには、高周波ク
ロック信号発振回路はビデオクロック信号の８倍の周波
数のクロック信号を発生しなければならない。
ビデオクロック信号の周波数を３０ＭＨｚとすると、高
周波クロック信号の周波数は２４０ＭＨｚになってしま
う。このような高い周波数の信号を処理できる発振回路
および分周回路は高価である。
周波クロック信号の周波数は２４０ＭＨｚになってしま
う。このような高い周波数の信号を処理できる発振回路
および分周回路は高価である。
〔発明が解決しようとする課題〕
以上のように従来装置は、高精度のクロック信号を安定
に発生しようとすると、高周波信号を処理できる高価な
処理回路を使用しなければならない問題があった。
に発生しようとすると、高周波信号を処理できる高価な
処理回路を使用しなければならない問題があった。
本発明の目的は、比較的低周波数特性の安価な処理回路
を用いて高精度のクロック信号を発生することにある。
を用いて高精度のクロック信号を発生することにある。
本発明は、源クロック信号を発生する源クロック信号発
生回路と、前記源クロック信号を分周して基本クロック
信号を発生する分周回路と、同期タイミング信号を発生
する同期タイミング信号発生回路と、前記同期タイミン
グ信号に基づいて前記分周回路の分周開始タイミングを
制御して前記基本クロック信号の発生位相を制御する位
相制御回路とを備えたクロック信号発生装置において、
前記分周回路に前記源クロック信号の立上りに応動する
第１の分周回路と前記源クロック信号の立下りに応動す
る第２の分周回路とを設け、前記位相制御回路に前記同
期タイミング信号発生時の前記源クロック信号の信号レ
ベルに応じて前記２つの分周回路の一方を選択的に有効
にする選択回路を設けたことを特徴とする。
生回路と、前記源クロック信号を分周して基本クロック
信号を発生する分周回路と、同期タイミング信号を発生
する同期タイミング信号発生回路と、前記同期タイミン
グ信号に基づいて前記分周回路の分周開始タイミングを
制御して前記基本クロック信号の発生位相を制御する位
相制御回路とを備えたクロック信号発生装置において、
前記分周回路に前記源クロック信号の立上りに応動する
第１の分周回路と前記源クロック信号の立下りに応動す
る第２の分周回路とを設け、前記位相制御回路に前記同
期タイミング信号発生時の前記源クロック信号の信号レ
ベルに応じて前記２つの分周回路の一方を選択的に有効
にする選択回路を設けたことを特徴とする。
前記選択回路は、前記源クロック信号の信号レベルを前
記同期タイミング信号発生タイミングでサンプリングし
、その出力で前記２つの分周回路の一方を選択的に有効
にするフリップフロップ回路を用いることが望ましく、
また、このクロック信号発生装置は、前記同期タイミン
グ信号を走査ビーム検出回路から得ることにより分周回
路がら出力される基本クロック信号をビデオクロック信
号として使用するのに好適となる。
記同期タイミング信号発生タイミングでサンプリングし
、その出力で前記２つの分周回路の一方を選択的に有効
にするフリップフロップ回路を用いることが望ましく、
また、このクロック信号発生装置は、前記同期タイミン
グ信号を走査ビーム検出回路から得ることにより分周回
路がら出力される基本クロック信号をビデオクロック信
号として使用するのに好適となる。
第１および第２の分周回路はそれぞれ源クロック信号を
分周して基本クロック信号を出力するので１分周率に相
応した段数（源クロック信号発生位相）で位相調整が可
能になる。しかも第１および第２の分周回路から出力さ
れるそれぞれの基本クロック信号は源クロック信号に換
算して２分の１サイクルだけ位相差をもっているので、
２つの基本クロック信号を選択することによって、結局
。
分周して基本クロック信号を出力するので１分周率に相
応した段数（源クロック信号発生位相）で位相調整が可
能になる。しかも第１および第２の分周回路から出力さ
れるそれぞれの基本クロック信号は源クロック信号に換
算して２分の１サイクルだけ位相差をもっているので、
２つの基本クロック信号を選択することによって、結局
。
分周率の２倍の段数（源クロック信号の２分の１サイク
ルの位相差）で位相調整が可能になる。このことは、基
本クロック信号の周波数と位相調整精度を従来装置と等
しくした場合、源クロック信号は従来の２分の１の周波
数で足りることになり、従って比較的低周波数特性の安
価な処理回路を用いて高精度のクロック信号を発生する
ことができる。
ルの位相差）で位相調整が可能になる。このことは、基
本クロック信号の周波数と位相調整精度を従来装置と等
しくした場合、源クロック信号は従来の２分の１の周波
数で足りることになり、従って比較的低周波数特性の安
価な処理回路を用いて高精度のクロック信号を発生する
ことができる。
フリップフロップ回路は、くり返し入京する次の同期タ
イミング信号が発生するまでのあいだ前の選択状態を保
持するのに有効であり、前記基本クロック信号をビデオ
クロック信号として使用すれば記録画素の位置ずれが少
ない高精細画像記録が可能となる。
イミング信号が発生するまでのあいだ前の選択状態を保
持するのに有効であり、前記基本クロック信号をビデオ
クロック信号として使用すれば記録画素の位置ずれが少
ない高精細画像記録が可能となる。
以下、本発明の一実施例を第１図および第５図を参照し
て説明する。
て説明する。
第１図において、源クロック信号発生回路１３は必要と
する基本クロック信号の周波数の整数倍の周波数の源ク
ロック信号ＣＰを発生する。第１の分周回路を構成する
分周器１４はそのクロック入力端子ＣＫに前記源クロッ
ク信号ＣＰをそのまま入力し、第２の分周回路を構成す
るインバータ１５と分周器１６はそのクロック入力端子
ＣＫに前記源クロック信号ＣＰの信号レベルを反転した
ものを入力する。２つの分周器１４．１６はクリア信号
入力端子ＣＬＨに入力されるクリア信号がハイレベルの
ときにクロック信号の立上りに応動して源クロック信号
ＣＰを分周するように構成されている。
する基本クロック信号の周波数の整数倍の周波数の源ク
ロック信号ＣＰを発生する。第１の分周回路を構成する
分周器１４はそのクロック入力端子ＣＫに前記源クロッ
ク信号ＣＰをそのまま入力し、第２の分周回路を構成す
るインバータ１５と分周器１６はそのクロック入力端子
ＣＫに前記源クロック信号ＣＰの信号レベルを反転した
ものを入力する。２つの分周器１４．１６はクリア信号
入力端子ＣＬＨに入力されるクリア信号がハイレベルの
ときにクロック信号の立上りに応動して源クロック信号
ＣＰを分周するように構成されている。
選択回路を構成するフリップフロップ回路１は、データ
入力端子りに入力される信号レベルをクロック信号入力
端子ＧＫに入力される同期タイミング信号ＢＤＴの立上
りでサンプリングして出力端子Ｑに出力し、出力端子Ｑ
にはその反転レベルを出力するように構成されている。
入力端子りに入力される信号レベルをクロック信号入力
端子ＧＫに入力される同期タイミング信号ＢＤＴの立上
りでサンプリングして出力端子Ｑに出力し、出力端子Ｑ
にはその反転レベルを出力するように構成されている。
出力端子Ｑは第１の分周器１４のクリア信号入力端子Ｃ
ＬＲに接続され、出力端子可は第２の分周器１６のクリ
ア信号入力端子ＣＬＲに接続されて、それぞれにクリア
信号ＣＬ Ｒ１，ＣＬ Ｒ２を入力する。
ＬＲに接続され、出力端子可は第２の分周器１６のクリ
ア信号入力端子ＣＬＲに接続されて、それぞれにクリア
信号ＣＬ Ｒ１，ＣＬ Ｒ２を入力する。
そして２つの分周器１４．１８の出力端子Ｑから出力さ
れる分周出力信号は論理和回路８を介して基本クロック
信号ｆｓとして出力される。
れる分周出力信号は論理和回路８を介して基本クロック
信号ｆｓとして出力される。
以上の構成になるクロック信号発生装置によれば、第５
図に示すように、源クロック信号ＣＰがハイレベルのと
きに同期タイミング信号ＢＤＴが立上ると、フリップフ
ロップ回路１７は出力端子Ｑの出力信号（クリア信号Ｃ
ＬＲｚ）がハイレベルになり、出力端子−命−の出力信
号（クリア信号ＣＬＲｚ）がロウレベルになり、次の同
期タイミング信号ＢＤＴが入力されるまでこの状態を保
持する。
図に示すように、源クロック信号ＣＰがハイレベルのと
きに同期タイミング信号ＢＤＴが立上ると、フリップフ
ロップ回路１７は出力端子Ｑの出力信号（クリア信号Ｃ
ＬＲｚ）がハイレベルになり、出力端子−命−の出力信
号（クリア信号ＣＬＲｚ）がロウレベルになり、次の同
期タイミング信号ＢＤＴが入力されるまでこの状態を保
持する。
これにより、第１の分周器１４が選択されて有効になっ
て源クロック信号ＣＰの立上りに応動してこれを分周し
、その分周出力を論理和回路１８を介して基本クロック
信号ｆ、として出力する（領域Ｉ）。
て源クロック信号ＣＰの立上りに応動してこれを分周し
、その分周出力を論理和回路１８を介して基本クロック
信号ｆ、として出力する（領域Ｉ）。
反対に、源クロック信号ＣＰがロウレベルのときに同期
タイミング信号ＢＤＴが立上ると、フリップフロップ回
路１７は出力端子Ｑの出力信号（クリア信号ＣＬＲＩ）
がロウレベル、出力端子Ｑ−の出力信号（ＣＬＲ２）が
ハイレベルになってこれを保持する。
タイミング信号ＢＤＴが立上ると、フリップフロップ回
路１７は出力端子Ｑの出力信号（クリア信号ＣＬＲＩ）
がロウレベル、出力端子Ｑ−の出力信号（ＣＬＲ２）が
ハイレベルになってこれを保持する。
これにより、第２の分周器１６が選択されて有効になっ
て源クロック信号ＣＰの立下りに応動してこれを分周し
、その分周出方を論理和回路１８を介して基本クロック
信号ｆｓとして出方する（領域■）。
て源クロック信号ＣＰの立下りに応動してこれを分周し
、その分周出方を論理和回路１８を介して基本クロック
信号ｆｓとして出方する（領域■）。
なお上記実施例は、フリップフロップ回路１７を同期タ
イミング信号ＢＤＴの立上りで動作させたが立下りで動
作させても同様な作用が得られ、更に、分周器１４．１
６に対するクリア信号ＣＬＲｘ 。
イミング信号ＢＤＴの立上りで動作させたが立下りで動
作させても同様な作用が得られ、更に、分周器１４．１
６に対するクリア信号ＣＬＲｘ 。
ＣＬＲｚを交換しても同様な作用が得られる。
このクロック信号発生装置を、レーザービームプリンタ
におけるビデオクロック信号発生のための前記走査位相
同期回路に利用するときは、前記同期タイミング信号Ｂ
ＤＴを、レーザービームが走査開始基準位置を通過する
タイミングを検出してタイミング信号を出力する走査ビ
ーム検出回路から得、前記基本クロック信号ｆｓをビデ
オクロック信号として出力するようにすればよく、ビデ
オクロック信号の位相が同期タイミング信号に高精度で
追従するので高精細画像記録が可能になる。
におけるビデオクロック信号発生のための前記走査位相
同期回路に利用するときは、前記同期タイミング信号Ｂ
ＤＴを、レーザービームが走査開始基準位置を通過する
タイミングを検出してタイミング信号を出力する走査ビ
ーム検出回路から得、前記基本クロック信号ｆｓをビデ
オクロック信号として出力するようにすればよく、ビデ
オクロック信号の位相が同期タイミング信号に高精度で
追従するので高精細画像記録が可能になる。
以上のように本発明は、源クロック信号を分周するため
に該源クロック信号の立上りに応動する第１の分周回路
と該源クロック信号の立下りに応動する第２の分周回路
とを設け、同期タイミング信号発生時の源クロック信号
の信号レベルに応じて前記２つの分周回路の一方を選択
的に有効にして基本クロック信号を得るようにしたので
、比較的低周波数の源クロック信号から高精度の基本ク
ロック信号を得ることができ回路構成が安価になる。
に該源クロック信号の立上りに応動する第１の分周回路
と該源クロック信号の立下りに応動する第２の分周回路
とを設け、同期タイミング信号発生時の源クロック信号
の信号レベルに応じて前記２つの分周回路の一方を選択
的に有効にして基本クロック信号を得るようにしたので
、比較的低周波数の源クロック信号から高精度の基本ク
ロック信号を得ることができ回路構成が安価になる。
また、前記２つの分周回路を選択的に有効にする選択回
路に用いたフリップフロップ回路は、くり返し入来する
同期タイミング信号のあいだ前の同期タイミング信号に
よる選択状態を保持するのに好都合であり、更にこのク
ロック信号発生装置はレーザービームプリンタの高精細
画像記録のためのビデオクロック信号発生に好適である
６
路に用いたフリップフロップ回路は、くり返し入来する
同期タイミング信号のあいだ前の同期タイミング信号に
よる選択状態を保持するのに好都合であり、更にこのク
ロック信号発生装置はレーザービームプリンタの高精細
画像記録のためのビデオクロック信号発生に好適である
６
第１図は本発明になるクロック信号発生装置の電気回路
図、第２図はレーザービームプリンタのブロック図、第
３図および第４図（ａ）、（ｂ）は記録例、第５図は本
発明になる第１図のクロック信号発生装置の動作タイム
チャートである。 １３・・・源クロック信号発生回路、１４．１６・・・
第１および第２の分周器、１７・・・フリップフ口ツプ
第１区 第２因
図、第２図はレーザービームプリンタのブロック図、第
３図および第４図（ａ）、（ｂ）は記録例、第５図は本
発明になる第１図のクロック信号発生装置の動作タイム
チャートである。 １３・・・源クロック信号発生回路、１４．１６・・・
第１および第２の分周器、１７・・・フリップフ口ツプ
第１区 第２因
Claims (1)
- 【特許請求の範囲】 １、源クロック信号を発生する源クロック信号発生回路
と、前記源クロック信号を分周して基本クロック信号を
発生する分周回路と、同期タイミング信号を発生する同
期タイミング信号発生回路と、前記同期タイミング信号
に基づいて前記分周回路の分周開始タイミングを制御し
て前記基本クロック信号の発生位相を制御する位相制御
回路とを備えたクロック信号発生装置において、前記分
周回路は、前記源クロック信号の立上りに応動する第１
の分周回路と前記源クロック信号の立下りに応動する第
２の分周回路とを備え、前記位相制御回路は、前記同期
タイミング信号発生時の前記源クロック信号の信号レベ
ルに応じて前記２つの分周回路の一方を選択的に有効に
する選択回路を備えたことを特徴とするクロック信号発
生装置。 ２、源クロック信号を発生する源クロック信号発生回路
と、前記源クロック信号を分周して基本クロック信号を
発生する分周回路と、同期タイミング信号を発生する同
期タイミング信号発生回路と、前記同期タイミング信号
に基づいて前記分周回路の分周開始タイミングを制御し
て前記基本クロック信号の発生位相を制御する位相制御
回路とを備えたクロック信号発生装置において、前記分
周回路は、前記源クロック信号の立上りに応動する第１
の分周回路と前記源クロック信号の立下りに応動する第
２の分周回路とを備え、前記位相制御回路は、前記源ク
ロック信号の信号レベルを前記同期タイミング信号発生
タイミングでサンプリングし、その出力で前記２つの分
周回路の一方を選択的に有効にするフリップフロップ回
路を備えたことを特徴とするクロック信号発生装置。 ３、源クロック信号を発生する源クロック信号発生回路
と、前記源クロック信号を分周してビデオクロック信号
を発生する分周回路と、走査同期タイミング信号を発生
する走査ビーム検出回路と、前記走査同期タイミング信
号に基づいて前記分周回路の分周開始タイミングを制御
して前記ビデオクロック信号の発生位相を制御する位相
制御回路とを備えたクロック信号発生装置において、前
記分周回路は、前記源クロック信号の立上りに応動する
第１の分周回路と前記源クロック信号の立下りに応動す
る第２の分周回路とを備え、前記位相制御回路は、前記
走査同期タイミング信号発生時の前記源クロック信号の
信号レベルに応じて前記２つの分周回路の一方を選択的
に有効にしてその分周出力をビデオクロック信号とする
選択回路を備えたことを特徴とするクロック信号発生装
置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63042044A JPH01218167A (ja) | 1988-02-26 | 1988-02-26 | クロツク信号発生装置 |
| US07/315,303 US4912564A (en) | 1988-02-26 | 1989-02-24 | Clock signal generation apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63042044A JPH01218167A (ja) | 1988-02-26 | 1988-02-26 | クロツク信号発生装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01218167A true JPH01218167A (ja) | 1989-08-31 |
Family
ID=12625127
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63042044A Pending JPH01218167A (ja) | 1988-02-26 | 1988-02-26 | クロツク信号発生装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4912564A (ja) |
| JP (1) | JPH01218167A (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0267883A (ja) * | 1988-09-02 | 1990-03-07 | Hitachi Ltd | ビデオプリンタ信号処理回路 |
| US5127036A (en) * | 1991-04-01 | 1992-06-30 | Racal Data Communications Inc. | Fifty percent duty cycle divided-by-m counter |
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| US5371416A (en) * | 1993-04-05 | 1994-12-06 | Motorola, Inc. | Circuit and method of synchronizing clock signals |
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| JPS62161271A (ja) * | 1986-01-10 | 1987-07-17 | Ricoh Co Ltd | レ−ザ−ビ−ムプリンタの同期回路 |
| JPH01162073A (ja) * | 1987-12-18 | 1989-06-26 | Fujitsu Ltd | 同期クロック生成回路 |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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-
1988
- 1988-02-26 JP JP63042044A patent/JPH01218167A/ja active Pending
-
1989
- 1989-02-24 US US07/315,303 patent/US4912564A/en not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| JPH01162073A (ja) * | 1987-12-18 | 1989-06-26 | Fujitsu Ltd | 同期クロック生成回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| US4912564A (en) | 1990-03-27 |
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