JP7101512B2 - 回路基板及びその製造方法 - Google Patents
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Description
2 回路基板
10a、10b、10c 認識マーク
11 第1の部分
12 第2の部分
13 第3の部分
14 第4の部分
15 第5の部分
16 第6の部分
17 第1のランド
18 第2のランド
20 外形
21 接続端子
22 固定端子
23 部品
30 電子部品
31、32 ランド
33 最上層配線層
dW 位置ずれ量
S1 第1の間隔
S2 第2の間隔
W1 第1の幅
W2 第2の幅
x 第1の方向
y 第2の方向
Claims (10)
- 部品を実装する回路基板であって、
前記回路基板は、前記部品を実装するための実装構造と、当該実装構造と同一の層に配置された認識マークと、を備え、
前記認識マークは、第1の部分と、前記第1の部分から第1の方向に沿って第1の間隔で離間して配置され、前記第1の方向に沿って前記第1の間隔と一直線上に並ぶ第1の幅を有する第2の部分と、を含み、前記第1の幅と前記第1の間隔との境界点が前記部品と前記実装構造との位置ずれ量が零である基準点を定義し、前記第1の間隔および前記第1の幅のそれぞれは、前記部品と前記実装構造との位置ずれ量の許容範囲を画定する、
回路基板。 - 前記第1の部分及び前記第2の部分はいずれも、前記第1の方向と直交する第2の方向に平行な辺を有する四角形からなる、
請求項1に記載の回路基板。 - 前記認識マークは、前記第2の部分と離間されて配置された第3の部分と、前記第3の部分から前記第2の方向に沿って第2の間隔で離間して配置され、前記第2の方向で第2の幅を有する第4の部分と、を更に有し、
前記第3の部分及び前記第4の部分はいずれも、前記第1の方向に平行な辺を含む四角形からなる、
請求項2に記載の回路基板。 - 前記第1の部分と、前記第3の部分と、が同じ位置に重ね合わせて配置される、
請求項3に記載の回路基板。 - 前記第2の部分は、前記第1の幅をもって前記第2の方向に延伸する長方形であり、
前記第4の部分は、前記第2の幅をもって前記第1の方向に延伸する長方形であり、
前記第2の部分の1部と前記第4の部分の1部とが重なり合ってL字形状を成す、
請求項3又は4に記載の回路基板。 - 前記実装構造は最上層配線層を有し、前記認識マークは当該最上層配線層で形成される、請求項1乃至5のいずれか1項に記載の回路基板。
- 前記最上層配線層は、前記部品の接続端子と接続されるランドを含む、
請求項6に記載の回路基板。 - 前記実装構造はビアホールを含み、前記認識マークは前記ビアホールからなる、請求項1乃至5のいずれか1項に記載の回路基板。
- 部品を実装する回路基板の製造方法であって、
基板を準備する、準備工程と、
前記基板に前記部品を実装するための実装構造を形成する、実装構造形成工程と、を備え、
前記実装構造形成工程は、前記実装構造の一部及び認識マークを同時に形成する、マーク形成工程を含み、
前記認識マークは、第1の部分と、前記第1の部分から第1の方向に沿って第1の間隔で離間して配置され、前記第1の方向に沿って前記第1の間隔と一直線上に並ぶ第1の幅を有する第2の部分と、により、前記実装構造の一部と前記部品との間の位置ずれ量が零である基準点および位置ずれ量を検出し、前記部品と前記実装構造との位置ずれ量が零である基準点は、前記第1の幅と前記第1の間隔との境界点により定義され、前記部品と前記実装構造との位置ずれ量の許容範囲は、前記第1の間隔および前記第1の幅により確定される、
回路基板の製造方法。 - 前記実装構造の一部の構造は、最上層配線層であって、
前記マーク形成工程は、前記基板に最上層配線層のための導電層を形成する、導電層形成工程と、前記導電層をパターニングして、前記最上層配線層と前記認識マークを同時に形成する、パターニング工程と、を更に含む、
請求項9に記載の回路基板の製造方法。
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