JP6839939B2 - 熱処理方法 - Google Patents

熱処理方法 Download PDF

Info

Publication number
JP6839939B2
JP6839939B2 JP2016145986A JP2016145986A JP6839939B2 JP 6839939 B2 JP6839939 B2 JP 6839939B2 JP 2016145986 A JP2016145986 A JP 2016145986A JP 2016145986 A JP2016145986 A JP 2016145986A JP 6839939 B2 JP6839939 B2 JP 6839939B2
Authority
JP
Japan
Prior art keywords
substrate
heat treatment
chamber
flash
semiconductor layer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2016145986A
Other languages
English (en)
Other versions
JP2018018873A (ja
Inventor
英昭 谷村
英昭 谷村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Screen Holdings Co Ltd
Original Assignee
Screen Holdings Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Screen Holdings Co Ltd filed Critical Screen Holdings Co Ltd
Priority to JP2016145986A priority Critical patent/JP6839939B2/ja
Priority to TW106117822A priority patent/TWI642107B/zh
Priority to CN201710573685.2A priority patent/CN107658225B/zh
Priority to US15/655,835 priority patent/US20180033640A1/en
Publication of JP2018018873A publication Critical patent/JP2018018873A/ja
Application granted granted Critical
Publication of JP6839939B2 publication Critical patent/JP6839939B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/324Thermal treatment for modifying the properties of semiconductor bodies, e.g. annealing, sintering
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/26Bombardment with radiation
    • H01L21/263Bombardment with radiation with high-energy radiation
    • H01L21/268Bombardment with radiation with high-energy radiation using electromagnetic radiation, e.g. laser radiation
    • H01L21/2686Bombardment with radiation with high-energy radiation using electromagnetic radiation, e.g. laser radiation using incoherent radiation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67098Apparatus for thermal treatment
    • H01L21/67115Apparatus for thermal treatment mainly by radiation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/26Bombardment with radiation
    • H01L21/263Bombardment with radiation with high-energy radiation
    • H01L21/265Bombardment with radiation with high-energy radiation producing ion implantation
    • H01L21/26506Bombardment with radiation with high-energy radiation producing ion implantation in group IV semiconductors
    • H01L21/26513Bombardment with radiation with high-energy radiation producing ion implantation in group IV semiconductors of electrically active species
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/683Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping
    • H01L21/687Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping using mechanical means, e.g. chucks, clamps or pinches
    • H01L21/68714Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping using mechanical means, e.g. chucks, clamps or pinches the wafers being placed on a susceptor, stage or support
    • H01L21/68757Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping using mechanical means, e.g. chucks, clamps or pinches the wafers being placed on a susceptor, stage or support characterised by a coating or a hardness or a material

Landscapes

  • Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Power Engineering (AREA)
  • High Energy & Nuclear Physics (AREA)
  • Health & Medical Sciences (AREA)
  • Toxicology (AREA)
  • Electromagnetism (AREA)
  • Optics & Photonics (AREA)
  • Container, Conveyance, Adherence, Positioning, Of Wafer (AREA)

Description

本発明は、ゲルマニウムまたはシリコンゲルマニウムを主成分とするp型半導体の熱処理方法に関する。
半導体デバイスの素材としては主にシリコン(Si)が使用されているが、一部にはゲルマニウム(Ge)も用いられている。ゲルマニウムはシリコンと比較して移動度が高いため、電界効果トランジスタ(FET)のチャネル材料として用いることが検討されている(例えば、特許文献1)。
特開2015−115415号公報
高純度のゲルマニウムにボロン(B)等の3価のドーパントを微量に添加したp型半導体(p−Ge)は、リン(P)やヒ素(As)等の5価のドーパントを添加したn型半導体(n−Ge)に比較して活性化アニール時におけるドーパントの活性化率が高い。その反面、ゲルマニウムのp型半導体は、n型半導体に比較してドーパントの拡散が非常に遅く活性化アニール時の拡散コントロールが困難であるという問題がある。これは、リンやヒ素がゲルマニウムの結晶中の空孔を経由して拡散するのに対して、ボロン等は結晶中の格子間の空隙を経由して拡散することに起因するものである。ゲルマニウムの結晶中には空孔が多く存在するため、空孔を経由して拡散するリンやヒ素は容易に拡散する一方、ボロン等は逆に多数の空孔が障害となって拡散しにくくなるのである。
本発明は、上記課題に鑑みてなされたものであり、ドーパントの拡散を適切にコントロールすることができるゲルマニウムまたはシリコンゲルマニウムを主成分とするp型半導体の熱処理方法を提供することを目的とする。
上記課題を解決するため、請求項1の発明は、ゲルマニウムまたはシリコンゲルマニウムを主成分とするp型半導体の熱処理方法において、ドーパントが注入されたゲルマニウムまたはシリコンゲルマニウムの半導体層をチャンバー内に搬入する搬入工程と、前記チャンバーに水素またはアンモニアを含む処理ガスを導入する雰囲気形成工程と、前記半導体層を水素またはアンモニアの雰囲気中で予備加熱温度にて予備加熱することによって、前記半導体層の表面に存在していた空孔を消滅させる予備加熱工程と、前記半導体層にフラッシュランプからフラッシュ光を照射して処理温度に加熱して前記半導体層中のゲルマニウムまたはシリコンゲルマニウムの格子欠陥を回復するとともに、前記ドーパントを活性化するフラッシュ加熱工程と、を備えることを特徴とする。
また、請求項2の発明は、請求項1の発明に係る熱処理方法において、前記予備加熱温度は200℃以上500℃以下であることを特徴とする。
また、請求項3の発明は、請求項1または請求項2の発明に係る熱処理方法において、前記処理温度は600℃以上900℃以下であることを特徴とする。
請求項1から請求項3の発明によれば、ドーパントが注入されたゲルマニウムまたはシリコンゲルマニウムの半導体層を水素またはアンモニアを含む雰囲気中にて予備加熱した後に、フラッシュ光照射によって処理温度に加熱しているため、半導体層の表面近傍に存在していた空孔が消滅してドーパントが比較的容易に拡散することができる状態でフラッシュ加熱が行われることとなり、フラッシュ光照射の条件を調整することによって、ドーパントの拡散を適切にコントロールすることができる。
本発明に係る熱処理方法に使用する熱処理装置の構成を示す縦断面図である。 保持部の全体外観を示す斜視図である。 サセプタの平面図である。 サセプタの断面図である。 移載機構の平面図である。 移載機構の側面図である。 複数のハロゲンランプの配置を示す平面図である。 フラッシュランプの駆動回路を示す図である。 図1の熱処理装置にて処理される基板の構造を模式的に示す図である。
以下、図面を参照しつつ本発明の実施の形態について詳細に説明する。
まず、本発明に係る熱処理方法を実施するための熱処理装置について説明する。図1は、本発明に係る熱処理方法に使用する熱処理装置1の構成を示す縦断面図である。図1の熱処理装置1は、円板形状の基板Wに対してフラッシュ光照射を行うことによってその基板Wを加熱するフラッシュランプアニール装置である。処理対象となる基板Wのサイズは特に限定されるものではないが、例えばφ300mmやφ450mmである。なお、図1および以降の各図においては、理解容易のため、必要に応じて各部の寸法や数を誇張または簡略化して描いている。
熱処理装置1は、基板Wを収容するチャンバー6と、複数のフラッシュランプFLを内蔵するフラッシュ加熱部5と、複数のハロゲンランプHLを内蔵するハロゲン加熱部4と、を備える。チャンバー6の上側にフラッシュ加熱部5が設けられるとともに、下側にハロゲン加熱部4が設けられている。また、熱処理装置1は、チャンバー6の内部に、基板Wを水平姿勢に保持する保持部7と、保持部7と装置外部との間で基板Wの受け渡しを行う移載機構10と、を備える。さらに、熱処理装置1は、ハロゲン加熱部4、フラッシュ加熱部5およびチャンバー6に設けられた各動作機構を制御して基板Wの熱処理を実行させる制御部3を備える。
チャンバー6は、筒状のチャンバー側部61の上下に石英製のチャンバー窓を装着して構成されている。チャンバー側部61は上下が開口された概略筒形状を有しており、上側開口には上側チャンバー窓63が装着されて閉塞され、下側開口には下側チャンバー窓64が装着されて閉塞されている。チャンバー6の天井部を構成する上側チャンバー窓63は、石英により形成された円板形状部材であり、フラッシュ加熱部5から出射されたフラッシュ光をチャンバー6内に透過する石英窓として機能する。また、チャンバー6の床部を構成する下側チャンバー窓64も、石英により形成された円板形状部材であり、ハロゲン加熱部4からの光をチャンバー6内に透過する石英窓として機能する。
また、チャンバー側部61の内側の壁面の上部には反射リング68が装着され、下部には反射リング69が装着されている。反射リング68,69は、ともに円環状に形成されている。上側の反射リング68は、チャンバー側部61の上側から嵌め込むことによって装着される。一方、下側の反射リング69は、チャンバー側部61の下側から嵌め込んで図示省略のビスで留めることによって装着される。すなわち、反射リング68,69は、ともに着脱自在にチャンバー側部61に装着されるものである。チャンバー6の内側空間、すなわち上側チャンバー窓63、下側チャンバー窓64、チャンバー側部61および反射リング68,69によって囲まれる空間が熱処理空間65として規定される。
チャンバー側部61に反射リング68,69が装着されることによって、チャンバー6の内壁面に凹部62が形成される。すなわち、チャンバー側部61の内壁面のうち反射リング68,69が装着されていない中央部分と、反射リング68の下端面と、反射リング69の上端面とで囲まれた凹部62が形成される。凹部62は、チャンバー6の内壁面に水平方向に沿って円環状に形成され、基板Wを保持する保持部7を囲繞する。チャンバー側部61および反射リング68,69は、強度と耐熱性に優れた金属材料(例えば、ステンレススチール)にて形成されている。
また、チャンバー側部61には、チャンバー6に対して基板Wの搬入および搬出を行うための搬送開口部(炉口)66が形設されている。搬送開口部66は、ゲートバルブ185によって開閉可能とされている。搬送開口部66は凹部62の外周面に連通接続されている。このため、ゲートバルブ185が搬送開口部66を開放しているときには、搬送開口部66から凹部62を通過して熱処理空間65への基板Wの搬入および熱処理空間65からの基板Wの搬出を行うことができる。また、ゲートバルブ185が搬送開口部66を閉鎖するとチャンバー6内の熱処理空間65が密閉空間とされる。
また、チャンバー6の内壁上部には熱処理空間65に処理ガスを供給するガス供給孔81が形設されている。ガス供給孔81は、凹部62よりも上側位置に形設されており、反射リング68に設けられていても良い。ガス供給孔81はチャンバー6の側壁内部に円環状に形成された緩衝空間82を介してガス供給管83に連通接続されている。ガス供給管83は処理ガス供給源85に接続されている。また、ガス供給管83の経路途中にはバルブ84が介挿されている。バルブ84が開放されると、処理ガス供給源85から緩衝空間82に処理ガスが送給される。緩衝空間82に流入した処理ガスは、ガス供給孔81よりも流体抵抗の小さい緩衝空間82内を拡がるように流れてガス供給孔81から熱処理空間65内へと供給される。処理ガスとしては、水素(H)、アンモニア(NH)、水素と窒素(N)とを混合した混合ガス等が用いられる。
一方、チャンバー6の内壁下部には熱処理空間65内の気体を排気するガス排気孔86が形設されている。ガス排気孔86は、凹部62よりも下側位置に形設されており、反射リング69に設けられていても良い。ガス排気孔86はチャンバー6の側壁内部に円環状に形成された緩衝空間87を介してガス排気管88に連通接続されている。ガス排気管88は排気部190に接続されている。また、ガス排気管88の経路途中にはバルブ89が介挿されている。バルブ89が開放されると、熱処理空間65の気体がガス排気孔86から緩衝空間87を経てガス排気管88へと排出される。なお、ガス供給孔81およびガス排気孔86は、チャンバー6の周方向に沿って複数設けられていても良いし、スリット状のものであっても良い。また、処理ガス供給源85および排気部190は、熱処理装置1に設けられた機構であっても良いし、熱処理装置1が設置される工場のユーティリティであっても良い。
また、搬送開口部66の先端にも熱処理空間65内の気体を排出するガス排気管191が接続されている。ガス排気管191はバルブ192を介して排気部190に接続されている。バルブ192を開放することによって、搬送開口部66を介してチャンバー6内の気体が排気される。
図2は、保持部7の全体外観を示す斜視図である。保持部7は、基台リング71、連結部72およびサセプタ74を備えて構成される。基台リング71、連結部72およびサセプタ74はいずれも石英にて形成されている。すなわち、保持部7の全体が石英にて形成されている。
基台リング71は円環形状から一部が欠落した円弧形状の石英部材である。この欠落部分は、後述する移載機構10の移載アーム11と基台リング71との干渉を防ぐために設けられている。基台リング71は凹部62の底面に載置されることによって、チャンバー6の壁面に支持されることとなる(図1参照)。基台リング71の上面に、その円環形状の周方向に沿って複数の連結部72(本実施形態では4個)が立設される。連結部72も石英の部材であり、溶接によって基台リング71に固着される。
サセプタ74は基台リング71に設けられた4個の連結部72によって支持される。図3は、サセプタ74の平面図である。また、図4は、サセプタ74の断面図である。サセプタ74は、保持プレート75、ガイドリング76および複数の基板支持ピン77を備える。保持プレート75は、石英にて形成された略円形の平板状部材である。保持プレート75の直径は基板Wの直径よりも大きい。すなわち、保持プレート75は、基板Wよりも大きな平面サイズを有する。
保持プレート75の上面周縁部にガイドリング76が設置されている。ガイドリング76は、基板Wの直径よりも大きな内径を有する円環形状の部材である。例えば、基板Wの直径がφ300mmの場合、ガイドリング76の内径はφ320mmである。ガイドリング76の内周は、保持プレート75から上方に向けて広くなるようなテーパ面とされている。ガイドリング76は、保持プレート75と同様の石英にて形成される。ガイドリング76は、保持プレート75の上面に溶着するようにしても良いし、別途加工したピンなどによって保持プレート75に固定するようにしても良い。或いは、保持プレート75とガイドリング76とを一体の部材として加工するようにしても良い。
保持プレート75の上面のうちガイドリング76よりも内側の領域が基板Wを保持する平面状の保持面75aとされる。保持プレート75の保持面75aには、複数の基板支持ピン77が立設されている。本実施形態においては、保持面75aの外周円(ガイドリング76の内周円)と同心円の周上に沿って30°毎に計12個の基板支持ピン77が立設されている。12個の基板支持ピン77を配置した円の径(対向する基板支持ピン77間の距離)は基板Wの径よりも小さく、基板Wの径がφ300mmであればφ270mm〜φ280mm(本実施形態ではφ280mm)である。それぞれの基板支持ピン77は石英にて形成されている。複数の基板支持ピン77は、保持プレート75の上面に溶接によって設けるようにしても良いし、保持プレート75と一体に加工するようにしても良い。
図2に戻り、基台リング71に立設された4個の連結部72とサセプタ74の保持プレート75の周縁部とが溶接によって固着される。すなわち、サセプタ74と基台リング71とは連結部72によって固定的に連結されている。このような保持部7の基台リング71がチャンバー6の壁面に支持されることによって、保持部7がチャンバー6に装着される。保持部7がチャンバー6に装着された状態においては、サセプタ74の保持プレート75は水平姿勢(法線が鉛直方向と一致する姿勢)となる。すなわち、保持プレート75の保持面75aは水平面となる。
チャンバー6に搬入された基板Wは、チャンバー6に装着された保持部7のサセプタ74の上に水平姿勢にて載置されて保持される。このとき、基板Wは保持プレート75上に立設された12個の基板支持ピン77によって支持されてサセプタ74に保持される。より厳密には、12個の基板支持ピン77の上端部が基板Wの下面に接触して当該基板Wを支持する。12個の基板支持ピン77の高さ(基板支持ピン77の上端から保持プレート75の保持面75aまでの距離)は均一であるため、12個の基板支持ピン77によって基板Wを水平姿勢に支持することができる。
また、基板Wは複数の基板支持ピン77によって保持プレート75の保持面75aから所定の間隔を隔てて支持されることとなる。基板支持ピン77の高さよりもガイドリング76の厚さの方が大きい。従って、複数の基板支持ピン77によって支持された基板Wの水平方向の位置ずれはガイドリング76によって防止される。
また、図2および図3に示すように、サセプタ74の保持プレート75には、上下に貫通して開口部78が形成されている。開口部78は、放射温度計120(図1参照)がサセプタ74に保持された基板Wの下面から放射される放射光(赤外光)を受光するために設けられている。すなわち、放射温度計120が開口部78を介してサセプタ74に保持された基板Wの下面から放射された光を受光し、別置のディテクタによってその基板Wの温度が測定される。さらに、サセプタ74の保持プレート75には、後述する移載機構10のリフトピン12が基板Wの受け渡しのために貫通する4個の貫通孔79が穿設されている。
図5は、移載機構10の平面図である。また、図6は、移載機構10の側面図である。移載機構10は、2本の移載アーム11を備える。移載アーム11は、概ね円環状の凹部62に沿うような円弧形状とされている。それぞれの移載アーム11には2本のリフトピン12が立設されている。各移載アーム11は水平移動機構13によって回動可能とされている。水平移動機構13は、一対の移載アーム11を保持部7に対して基板Wの移載を行う移載動作位置(図5の実線位置)と保持部7に保持された基板Wと平面視で重ならない退避位置(図5の二点鎖線位置)との間で水平移動させる。水平移動機構13としては、個別のモータによって各移載アーム11をそれぞれ回動させるものであっても良いし、リンク機構を用いて1個のモータによって一対の移載アーム11を連動させて回動させるものであっても良い。
また、一対の移載アーム11は、昇降機構14によって水平移動機構13とともに昇降移動される。昇降機構14が一対の移載アーム11を移載動作位置にて上昇させると、計4本のリフトピン12がサセプタ74に穿設された貫通孔79(図2,3参照)を通過し、リフトピン12の上端がサセプタ74の上面から突き出る。一方、昇降機構14が一対の移載アーム11を移載動作位置にて下降させてリフトピン12を貫通孔79から抜き取り、水平移動機構13が一対の移載アーム11を開くように移動させると各移載アーム11が退避位置に移動する。一対の移載アーム11の退避位置は、保持部7の基台リング71の直上である。基台リング71は凹部62の底面に載置されているため、移載アーム11の退避位置は凹部62の内側となる。なお、移載機構10の駆動部(水平移動機構13および昇降機構14)が設けられている部位の近傍にも図示省略の排気機構が設けられており、移載機構10の駆動部周辺の雰囲気がチャンバー6の外部に排出されるように構成されている。
図1に戻り、チャンバー6の上方に設けられたフラッシュ加熱部5は、筐体51の内側に、複数本(本実施形態では30本)のキセノンフラッシュランプFLからなる光源と、その光源の上方を覆うように設けられたリフレクタ52と、を備えて構成される。また、フラッシュ加熱部5の筐体51の底部にはランプ光放射窓53が装着されている。フラッシュ加熱部5の床部を構成するランプ光放射窓53は、石英により形成された板状の石英窓である。フラッシュ加熱部5がチャンバー6の上方に設置されることにより、ランプ光放射窓53が上側チャンバー窓63と相対向することとなる。フラッシュランプFLはチャンバー6の上方からランプ光放射窓53および上側チャンバー窓63を介して熱処理空間65にフラッシュ光を照射する。
複数のフラッシュランプFLは、それぞれが長尺の円筒形状を有する棒状ランプであり、それぞれの長手方向が保持部7に保持される基板Wの主面に沿って(つまり水平方向に沿って)互いに平行となるように平面状に配列されている。よって、フラッシュランプFLの配列によって形成される平面も水平面である。
図8は、フラッシュランプFLの駆動回路を示す図である。同図に示すように、コンデンサ93と、コイル94と、フラッシュランプFLと、IGBT(絶縁ゲートバイポーラトランジスタ)96とが直列に接続されている。また、図8に示すように、制御部3は、パルス発生器31および波形設定部32を備えるとともに、入力部33に接続されている。入力部33としては、キーボード、マウス、タッチパネル等の種々の公知の入力機器を採用することができる。入力部33からの入力内容に基づいて波形設定部32がパルス信号の波形を設定し、その波形に従ってパルス発生器31がパルス信号を発生する。
フラッシュランプFLは、その内部にキセノンガスが封入されその両端部に陽極および陰極が配設された棒状のガラス管(放電管)92と、該ガラス管92の外周面上に付設されたトリガー電極91とを備える。コンデンサ93には、電源ユニット95によって所定の電圧が印加され、その印加電圧(充電電圧)に応じた電荷が充電される。また、トリガー電極91にはトリガー回路97から高電圧を印加することができる。トリガー回路97がトリガー電極91に電圧を印加するタイミングは制御部3によって制御される。
IGBT96は、ゲート部にMOSFET(Metal Oxide Semiconductor Field effect transistor)を組み込んだバイポーラトランジスタであり、大電力を取り扱うのに適したスイッチング素子である。IGBT96のゲートには制御部3のパルス発生器31からパルス信号が印加される。IGBT96のゲートに所定値以上の電圧(Highの電圧)が印加されるとIGBT96がオン状態となり、所定値未満の電圧(Lowの電圧)が印加されるとIGBT96がオフ状態となる。このようにして、フラッシュランプFLを含む駆動回路はIGBT96によってオンオフされる。IGBT96がオンオフすることによってフラッシュランプFLと対応するコンデンサ93との接続が断続され、フラッシュランプFLに流れる電流がオンオフ制御される。
コンデンサ93が充電された状態でIGBT96がオン状態となってガラス管92の両端電極に高電圧が印加されたとしても、キセノンガスは電気的には絶縁体であることから、通常の状態ではガラス管92内に電気は流れない。しかしながら、トリガー回路97がトリガー電極91に高電圧を印加して絶縁を破壊した場合には両端電極間の放電によってガラス管92内に電流が瞬時に流れ、そのときのキセノンの原子あるいは分子の励起によって光が放出される。
図8に示すような駆動回路は、フラッシュ加熱部5に設けられた複数のフラッシュランプFLのそれぞれに個別に設けられている。本実施形態では、30本のフラッシュランプFLが平面状に配列されているため、それらに対応して図8に示す如き駆動回路が30個設けられている。よって、30本のフラッシュランプFLのそれぞれに流れる電流が対応するIGBT96によって個別にオンオフ制御されることとなる。
また、リフレクタ52は、複数のフラッシュランプFLの上方にそれら全体を覆うように設けられている。リフレクタ52の基本的な機能は、複数のフラッシュランプFLから出射されたフラッシュ光を熱処理空間65の側に反射するというものである。リフレクタ52はアルミニウム合金板にて形成されており、その表面(フラッシュランプFLに臨む側の面)はブラスト処理により粗面化加工が施されている。
チャンバー6の下方に設けられたハロゲン加熱部4は、筐体41の内側に複数本(本実施形態では40本)のハロゲンランプHLを内蔵している。ハロゲン加熱部4は、複数のハロゲンランプHLによってチャンバー6の下方から下側チャンバー窓64を介して熱処理空間65への光照射を行って基板Wを加熱する光照射部である。
図7は、複数のハロゲンランプHLの配置を示す平面図である。40本のハロゲンランプHLは上下2段に分けて配置されている。保持部7に近い上段に20本のハロゲンランプHLが配設されるとともに、上段よりも保持部7から遠い下段にも20本のハロゲンランプHLが配設されている。各ハロゲンランプHLは、長尺の円筒形状を有する棒状ランプである。上段、下段ともに20本のハロゲンランプHLは、それぞれの長手方向が保持部7に保持される基板Wの主面に沿って(つまり水平方向に沿って)互いに平行となるように配列されている。よって、上段、下段ともにハロゲンランプHLの配列によって形成される平面は水平面である。
また、図7に示すように、上段、下段ともに保持部7に保持される基板Wの中央部に対向する領域よりも周縁部に対向する領域におけるハロゲンランプHLの配設密度が高くなっている。すなわち、上下段ともに、ランプ配列の中央部よりも周縁部の方がハロゲンランプHLの配設ピッチが短い。このため、ハロゲン加熱部4からの光照射による加熱時に温度低下が生じやすい基板Wの周縁部により多い光量の照射を行うことができる。
また、上段のハロゲンランプHLからなるランプ群と下段のハロゲンランプHLからなるランプ群とが格子状に交差するように配列されている。すなわち、上段に配置された20本のハロゲンランプHLの長手方向と下段に配置された20本のハロゲンランプHLの長手方向とが互いに直交するように計40本のハロゲンランプHLが配設されている。
ハロゲンランプHLは、ガラス管内部に配設されたフィラメントに通電することでフィラメントを白熱化させて発光させるフィラメント方式の光源である。ガラス管の内部には、窒素やアルゴン等の不活性ガスにハロゲン元素(ヨウ素、臭素等)を微量導入した気体が封入されている。ハロゲン元素を導入することによって、フィラメントの折損を抑制しつつフィラメントの温度を高温に設定することが可能となる。したがって、ハロゲンランプHLは、通常の白熱電球に比べて寿命が長くかつ強い光を連続的に照射できるという特性を有する。すなわち、ハロゲンランプHLは少なくとも1秒以上連続して発光する連続点灯ランプである。また、ハロゲンランプHLは棒状ランプであるため長寿命であり、ハロゲンランプHLを水平方向に沿わせて配置することにより上方の基板Wへの放射効率が優れたものとなる。
また、ハロゲン加熱部4の筐体41内にも、2段のハロゲンランプHLの下側にリフレクタ43が設けられている(図1)。リフレクタ43は、複数のハロゲンランプHLから出射された光を熱処理空間65の側に反射する。
制御部3は、熱処理装置1に設けられた上記の種々の動作機構を制御する。制御部3のハードウェアとしての構成は一般的なコンピュータと同様である。すなわち、制御部3は、各種演算処理を行う回路であるCPU、基本プログラムを記憶する読み出し専用のメモリであるROM、各種情報を記憶する読み書き自在のメモリであるRAMおよび制御用ソフトウェアやデータなどを記憶しておく磁気ディスクを備えている。制御部3のCPUが所定の処理プログラムを実行することによって熱処理装置1における処理が進行する。
上記の構成以外にも熱処理装置1は、基板Wの熱処理時にハロゲンランプHLおよびフラッシュランプFLから発生する熱エネルギーによるハロゲン加熱部4、フラッシュ加熱部5およびチャンバー6の過剰な温度上昇を防止するため、様々な冷却用の構造を備えている。例えば、チャンバー6の壁体には水冷管(図示省略)が設けられている。また、ハロゲン加熱部4およびフラッシュ加熱部5は、内部に気体流を形成して排熱する空冷構造とされている。また、上側チャンバー窓63とランプ光放射窓53との間隙にも空気が供給され、フラッシュ加熱部5および上側チャンバー窓63を冷却する。
次に、本発明に係る半導体の熱処理方法について説明する。本実施形態においては、ボロンを注入したゲルマニウムのp型半導体の活性化アニール処理を上記の熱処理装置1によって行う。
図9は、熱処理装置1にて処理される基板Wの構造を模式的に示す図である。本実施形態においては、シリコンの基材101の上面の一部領域にゲルマニウムの半導体層102が形成されている。半導体層102は、単結晶のゲルマニウムである。半導体層102の膜厚は極めて薄く、数10nmである。半導体層102の形成手法としては、例えばCVD等の公知の種々の方法を採用することが可能である。
本発明に係る熱処理に先立って、ゲルマニウムの半導体層102の表面にボロンがドーパントとして注入される。ドーパントの注入は、熱処理装置1とは異なるイオン注入装置によって行われる。イオン注入時の加速エネルギーおよびドーズ量は適宜のものとすることができる。ボロンが微量に注入されることによって半導体層102はゲルマニウムを主成分とするp型半導体となる。
イオン注入によって打ち込まれたばかりのボロンはゲルマニウムの結晶と整合していないため不活性であり、またゲルマニウムの結晶中にもイオン注入によって格子欠陥が生じているためこれを回復する必要がある。このため、ボロンが微量に注入されたゲルマニウムの半導体層102に対して熱処理装置1によるフラッシュランプアニールを行う。熱処理装置1は、シリコン基材101上に半導体層102を形成した基板Wに対して熱処理を行う。以下、熱処理装置1による基板Wの熱処理について説明する。以下に説明する熱処理装置1の処理手順は、制御部3が熱処理装置1の各動作機構を制御することにより進行する。
まず、ゲートバルブ185が開いて搬送開口部66が開放され、装置外部の搬送ロボットにより搬送開口部66を介して基板Wがチャンバー6内の熱処理空間65に搬入される。すなわち、半導体層102がチャンバー6内に搬入される。搬送ロボットによって搬入された基板Wは保持部7の直上位置まで進出して停止する。そして、移載機構10の一対の移載アーム11が退避位置から移載動作位置に水平移動して上昇することにより、リフトピン12が貫通孔79を通ってサセプタ74の保持プレート75の上面から突き出て基板Wを受け取る。このとき、リフトピン12は基板支持ピン77の上端よりも上方にまで上昇する。
基板Wがリフトピン12に載置された後、搬送ロボットが熱処理空間65から退出し、ゲートバルブ185によって搬送開口部66が閉鎖される。そして、一対の移載アーム11が下降することにより、基板Wは移載機構10から保持部7のサセプタ74に受け渡されて水平姿勢にて下方より保持される。基板Wは、保持プレート75上に立設された複数の基板支持ピン77によって支持されてサセプタ74に保持される。また、基板Wは、半導体層102が形成された表面を上面として保持部7に保持される。複数の基板支持ピン77によって支持された基板Wの裏面(表面とは反対側の主面)と保持プレート75の保持面75aとの間には所定の間隔が形成される。サセプタ74の下方にまで下降した一対の移載アーム11は水平移動機構13によって退避位置、すなわち凹部62の内側に退避する。
また、ゲートバルブ185によって搬送開口部66が閉鎖されて熱処理空間65が密閉空間とされた後、チャンバー6内の雰囲気調整が行われる。具体的にはバルブ84が開放されてガス供給孔81から熱処理空間65に処理ガスが供給される。本実施形態では、水素と窒素との混合ガス(フォーミングガス)が処理ガスとしてチャンバー6内の熱処理空間65に供給される。また、バルブ89が開放されてガス排気孔86からチャンバー6内の気体が排気される。これにより、チャンバー6内の熱処理空間65の上部から供給された処理ガスが下方へと流れて熱処理空間65の下部から排気され、熱処理空間65が水素を含む雰囲気に置換される。また、バルブ192が開放されることによって、搬送開口部66からもチャンバー6内の気体が排気される。さらに、図示省略の排気機構によって移載機構10の駆動部周辺の雰囲気も排気される。
チャンバー6内が水素を含む雰囲気に置換され、基板Wが保持部7のサセプタ74によって水平姿勢にて下方より保持された後、ハロゲン加熱部4の40本のハロゲンランプHLが一斉に点灯して予備加熱(アシスト加熱)が開始される。ハロゲンランプHLから出射されたハロゲン光は、石英にて形成された下側チャンバー窓64およびサセプター74を透過して基板Wの裏面から照射される。ハロゲンランプHLからの光照射を受けることによって基板Wが予備加熱されて温度が上昇する。なお、移載機構10の移載アーム11は凹部62の内側に退避しているため、ハロゲンランプHLによる予備加熱の障害となることは無い。
ハロゲンランプHLによる予備加熱を行うときには、基板Wの温度が放射温度計120によって測定されている。すなわち、サセプタ74に保持された基板Wの裏面から開口部78を介して放射された赤外光を放射温度計120が受光して昇温中の基板温度を測定する。測定された基板Wの温度は制御部3に伝達される。制御部3は、ハロゲンランプHLからの光照射によって昇温する基板Wの温度が所定の予備加熱温度T1に到達したか否かを監視しつつ、ハロゲンランプHLの出力を制御する。すなわち、制御部3は、放射温度計120による測定値に基づいて、基板Wの温度が予備加熱温度T1となるようにハロゲンランプHLの出力をフィードバック制御する。予備加熱温度T1は、200℃以上500℃以下とされる(本実施の形態では500℃)。
基板Wの温度が予備加熱温度T1に到達した後、制御部3は基板Wをその予備加熱温度T1に暫時維持する。具体的には、放射温度計120によって測定される基板Wの温度が予備加熱温度T1に到達した時点にて制御部3がハロゲンランプHLの出力を調整し、基板Wの温度をほぼ予備加熱温度T1に維持している。
このようなハロゲンランプHLによる予備加熱を行うことによって、基板Wの全体を予備加熱温度T1に均一に昇温している。よって、半導体層102も予備加熱温度T1にて予備加熱されることとなる。ハロゲンランプHLによる予備加熱の段階においては、より放熱が生じやすい基板Wの周縁部の温度が中央部よりも低下する傾向にあるが、ハロゲン加熱部4におけるハロゲンランプHLの配設密度は、基板Wの中央部に対向する領域よりも周縁部に対向する領域の方が高くなっている。このため、放熱が生じやすい基板Wの周縁部に照射される光量が多くなり、予備加熱段階における基板Wの面内温度分布を均一なものとすることができる。
既述した通り、半導体層102を構成するゲルマニウムの結晶中には多数の空孔が存在している。水素を含む処理ガスの雰囲気中にて半導体層102を予備加熱温度T1にて予備加熱することにより、半導体層102の表面近傍に存在していた空孔が水素によって終端されて消滅する。
基板Wの温度が予備加熱温度T1に到達して所定時間が経過した時点にてフラッシュ加熱部5のフラッシュランプFLから基板Wの表面にフラッシュ光照射を行う。フラッシュランプFLがフラッシュ光照射を行うに際しては、予め電源ユニット95によってコンデンサ93に電荷を蓄積しておく。そして、コンデンサ93に電荷が蓄積された状態にて、制御部3のパルス発生器31からIGBT96にパルス信号を出力してIGBT96をオンオフ駆動する。
パルス信号の波形は、パルス幅の時間(オン時間)とパルス間隔の時間(オフ時間)とをパラメータとして順次設定したレシピを入力部33から入力することによって規定することができる。このようなレシピをオペレータが入力部33から制御部3に入力すると、それに従って制御部3の波形設定部32はオンオフを繰り返すパルス波形を設定する。そして、波形設定部32によって設定されたパルス波形に従ってパルス発生器31がパルス信号を出力する。その結果、IGBT96のゲートには設定された波形のパルス信号が印加され、IGBT96のオンオフ駆動が制御されることとなる。具体的には、IGBT96のゲートに入力されるパルス信号がオンのときにはIGBT96がオン状態となり、パルス信号がオフのときにはIGBT96がオフ状態となる。
また、パルス発生器31から出力するパルス信号がオンになるタイミングと同期して制御部3がトリガー回路97を制御してトリガー電極91に高電圧(トリガー電圧)を印加する。コンデンサ93に電荷が蓄積された状態にてIGBT96のゲートにパルス信号が入力され、かつ、そのパルス信号がオンになるタイミングと同期してトリガー電極91に高電圧が印加されることにより、パルス信号がオンのときにはガラス管92内の両端電極間で必ず電流が流れ、そのときのキセノンの原子あるいは分子の励起によって光が放出される。
このようにしてフラッシュ加熱部5の30本のフラッシュランプFLが発光し、保持部7に保持された基板Wの表面にフラッシュ光が照射される。ここで、IGBT96を使用することなくフラッシュランプFLを発光させた場合には、コンデンサ93に蓄積されていた電荷が1回の発光で消費され、フラッシュランプFLからの出力波形は幅が0.1ミリセカンドないし10ミリセカンド程度の単純なシングルパルスとなる。これに対して、本実施の形態では、回路中にスイッチング素子たるIGBT96を接続してそのゲートにパルス信号を出力することにより、コンデンサ93からフラッシュランプFLへの電荷の供給をIGBT96によって断続してフラッシュランプFLに流れる電流をオンオフ制御している。その結果、いわばフラッシュランプFLの発光がチョッパ制御されることとなり、コンデンサ93に蓄積された電荷が分割して消費され、極めて短い時間の間にフラッシュランプFLが点滅を繰り返す。なお、回路を流れる電流値が完全に”0”になる前に次のパルスがIGBT96のゲートに印加されて電流値が再度増加するため、フラッシュランプFLが点滅を繰り返している間も発光出力が完全に”0”になるものではない。
IGBT96によってフラッシュランプFLに流れる電流をオンオフ制御することにより、フラッシュランプFLの発光パターン(発光出力の時間波形)を自在に規定することができ、発光時間および発光強度を自由に調整することができる。IGBT96のオンオフ駆動のパターンは、入力部33から入力するパルス幅の時間とパルス間隔の時間とによって規定される。すなわち、フラッシュランプFLの駆動回路にIGBT96を組み込むことによって、入力部33から入力するパルス幅の時間とパルス間隔の時間とを適宜に設定するだけで、フラッシュランプFLの発光パターンを自在に規定することができるのである。
具体的には、例えば、入力部33から入力するパルス間隔の時間に対するパルス幅の時間の比率を大きくすると、フラッシュランプFLに流れる電流が増大して発光強度が強くなる。逆に、入力部33から入力するパルス間隔の時間に対するパルス幅の時間の比率を小さくすると、フラッシュランプFLに流れる電流が減少して発光強度が弱くなる。また、入力部33から入力するパルス間隔の時間とパルス幅の時間の比率を適切に調整すれば、フラッシュランプFLの発光強度が一定に維持される。さらに、入力部33から入力するパルス幅の時間とパルス間隔の時間との組み合わせの総時間を長くすることによって、フラッシュランプFLに比較的長時間にわたって電流が流れ続けることとなり、フラッシュランプFLの発光時間が長くなる。本実施形態においては、フラッシュランプFLの発光時間が0.1ミリ秒〜100ミリ秒の間に設定される。
このようにしてフラッシュランプFLから基板Wの表面に0.1ミリ秒以上100ミリ秒以下の照射時間にてフラッシュ光が照射されて基板Wのフラッシュ加熱が行われる。照射時間が0.1ミリ秒以上100ミリ秒以下の極めて短く強いフラッシュ光が照射されることによってゲルマニウムの半導体層102を含む基板Wの表面が瞬間的に処理温度T2にまで昇温する。フラッシュ光照射によって基板Wの表面が到達する最高温度(ピーク温度)である処理温度T2は600℃以上900℃以下であり、本実施形態では800℃である。フラッシュ加熱では、フラッシュ光の照射時間が100ミリ秒以下の極めて短時間であるため、基板Wの表面温度は瞬間的に処理温度T2にまで昇温した後、ただちに予備加熱温度T1近傍にまで降温する。
基板Wの表面にフラッシュ光が照射されたときに、ゲルマニウムの半導体層102も処理温度T2に加熱される。表面にドーパントとしてのボロンが注入された半導体層102が瞬間的に処理温度T2に加熱されることによって、ドーパントが活性化される。また、イオン注入によってゲルマニウムの結晶中に生じた格子欠陥も回復される。さらに、半導体層102に注入されたドーパントが適切に拡散する。
ゲルマニウムの結晶中には空孔が多く存在するため、p型半導体の場合、ボロン等のドーパントは多数の空孔が障害となって拡散しにくいのであるが、本実施形態においては、水素を含む雰囲気中にて半導体層102を予備加熱することにより、半導体層102の表面近傍に存在していた空孔を消滅させている。このため、半導体層102がp型半導体であっても、ボロン等のドーパントは比較的容易に拡散できるようになる。その結果、フラッシュランプFLの発光時間および発光強度を適宜に調整することによって、ドーパントの拡散を適切にコントロールすることができるのである。
フラッシュ加熱処理が終了した後、所定時間経過後にハロゲンランプHLが消灯する。これにより、基板Wが予備加熱温度T1から急速に降温する。また、チャンバー6内への水素の供給が停止されるとともに、窒素のみが供給されてチャンバー6内の熱処理空間65が窒素雰囲気に置換される。降温中の基板Wの温度は放射温度計120によって測定され、その測定結果は制御部3に伝達される。制御部3は、放射温度計120の測定結果より基板Wの温度が所定温度まで降温したか否かを監視する。そして、基板Wの温度が所定以下にまで降温した後、移載機構10の一対の移載アーム11が再び退避位置から移載動作位置に水平移動して上昇することにより、リフトピン12がサセプタ74の上面から突き出て熱処理後の基板Wをサセプタ74から受け取る。続いて、ゲートバルブ185により閉鎖されていた搬送開口部66が開放され、リフトピン12上に載置された基板Wが装置外部の搬送ロボットにより搬出され、熱処理装置1における基板Wの加熱処理が完了する。
本実施形態においては、ボロン等のドーパントが注入されたゲルマニウムの半導体層102を水素を含む雰囲気中にて予備加熱温度T1にて予備加熱することにより、半導体層102の表面近傍に存在していた空孔を水素によって消滅させている。そして、その後、半導体層102にフラッシュランプFLからフラッシュ光を照射して半導体層102を処理温度T2に加熱している。フラッシュ加熱前に半導体層102の表面近傍に存在していた空孔を消滅させているため、フラッシュ加熱時にドーパントは比較的容易に拡散することができ、フラッシュランプFLの発光時間および発光強度を適宜に調整することによって、ドーパントの拡散を適切にコントロールすることができる。
特に、Fin構造のFETでは、イオン注入時に必要な領域に均一にドーパントを導入することが困難である場合も多い。そのような場合であっても、ドーパントの拡散を適切にコントロールすることにより、イオン注入時にドーパントを注入できなかった領域にもドーパントを導入することができる。
以上、本発明の実施の形態について説明したが、この発明はその趣旨を逸脱しない限りにおいて上述したもの以外に種々の変更を行うことが可能である。例えば、上記実施形態においては、チャンバー6内に水素と窒素との混合ガスを供給して水素を含む雰囲気を形成するようにしていたが、これに代えて、アンモニアと窒素との混合ガスを供給してアンモニアを含む雰囲気をチャンバー6内に形成するようにしても良い。ドーパントが注入された半導体層102をアンモニアを含む雰囲気中にて予備加熱温度T1にて予備加熱することにより、上記実施形態と同様に、半導体層102の表面近傍に存在していた空孔を消滅させることができる。その結果、フラッシュ加熱時にドーパントの拡散を適切にコントロールすることができる。
また、上記実施形態では、ゲルマニウムの半導体層102にドーパントとしてボロンを注入していたが、これに限定されるものではなく、例えばインジウム(In)等の3価のドーパントであれば良い。すなわち、ゲルマニウムに添加されることによってp型半導体を形成するドーパントであれば良い。
また、上記実施形態においては、チャンバー6内を常圧として基板Wの加熱処理を行っていたが、チャンバー6内を減圧して予備加熱およびフラッシュ加熱を行うようにしても良い。具体的には、チャンバー6内の圧力が20Pa〜大気圧(約101325Pa)の範囲内で基板Wの予備加熱およびフラッシュ加熱を行うようにしても良い。
また、上記実施形態においては、半導体層102がゲルマニウムにて形成されていたが、これに限定されるものではなく、半導体層102はシリコンゲルマニウムにて形成されていても良い。シリコンゲルマニウムの半導体層102にボロン等のドーパントを注入することによって半導体層102はシリコンゲルマニウムを主成分とするp型半導体となる。そして、シリコンゲルマニウムの半導体層102に上記実施形態と同様の熱処理を行うことにより、ドーパントの拡散を適切にコントロールすることができる。
また、上記実施形態においては、シリコンの基材101の上面の一部領域にゲルマニウムの半導体層102を形成していたが、ゲルマニウム単結晶の半導体ウェハーを基板としても良い。
また、上記実施形態においては、フラッシュ加熱部5に30本のフラッシュランプFLを備えるようにしていたが、これに限定されるものではなく、フラッシュランプFLの本数は任意の数とすることができる。また、フラッシュランプFLはキセノンフラッシュランプに限定されるものではなく、クリプトンフラッシュランプであっても良い。また、ハロゲン加熱部4に備えるハロゲンランプHLの本数も40本に限定されるものではなく、任意の数とすることができる。
また、上記実施形態においては、ハロゲンランプHLからのハロゲン光照射によって基板Wを予備加熱するようにしていたが、予備加熱の手法はこれに限定されるものではなく、ホットプレートに載置することによって基板Wを予備加熱するようにしても良い。
1 熱処理装置
3 制御部
4 ハロゲン加熱部
5 フラッシュ加熱部
6 チャンバー
7 保持部
65 熱処理空間
74 サセプタ
75 保持プレート
77 基板支持ピン
93 コンデンサ
95 電源ユニット
96 IGBT
101 基材
102 半導体層
120 放射温度計
FL フラッシュランプ
HL ハロゲンランプ
W 基板

Claims (3)

  1. ゲルマニウムまたはシリコンゲルマニウムを主成分とするp型半導体の熱処理方法であって、
    ドーパントが注入されたゲルマニウムまたはシリコンゲルマニウムの半導体層をチャンバー内に搬入する搬入工程と、
    前記チャンバーに水素またはアンモニアを含む処理ガスを導入する雰囲気形成工程と、
    前記半導体層を水素またはアンモニアの雰囲気中で予備加熱温度にて予備加熱することによって、前記半導体層の表面に存在していた空孔を消滅させる予備加熱工程と、
    前記半導体層にフラッシュランプからフラッシュ光を照射して処理温度に加熱して前記半導体層中のゲルマニウムまたはシリコンゲルマニウムの格子欠陥を回復するとともに、前記ドーパントを活性化するフラッシュ加熱工程と、
    を備えることを特徴とする熱処理方法。
  2. 請求項1記載の熱処理方法において、
    前記予備加熱温度は200℃以上500℃以下であることを特徴とする熱処理方法。
  3. 請求項1または請求項2記載の熱処理方法において、
    前記処理温度は600℃以上900℃以下であることを特徴とする熱処理方法。
JP2016145986A 2016-07-26 2016-07-26 熱処理方法 Active JP6839939B2 (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP2016145986A JP6839939B2 (ja) 2016-07-26 2016-07-26 熱処理方法
TW106117822A TWI642107B (zh) 2016-07-26 2017-05-31 熱處理方法
CN201710573685.2A CN107658225B (zh) 2016-07-26 2017-07-14 热处理方法
US15/655,835 US20180033640A1 (en) 2016-07-26 2017-07-20 Heat treatment method for p-type semiconductor

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2016145986A JP6839939B2 (ja) 2016-07-26 2016-07-26 熱処理方法

Publications (2)

Publication Number Publication Date
JP2018018873A JP2018018873A (ja) 2018-02-01
JP6839939B2 true JP6839939B2 (ja) 2021-03-10

Family

ID=61010515

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2016145986A Active JP6839939B2 (ja) 2016-07-26 2016-07-26 熱処理方法

Country Status (4)

Country Link
US (1) US20180033640A1 (ja)
JP (1) JP6839939B2 (ja)
CN (1) CN107658225B (ja)
TW (1) TWI642107B (ja)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP7032955B2 (ja) * 2018-02-28 2022-03-09 株式会社Screenホールディングス 熱処理方法
CN108987265A (zh) 2018-06-26 2018-12-11 武汉华星光电半导体显示技术有限公司 显示器件制造方法及装置

Family Cites Families (30)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB1107700A (en) * 1966-03-29 1968-03-27 Matsushita Electronics Corp A method for manufacturing semiconductor devices
JPS6472533A (en) * 1987-09-11 1989-03-17 Nippon Telegraph & Telephone Manufacture of single crystal semiconductor substrate
TWI313059B (ja) * 2000-12-08 2009-08-01 Sony Corporatio
US6849831B2 (en) * 2002-03-29 2005-02-01 Mattson Technology, Inc. Pulsed processing semiconductor heating methods using combinations of heating sources
US6841457B2 (en) * 2002-07-16 2005-01-11 International Business Machines Corporation Use of hydrogen implantation to improve material properties of silicon-germanium-on-insulator material made by thermal diffusion
JP3699946B2 (ja) * 2002-07-25 2005-09-28 株式会社東芝 半導体装置の製造方法
JP2005072045A (ja) * 2003-08-26 2005-03-17 Toshiba Corp 半導体装置およびその製造方法
JP4393235B2 (ja) * 2004-03-15 2010-01-06 財団法人国際科学振興財団 半導体装置の製造方法、及び半導体製造装置
US7247535B2 (en) * 2004-09-30 2007-07-24 Texas Instruments Incorporated Source/drain extensions having highly activated and extremely abrupt junctions
US20080017931A1 (en) * 2006-07-19 2008-01-24 Hung-Lin Shih Metal-oxide-semiconductor transistor device, manufacturing method thereof, and method of improving drain current thereof
US7902569B2 (en) * 2007-07-17 2011-03-08 The Ohio State University Research Foundation Si/SiGe interband tunneling diodes with tensile strain
JP2010021525A (ja) * 2008-06-13 2010-01-28 Toshiba Corp 半導体装置の製造方法
WO2010061619A1 (ja) * 2008-11-28 2010-06-03 住友化学株式会社 半導体基板の製造方法、半導体基板、電子デバイスの製造方法、および反応装置
US8614432B2 (en) * 2009-01-15 2013-12-24 Hewlett-Packard Development Company, L.P. Crystalline silicon-based memristive device with multiple mobile dopant species
US20100193154A1 (en) * 2009-01-28 2010-08-05 Applied Materials, Inc. Rapid cooling of a substrate by motion
JP2011014762A (ja) * 2009-07-03 2011-01-20 Toshiba Corp 半導体装置及び半導体装置の製造方法
WO2011034814A1 (en) * 2009-09-17 2011-03-24 The Ohio State University Tunneling field effect transistors and transistor circuitry employing same
JP2012104808A (ja) * 2010-10-14 2012-05-31 Dainippon Screen Mfg Co Ltd 熱処理装置および熱処理方法
US20120190216A1 (en) * 2011-01-20 2012-07-26 International Business Machines Corporation Annealing techniques for high performance complementary metal oxide semiconductor (cmos) device fabrication
TWI566300B (zh) * 2011-03-23 2017-01-11 斯克林集團公司 熱處理方法及熱處理裝置
CN103184438B (zh) * 2011-12-30 2016-02-17 中芯国际集成电路制造(上海)有限公司 薄膜的热处理方法及热处理装置、化学气相沉积装置
JP5955658B2 (ja) * 2012-06-15 2016-07-20 株式会社Screenホールディングス 熱処理方法および熱処理装置
US9722083B2 (en) * 2013-10-17 2017-08-01 Taiwan Semiconductor Manufacturing Company, Ltd. Source/drain junction formation
WO2015064338A1 (ja) * 2013-10-31 2015-05-07 独立行政法人科学技術振興機構 ゲルマニウム層を熱処理する半導体基板の製造方法および半導体装置の製造方法
JP6235325B2 (ja) * 2013-12-10 2017-11-22 株式会社東芝 電界効果トランジスタ及びその製造方法、半導体デバイス及びその製造方法
CN103681355B (zh) * 2013-12-18 2016-04-06 北京大学 制备准soi源漏场效应晶体管器件的方法
US20150311067A1 (en) * 2014-04-24 2015-10-29 Applied Materials, Inc. Millisecond annealing in ammonia ambient for precise placement of nitrogen in thin film stacks
DE102014208054A1 (de) * 2014-04-29 2015-10-29 Evonik Degussa Gmbh Verfahren zur Erzeugung unterschiedlich dotierter Halbleiter
JP6472247B2 (ja) * 2015-01-07 2019-02-20 株式会社Screenホールディングス 熱処理方法および熱処理装置
US10730264B2 (en) * 2015-02-23 2020-08-04 Tesa Se Bridge tape

Also Published As

Publication number Publication date
TW201804533A (zh) 2018-02-01
TWI642107B (zh) 2018-11-21
US20180033640A1 (en) 2018-02-01
CN107658225A (zh) 2018-02-02
JP2018018873A (ja) 2018-02-01
CN107658225B (zh) 2021-04-30

Similar Documents

Publication Publication Date Title
CN106340451B (zh) 热处理方法以及热处理装置
JP6539568B2 (ja) 熱処理方法および熱処理装置
JP6768481B2 (ja) ドーパント導入方法および熱処理方法
JP6184697B2 (ja) 熱処理装置および熱処理方法
JP6774800B2 (ja) 半導体装置の製造方法
US11004693B2 (en) Light-irradiation heat treatment method and heat treatment apparatus
JP6598630B2 (ja) 熱処理方法
JP6810578B2 (ja) ドーパント導入方法および熱処理方法
JP5507227B2 (ja) 熱処理方法および熱処理装置
JP6839940B2 (ja) 熱処理方法
KR101389636B1 (ko) 열처리 방법
JP6960344B2 (ja) 熱処理方法および熱処理装置
JP6839939B2 (ja) 熱処理方法
JP7032947B2 (ja) 熱処理方法
JP6841666B2 (ja) 結晶構造制御方法および熱処理方法
WO2020188979A1 (ja) 熱処理方法および熱処理装置
JP6810591B2 (ja) シリコン基板の熱処理方法
JP2012199470A (ja) 熱処理方法および熱処理装置
JP6945703B2 (ja) ドーパント導入方法および熱処理方法
JP2018029128A (ja) ドーパント導入方法
JP2018101760A (ja) 熱処理方法
KR102303332B1 (ko) p형 질화갈륨계 반도체의 제조 방법 및 열처리 방법
JP6791693B2 (ja) 熱処理装置
JP2018022715A (ja) ドーパント導入方法

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20190624

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20200624

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20200630

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20200827

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20200923

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20201223

C60 Trial request (containing other claim documents, opposition documents)

Free format text: JAPANESE INTERMEDIATE CODE: C60

Effective date: 20201223

A911 Transfer to examiner for re-examination before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20210106

C21 Notice of transfer of a case for reconsideration by examiners before appeal proceedings

Free format text: JAPANESE INTERMEDIATE CODE: C21

Effective date: 20210112

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20210126

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20210216

R150 Certificate of patent or registration of utility model

Ref document number: 6839939

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250