JP6662150B2 - ハイパスフィルタ - Google Patents
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Description
以下、一実施形態に係るハイパスフィルタの構成について図面を参照しながら説明する。図1は、一実施形態に係るハイパスフィルタ10,10a〜10cの等価回路図である。
本実施形態に係るハイパスフィルタ10によれば、通過特性に現れる2つの減衰極を近づけることができる。図4Aは、ハイパスフィルタ10の通過特性S21及び反射特性S11,S22のシミュレーション結果を示したグラフである。図4Bは、比較例に係るハイパスフィルタの通過特性S21及び反射特性S11,S22のシミュレーション結果を示したグラフである。縦軸は通過特性及び反射特性を示し、横軸は周波数を示す。
以下、第1の変形例に係るハイパスフィルタ10aの構成について図面を参照しながら説明する。図5は、第1の変形例に係るハイパスフィルタ10aの分解斜視図である。ハイパスフィルタ10aの等価回路図及び外観斜視図は、ハイパスフィルタ10の等価回路図及び外観斜視図と同じであるので、図1及び図2を援用する。
以下、第2の変形例に係るハイパスフィルタ10bの構成について図面を参照しながら説明する。図6は、第2の変形例に係るハイパスフィルタ10bの分解斜視図である。ハイパスフィルタ10bの等価回路図及び外観斜視図は、ハイパスフィルタ10の等価回路図及び外観斜視図と同じであるので、図1及び図2を援用する。
以下、第3の変形例に係るハイパスフィルタ10cの構成について図面を参照しながら説明する。図7は、第3の変形例に係るハイパスフィルタ10cの分解斜視図である。ハイパスフィルタ10cの等価回路図及び外観斜視図は、ハイパスフィルタ10の等価回路図及び外観斜視図と同じであるので、図1及び図2を援用する。
本発明に係るハイパスフィルタは、ハイパスフィルタ10,10a〜10cに限らず、その要旨の範囲内において変更可能である。
12:積層体
14a〜14d:外部電極
16a〜16s:絶縁体層
18a〜18f,20a〜20f:インダクタ導体層
22,24,26a,26b,28a,28b,29:コンデンサ導体層
30,32,34:コンデンサ導体層
36a,36b,38a,38b:接続導体層
114a〜114d:側面部
115a〜115d:底面部
116a〜116d:上面部
500 :ハイパスフィルタ
C1〜C5,C11:コンデンサ
L1,L2:インダクタ
LC1,LC2:LC直列共振器
SL:信号経路
v1〜v5,v11〜v15:ビアホール導体
Claims (8)
- 第1の入出力端子、第2の入出力端子及び少なくとも1以上のグランド端子と、
前記第1の入出力端子と前記第2の入出力端子との間に設けられている信号経路と、
前記信号経路に電気的に接続されている第1の端部、及び、前記少なくとも1以上のグランド端子に電気的に接続されている第2の端部を有する第1のLC直列共振器であって、第1のインダクタ及び第1のコンデンサを含む第1のLC直列共振器であって、前記第1のコンデンサ及び前記第1のインダクタは、前記第1の端部と前記第2の端部との間においてこの順に直列に接続されている、第1のLC直列共振器と、
前記信号経路に電気的に接続されている第3の端部、及び、前記少なくとも1以上のグランド端子に電気的に接続されている第4の端部を有する第2のLC直列共振器であって、第2のインダクタ及び第2のコンデンサを含む第2のLC直列共振器であって、前記第2のコンデンサ及び前記第2のインダクタは、前記第3の端部と前記第4の端部との間においてこの順に直列に接続されている、第2のLC直列共振器と、
前記第1のコンデンサにおいて前記第1のインダクタに接続されている第1の電極から該第1のインダクタにおいて該第1のコンデンサに接続されていない端部よりも該第1の電極側の部分までの区間と、前記第2のコンデンサにおいて前記第2のインダクタに接続されている第2の電極から該第2のインダクタにおいて該第2のコンデンサに接続されていない端部よりも該第2の電極側の部分までの区間との間に形成されている第3のコンデンサと、
複数の絶縁体層が積層方向に積層された構造を有する積層体と、
を備えており、
前記第1のLC直列共振器は、前記絶縁体層上に設けられている少なくとも1以上の第1の導体層を含んでおり、
前記第2のLC直列共振器は、前記絶縁体層上に設けられている少なくとも1以上の第2の導体層を含んでおり、
前記第3のコンデンサは、前記第1の導体層及び/又は前記第2の導体層と前記絶縁体層を介して対向する第1のコンデンサ導体層を含んでおり、
前記少なくとも1以上の第1の導体層は、少なくとも1以上の第1のインダクタ導体層、及び、第2のコンデンサ導体層を含んでおり、
前記少なくとも1以上の第2の導体層は、少なくとも1以上の第2のインダクタ導体層、及び、第3のコンデンサ導体層を含んでおり、
前記第1のコンデンサ導体層と前記第1のインダクタ導体層とは容量結合している、及び/又は、前記第1のコンデンサ導体層と前記第2のインダクタ導体層とは容量結合していること、
を特徴とするハイパスフィルタ。 - 前記第1のコンデンサ導体層は、前記絶縁体層を介して前記第1のインダクタ導体層及び/又は前記第2のインダクタ導体層と対向していること、
を特徴とする請求項1に記載のハイパスフィルタ。 - 前記1以上の第1のインダクタ導体層は、前記積層方向から見たときに、所定方向に巻いており、
前記1以上の第2のインダクタ導体層は、前記積層方向から見たときに、前記所定方向の反対方向に巻いていること、
を特徴とする請求項1又は請求項2のいずれかに記載のハイパスフィルタ。 - 前記第1のコンデンサ導体層は、前記絶縁体層を介して前記第1のインダクタ導体層及び前記第2のインダクタ導体層と対向しており、かつ、前記第2のコンデンサ導体層及び前記第3のコンデンサ導体層よりも該第1のインダクタ導体層及び該第2のインダクタ導体層の近くに設けられていること、
を特徴とする請求項1ないし請求項3のいずれかに記載のハイパスフィルタ。 - 前記第1のインダクタは、前記絶縁体層を前記積層方向に貫通し、かつ、前記第1のインダクタ導体層と前記第2のコンデンサ導体層とを電気的に接続する第1のビアホール導体を更に含んでおり、
前記第1のコンデンサ導体層は、前記第1のビアホール導体に接続され、前記絶縁体層を介して前記第2のインダクタ導体層と対向しており、かつ、前記第3のコンデンサ導体層よりも該第2のインダクタ導体層の近くに設けられていること、
を特徴とする請求項1ないし請求項3のいずれかに記載のハイパスフィルタ。 - 前記第1のインダクタは、複数の前記第1のインダクタ導体層が少なくとも1以上のビアホール導体により接続されることにより、前記積層方向から見たときに前記所定方向に巻きながら該積層方向に進行する螺旋状をなしており、
前記第2のインダクタは、複数の前記第2のインダクタ導体層が少なくとも1以上のビアホール導体により接続されることにより、前記積層方向から見たときに前記所定方向の反対方向に巻きながら該積層方向に進行する螺旋状をなしていること、
を特徴とする請求項3に記載のハイパスフィルタ。 - 前記少なくとも1以上のグランド端子は、前記積層体において前記積層方向の一方側に位置する面に設けられている底面部を含んでおり、
前記第1のインダクタの前記積層方向の他方側の端部、及び、前記第2のインダクタの前記積層方向の他方側の端部は、少なくとも1以上の前記底面部に電気的に接続されていること、
を特徴とする請求項6に記載のハイパスフィルタ。 - 前記第2のコンデンサ及び前記第3のコンデンサは、前記第1のインダクタ及び前記第2のインダクタよりも前記積層方向の一方側に位置していること、
を特徴とする請求項7に記載のハイパスフィルタ。
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