JP6653235B2 - 半導体装置の製造方法および半導体装置 - Google Patents
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- H01L2224/45099—Material
- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/45144—Gold (Au) as principal constituent
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- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
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- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
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- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48245—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
- H01L2224/48247—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
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- H01L2224/48257—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a die pad of the item
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- H01L2224/491—Disposition
- H01L2224/4911—Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain
- H01L2224/49113—Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain the connectors connecting different bonding areas on the semiconductor or solid-state body to a common bonding area outside the body, e.g. converging wires
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- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73265—Layer and wire connectors
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- H01L2224/7825—Means for applying energy, e.g. heating means
- H01L2224/783—Means for applying energy, e.g. heating means by means of pressure
- H01L2224/78301—Capillary
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- H01L2224/787—Means for aligning
- H01L2224/78703—Mechanical holding means
- H01L2224/78704—Mechanical holding means in the lower part of the bonding apparatus, e.g. in the apparatus chuck
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/83009—Pre-treatment of the layer connector or the bonding area
- H01L2224/8301—Cleaning the layer connector, e.g. oxide removal step, desmearing
- H01L2224/83011—Chemical cleaning, e.g. etching, flux
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/838—Bonding techniques
- H01L2224/8385—Bonding techniques using a polymer adhesive, e.g. an adhesive based on silicone, epoxy, polyimide, polyester
- H01L2224/83855—Hardening the adhesive by curing, i.e. thermosetting
- H01L2224/83862—Heat curing
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- H01L2224/83909—Post-treatment of the layer connector or bonding area
- H01L2224/8391—Cleaning, e.g. oxide removal step, desmearing
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- H01L2224/8512—Aligning
- H01L2224/85148—Aligning involving movement of a part of the bonding apparatus
- H01L2224/85169—Aligning involving movement of a part of the bonding apparatus being the upper part of the bonding apparatus, i.e. bonding head, e.g. capillary or wedge
- H01L2224/8518—Translational movements
- H01L2224/85181—Translational movements connecting first on the semiconductor or solid-state body, i.e. on-chip, regular stitch
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- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
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- H01L2224/85201—Compression bonding
- H01L2224/85205—Ultrasonic bonding
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- H01L2224/852—Applying energy for connecting
- H01L2224/85201—Compression bonding
- H01L2224/85205—Ultrasonic bonding
- H01L2224/85207—Thermosonic bonding
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- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
- H01L2224/8538—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/85399—Material
- H01L2224/854—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/85438—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/85439—Silver (Ag) as principal constituent
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- H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
- H01L2224/92—Specific sequence of method steps
- H01L2224/922—Connecting different surfaces of the semiconductor or solid-state body with connectors of different types
- H01L2224/9222—Sequential connecting processes
- H01L2224/92242—Sequential connecting processes the first connecting process involving a layer connector
- H01L2224/92247—Sequential connecting processes the first connecting process involving a layer connector the second connecting process involving a wire connector
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- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49541—Geometry of the lead-frame
- H01L23/49548—Cross section geometry
- H01L23/49551—Cross section geometry characterised by bent parts
- H01L23/49555—Cross section geometry characterised by bent parts the bent parts being the outer leads
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49541—Geometry of the lead-frame
- H01L23/49562—Geometry of the lead-frame for devices being provided for in H01L29/00
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- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
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- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L24/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
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- H01L24/42—Wire connectors; Manufacturing methods related thereto
- H01L24/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L24/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
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- H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L24/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
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- H01L24/42—Wire connectors; Manufacturing methods related thereto
- H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L24/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
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Description
本願において、実施の態様の記載は、必要に応じて、便宜上複数のセクション等に分けて記載するが、特にそうでない旨明示した場合を除き、これらは相互に独立別個のものではなく、記載の前後を問わず、単一の例の各部分、一方が他方の一部詳細または一部または全部の変形例等である。また、原則として、同様の部分は繰り返しの説明を省略する。また、実施の態様における各構成要素は、特にそうでない旨明示した場合、理論的にその数に限定される場合および文脈から明らかにそうでない場合を除き、必須のものではない。
まず、本実施の形態の半導体装置PKG1の構成の概要について、図1〜図5を用いて説明する。図1は本実施の形態の半導体装置の上面図である。図2は、図1に示す矢印Aの方向から視た側面図である。図3は、図1に示す封止体を取り除いた状態で半導体装置の内部構造を示す透視平面図である。また、図4は、図3のA−A線に沿った断面図、図5は、図3のB−B線に沿った断面図である。
次に半導体装置PKG1の内部構造について説明する。図3に示すように、本実施の形態の半導体装置PKG1は、半導体チップCPを含む複数の電子部品(チップ部品)を内蔵する半導体パッケージである。図3に示す例では、半導体装置PKG1は、半導体チップCPの他、複数(図3では3個)のコンデンサ(容量素子、チップコンデンサ、電子部品、チップ部品)CCを有している。
次に、図1〜図5に示す半導体装置が備えている回路の構成例について説明する。図6は、図1に示す半導体装置に形成された回路構成の一例を示す回路ブロック図である。本実施の形態の半導体装置PKG1は、電力変換回路であるインバータIVTと、インバータIVTの動作を制御する制御回路CTCとを内蔵するパワー半導体装置である。図6に示す例では、インバータIVTは、3相交流の電力を出力する電力変換装置である。このため、インバータIVTは、U相の出力端子である端子MU、V相の出力端子である端子MV、およびW相の出力端子である端子MWが接続されている。端子MU、MV、MWのそれぞれは、リードLDに対応し、図3に示す例では、側面MRs2から露出する3個のリードLDが、それぞれ端子MU、MV、またはMWに対応する。
次に、部品搭載部に搭載されたコンデンサの詳細について説明する。図7は、図5に示す複数のコンデンサのうちの一つを拡大して示す拡大断面図である。なお、図5に示す複数のコンデンサCCのそれぞれは互いに同様な構造になっている。図7では、図5に示す複数のコンデンサCCのうち、コンデンサCC1を代表例として示し、他のコンデンサCC2、CC3の拡大図は図示を省略する。また、図7では、図5に示す封止体MRは図示を省略している。
次に、コンデンサCCのようなチップ部品が部品搭載部DPに搭載されている場合の、接続状態について説明する。半導体装置の製造方法の全体的なフローは後述するが、本セクションでは、チップ部品と部品搭載部との接続状態に特に関連性が高い製造工程について先に説明する。図8は、チップ部品と部品搭載部の接着界面が剥離するモードを模式的に示す説明図である。図9は、図3に示す半導体装置の製造工程において、吊りリードを切断している状態を示す拡大断面図である。また、図10は、図9に対する検討例である吊りリードを切断している状態を示す拡大断面図である。図11は、図10に示す吊りリードの切断前の平面図である。図12は、図10に示す吊りリードが曲がる方向を示す断面図である。
図13は、図9に示す吊りリードの切断前の平面図である。また、図14は、図13に示すA部の拡大平面図である。図15は、図14のA−A線に沿った拡大断面図である。図14は平面図であるが、吊りリードTL4を構成する各部分の境界を示すために、複数の部分のそれぞれに、異なる種類のハッチングを付している。図13に示す吊りリードTLは切断前の状態であり、吊りリードTLは部品搭載部DP2に接続される部分の反対側において、タイバー(連結部)TBに接続されている。また、以下の説明において、吊りリードTL2や吊りリードTL4を構成する各部分の幅(または太さ)とは、吊りリードTL4の延在方向であるX方向に対して交差するY方向の長さの事を意味する。
次に、図1〜図5示す半導体装置PKG1の製造工程について、説明する。本実施の形態における半導体装置PKG1は、図19に示す組立てフローに沿って製造される。図19は、図1〜図5に示す半導体装置の組み立てフローを示す説明図である。以下の各工程の説明において、原則として平面図を示し、各工程における断面は、既に説明した図4や図5を参照して説明する。なお、本実施の形態では、図1に示す一つの半導体装置PKG1に対応したリードフレームを用いて半導体装置を組み立てる実施態様について説明する。しかし、変形例としては、複数の半導体装置PKG1に複数の製品形成領域を備える、所謂多数個取り基板を準備して、複数の半導体装置を一括して組立てた後、製品形成領域毎に個片化する方法もある。この場合、組立工程を効率化することができる。
まず、図19に示すリードフレーム準備工程として、図20に示すようなリードフレームLF1を準備する。図20は、図19のリードフレーム準備工程で準備するリードフレームを示す平面図である。図20は平面図であるが、銅から成る基材上に、銀膜(銀メッキ膜)などの金属膜(メッキ膜)が形成された部分にハッチングを付している。
複数の部品搭載部DPの周囲には、複数のリードLDおよび複数の吊りリードTL2が形成されている。複数のリードLDのそれぞれは、タイバーTBの外側に設けられた(封止工程の後、封止体から露出する)アウタリード部LDO、およびタイバーTBの内側に設けられた(封止工程の後、封止体に封止される)インナリード部LDIを備える。複数のリードTLおよび複数の吊りリードTL2、TL3のそれぞれは、X方向に沿って延在する。また、部品搭載部DP1の一方の長辺側(図3に示す辺S5側)には、辺S5に沿って複数のリードLDと複数の吊りリードTL2とが交互に配列されている。辺S5側に配列される複数のリードには、基準電位が供給されるリードLDG、制御信号が供給されるリードLDS、およびハイサイド電位が供給されるリードLDが含まれる。複数のリードLDおよび複数の吊りリードTL2のそれぞれは、タイバーTBを介して互いに連結されている。
ワイヤBW(図3参照)を接続する領域である、ワイヤボンディング部(ワイヤボンディング領域)WBAになっている。図20においてハッチングを付している部分、詳しくは、複数の部品搭載部DPの上面およびワイヤボンディング部WBAの上面には、基材の表面を覆う、金属膜が形成されている。この金属膜は、例えば銀や金などから成り、メッキ法により形成されたメッキ膜である。複数の部品搭載部DPの上面およびワイヤボンディング部WBAの上面に金属膜が形成されている場合、ワイヤBW(図3)あるいは接着材BD1(図4参照)との電気的接続信頼性が向上する。なお、既に説明した図3〜5では、金属膜の図示を省略しているが、図7に示す金属膜MTLが図20においてハッチングで示す金属膜に相当する。
次に、図19に示す半導体チップ搭載工程として、図21に示すように部品搭載部DP1上に、接着材BD1を介して半導体チップCPを搭載する。図21は、図20に示すダイパッド上に、接着材を介して半導体チップを搭載した状態を示す平面図である。
次に、図19に示すチップ部品搭載工程として、図22および図23に示すように複数の部品搭載部DP上に、接着材BD1を介して複数のコンデンサCCを搭載する。図22は、図21に示す部品搭載部上に、接着材を介して複数のチップ部品を搭載した状態を示す平面図である。また図23は図22のA−A線に沿った断面図である。
次に、図19に示すワイヤボンディング工程として、図24に示すように、半導体チップCPの複数のパッドPDと複数のリードLDとを、複数のワイヤ(導電性部材)BWを介して、それぞれ電気的に接続する。図24は、図22に示す半導体チップと複数のリードを、ワイヤを介して電気的に接続した状態を示す平面図である。図25は、ワイヤボンディング工程における、リードフレーム、ステージ、およびクランパの平面的な位置関係を示す平面図である。また、図26は、図25のA−A線に沿った拡大断面図である。図25では、リードフレームLF1、ステージSTG、およびクランパCLPの平面視における位置関係を示すため、ステージSTGにはドットパターンを付し、クランパCLPにはハッチングを付している。また、図25では、図24に示す半導体チップCP、コンデンサCC、ワイヤBW、および接着材BD1のそれぞれは、図示を省略している。一方、図26では、半導体チップCP、コンデンサCC、ワイヤBW、および接着材BD1を図示している。
次に、図19に示す封止工程として、図29に示すように、封止体(樹脂体)MRを形成する。図29は、図24に示すリードフレームのデバイス領域に、封止体を形成した状態を示す平面図である。図30は、図19に示す封止工程において、成形金型内にリードフレームを固定した状態を示す拡大断面図である。また、図31は、図30に示す吊りリードと成形金型のキャビティとの平面的な位置関係を示す拡大平面図である。なお、図30は、図27に示すA−A線に沿った断面に対応している。本工程では、図24に示す部品または部材のうち、半導体チップCP、複数のコンデンサCC、複数の部品搭載部DP、複数のワイヤBW、複数のリードLDのそれぞれの一部分(被封止部、インナリード部)、および吊りリードTL1の一部分(被封止部)、および吊りリードTL2の一部分(被封止部)、および吊りリードTL3を樹脂により封止する。
次に、図19に示すタイバーカット工程として、図29に示すタイバーTBを切断し、図32に示すように、複数のリードLDのそれぞれをタイバーTBから分離する。また、本工程では、図29に示す複数の吊りリードTL2のそれぞれの一部分(封止体MRから露出する部分)を切断する(吊りリードカット工程)。タイバーTBと吊りリードTL2とは、それぞれ個別に順番に切断しても良いし、同時に一括して切断しても良い。図32は、図29に示すタイバーおよび吊りリードの一部を切断した状態を示す平面図である。
次に、図19に示すメッキ工程として、図32に示すリードフレームLF1のうち、封止体MRから露出する部分の表面に、半田膜などの金属膜を形成する。半田膜は、リードLDを図示しない実装基板側の端子と接合する際に接合材の濡れ性を向上させる機能を備えている。本実施の形態の半田膜は、例えば、鉛(Pb)を実質的に含まない、所謂、鉛フリー半田からなり、例えば錫(Sn)のみ、錫−ビスマス(Sn−Bi)、または錫−銅−銀(Sn−Cu−Ag)などである。
次に、図19に示すリード成形工程として、図33に示すように複数のリードLDのそれぞれを図4に例示したような形状に成形する。図33は、図32に示す複数のリードを切断し、成形した状態を示す平面図である。
次に、図19に示すフレーム分離工程として、図33に示す複数の吊りリードTL1の一部分を切断することにより、図1に示す半導体装置PKG1に相当する組立体をリードフレームLF1の外枠LFfから分離させる。吊りリードTL1を切断する方法は、図10に示すプレス切断により切断することができる。
以上、本願発明者によってなされた発明を実施の形態および種々の変形例に基づき具体的に説明したが、本発明は前記実施の形態に限定されるものではなく、その要旨を逸脱しない範囲で上記した変形例以外にも、種々変更可能であることはいうまでもない。
BDb 樹脂
BDc 導電性粒子
BW ワイヤ(導電性部材)
CBT1、CBT2 キャビティ(凹部)
CBTs 端部(周縁部)
CC、CC1、CC2、CC3 コンデンサ(容量素子、チップコンデンサ、電子部品、チップ部品)
CCb 下面
CCs 側面
CCt 上面
CCz 絶縁層(誘電体層、絶縁体)
CLP クランパ(クランプツール、固定治具)
CLPb 下面
CP 半導体チップ
CPb 裏面(主面、下面)
CPt 表面(主面、上面)
CTC 制御回路
CTL 切断線(切断ライン)
DNP 窪み(開口部)
DP、DP1、DP2、DP3、DP4、DP5、DP6 部品搭載部(ダイパッド、半導体チップ搭載部、タブ)
DPb 下面
DPt 上面
EL1 電極(電極端子、外部電極、金属膜)
EL2 電極(電極端子、外部電極、金属膜)
GND 端子(基準電位端子、ロウサイド端子)
GP1、GP2 離間距離(距離)
HL 開口部
IEL、IEL1、IEL2 内部電極(電極)
IVT インバータ
LD、LDG、LDS リード(端子、外部端子)
LDI インナリード部(封止部)
LDO アウタリード部(露出部)
LF1 リードフレーム
LFb 下面
LFd デバイス領域(製品形成領域)
LFf 外枠(枠部)
LFt 上面
MD 成形金型
MD1 上型(金型)
MD2 下型(金型)
MDc1、MDc2 クランプ面(金型面、押し付け面、面)
MR 封止体(樹脂体)
MRb 下面
MRd ダム内樹脂
MRs 側面
MRs1、MRs2、MRs3、MRs4 側面(辺)
MRt 上面(面、主面)
MTL 金属膜
MU、MV、MW、SG 端子
PD パッド(電極、電極パッド、ボンディングパッド)
PKG1 半導体装置
PRT 切断治具(切断ツール、治具、ツール)
PRT1、PRT2 ダイ
PRT3 パンチ
PWC 内部電源回路
RLV 基準面
S1、S2、S3、S4、S5、S6、S7、S8 辺
STG、STG2 ステージ
STGt 上面
TB タイバー(連結部)
TL、TL1、TL2、TL2A、TL2B、TL2C、TL3、TL4、TL4A、TL4B、TL4C、TLh 吊りリード
TL5 連結部(吊りリード)
TLb 下面
TLH 貫通孔(開口部)
TLs 側面
TLt 上面
TLtr、TLtr2 溝部
TP1、TP2、TP2C、TP3、TP4、TP5、TP6 部分
VD 端子(電源電位端子、ハイサイド端子)
W1、W2、W3 幅
WBA ワイヤボンディング部(ワイヤボンディング領域)
WBT ボンディングツール
Claims (16)
- 以下の工程を含む半導体装置の製造方法:
(a)第1吊りリードが接続された第1部品搭載部と、第1方向において前記第1部品搭載部と対向する辺を有し、第2吊りリードが接続された第2部品搭載部と、前記第1方向と交差する第2方向において、前記第2部品搭載部の隣に配置されている第3部品搭載部と、複数のリードと、前記第1吊りリード、前記第2吊りリード、および前記複数のリードが接続されている枠部と、前記複数のリードおよび前記第2吊りリードのそれぞれが連結される第1連結部と、を有するリードフレームを準備する工程;
(b)前記(a)工程の後、前記第1部品搭載部に第1接着材を介して半導体チップを、前記第2部品搭載部および前記第3部品搭載部に跨るように前記第2部品搭載部および前記第3部品搭載部に前記第1接着材を介して第1電子部品を、それぞれ搭載する工程;
(c)前記(b)工程の後、前記半導体チップと前記複数のリードとをワイヤを介して電気的に接続する工程;
(d)前記(c)工程の後、前記半導体チップ、前記第1電子部品、前記第1部品搭載部、前記第2部品搭載部、前記第3部品搭載部、前記ワイヤ、前記複数のリードのそれぞれの被封止部、前記第1吊りリードの被封止部、および前記第2吊りリードの被封止部を樹脂で封止し、封止体を形成する工程;
(e)前記(d)工程の後、前記第2吊りリードのうちの前記封止体から露出した露出部に切断治具を押し当てることにより、前記第2吊りリードを切断する工程:
ここで、
前記第1接着材は、複数の導電性粒子を含有する樹脂であり、
前記第2吊りリードは、平面視において、前記第2部品搭載部と前記第1連結部の間に位置する第1部分と、前記第1部分と前記第1連結部の間に位置する第2部分と、を有し、
前記第2部分は、前記第1部分と繋がり、かつ、前記第1部分の幅よりも細い第3部分と、前記第1部分と繋がり、かつ、前記第1部分の幅よりも細い第4部分と、前記第3部分と前記第4部分との間に位置する第1開口部と、を有し、
前記第1部分、前記第3部分および前記第4部分のそれぞれは、互いに同じ第1の厚さから成り、
前記(d)工程では、前記第2吊りリードの前記露出部が前記封止体から露出するように、前記第1部分および前記第2部分の一部を封止する、半導体装置の製造方法。 - 請求項1において、
前記第2部品搭載部には、平面視において、前記第1方向に沿って延びる複数の前記第2吊りリードが接続され、
複数の前記第2吊りリードのそれぞれは、前記第3部分、前記第4部分、および前記第1開口部を有している、半導体装置の製造方法。 - 請求項2において、
前記リードフレームの前記第2部品搭載部は、前記第1部品搭載部と対向する第1辺、前記第1辺の反対側に位置し、前記第1連結部と対向する第2辺、前記第1辺および前記第2辺と交差する第3辺、および前記第3辺の反対側に位置する第4辺を有し、
前記第2部品搭載部に接続される複数の前記第2吊りリードのそれぞれは、前記第2部品搭載部の前記第2辺側に接続され、
前記第2部品搭載部の前記第1辺、前記第3辺、および前記第4辺のそれぞれは、前記リードフレームの他の構成部材と離間している、半導体装置の製造方法。 - 請求項3において、
前記第3部品搭載部は、前記第3部品搭載部と前記第1部品搭載部との間に設けられた第2連結部を介して前記第1部品搭載部に接続されている、半導体装置の製造方法。 - 請求項4において、
前記第3部品搭載部には、前記第2連結部の反対側に位置し、かつ、前記第1連結部を介して複数の前記第2吊りリードと連結される、第1リードが接続され、
前記第1リードは、前記(e)工程で切断されず、かつ、前記第2吊りリードが有する前記第2部分を有していない、半導体装置の製造方法。 - 請求項3において、
前記第1部品搭載部は平面視において、前記第2部品搭載部および前記第3部品搭載部のそれぞれと対向する第5辺、前記第5辺の反対側に位置する第6辺、前記第5辺および前記第6辺と交差する第7辺、および前記第7辺の反対側に位置する第8辺を有し、
前記第1部品搭載部の前記第7辺および前記第8辺のそれぞれには、第2方向に沿って延びる前記第1吊りリードが接続され、
(f)前記(d)工程の後、複数の前記第1吊りリードのそれぞれの一部分を切断する工程を更に備えている、半導体装置の製造方法。 - 請求項6において、
前記リードフレームは、前記第1部品搭載部の前記第6辺に沿って配列される、前記複数のリードと、前記複数のリードのそれぞれに連結される第3連結部を有し、
前記複数のリードのそれぞれは、前記(e)工程で切断されず、かつ、前記第2吊りリードが有する前記第2部分を有していない、半導体装置の製造方法。 - 請求項6において、
前記複数の第1吊りリードのそれぞれは、前記封止体に封止された被封止部と前記封止体から露出する露出部との境界に、溝部を有し、
前記溝部は、前記第1吊りリードの一方の側面から他方の側面まで延び、
前記(f)工程では、前記溝部のうちの前記封止体から露出した部分に切断治具を押し当てることにより、前記第1吊りリードを切断する、半導体装置の製造方法。 - 請求項1において
前記(e)工程では、前記第3部分および前記第4部分が切断される、半導体装置の製造方法。 - 請求項1において、
前記(c)工程では、前記リードフレームをステージに固定した状態で前記ワイヤが接続され、
前記ステージは、前記第2部品搭載部の全体と重なる位置に形成された第2開口部を有し、
前記(c)工程では、前記複数のリードのそれぞれは前記ステージと接触し、かつ、前記第2部品搭載部は前記ステージと接触しない、半導体装置の製造方法。 - 請求項1において、
前記第2部品搭載部は、前記第1部品搭載部と離間して設けられ、かつ、前記ワイヤを介して前記半導体チップと電気的に接続されている、半導体装置の製造方法。 - 請求項11において
前記第2部品搭載部には、前記第2部品搭載部と前記第1部品搭載部との間に位置し、かつ、前記ワイヤの一方の端部が接続されるワイヤボンディング部が接続されている、半導体装置の製造方法。 - 請求項1において、
前記第3部品搭載部には第3吊りリードが接続され、
前記第3吊りリードは、一方の端部が前記第3部品搭載部に接続され、他方の端部が前記第1部品搭載部に接続され、
前記(d)工程では、前記第3吊りリードおよび前記第3部品搭載部の全体が封止される、半導体装置の製造方法。 - 請求項1において、
前記半導体チップは、電極が形成された表面と、前記表面とは反対側に位置し、かつ、電極が形成されていない裏面と、を有し、
前記(b)工程では、前記半導体チップの前記裏面が前記第1部品搭載部と対向するように、前記第1接着材を介して前記第1部品搭載部に搭載され、
前記(c)工程では、前記ワイヤを前記半導体チップの前記表面に形成された前記電極に接続する、半導体装置の製造方法。 - 第1吊りリードが接続された第1部品搭載部と、
複数の導電性粒子を含有する樹脂である第1接着材を介して前記第1部品搭載部に搭載された半導体チップと、
第1方向において前記第1部品搭載部と対向する辺を有し、第2吊りリードが接続された第2部品搭載部と、
前記第1方向と交差する第2方向において、第2部品搭載部の隣に配置されている第3部品搭載部と、
前記第2部品搭載部および前記第3部品搭載部を跨ぐように、前記第2部品搭載部および前記第3部品搭載部に前記第1接着材を介して搭載されている第1電子部品と、
複数のリードと、
前記半導体チップと、前記複数のリードとを電気的に接続するワイヤと、
前記半導体チップ、前記第1電子部品、前記第1部品搭載部、前記第2部品搭載部、前記第3部品搭載部、前記ワイヤ、前記複数のリードのそれぞれの被封止部、前記第1吊りリードの被封止部、および前記第2吊りリードの被封止部を封止する封止体と、
を有し、
前記第2吊りリードのそれぞれは、前記第2吊りリードの延在方向である第1方向において、前記第2部品搭載部から、前記封止体の側面に向かって順に配列されている第1部分および第2部分を有し、
前記第2部分は、前記第1部分と繋がり、かつ、前記第1部分の幅よりも細い第3部分と、前記第1部分と繋がり、かつ、前記第1部分の幅よりも細い第4部分と、前記第3部分と前記第4部分との間に位置する第1開口部と、を有し、
前記第1部分、前記第3部分および前記第4部分のそれぞれは、互いに同じ第1の厚さから成り、
前記第1部分は前記封止体に封止され、かつ、前記第3部分および前記第4部分の端面は、前記封止体の側面から露出している、半導体装置。 - 請求項15において、
前記半導体チップは、電極が形成された前記表面と、前記表面とは反対側に位置し、かつ、前記電極が形成されていない前記裏面と、を有し、
前記半導体チップは、前記半導体チップの前記裏面が前記第1部品搭載部と対向するように、前記第1接着材を介して前記第1部品搭載部に搭載され、
前記ワイヤは、前記半導体チップの前記表面に形成された前記電極に接続されている、半導体装置。
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