JP6640171B2 - 車載電子装置 - Google Patents
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Description
CXPI通信ネットワークを介して他の車載電子装置とデータ通信するための第1クロックを発生するように構成した発生ユニットと、
この第1クロックのデューティ幅を調整するように構成した調整ユニットと
を備えるようにする。
CXPI通信ネットワークを介して他の車載電子装置とデータ通信するための第1クロックを発生するように構成した発生ユニットと、
この第1クロックにスペクトラム拡散を行うように構成した調整ユニットと
を備えるようにする。
内部クロックを遅延させることにより第1クロックを発生させるように構成した遅延ユニットと、
この内部クロックのスルーレートを増大させることにより第2クロックを発生させるように構成した整形ユニットと、
第1クロックの立上りエッジ及び第2クロックの立下りエッジを有する第3クロックを、第1クロック及び第2クロックに基づいて出力するように構成したスイッチと、
CXPI通信ネットワークを介して他の車載電子装置とデータ通信するのに用いる基準クロックが低レベルになった際に第3クロックを低レベルとするように構成したインターフェースと
を備えるようにする。
クロックのサイクルを検出するとともに、このクロックと、このクロックとは別に発生されたデータ信号との間の位相差を検出するように構成した検出ユニットと、
これらサイクル及び位相差に基づいて、このクロックのエッジからシフトしたデータ捕捉タイミングを得るように構成した計算ユニットと、
このデータ捕捉タイミングのタイミングでデータ信号の値を捕捉するとともに、CXPI通信ネットワークを介して他の車載電子装置に送信すべきデータ信号を発生させるように構成した同期ユニットと
を備えるようにする。
マスターノードからCXPI通信ネットワークを介して符号化された基準クロックを受信し、この基準クロックを復号化し、この基準クロックを第1出力クロックとして出力するために第1モードで動作するか、又は基準クロックを復号化せずに第2出力クロックとして出力するために第2モードで動作するように構成した送受信機と、
この送受信機を第1モードから第2モードに移行させる信号をこの送受信機に送信するとともに、この送受信機から第2出力クロックを受信すると、この送受信機を第2モードから第1モードに移行させる信号をこの送受信機に送信することにより、この送受信機から第1出力クロックを得るように構成した制御ユニットと
を備えるようにする。
第1クロックと、この第1クロックの周波数よりも遅い周波数を有する第2クロックとの間の位相差を検出するように構成された検出ユニットと、
この位相差と第1及び第2クロックのサイクルとに基づいて、第2クロックのエッジが第1クロックのサイクルの第1半部に一致した際に第1パターンを、及び第2クロックのエッジが第1クロックのサイクルの第2半部に一致した際に第2パターンを選択するように構成した選択ユニットと、
第1パターンにおいて第1クロックを遅延することなく第2クロックを遅延させ、第2パターンにおいて第2クロックを遅延することなく第1クロックを遅延させるとともに、第1クロックを第1回路に送信してこの第1回路が第1クロックと同期してデータを送信するようにし、第2クロックを第2回路に送信してこの第2回路が第2クロックと同期して前記データを受信するように構成した遅延回路と
を備えるようにする。
入力された信号を増幅し、この信号が電源電位よりも低い第1電位と接地電位よりも高い第2電位との間の振幅を有するようにするとともに、この信号を車載ネットワークに出力するようにする出力バッファと、
入力された、ある振幅を有する信号を整形し、この信号が前記出力バッファから出力される際に第1電位及び第2電位間の振幅を有するように構成した整形ユニットと
を備えるようにする。
図1はCXPI通信中のマスターノード及びスレーブノードの一例を示す線図である。マスターノード10は送受信機102とMCU(マイクロ・コントローラ・ユニット)101とを有している。スレーブノード12も送受信機104とMCU103とを有している。MCU101及び103はそれぞれ、UART(ユニバーサル・アシンクロナス・レシーバ・トランスミッタ;汎用非同期送受信回路)を介してデータ(TXD、RXD)を送受信機102及び104に送信するとともに送受信機102及び104から受信する。マスターノード10の送受信機102及びスレーブノード12の送受信機104はバス14を介してデータの送受信を実行する。CXPI通信では、デューティ比が50%でない方形波信号が基準クロックCLKとして用いられている。送受信機102及び104の各々は、送受信回路、DSP(デジタル信号プロセッサ)、ASIC(アプリケーション・スペシフィックIC;特定用途向けIC)、等のような種々の信号処理を実行する回路を含めることにより構成することができる。
第2実施例は、スペクトラム拡散法を134kHz帯域における調波のレベルを低減させる手段として考慮することにより、CXPI通信システムにおける基準クロック及びスマートキーシステムの電波間の混信を阻止するものである。スペクトラム拡散法によれば、基準クロックの電力が特定の周波数帯域内に集中されるのを阻止し、これにより134kHz帯域における調波のレベルを抑圧することができる。しかし、スペクトラム拡散法を用いる場合、以下のことが関係しうる。
[式1]
RBW<SSMF<TF×SSMR
ここで、
RBW:分解能周波数、
SSMF:変調周波数、
TF:抑圧目標周波数(134kHz)及び
SSMR:変調レート(CXPI通信では1%)
である。この第2実施例は上記の[式1]を満足する変調周波数での基準クロックに関しスペクトラム拡散処理を実行することに関するものである。この実施例は更に、クロック調整ユニット21及び送受信機24の、図2Aに示す構成に対する変形例に関するものである。
CXPI通信システムでは、スレーブノードの送受信機により、発生させる内部クロックのエッジ自体を基準クロックの立下りエッジと同期させて低くする。これにより、スレーブノードはマスターノードの処理論理と同期させて処理を実行する。スレーブノードの内部クロックの立下りが鈍い場合には、すなわちスルーレートが高い場合には、予想外のスパイク雑音が基準クロックに重畳され、通信特性を悪化させる。スルーレートが高くなるにつれ、耐雑音性が悪くなる。第3実施例は、スレーブノード側及びマスターノード側に対する送受信機に関連する上述した問題に対処するものである。
CXPI通信のマスターノードでは、MCUが基準信号と同期させて高レベル又は低レベルのデータ信号を送受信機に送信する。次いで、この送受信機は、MCUから受信した基準クロックに応じてデータ信号のパルス幅を変調する。例えば、図13Aに示すように、送受信機は、クロックCLKの立下りエッジのタイミングにおいて、データ信号TXDが高レベルにある際に値“1”に相当する高デユーティ比のデータ信号TXを発生するか、又はデータ信号TXDが低レベルにある際に値“0”に相当する低デユーティ比のデータ信号TXを発生し、このデータ信号TXをバスに送信する。
TS=EC1+T1/2
TS=TS+T
その結果、ボーレートクロックbCLKのエッジからシフトしたデータ捕捉タイミングを得ることができる。次いで、処理をステップS166に戻す。
TS=EC1+(T1+T)/2
TS=TS+T×3/4
一方、正確なデータTXをボーレートクロックbCLKに応じて出力できない、すなわち期間T1がサイクルTの50%以下である場合には、以下の式を用いうる。
TS=TS+T×5/4
CXPI通信システムでは、マスターノードのECU及びスレーブノードのECUの各々はノーマルモード、スリープモード及びスタンバイモードのようなモードで動作する。ノーマルモードでは、ECUがデータ信号の符号化/復号化及びネットワーク上でのデータ通信を実行する。ECUは、このECUがマスターノードである場合にスリープモードに対する状態に適合するか、又はECUがスレーブノードである場合にマスターモードからスリープフレームを受信した際に、ノーマルモードからスリープモードに移行する。ECUは、スリープモード中に、データ信号の符号化/復号化及びデータ通信を停止し、電力の消費を少なくする。スリープモード中にウェークアップファクタ(wake−upfactor)が生じると、各ECUはスタンバイモードに移行する。スタンバイモードはスリープモードからノーマルモードへの移行モードであり、スタンバイモード中は、ECUはデータ信号を符号化/復号化することなくネットワーク上でのデータ送信/受信を実行する。
動作クロックが回路間で異なる非同期クロックを用いる通信が実行される場合がある。非同期クロックを用いるこのような通信では、セットアップ及びホールドのタイミングでデータが中間電位に保持されるようなメタスタビリティが関連する場合がある。2段のフリップフロップをメタスタビリティに対する対応策として受信回路に設ける場合には、受信側で常に2つのクロックが使用され、これにより遅延を生ぜしめる。回路間の非同期クロックが予め決定した位相差をもはや維持しない場合にデータ転送が一時的に停止される動作の場合には、この一時的な停止による遅延により不都合な状態を生ぜしめるおそれがある。
γ+(β−αx)<β/2
ここで、xはクロックCLKBの1サイクルβ内に含まれるクロックCLKAのサイクルαの数である。一方、以下の式が満足される場合に、選択ユニット208は第2の半部を決定する。
γ+(β−αx)≧β/2
車載LANの場合、調波の放射による他の装置との混信を阻止するために、パルス信号のエッジを波形整形により丸め、正弦波形状に近い方形波を用いる。波形整形の場合、DA(デジタル‐アナログ)コンバータ等を用いる。各ECUでは、成形された信号が出力バッファ内に記憶され、多段非反転増幅器回路等により適切に増幅された後にバスに送信される。
CXPI通信ネットワークを介して他の車載電子装置とデータ通信するための第1クロックを発生する発生ユニットと、
この第1クロックのデューティ幅を調整するように構成した調整ユニットと
を備えている。
前記調整ユニットは第1クロックの周波数よりも高い周波数を有する第2クロックを発生し、第1クロックのデューティ幅をこの第1クロックのサイクルに相当する第2クロックのクロック数の比率で調整するようにする。
前記調整ユニットは、送信すべきデータを符号化する前に第1クロックのデューティ幅を調整するようにする。
前記調整ユニットは、送信すべき符号化データを送信する際に、第1クロックのデューティ幅を調整するようにする。
CXPI通信ネットワークを介して他の車載電子装置とデータ通信するための第1クロックを発生するように構成した発生ユニットと、
この第1クロックにスペクトラム拡散を行うように構成した調整ユニットと
を備えるようにする。
前記調整ユニットにより、予め決定した変調比及び第1クロックの周波数に基づいてスペクトラム拡散の変調周波数を求めるようにする。
変調周波数を200Hzよりも高く、且つ予め決定した目標周波数と予め決定した変調比との積よりも低くするようにする。
内部クロックを遅延させることにより第1クロックを発生させるように構成した遅延ユニットと、
この内部クロックのスルーレートを増大させることにより第2クロックを発生させるように構成した整形ユニットと、
第1クロックの立上りエッジ及び第2クロックの立下りエッジを有する第3クロックを、第1クロック及び第2クロックに基づいて出力するように構成したスイッチと、
CXPI通信ネットワークを介して他の車載電子装置とデータ通信するのに用いる基準クロックが低レベルになった際に第3クロックを低レベルとするように構成したインターフェースと
を備えるようにする。
クロックのサイクルを検出するとともに、このクロックと、このクロックとは別に発生されたデータ信号との間の位相差を検出するように構成した検出ユニットと、
これらサイクル及び位相差に基づいて、このクロックのエッジからシフトしたデータ捕捉タイミングを得るように構成した計算ユニットと、
このデータ捕捉タイミングのタイミングでデータ信号の値を捕捉するとともに、CXPI通信ネットワークを介して他の車載電子装置に送信すべきデータ信号を発生させるように構成した同期ユニットと
を備えるようにする。
前記計算ユニットが、開始ビット後のデータ信号の値を捕捉するデータ捕捉タイミングの、クロックのエッジからのシフト幅を、前記開始ビットの値が前記クロックのエッジのタイミングで捕捉されたか否かに基づいて調整するようにする。
検出処理は、複数の検出値の平均を位相差として採用するようにする。
前記検出ユニットは、サイクルを検出する際に、予め決定した下限よりも短いクロックと予め決定した上限よりも長いクロックとを排除するようにする。
マスターノードからCXPI通信ネットワークを介して符号化された基準クロックを受信し、この基準クロックを復号化し、この基準クロックを第1出力クロックとして出力するために第1モードで動作するか、又は基準クロックを復号化せずに第2出力クロックとして出力するために第2モードで動作するように構成した送受信機と、
この送受信機を第1モードから第2モードに移行させる信号をこの送受信機に送信するとともに、この送受信機から第2出力クロックを受信すると、この送受信機を第2モードから第1モードに移行させる信号をこの送受信機に送信することにより、この送受信機から第1出力クロックを得るように構成した制御ユニットと
を備えるようにする。
前記送受信機には、基準クロックを復号化するように構成した復号化ユニットと、第1モード及び第2モードに応じて第1クロック及び第2クロックの何れかを制御ユニットに選択的に出力するように構成された出力選択ユニットとが設けられているようにする。
前記送受信機は、他の車載電子装置からネットワークを介して受信された符号化されたデータ信号を復号化するように構成された復号化ユニットと、第1モードで動作する際に復号化し又は第2モードで動作する際に復号化しないデータ信号を制御ユニットに出力するように構成した出力制御ユニットとを備えるようにする。
前記送受信機は、制御ユニットから信号を受信した際に、マスターノードが基準クロックを送信し、これによりこの基準クロックを得るようにする信号をマスターノードに送信するようにする。
第1クロックと、この第1クロックの周波数よりも遅い周波数を有する第2クロックとの間の位相差を検出するように構成された検出ユニットと、
この位相差と第1及び第2クロックのサイクルとに基づいて、第2クロックのエッジが第1クロックのサイクルの第1半部に一致した際に第1パターンを、及び第2クロックのエッジが第1クロックのサイクルの第2半部に一致した際に第2パターンを選択するように構成した選択ユニットと、
第1パターンにおいて第1クロックを遅延することなく第2クロックを遅延させ、第2パターンにおいて第2クロックを遅延することなく第1クロックを遅延させるとともに、第1クロックを第1回路に送信してこの第1回路が第1クロックと同期してデータを送信するようにし、第2クロックを第2回路に送信してこの第2回路が第2クロックと同期して前記データを受信するように構成した遅延回路と
を備えるようにする。
前記検出ユニットが第1クロック及び第2クロックのサイクルに基づいて位相差を検出する。
前記検出ユニットが第1クロック及び第2クロックのサイクルに基づいて第1位相差を検出し、次いでこの第1位相差と第1クロック及び第2クロックのサイクルとに基づいて第2位相差を検出するようにする。
入力された信号を増幅し、この信号が電源電位よりも低い第1電位と接地電位よりも高い第2電位との間の振幅を有するようにするとともに、この信号を車載ネットワークに出力するようにする出力バッファと、
入力された、ある振幅を有する信号を整形し、この信号が前記出力バッファから出力される際に第1電位及び第2電位間の振幅を有するように構成した整形ユニットと
を備えるようにする。
前記出力バッファは、車載ネットワークに送信すべき信号を発生させるために、ターンオン/ターンオフさせるトランジスタスイッチを有し、このトランジスタスイッチは、前記整形ユニットから出力される信号が高レベルに達した際にターンオンされるようになっており、車載電子装置は更に、
前記トランジスタスイッチにそのしきい値電圧を供給するように構成した電圧発生器と、
この電圧発生器からこのトランジスタスイッチにそのしきい値電圧を供給するのをターンオン/ターンオフさせるように構成したスイッチと、
前記整形ユニットから前記出力バッファに送信される信号が高レベルに達する前に前記スイッチをターンオンさせるように構成した回路と
を備えているようにする。
Claims (11)
- 第1クロックソースから第1遅延ユニットへの第1の入力を含む送信回路と、
第2クロックソースから第2遅延ユニットへの第2の入力を含む受信回路と、
前記第1遅延ユニットへの第1の制御入力で前記送信回路に結合され、前記第2遅延ユニットへの第2の制御入力で前記受信回路に結合された制御ユニットと、を備え、
前記制御ユニットは、
前記第1クロックソース及び前記第2クロックソースに結合され、前記第1クロックソースと前記第2クロックソースとの間の現在の位相差を検出する位相差検出ユニットと、
前記位相差検出ユニットの出力に基づいてメタスタビリティが発生するサイクルを予測する予測ユニットと、
前記第2クロックソースの立上りエッジが前記第1クロックソースのサイクルの1周期中の第1の半部に生じるか又は前記第2クロックソースの立上りエッジが前記第1クロックソースのサイクルの1周期中の第2の半部に生じるかを決定する選択ユニットと、を備え、
前記選択ユニットは、前記第1遅延ユニットのセレクタを制御する制御信号を前記第1遅延ユニットに送信し、前記第2遅延ユニットのセレクタを制御する制御信号を前記第2遅延ユニットに送信する、クロック同期回路。 - 前記第1遅延ユニットの出力は、前記送信回路の第1フリップフロップのイネーブルに結合され、
前記第2遅延ユニットの出力は、前記受信回路の第2フリップフロップのイネーブルに結合される、請求項1に記載のクロック同期回路。 - 前記位相差検出ユニットは、
前記第1クロックソース及び前記第2クロックソースの間の初期の位相差を検出し、
前記第1クロックソース及び前記第2クロックソースの間の計算した位相差を計算し、
前記計算した位相差と前記初期の位相差との加算によって、前記第1クロックソース及び前記第2クロックソースの間の前記現在の位相差を発生させる、請求項1に記載のクロック同期回路。 - 前記予測ユニットは、
前記第1クロックソース及び前記第2クロックソースの間の前記現在の位相差を受信し、
前記メタスタビリティが発生するサイクルを予測し、
次のサイクルの位相差が、前記第1クロックソースのサイクルよりも大きい場合には、前記次のサイクルの位相差から前記第1クロックソースのサイクルの値を減算する、請求項3に記載のクロック同期回路。 - 前記メタスタビリティが発生するサイクルに基づいて、前記選択ユニットによって前記第2クロックソースが前記第1クロックソースのサイクルの第1の半部に生じるか又は前記第2クロックソースが前記第1クロックソースのサイクルの第2の半部に生じるかを決定する、請求項1に記載のクロック同期回路。
- 前記制御ユニットは、
前記第2クロックソースの立上りエッジが前記第1クロックソースのサイクルの1周期中の第1の半部に生じる場合に、前記第1クロックソースが遅延されず、前記第2クロックソースが遅延されるように、前記第1遅延ユニット及び前記第2遅延ユニットに制御信号を送信する、請求項1に記載のクロック同期回路。 - 前記制御ユニットは、
前記第2クロックソースの立上りエッジが前記第1クロックソースのサイクルの1周期中の第2の半部に生じる場合に、前記第2クロックソースが遅延されず、前記第1クロックソースが遅延されるように、前記第1遅延ユニット及び前記第2遅延ユニットに制御信号を送信する、請求項1に記載のクロック同期回路。 - 第1クロックソース及び第2クロックソースを同期させる方法であって、
位相差検出ユニットによって、前記第1クロックソース及び前記第2クロックソースの間の位相差を得ること、
次のサイクルの位相差が前記第1クロックソースのサイクルよりも大きい場合には、前記次のサイクルの位相差から前記第1クロックソースのサイクルの値を減算すること、
前記第2クロックソースの立上りエッジが前記第1クロックソースのサイクルの第1の半部内に生じるかを決定すること、を含む方法。 - 前記第2クロックソースの立上りエッジが前記第1クロックソースのサイクルの1周期中の第2の半部内に生じた場合に、前記第2クロックソースが遅延されず、前記第1クロックソースが遅延されるように、前記第1遅延ユニット及び前記第2遅延ユニットを制御すること、を含む、請求項8に記載の方法。
- 前記第2クロックソースの立上りエッジが前記第1クロックソースのサイクルの1周期中の第1の半部内に生じた場合に、前記第1クロックソースが遅延されず、前記第2クロックソースが遅延されるように、前記第1遅延ユニット及び前記第2遅延ユニットを制御すること、を含む、請求項8に記載の方法。
- 予測ユニットによってメタスタビリティが発生するサイクルを予測すること、を含み、
前記第1クロックソース及び前記第2クロックソースの間の初期の位相差を検出すること、
前記第2クロックソースのサイクルと前記第1クロックソースのサイクルとの比率である計算した位相差を計算すること、
前記計算した位相差と前記初期の位相差との加算によって、前記第1クロックソース及び前記第2クロックソースの間の現在の位相差を発生させること、を含む、請求項8に記載の方法。
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DE102018200931A1 (de) * | 2018-01-22 | 2019-07-25 | Robert Bosch Gmbh | Verfahren zum Aktivieren einer Recheneinheit mittels einer Schaltungsanordnung in Reaktion auf ein Aktivierungssignal |
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DE102018220398A1 (de) * | 2018-11-28 | 2020-05-28 | Robert Bosch Gmbh | Verfahren zum Abschalten einer Kommunikation und korrespondierende Kommunikationsanordnung |
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DE102020128430A1 (de) * | 2019-11-28 | 2021-06-02 | Infineon Technologies Ag | Feldbussystem mit umschaltbarer slew-rate |
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CN111404658B (zh) * | 2020-03-26 | 2021-07-16 | 上海交通大学 | 亚稳态校正方法 |
DE102020205278A1 (de) * | 2020-04-27 | 2021-10-28 | Robert Bosch Gesellschaft mit beschränkter Haftung | Kommunikationssteuereinrichtung und Sende-/Empfangseinrichtung für eine Teilnehmerstation eines seriellen Bussystems und Verfahren zur Kommunikation in einem seriellen Bussystem |
CN114356833A (zh) * | 2021-12-21 | 2022-04-15 | 上海交通大学 | 一种跨时钟域数据传输中亚稳态风险规避方法和电路 |
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Family Cites Families (44)
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---|---|---|---|---|
US5133064A (en) * | 1987-04-27 | 1992-07-21 | Hitachi, Ltd. | Data processing system generating clock signal from an input clock, phase locked to the input clock and used for clocking logic devices |
US5132990A (en) | 1990-11-05 | 1992-07-21 | Ncr Corporation | High speed data synchronizer |
JPH05130094A (ja) * | 1991-11-06 | 1993-05-25 | Fujitsu Ltd | クロツク乗換回路 |
JPH06112782A (ja) * | 1992-09-30 | 1994-04-22 | Nec Ic Microcomput Syst Ltd | 半導体集積回路 |
US7924783B1 (en) | 1994-05-06 | 2011-04-12 | Broadcom Corporation | Hierarchical communications system |
JP2666708B2 (ja) * | 1993-12-24 | 1997-10-22 | 日本電気株式会社 | データ転送装置 |
US5602878A (en) | 1994-09-23 | 1997-02-11 | Intel Corporation | Method of delivering stable data across an asynchronous interface |
JPH08330932A (ja) * | 1995-05-29 | 1996-12-13 | Fujitsu Ltd | 同期回路制御装置 |
JPH0964855A (ja) * | 1995-08-22 | 1997-03-07 | Fujitsu Ltd | 遅延挿脱回路及び該回路を備えるデータ通信装置 |
AU9798698A (en) | 1997-10-10 | 1999-05-03 | Rambus Incorporated | Method and apparatus for fail-safe resynchronization with minimum latency |
JP3490368B2 (ja) * | 2000-02-07 | 2004-01-26 | インターナショナル・ビジネス・マシーンズ・コーポレーション | 信号出力装置、ドライバ回路、信号伝送システム、および信号伝送方法 |
US8155256B2 (en) | 2000-10-23 | 2012-04-10 | Texas Instruments Incorporated | Method and apparatus for asynchronous clock retiming |
JP2002156422A (ja) * | 2000-11-17 | 2002-05-31 | Advantest Corp | 半導体試験装置 |
JP2002300009A (ja) * | 2001-04-02 | 2002-10-11 | Hitachi Ltd | D型フリップフロップ回路装置 |
KR20040002383A (ko) | 2001-04-27 | 2004-01-07 | 미쯔비시 지도샤 고교 가부시끼가이샤 | 차량용 다중통신 장치 |
KR100557550B1 (ko) * | 2001-12-21 | 2006-03-03 | 주식회사 하이닉스반도체 | 클럭 동기 회로 |
US6794912B2 (en) * | 2002-02-18 | 2004-09-21 | Matsushita Electric Industrial Co., Ltd. | Multi-phase clock transmission circuit and method |
JP4122204B2 (ja) * | 2002-09-27 | 2008-07-23 | 松下電器産業株式会社 | 同期回路 |
US20040218705A1 (en) | 2003-01-30 | 2004-11-04 | International Business Machines Corporation | Phase rotator, phase rotation method and clock and data recovery receiver incorporating said phase rotator |
DE602004008621T2 (de) * | 2003-05-27 | 2008-06-05 | Nxp B.V. | Betreiben langer busse auf einem chip |
JP2005109955A (ja) | 2003-09-30 | 2005-04-21 | Matsushita Electric Ind Co Ltd | 非同期通信回路 |
DE602004012966T2 (de) | 2004-05-03 | 2009-05-07 | Freescale Semiconductor Inc. (n.d.Ges.d. Staates Delaware), Austin | Verfahren und Vorrichtung zur Knotenaufwachung in einem seriellen Datenbus |
JP4252561B2 (ja) * | 2005-06-23 | 2009-04-08 | 富士通マイクロエレクトロニクス株式会社 | クロック発生回路及びクロック発生方法 |
CN101479974A (zh) | 2006-06-30 | 2009-07-08 | Nxp股份有限公司 | 提供不间断数据流的异步数据fifo |
US7928781B2 (en) * | 2006-12-04 | 2011-04-19 | Micron Technology, Inc. | Fast measurement initialization for memory |
JP2008160500A (ja) * | 2006-12-25 | 2008-07-10 | Sony Corp | データ転送装置及びデータ転送方法 |
US7701272B2 (en) * | 2007-05-31 | 2010-04-20 | Micron Technology, Inc. | Method and apparatus for output data synchronization with system clock |
JP2009195602A (ja) * | 2008-02-25 | 2009-09-03 | Fujinon Corp | 電子通信システム及び内視鏡システム |
JP2010098351A (ja) * | 2008-10-14 | 2010-04-30 | Toshiba Corp | 半導体集積回路 |
KR101022674B1 (ko) * | 2008-12-05 | 2011-03-22 | 주식회사 하이닉스반도체 | 지연고정루프회로 및 그 동작방법 |
JP2011055112A (ja) | 2009-08-31 | 2011-03-17 | Denso Corp | 通信システムおよび通信装置 |
JP2011235770A (ja) | 2010-05-11 | 2011-11-24 | Autonetworks Technologies Ltd | 車載用制御装置 |
CN102075167B (zh) * | 2010-11-22 | 2014-03-12 | 西安电子科技大学 | 时钟调整电路和时钟电路的调整方法 |
US20120327942A1 (en) * | 2011-06-27 | 2012-12-27 | Denso Corporation | Communication network system |
JP5800752B2 (ja) * | 2012-04-25 | 2015-10-28 | 三菱電機株式会社 | 信号源同期回路 |
US9288777B2 (en) * | 2012-05-11 | 2016-03-15 | Apple Inc. | Methods and apparatus for synchronizing clock signals in a wireless system |
US9112721B2 (en) | 2012-05-28 | 2015-08-18 | Freescale Semiconductor, Inc. | System and methods for enabling a controller area network (CAN) device to operate in different power modes based upon the payload of a wake-up message |
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KR20140069978A (ko) * | 2012-11-30 | 2014-06-10 | 에스케이하이닉스 주식회사 | 반도체 장치 및 이의 듀티비 보정 방법 |
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