JP6512053B2 - 音楽再生装置 - Google Patents

Description

本発明は、音声信号を出力する音楽再生装置に関する。

ヘッドホンに音声信号を出力する音楽再生装置において、ヘッドホン出力には、アンバランス、バランスと呼ばれる方式がある（例えば、特許文献１参照。）。アンバランス方式では、「正相信号」、「グラウンド」で音声信号を伝送する。一方、バランス方式では、「正相信号」、「逆相信号」で信号を伝送する。外来ノイズが発生した場合、「正相信号」、「逆相信号」双方に同じ位相のノイズが乗ることになり、外来ノイズは打ち消しあう。このため、バランス方式は、ノイズに強い。

図６は、出願人による特願２０１５−１７１９４５に記載の音楽再生装置（デジタルオーディオプレーヤー）が備えるＤＡＣ（Ｄ／Ａコンバーター）、増幅回路、及びこれらの周辺回路を示す図である。ポジティブ側（非反転信号用）のＤＡＣ７には、Ｉ２Ｓ形式のＬＲ（左右）２チャンネルのデジタルオーディオデータ（デジタル音声信号）が入力される。ＤＡＣ７は、ＬＲ２チャンネルのデジタルオーディオデータを、ＬＲ２チャンネルのアナログオーディオデータ（アナログ音声信号）に変換する。ポジティブ側（非反転信号用）の増幅回路９は、ＤＡＣ７がＤ／Ａ変換したＬＲ２チャンネルのアナログオーディオデータを増幅する。増幅回路９は、２つの増幅器１８、１９を含む。増幅器１８は、Ｌチャンネルのアナログオーディオデータを増幅する。増幅器１９は、Ｒチャンネルのアナログオーディオデータを増幅する。増幅回路９が増幅したアナログオーディオデータは、バランス出力端子１６、アンバランス出力端子１７に出力される。

ネガティブ側（反転信号用）のＤＡＣ８には、Ｉ２Ｓ形式のＬＲ２チャンネルのデジタルオーディオデータが入力される。ＤＡＣ８は、ＬＲ２チャンネルのデジタルオーディオデータを、ＬＲ２チャンネルのアナログオーディオデータにＤ／Ａ変換する。ネガティブ側（反転信号用）の増幅回路１０には、ＤＡＣ８がＤ／Ａ変換したＬＲ２チャンネルのアナログオーディオデータを反転したＬＲ２チャンネルの反転アナログオーディオデータが入力される。増幅回路１０は、ＬＲ２チャンネルの反転アナログオーディオデータを増幅する。増幅回路１０は、２つの増幅器２０、２１を含む。増幅器２０は、Ｌチャンネルの反転アナログオーディオデータを増幅する。増幅器２１は、Ｒチャンネルの反転アナログオーディオデータを増幅する。増幅回路１０が増幅した反転アナログオーディオデータは、バランス出力端子１６に出力される。

バランス出力の場合、ＣＰＵは、リニアレギュレーター１４からの電源電圧をＤＡＣ７と増幅回路９とに供給する。また、ＣＰＵは、リニアレギュレーター１５からの電源電圧をＤＡＣ８と増幅回路１０とに供給する。アンバランス出力の場合、ＣＰＵは、リニアレギュレーター１４からの電源電圧をＤＡＣ７と増幅回路９とに供給する。一方、ＣＰＵは、リニアレギュレーター１５をシャットダウンする。このため、リニアレギュレーター１５と、ＤＡＣ８と、増幅回路１０とは、シャットダウンする。これにより、アンバランス出力の場合、動作していない回路をシャットダウンして、高効率を実現することができる。

特開２０１３−００５２９１号公報

アンバランス出力の場合、バランス出力端子１６のネガティブ端子にアナログオーディオデータを出力する増幅回路１０の電源は、オフされている。しかし、ネガティブ端子がオープン状態等の不安定になることにより、バランス出力端子１６から異音が発生するという問題がある。これを解決する従来手法としては、ミュート回路等によりネガティブ端子をグラウンドに接続することで、上記の問題を解決することができる。しかし、そのためには、マイクロコンピューター等から、従来のミュート端子とは別の制御信号が必要となってしまう。

本発明の目的は、簡易な構成で、バランス出力端子から異音が発生することを防止することである。

第１の発明の音楽再生装置は、バランス出力とアンバランス出力とを有する音楽再生装置であって、左右２チャンネルのデジタル音声信号を左右２チャンネルのアナログ音声信号にＤ／Ａ変換する第１Ｄ／Ａコンバーターと、前記第１Ｄ／ＡコンバーターがＤ／Ａ変換した左右２チャンネルのアナログ音声信号を増幅する第１増幅回路と、左右２チャンネルのデジタル音声信号を左右２チャンネルのアナログ音声信号にＤ／Ａ変換する第２Ｄ／Ａコンバーターと、前記第２Ｄ／ＡコンバーターがＤ／Ａ変換した左右２チャンネルのアナログ音声信号を反転した左右２チャンネルの反転アナログ音声信号を増幅する第２増幅回路と、前記第２増幅回路とバランス出力端子との間でグラウンドに接続されるスイッチと、前記第１Ｄ／Ａコンバーターと前記第１増幅回路とに電源電圧を供給する第１電源回路と、前記第２Ｄ／Ａコンバーターと前記第２増幅回路とに電源電圧を供給する第２電源回路と、アンバランス出力の場合、前記第２電源回路をシャットダウンする制御部と、前記第２電源回路のシャットダウンを検出した場合に、前記スイッチをオンの状態とする検出回路と、を備えることを特徴とする。

本発明では、検出回路は、第２電源回路のシャットダウンを検出した場合に、スイッチをオンの状態とする。このため、シャットダウンされた第２増幅回路の出力がグラウンドに接続される。これにより、アンバランス出力の場合に、バランス出力端子から異音が発生することが防止される。また、第２電源回路がシャットダウンされることを利用することで、マイクロコンピューターからの制御信号を用いずに制御が可能となり、マイクロコンピューターからの別系統制御信号は必要とならない。このように、本発明によれば、簡易な構成で、バランス出力端子から異音が発生することが防止される。

第２の発明の音楽再生装置は、第１の発明の音楽再生装置において、前記検出回路は、ベースが、前記第２電源回路の正側電源に接続され、エミッタが、正電源に接続され、コレクタが、前記スイッチに接続された、ｐｎｐ型の第１バイポーラトランジスタであることを特徴とする。

第３の発明の音楽再生装置は、第２の発明の音楽再生装置において、前記スイッチは、ベースが、前記第１バイポーラトランジスタのコレクタに接続され、エミッタが、前記グラウンドに接続され、コレクタが、前記第２増幅回路と前記バランス出力端子との間に接続された、ｎｐｎ型の第２バイポーラトランジスタであることを特徴とする。

第４の発明の音楽再生装置は、第２の発明の音楽再生装置において、前記スイッチは、ベースが、前記第１バイポーラトランジスタのコレクタに接続され、コレクタが、前記グラウンドに接続され、エミッタが、前記第２増幅回路と前記バランス出力端子との間に接続された、ｎｐｎ型の第２バイポーラトランジスタであることを特徴とする。

第３及び第４の発明では、第２電源回路がシャットダウンされ、正側電源の電源電圧が降下すると、ｐｎｐ型の第１バイポーラトランジスタのベース電圧が降下する。ｐｎｐ型の第１バイポーラトランジスタは、ベース電圧が降下すると、オンの状態となる。また、第１バイポーラトランジスタがオンの状態となると、ｎｐｎ型の第２バイポーラトランジスタのベース電圧が上昇する。ｎｐｎ型の第２バイポーラトランジスタは、ベース電圧が上昇すると、オンの状態となる。このため、シャットダウンされた第２増幅回路の出力がグラウンドに接続される。第３及び第４の発明によれば、検出回路及びスイッチを、バイポーラトランジスタを用いた簡易な構成とすることができる。

第５の発明の音楽再生装置は、第１の発明の音楽再生装置において、前記検出回路は、ゲートが、前記第２電源回路の正側電源に接続され、ソースが、正電源に接続され、ドレインが、前記スイッチに接続された、Ｐチャネル型のＭＯＳＦＥＴであることを特徴とする。

第６の発明の音楽再生装置は、第５の発明の音楽再生装置において、前記スイッチは、ベースが、前記ＭＯＳＦＥＴのドレインに接続され、エミッタが、前記グラウンドに接続され、コレクタが、前記第２増幅回路と前記バランス出力端子との間に接続された、ｎｐｎ型の第２バイポーラトランジスタであることを特徴とする。

第７の発明の音楽再生装置は、第５の発明の音楽再生装置において、前記スイッチは、ベースが、前記ＭＯＳＦＥＴのドレインに接続され、コレクタが、前記グラウンドに接続され、エミッタが、前記第２増幅回路と前記バランス出力端子との間に接続された、ｎｐｎ型の第２バイポーラトランジスタであることを特徴とする。

第６及び第７の発明では、第２電源回路がシャットダウンされ、正側電源の電源電圧が降下すると、Ｐチャネル型のＭＯＳＦＥＴのゲート電圧が降下する。Ｐチャネル型のＭＯＳＦＥＴは、ゲート電圧が降下すると、オンの状態となる。また、ＭＯＳＦＥＴがオンの状態となると、ｎｐｎ型の第２バイポーラトランジスタのベース電圧が上昇する。ｎｐｎ型の第２バイポーラトランジスタは、ベース電圧が上昇すると、オンの状態となる。このため、シャットダウンされた第２増幅回路の出力がグラウンドに接続される。第７及び第８の発明によれば、検出回路及びスイッチを、ＭＯＳＦＥＴ、バイポーラトランジスタを用いた簡易な構成とすることができる。

本発明によれば、簡易な構成で、バランス出力端子から異音が発生することが防止される。

本発明の実施形態に係るデジタルオーディオプレーヤーの構成を示すブロック図である。 ＤＡＣ、増幅回路、及びこれらの周辺回路を示す図である（第１実施形態）。 ＤＡＣ、増幅回路、及びこれらの周辺回路を示す図である（第２実施形態）。 ＤＡＣ、増幅回路、及びこれらの周辺回路を示す図である（第３実施形態）。 ＤＡＣ、増幅回路、及びこれらの周辺回路を示す図である（第４実施形態）。 従来のデジタルオーディオプレーヤーが備えるＤＡＣ、増幅回路、及びこれらの周辺回路を示す図である。

以下、本発明の実施形態について説明する。図１は、本発明の実施形態に係るデジタルオーディオプレーヤー（以下、「ＤＡＰ」という。）の構成を示すブロック図である。ＤＡＰ１（音楽再生装置）は、ヘッドホン１０１、１０２にアナログオーディオデータ（アナログ音声信号）を出力する。ヘッドホン１０１、１０２は、アナログオーディオデータに基づいて、音声を外部に出力する。ヘッドホン１０１は、バランス用のヘッドホンであり、バランス出力端子に接続される。ヘッドホン１０２は、アンバランス用のヘッドホンであり、アンバランス出力端子に接続される。ＤＡＰ１は、バランス出力とアンバランス出力とを有する。

図１に示すように、ＤＡＰ１は、ＣＰＵ２、記憶部３、表示部４、操作部５、ＤＳＰ６、Ｄ／Ａコンバーター（以下、「ＤＡＣ」という。）７、８、増幅回路９、１０、無線モジュール１１、ＵＳＢインターフェース（以下、「ＵＳＢ Ｉ／Ｆ」という。）１２を備える。

ＣＰＵ（Central Processing Unit）２（制御部）は、制御プログラム、ＯＳプログラム、アプリケーションプログラムに従って、ＤＡＰ１を構成する各部を制御する。記憶部３は、ＣＰＵ２の主メモリとして機能するＲＡＭ（Random Access Memory）、制御プログラムを記憶するＲＯＭ（Read Only Memory）、ＯＳプログラム、アプリケーションプログラム等のプログラム、デジタルオーディオデータ等の各種データを記憶するフラッシュメモリから構成されている。なお、記憶部３は、例示する構成に限られず、ＨＤＤ（Hard Disk Drive）等を含んでいてもよい。

表示部４は、種々の画像（静止画像、動画像を含む）を表示するものであり、液晶パネルにより構成されている。操作部５は、各種設定を行うための操作キー、及び、表示部４と連動したタッチパネルを備えている。ユーザーは、操作部５を介して、各種の文字入力、設定などを行うことが可能である。

ＤＳＰ（Digital Signal Processor）６は、デジタルオーディオデータに、イコライザー処理等の信号処理を行う。ＤＡＣ７、８は、デジタルオーディオデータをアナログオーディオデータにＤ／Ａ変換する。増幅回路９、１０は、ＤＡＣ７、８がＤ／Ａ変換したアナログオーディオデータを増幅し、ヘッドホン１０１又はヘッドホン１０２に出力する。ＤＡＣ７、８、増幅回路９、１０の詳細については、後述する。無線モジュール１１は、Ｂｌｕｅｔｏｏｔｈ（登録商標）規格、Ｗｉ−Ｆｉ規格に従った無線通信を行うためのものである。ＵＳＢ Ｉ／Ｆ１２は、ＵＳＢ規格に従った通信を行うためのものである。

（第１実施形態）
図２は、ＤＡＣ７、８、増幅回路９、１０及びこれらの周辺回路を示す図である。図２に示すように、ＤＡＰ１は、さらに、ＤＣ／ＤＣコンバーター１３、リニアレギュレーター１４、１５、バイポーラトランジスタＱ１〜Ｑ５を備える。ＤＣ／ＤＣコンバーター１３は、バッテリーから供給される電圧を昇圧し、昇圧した電圧をリニアレギュレーター１４、１５に供給する。リニアレギュレーター１４（第１電源回路）は、ＤＡＣ７（第１Ｄ／Ａコンバーター）と増幅回路９（第１増幅回路）とに電源電圧を供給する。リニアレギュレーター１５（第２電源回路）は、ＤＡＣ８（第２Ｄ／Ａコンバーター）と増幅回路１０（第２増幅回路）とに電源電圧を供給する。なお、リニアレギュレーター１４、１５は、ＤＣ／ＤＣコンバーター１３からの電圧を降圧して、各回路に供給する。

ポジティブ側（非反転信号用）のＤＡＣ７には、Ｉ２Ｓ形式のＬＲ（左右）２チャンネルのデジタルオーディオデータ（デジタル音声信号）が入力される。ＤＡＣ７は、ＬＲ２チャンネルのデジタルオーディオデータを、ＬＲ２チャンネルのアナログオーディオデータ（アナログ音声信号）に変換する。ポジティブ側（非反転信号用）の増幅回路９は、ＤＡＣ７がＤ／Ａ変換したＬＲ２チャンネルのアナログオーディオデータを増幅する。増幅回路９は、２つの増幅器１８、１９を含む。増幅器１８は、Ｌチャンネルのアナログオーディオデータを増幅する。増幅器１９は、Ｒチャンネルのアナログオーディオデータを増幅する。増幅回路９が増幅したアナログオーディオデータは、バランス出力端子１６、アンバランス出力端子１７に出力される。

ネガティブ側（反転信号用）のＤＡＣ８には、Ｉ２Ｓ形式のＬＲ２チャンネルのデジタルオーディオデータが入力される。ＤＡＣ８は、ＬＲ２チャンネルのデジタルオーディオデータを、ＬＲ２チャンネルのアナログオーディオデータにＤ／Ａ変換する。ネガティブ側（反転信号用）の増幅回路１０には、ＤＡＣ８がＤ／Ａ変換したＬＲ２チャンネルのアナログオーディオデータを反転したＬＲ２チャンネルの反転アナログオーディオデータが入力される。増幅回路１０は、ＬＲ２チャンネルの反転アナログオーディオデータを増幅する。増幅回路１０は、２つの増幅器２０、２１を含む。増幅器２０は、Ｌチャンネルの反転アナログオーディオデータを増幅する。増幅器２１は、Ｒチャンネルの反転アナログオーディオデータを増幅する。増幅回路１０が増幅した反転アナログオーディオデータは、バランス出力端子１６に出力される。

バイポーラトランジスタＱ１（検出回路、第１バイポーラトランジスタ）は、リニアレギュレーター１５のシャットダウンを検出した場合に、バイポーラトランジスタＱ４、Ｑ５をオンの状態とする。バイポーラトランジスタＱ１は、ｐｎｐ型、すなわち、ベースの電圧が、エミッタの電圧に対して、ローレベルの電位となることでオンの状態となるバイポーラトランジスタである。バイポーラトランジスタＱ１は、ベースが、リニアレギュレーター１５の正側電源（＋３．３Ｖ）に接続されている。また、バイポーラトランジスタＱ１は、エミッタが、正電源（＋１．８Ｖ）に接続されている。また、バイポーラトランジスタＱ１は、コレクタが、バイポーラトランジスタＱ４、Ｑ５のベースに接続されている。

バイポーラトランジスタＱ２〜Ｑ５は、ミュートトランジスタである。バイポーラトランジスタＱ２、Ｑ３は、増幅回路９とバランス出力端子１６のポジティブ端子との間でグラウンドに接続されている。また、バイポーラトランジスタＱ２、Ｑ３は、増幅回路９とアンバランス出力端子１７との間でグラウンドに接続されている。バイポーラトランジスタＱ２、Ｑ３は、ｎｐｎ型、すなわち、ベースの電圧が、エミッタの電圧に対して、ハイレベルの電位でオンの状態となるバイポーラトランジスタである。

バイポーラトランジスタＱ２、Ｑ３は、ベースが、ミュート端子に接続されている。また、バイポーラトランジスタＱ２、Ｑ３は、コレクタが、増幅回路９とバランス出力端子１６のポジティブ端子との間、また、増幅回路９とアンバランス出力端子１７との間に接続されている。また、バイポーラトランジスタＱ２、Ｑ３は、エミッタが、グラウンドに接続されている。

バイポーラトランジスタＱ４、Ｑ５（スイッチ、第２バイポーラトランジスタ）は、増幅回路１０とバランス出力端子１６のネガティブ端子との間でグラウンドに接続されている。バイポーラトランジスタＱ４、Ｑ５は、ベースが、ミュート端子に接続されている。また、バイポーラトランジスタＱ４、Ｑ５は、ベースが、バイポーラトランジスタＱ１のコレクタにも接続されている。また、バイポーラトランジスタＱ４、Ｑ５は、コレクタが、増幅回路１０とバランス出力端子１６のネガティブ端子との間に接続されている。また、バイポーラトランジスタＱ４、Ｑ５は、エミッタが、グラウンドに接続されている。

通常のミュート処理では、マイクロコンピューター（不図示）は、ミュート端子をハイレベルとする。このため、バイポーラトランジスタＱ２〜Ｑ５は、ベースの電圧が、ハイレベルとなり、オンの状態となる。バイポーラトランジスタＱ２〜Ｑ５がオンの状態となることで、増幅回路９、１０の出力がグラウンドに接続され、ミュート状態となる。

ここで、バランス出力の場合、ＣＰＵ２は、リニアレギュレーター１４からの電源電圧をＤＡＣ７と増幅回路９とに供給する。また、ＣＰＵ２は、リニアレギュレーター１５からの電源電圧をＤＡＣ８と増幅回路１０とに供給する。アンバランス出力の場合、ＣＰＵ２は、リニアレギュレーター１４からの電源電圧をＤＡＣ７と増幅回路９とに供給する。一方、ＣＰＵ２は、リニアレギュレーター１５をシャットダウンする。このため、リニアレギュレーター１５と、ＤＡＣ８と、増幅回路１０とは、シャットダウンする。

リニアレギュレーター１５がシャットダウンされ、正側電源（＋３．３Ｖ）の電源電圧が降下すると、ｐｎｐ型のバイポーラトランジスタＱ１のベース電圧が降下する。ｐｎｐ型のバイポーラトランジスタＱ１は、ベース電圧が降下すると、オンの状態となる。また、バイポーラトランジスタＱ１がオンの状態となると、ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５のベース電圧が上昇する。ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５は、ベース電圧が上昇すると、オンの状態となる。このようにして、バイポーラトランジスタＱ１は、リニアレギュレーター１４のシャットダウンを検出し、バイポーラトランジスタＱ４、Ｑ５をオンの状態とする。バイポーラトランジスタＱ４、Ｑ５がオンの状態となると、シャットダウンされた増幅回路１０の出力がグラウンドに接続される。

（第２実施形態）
図３は、ＤＡＣ７、８、増幅回路９、１０及びこれらの周辺回路を示す図である。第１実施形態と比較して、バイポーラトランジスタＱ２、Ｑ３、バイポーラトランジスタＱ４、Ｑ５（スイッチ、第２バイポーラトランジスタ）の接続が異なる。バイポーラトランジスタＱ２、Ｑ３は、ベースが、ミュート端子に接続されている。また、バイポーラトランジスタＱ２、Ｑ３は、エミッタが、増幅回路９とバランス出力端子１６のポジティブ端子との間、また、増幅回路９とアンバランス出力端子１７との間に接続されている。また、バイポーラトランジスタＱ２、Ｑ３は、コレクタが、グラウンドに接続されている。

バイポーラトランジスタＱ４、Ｑ５は、ベースが、ミュート端子に接続されている。また、バイポーラトランジスタＱ４、Ｑ５は、ベースが、バイポーラトランジスタＱ１のコレクタにも接続されている。また、バイポーラトランジスタＱ４、Ｑ５は、エミッタが、増幅回路１０とバランス出力端子１６のネガティブ端子との間に接続されている。また、バイポーラトランジスタＱ４、Ｑ５は、コレクタが、グラウンドに接続されている。

リニアレギュレーター１５がシャットダウンされ、正側電源（＋３．３Ｖ）の電源電圧が降下すると、ｐｎｐ型のバイポーラトランジスタＱ１のベース電圧が降下する。ｐｎｐ型のバイポーラトランジスタＱ１は、ベース電圧が降下すると、オンの状態となる。また、バイポーラトランジスタＱ１がオンの状態となると、ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５のベース電圧が上昇する。ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５は、ベース電圧が上昇すると、オンの状態となる。このようにして、バイポーラトランジスタＱ１は、リニアレギュレーター１５のシャットダウンを検出し、バイポーラトランジスタＱ４、Ｑ５をオンの状態とする。バイポーラトランジスタＱ４、Ｑ５がオンの状態となると、シャットダウンされた増幅回路１０の出力がグラウンドに接続される。

以上説明したように、第１及び第２実施形態では、バイポーラトランジスタＱ１は、リニアレギュレーター１５のシャットダウンを検出した場合に、バイポーラトランジスタＱ４、Ｑ５をオンの状態とする。このため、シャットダウンされた増幅回路１０の出力がグラウンドに接続される。これにより、アンバランス出力の場合に、バランス出力端子１６から異音が発生することが防止される。また、リニアレギュレーター１５がシャットダウンされることを利用することで、マイクロコンピューターからの制御信号を用いずに制御が可能となり、マイクロコンピューターからの別系統制御信号が必要とならない。このように、第１及び第２実施形態によれば、簡易な構成で、バランス出力端子１６から異音が発生することが防止される。

また、第１及び第２実施形態では、リニアレギュレーター１５がシャットダウンされ、正側電源（＋３．３Ｖ）の電源電圧が降下すると、ｐｎｐ型のバイポーラトランジスタＱ１のベース電圧が降下する。ｐｎｐ型のバイポーラトランジスタＱ１は、ベース電圧が降下すると、オンの状態となる。また、バイポーラトランジスタＱ１がオンの状態となると、ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５のベース電圧が上昇する。ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５は、ベース電圧が上昇すると、オンの状態となる。このため、シャットダウンされた増幅回路１０の出力がグラウンドに接続される。第１及び第２実施形態によれば、バイポーラトランジスタＱ１、Ｑ４、Ｑ５を用いた簡易な構成で、バランス出力端子１６から異音が発生することが防止される。

（第３実施形態）
図４は、ＤＡＣ７、８、増幅回路９、１０及びこれらの周辺回路を示す図である。第１実施形態と比較して、パイポーラトランジスタＱ１に替えて、ＭＯＳトランジスタＭ１（検出回路、ＭＯＳＦＥＴ）が用いられている構成が異なる。ＭＯＳトランジスタＭ１は、リニアレギュレーター１５のシャットダウンを検出した場合に、バイポーラトランジスタＱ４、Ｑ５をオンの状態とする。ＭＯＳトランジスタＭ１は、Ｐチャネル型、すなわち、ゲートの電圧が、ローレベルの電位となることでオンの状態となるＭＯＳトランジスタである。ＭＯＳトランジスタＭ１は、ゲートが、リニアレギュレーター１５の正側電源（＋３．３Ｖ）に接続されている。また、ＭＯＳトランジスタＭ１は、ソースが、正電源（＋１．８Ｖ）に接続されている。また、ＭＯＳトランジスタＭ１は、ドレインが、バイポーラトランジスタＱ４、Ｑ５のベースに接続されている。

（第４実施形態）
図５は、ＤＡＣ７、８、増幅回路９、１０及びこれらの周辺回路を示す図である。第３実施形態と比較して、バイポーラトランジスタＱ２、Ｑ３、バイポーラトランジスタＱ４、Ｑ５（スイッチ、第２バイポーラトランジスタ）の接続が異なる。バイポーラトランジスタＱ２、Ｑ３は、ベースが、ミュート端子に接続されている。また、バイポーラトランジスタＱ２、Ｑ３は、エミッタが、増幅回路９とバランス出力端子１６のポジティブ端子との間、また、増幅回路９とアンバランス出力端子１７との間に接続されている。また、バイポーラトランジスタＱ２、Ｑ３は、コレクタが、グラウンドに接続されている。

バイポーラトランジスタＱ４、Ｑ５は、ベースが、ミュート端子に接続されている。また、バイポーラトランジスタＱ４、Ｑ５は、ベースが、ＭＯＳトランジスタＭ１のドレインにも接続されている。また、バイポーラトランジスタＱ４、Ｑ５は、エミッタが、増幅回路１０とバランス出力端子１６のネガティブ端子との間に接続されている。また、バイポーラトランジスタＱ４、Ｑ５は、コレクタが、グラウンドに接続されている。

リニアレギュレーター１５がシャットダウンされ、正側電源（＋３．３Ｖ）の電源電圧が降下すると、Ｐチャネル型のＭＯＳトランジスタＭ１のゲート電圧が降下する。Ｐチャネル型のＭＯＳトランジスタＭ１は、ゲート電圧が降下すると、オンの状態となる。また、ＭＯＳトランジスタＭ１がオンの状態となると、ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５のベース電圧が上昇する。ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５は、ベース電圧が上昇すると、オンの状態となる。このようにして、ＭＯＳトランジスタＭ１は、リニアレギュレーター１５のシャットダウンを検出し、バイポーラトランジスタＱ４、Ｑ５をオンの状態とする。バイポーラトランジスタＱ４、Ｑ５がオンの状態となると、シャットダウンされた増幅回路１０の出力がグラウンドに接続される。

以上説明したように、第３及び第４実施形態では、ＭＯＳトランジスタＭ１は、リニアレギュレーター１５のシャットダウンを検出した場合に、バイポーラトランジスタＱ４、Ｑ５をオンの状態とする。このため、シャットダウンされた増幅回路１０の出力がグラウンドに接続される。これにより、アンバランス出力の場合に、バランス出力端子１６から異音が発生することが防止される。また、リニアレギュレーター１５がシャットダウンされることを利用することで、マイクロコンピューターからの制御信号を用いずに制御が可能となり、マイクロコンピューターからの別系統制御信号が必要とならない。このように、第３及び第４実施形態によれば、簡易な構成で、バランス出力端子１６から異音が発生することが防止される。

また、第３及び第４実施形態では、リニアレギュレーター１５がシャットダウンされ、正側電源（＋３．３Ｖ）の電源電圧が降下すると、Ｐチャネル型のＭＯＳトランジスタＭ１のベース電圧が降下する。Ｐチャネル型のＭＯＳトランジスタＭ１は、ゲート電圧が降下すると、オンの状態となる。また、ＭＯＳトランジスタＭ１がオンの状態となると、ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５のベース電圧が上昇する。ｎｐｎ型のバイポーラトランジスタＱ４、Ｑ５は、ベース電圧が上昇すると、オンの状態となる。このため、シャットダウンされた増幅回路１０の出力がグラウンドに接続される。第３及び第４実施形態によれば、ＭＯＳトランジスタＭ１、バイポーラトランジスタＱ４、Ｑ５を用いた簡易な構成で、バランス出力端子１６から異音が発生することが防止される。

以上、本発明の実施形態について説明したが、本発明を適用可能な形態は、上述の実施形態には限られるものではなく、以下に例示するように、本発明の趣旨を逸脱しない範囲で適宜変更を加えることが可能である。

上述の実施形態においては、音楽再生装置として、ＤＡＰを例示した。これに限らず、スマートフォン、タブレットＰＣ、ＵＳＢ ＤＡＣ等であってもよい。

本発明は、音声信号を出力する音楽再生装置に好適に採用され得る。

１ ＤＡＰ（音楽再生装置）
２ ＣＰＵ（制御部）
７ ＤＡＣ（第１Ｄ／Ａコンバーター）
８ ＤＡＣ（第２Ｄ／Ａコンバーター）
９ 増幅回路（第１増幅回路）
１０ 増幅回路（第２増幅回路）
１４ リニアレギュレーター（第１電源回路）
１５ リニアレギュレーター（第２電源回路）
１６ バランス出力端子
１７ アンバランス出力端子
１０１ ヘッドホン
１０２ ヘッドホン
Ｑ１ バイポーラトランジスタ（検出回路、第１バイポーラトランジスタ）
Ｑ２、Ｑ３ バイポーラトランジスタ
Ｑ４、Ｑ５ バイポーラトランジスタ（スイッチ、第２バイポーラトランジスタ）
Ｍ１ ＭＯＳトランジスタ（検出回路、ＭＯＳＦＥＴ）

Claims (7)

1. バランス出力とアンバランス出力とを有する音楽再生装置であって、
   左右２チャンネルのデジタル音声信号を左右２チャンネルのアナログ音声信号にＤ／Ａ変換する第１Ｄ／Ａコンバーターと、
   前記第１Ｄ／ＡコンバーターがＤ／Ａ変換した左右２チャンネルのアナログ音声信号を増幅する第１増幅回路と、
   左右２チャンネルのデジタル音声信号を左右２チャンネルのアナログ音声信号にＤ／Ａ変換する第２Ｄ／Ａコンバーターと、
   前記第２Ｄ／ＡコンバーターがＤ／Ａ変換した左右２チャンネルのアナログ音声信号を反転した左右２チャンネルの反転アナログ音声信号を増幅する第２増幅回路と、
   前記第２増幅回路とバランス出力端子との間でグラウンドに接続されるスイッチと、
   前記第１Ｄ／Ａコンバーターと前記第１増幅回路とに電源電圧を供給する第１電源回路と、
   前記第２Ｄ／Ａコンバーターと前記第２増幅回路とに電源電圧を供給する第２電源回路と、
   アンバランス出力の場合、前記第２電源回路をシャットダウンする制御部と、
   前記第２電源回路のシャットダウンを検出した場合に、前記スイッチをオンの状態とする検出回路と、
   を備えることを特徴とする音楽再生装置。
2. 前記検出回路は、
   ベースが、前記第２電源回路の正側電源に接続され、
   エミッタが、正電源に接続され、
   コレクタが、前記スイッチに接続された、ｐｎｐ型の第１バイポーラトランジスタであることを特徴とする請求項１に記載の音楽再生装置。
3. 前記スイッチは、
   ベースが、前記第１バイポーラトランジスタのコレクタに接続され、
   エミッタが、前記グラウンドに接続され、
   コレクタが、前記第２増幅回路と前記バランス出力端子との間に接続された、ｎｐｎ型の第２バイポーラトランジスタであることを特徴とする請求項２に記載の音楽再生装置。
4. 前記スイッチは、
   ベースが、前記第１バイポーラトランジスタのコレクタに接続され、
   コレクタが、前記グラウンドに接続され、
   エミッタが、前記第２増幅回路と前記バランス出力端子との間に接続された、ｎｐｎ型の第２バイポーラトランジスタであることを特徴とする請求項２に記載の音楽再生装置。
5. 前記検出回路は、
   ゲートが、前記第２電源回路の正側電源に接続され、
   ソースが、正電源に接続され、
   ドレインが、前記スイッチに接続された、Ｐチャネル型のＭＯＳＦＥＴであることを特徴とする請求項１に記載の音楽再生装置。
6. 前記スイッチは、
   ベースが、前記ＭＯＳＦＥＴのドレインに接続され、
   エミッタが、前記グラウンドに接続され、
   コレクタが、前記第２増幅回路と前記バランス出力端子との間に接続された、ｎｐｎ型の第２バイポーラトランジスタであることを特徴とする請求項５に記載の音楽再生装置。
7. 前記スイッチは、
   ベースが、前記ＭＯＳＦＥＴのドレインに接続され、
   コレクタが、前記グラウンドに接続され、
   エミッタが、前記第２増幅回路と前記バランス出力端子との間に接続された、ｎｐｎ型の第２バイポーラトランジスタであることを特徴とする請求項５に記載の音楽再生装置。

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