JP6500579B2 - 回路装置、電子機器及び移動体 - Google Patents
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Description
まず本実施形態の手法について説明する。特許文献1や特許文献2のように、種々の温度センサー、温度検出回路が知られている。温度データを求める際には、温度依存性を有する所与の出力電圧(特許文献1等における温度依存電圧)を用いることが一般的である。そして、出力電圧の生成には、I−V変換回路を用いることが多く、当該I−V変換回路は所与の抵抗素子を有するものとなる。
本実施形態に係る回路装置20の詳細な構成例を示す。まず回路装置20の全体構成例を説明し、その後、各部の詳細について説明する。
本実施形態に係る回路装置20の全体構成例は図1に示したとおりである。回路装置20は、第1の電流生成回路181と、第2の電流生成回路182と、電圧出力回路150と、A/D変換回路160と、処理部170を含む。
図1に示したように、本実施形態に係る回路装置20は、第1の電流IREFを生成する第1の電流生成回路181と、第2の電流IPTATを生成する第2の電流生成回路182を含む。このようにすれば、第1の電流IREFと第2の電流IPTATとを、それぞれ電流生成回路(狭義には後述するような仕事関数差を用いた回路)により生成することが可能になる。以下、図2〜図5を用いて、各電流生成回路の構成や、第1,第2の電流の温度特性について説明する。
次に、電圧出力回路150について説明する。電圧出力回路150は、第1の電流IREFに基づく第1の出力電圧VREFと、第2の電流IPTATに基づく第2の出力電圧VPTATを出力する。上述したように、第1,第2の電流がそれぞれ第1,第2の電流生成回路により生成されるのであれば、電圧出力回路150は、第1の電流生成回路181により生成された第1の電流IREFが、抵抗素子に流れたときの電圧を第1の出力電圧VREFとして出力し、第2の電流生成回路182により生成された第2の電流IPTATが、抵抗素子に流れたときの電圧を第2の出力電圧VPTATとして出力すればよい。
VREFN=VDD−IREFR2 ・・・・・(2)
VREF=IREF(R1+R2)−VDD ・・・・・(3)
また、第2の期間では第2の電流IPTATを抵抗素子に出力する。つまり第2の期間では、図7(B)に示したように、トランジスターTC2及びTC4をオンにし、TC1及びTC3をオフにすればよい。この場合、抵抗素子R1及びR2にはそれぞれ第2の電流IPTATが流れることになり、ノードNC1の電圧値VPTATP及びノードNC2の電圧値VPTATNが第2の出力電圧VPTATとしてA/D変換回路160に対して出力される。具体的なVPTATP、VPTATN、VPTATの値は上式(1)〜(3)と同様であり、下式(4)〜(6)により求めることができる。
VPTATN=VDD−IPTATR2 ・・・・・(5)
VPTAT=IPTAT(R1+R2)−VDD ・・・・・(6)
なお、電圧出力回路150に含まれる抵抗素子R1,R2は種々の手法により実現可能である。例えばR1及びR2は広く知られたポリ抵抗(ポリシリコン抵抗)により実現してもよいし、ウェル抵抗により実現してもよい。
次にA/D変換回路160の詳細について説明する。図7(A)、図7(B)に示したように、A/D変換回路160は差動型、SAR型のA/D変換回路であってもよい。なお、A/D変換回路の具体的な構成例については、種々の手法が知られており、本実施形態ではそれらを広く適用可能であるため、詳細な説明は省略する。
=(Vdiff/VDD)×29 ・・・・・(7)
上式(7)において、2VDDという電圧値はA/D変換における入力電圧範囲(フルスケールレンジ)であり、例えば図11(A)等における−VDDを最小のデジタル値(例えば−511)、+VDDを最大のデジタル値(例えば+511)として出力する場合に相当する。なお、入力電圧範囲は他の値に変更してもよい。
図12に処理部170の詳細な構成例を示す。処理部170は、除算処理部171と、摂氏変換部173と、LPF175を含んでもよい。処理部170は、例えばDSPにより実現され、当該DSPが、除算処理、摂氏変換処理、デジタルローパスフィルター処理を実行すればよい。
・・・・・(10)
よって、上式(10)を一般化すれば、第1のデジタル値をDREFとし、第2のデジタル値をDPTATとし、所与の定数をmとした場合に、処理部170は、除算処理として、(DPTAT+m)/(DREF+m)を演算する処理を行うことになる。上述したように、A/D変換のビット数やフルスケールレンジが変化すれば、mの値も変化することになる。また、図19及び下式(15)〜(20)を用いて後述するように、A/D変換回路160がシングルエンドであるとすれば、A/D変換のビット数やフルスケールレンジによらずm=0となる。つまりここでのmとは、0であってもよいし、0以外の定数であってもよい。
また、本実施形態の回路装置20は、物理量トランスデューサー18から出力される物理量に応じた検出信号に基づいて、物理量に対応する物理量データを出力する検出回路60と、物理量トランスデューサーを駆動する駆動回路30を含んでもよい。そして処理部170は、検出回路60からの物理量データに対して、温度データに基づく補正処理を行ってもよい。
以上では、図7(A)、図7(B)に示したように、電圧出力回路150は2つの入力信号で構成される差動入力信号に対応する2つの出力電圧VREFP,VREFN(VPTATP,VPTATN)をA/D変換回路160に出力するものであり、A/D変換回路160は差動型のA/D変換回路であるものとした。
また、第2の期間では第2の電流IPTATを抵抗素子に出力する。つまり第2の期間では、図19(B)に示したように、トランジスターTC2をオンにし、TC1をオフにすればよい。この場合、抵抗素子R1には第2の電流IPTATが流れることになり、ノードNC1の電圧値である第2の出力電圧VPTATがA/D変換回路160に対して出力される。VPTATの値は下式(16)により求めることができる。
この場合、A/D変換回路160でのA/D変換は、下式(17)により行われる。ビット数は差動の場合と同様に10ビットとしているが、シングルでの動作ではフルスケールレンジが差動の場合の半分(差動がシングルの倍)となるため、上式(7)に対応する例ではVDDとなる。
よって、第1のデジタル値DREF及び第2のデジタル値DPTATは下式(18)、(19)により求められる。
シングルの場合には、上式(10)の29に相当するような値は必要なく、上述したように定数mは0とすればよい。
18 物理量トランスデューサー、20 回路装置、30 駆動回路、32 増幅回路、
40 ゲイン制御回路、50 駆動信号出力回路、52 同期信号出力回路、
60 検出回路、61 増幅回路、81 同期検波回路、90 フィルター部、
100 A/D変換回路、140 制御部、142 レジスター部、
150 電圧出力回路、160 A/D変換回路、170 処理部、
171 除算処理部、173 摂氏変換部、175 LPF、
181 第1の電流生成回路、182 第2の電流生成回路、206 自動車、
207 車体、208 車体姿勢制御装置、209 車輪、500 電子機器、
510 ジャイロセンサー、520 処理部、530 メモリー、540 操作部、
550 表示部、C1,C2 コンデンサー、
R1,R2,RA1,RA2,RB1,RB2 抵抗素子、
TA1〜TA10,TB1〜TB11,TC1〜TC4 トランジスター
Claims (17)
- 第1の温度特性の第1の電流が抵抗素子に流れたときの第1の出力電圧と、前記第1の温度特性とは異なる第2の温度特性の第2の電流が前記抵抗素子に流れたときの第2の出力電圧と、を出力する電圧出力回路と、
前記第1の出力電圧をA/D変換して第1のデジタル値を出力し、前記第2の出力電圧をA/D変換して第2のデジタル値を出力するA/D変換回路と、
前記第1のデジタル値及び前記第2のデジタル値に基づくデジタル演算処理により、温度データを求める処理部と、
を含むことを特徴とする回路装置。 - 請求項1に記載の回路装置において、
前記処理部は、
前記抵抗素子の抵抗値に対する前記温度データの依存性を低減する前記デジタル演算処理を行うことを特徴とする回路装置。 - 請求項1に記載の回路装置おいて、
前記処理部は、
前記抵抗素子の抵抗値の変動による前記温度データの第1の変動、及び前記抵抗素子の温度特性による前記温度データの第2の変動のうち、少なくとも一方の変動を低減する前記デジタル演算処理を行うことを特徴とする回路装置。 - 請求項1乃至3のいずれか一項に記載の回路装置において、
前記処理部は、
前記第2のデジタル値を前記第1のデジタル値で除算する除算処理を含む前記デジタル演算処理により、前記温度データを求めることを特徴とする回路装置。 - 請求項4に記載の回路装置おいて、
前記第1のデジタル値をDREFとし、前記第2のデジタル値をDPTATとし、所与の定数をmとした場合に、
前記処理部は、
前記除算処理として、(DPTAT+m)/(DREF+m)を演算する処理を行うことを特徴とする回路装置。 - 請求項1乃至5のいずれか一項に記載の回路装置において、
前記第1の電流を生成する第1の電流生成回路と、
前記第2の電流を生成する第2の電流生成回路と、
を含み、
前記電圧出力回路は、
前記第1の電流生成回路により生成された前記第1の電流が、前記抵抗素子に流れたときの電圧を前記第1の出力電圧として出力し、
前記第2の電流生成回路により生成された前記第2の電流が、前記抵抗素子に流れたときの電圧を前記第2の出力電圧として出力することを特徴とする回路装置。 - 請求項1乃至6のいずれか一項に記載の回路装置において、
前記電圧出力回路は、
第1の期間においては、前記第1の電流を選択して前記抵抗素子に出力し、第2の期間においては前記第2の電流を選択して前記抵抗素子に出力する選択回路を有することを特徴とする回路装置。 - 請求項1乃至7のいずれか一項の記載の回路装置において、
前記第1の電流は、温度特性がフラットな基準電流であり、
前記第2の電流は、正の温度特性又は負の温度特性の一方の温度特性を有する電流であることを特徴とする回路装置。 - 請求項8に記載の回路装置において、
前記第2の電流が正の温度特性を有する場合には、前記抵抗素子は正の温度特性を有する抵抗素子であり、
前記第2の電流が負の温度特性を有する場合には、前記抵抗素子は負の温度特性を有する抵抗素子であることを特徴とする回路装置。 - 請求項8又は9に記載の回路装置において、
前記第2の電流は、正の温度特性を有し、
前記抵抗素子は、ウェル抵抗又は拡散抵抗であることを特徴とする回路装置。 - 請求項1乃至10のいずれか一項に記載の回路装置において、
前記処理部は、
前記デジタル演算処理により求められた前記温度データに対して、デジタルローパスフィルター処理を行うことを特徴とする回路装置。 - 請求項11に記載の回路装置において、
前記処理部は、
前記デジタル演算処理により求められた前記温度データに対して、カットオフ周波数が可変の前記デジタルローパスフィルター処理を行うことを特徴とする回路装置。 - 請求項12に記載の回路装置において、
前記処理部は、
起動後の第1の期間においては、前記カットオフ周波数を第1の周波数に設定し、
前記第1の期間の経過後の第2の期間においては、前記カットオフ周波数を前記第1の周波数よりも低い第2の周波数に設定することを特徴とする回路装置。 - 請求項1乃至13のいずれか一項に記載の回路装置において、
前記A/D変換回路は、第1の入力信号と第2の入力信号で構成される差動入力信号が入力される差動型のA/D変換回路であり、
前記電圧出力回路は、
前記抵抗素子として第1の抵抗素子と第2の抵抗素子を有し、
前記電圧出力回路は、
前記第1の出力電圧を出力する場合は、前記第1の電流が前記第1の抵抗素子に流れたときの出力電圧を前記第1の入力信号の電圧として前記A/D変換回路に出力し、前記第1の電流が前記第2の抵抗素子に流れたときの出力電圧を前記第2の入力信号の電圧として前記A/D変換回路に出力し、
前記第2の出力電圧を出力する場合は、前記第2の電流が前記第1の抵抗素子に流れたときの出力電圧を前記第1の入力信号の電圧として前記A/D変換回路に出力し、前記第2の電流が前記第2の抵抗素子に流れたときの出力電圧を前記第2の入力信号の電圧として前記A/D変換回路に出力することを特徴とする回路装置。 - 請求項1乃至14のいずれか一項に記載の回路装置において、
物理量トランスデューサーから出力される物理量に応じた検出信号に基づいて、前記物理量に対応する物理量データを出力する検出回路と、
前記物理量トランスデューサーを駆動する駆動回路と、
を含み、
前記処理部は、
前記検出回路からの前記物理量データに対して、前記温度データに基づく補正処理を行うことを特徴とする回路装置。 - 請求項1乃至15のいずれか一項に記載の回路装置を含むことを特徴とする電子機器。
- 請求項1乃至15のいずれか一項に記載の回路装置を含むことを特徴とする移動体。
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